JP2017532908A - データキャッシング方法、装置及び記憶媒体 - Google Patents
データキャッシング方法、装置及び記憶媒体 Download PDFInfo
- Publication number
- JP2017532908A JP2017532908A JP2017520382A JP2017520382A JP2017532908A JP 2017532908 A JP2017532908 A JP 2017532908A JP 2017520382 A JP2017520382 A JP 2017520382A JP 2017520382 A JP2017520382 A JP 2017520382A JP 2017532908 A JP2017532908 A JP 2017532908A
- Authority
- JP
- Japan
- Prior art keywords
- cell
- dequeue
- cycle
- waiting
- dequeued
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L47/00—Traffic control in data switching networks
- H04L47/50—Queue scheduling
- H04L47/62—Queue scheduling characterised by scheduling criteria
- H04L47/6245—Modifications to standard FIFO or LIFO
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
- G06F12/0806—Multiuser, multiprocessor or multiprocessing cache systems
- G06F12/0815—Cache consistency protocols
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L49/00—Packet switching elements
- H04L49/90—Buffering arrangements
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2212/00—Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
- G06F2212/10—Providing a specific technical effect
- G06F2212/1008—Correctness of operation, e.g. memory ordering
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2212/00—Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
- G06F2212/15—Use in a specific computing environment
- G06F2212/154—Networked environment
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F2212/00—Indexing scheme relating to accessing, addressing or allocation within memory systems or architectures
- G06F2212/60—Details of cache memory
- G06F2212/608—Details relating to cache mapping
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Memory System Of A Hierarchy Structure (AREA)
Abstract
Description
セルの入力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングし、前記デキュー待ちのセルに占用される接合ユニットの数の実際値を取得し、前記デキュー待ちのセルをセル接合の方式でバスのビット幅と同じビット幅のレジスタに記憶することと、含み、
ここで、前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第1背圧カウント値が第1プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第1背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第1背圧カウント値によって得られ、Kが正の整数である。
セルの入力ポート番号に基づいて、前記入力ポート番号に対応している先入先出のキューのテールポインタ、エンキューサブポインタ及びフリーアドレスを取得し、前記セルを、長さがアドレス毎に占用されるキャッシュユニットの数であることに基づいて、前記先入先出のキューに記憶し、前記セルに占用される有効のキャッシュユニットを読み込み、前記有効のキャッシュユニットがフリーアドレスを占有していない場合、前記先入先出のキューのエンキューサブポインタを更新し、前記フリーアドレスを解放し、前記セルに占用される有効のキャッシュユニットがフリーアドレスを占有している場合、前記先入先出のキューのテールポインタ及びエンキューサブポインタを更新することを含む。
前記デキュー待ちのセルに占用される接合ユニットの実際の数、及び前記デキュー待ちのセルに占用されるキャッシュユニットの数に基づいて、前記第1背圧カウント値に対して校正を行うことを含む。
書き込みポインタを探し出し、前記デキュー待ちのセルに占用される接合ユニットの実際の数に基づいて、前記セルを前記書き込みポインタに対応するレジスタに記憶し、前記レジスタに有効のセルが含まれている場合、接合ユニットを単位として前記デキュー待ちのセルを前記有効のセルと接合し、セルの接合情報を記録し、書き込みポインタを更新することを含む。
セルの入力ポート番号に基づいて前記セルを対応する先入先出のキューに記憶するように構成されるキャッシングモジュールと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングし、前記デキュー待ちのセルに占用される接合ユニットの数の実際値を取得し、データの伝送を行うために、前記デキュー待ちのセルをセル接合の方式でバスのビット幅と同じビット幅のレジスタに記憶するように構成される処理モジュールと、含み、
ここで、前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第1背圧カウント値が第1プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第1背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第1背圧カウント値によって得られ、Kが正の整数である。
セル接合の方式で接合されているデータを別々のセルに還元することと、
セルの出力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングすることと、を含み、
ここで、前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第2背圧カウント値が第2プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第2背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第2背圧カウント値によって得られ、Kが正の整数である。
前記データに含まれているセルの接合情報に基づいて、セル接合の方式で接合されているデータを別々のセルに還元することを含む。
セル接合の方式で接合されているデータを別々のセルに還元するように構成される還元モジュールと、
セルの出力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶するように構成される記憶モジュールと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、デキュー待ちのセルをデキューするようスケジューリングするように構成されるスケジューリングモジュールと、を含み、
ここで、前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第2背圧カウント値が第2プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第2背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第2背圧カウント値によって得られ、Kが正の整数である。
前記先入先出のキューが空であること、又は前記テールポインタ内のキャッシュユニットが既に満杯に書き込まれていることを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、上位ビットから下位ビットの順序で前記セルをフリーアドレスに書き込むことと、
前記先入先出のキューが空ではないこと、又は前記テールポインタ内のキャッシュユニットが満杯に書き込まれていないことを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じのM個のグループの分割データに分け、また、エンキューサブポインタの位置に基づいて、上位ビットから下位ビットの順序で、前記セルのM個のグループの分割データを書き込み、エンキューサブポインタの位置に、セルの最上位ビットに位置付けられている1つのグループの分割データを書き込み、エンキューサブポインタから1を引いたものである前記フリーアドレスの番号のキャッシュユニットに、前記セルの分割データの最後の1つのグループの分割データを書き込むことと、含む。
レジスタセット内の書き込みポインタを取得し、前記デキュー待ちのセルに占用される接合ユニットの実際の数に基づいて、前記セルを前記書き込みポインタに対応するレジスタ内に記憶し、前記レジスタに有効のセルを含む場合、接合ユニットを単位として、前記デキュー待ちのセルを前記有効のセルと接合し、セルの接合情報を記録し、書き込みポインタを、前記デキュー待ちのセルに占用される接合ユニットの数と元書き込みポインタの加算後の値に更新し、前記加算後の値がY以上である場合、前記加算後の値からYを引いて、新たな書き込みポインタとすることを含む。ここで、前記書き込みポインタが接合ユニットをステッピング値とする。本発明におけるセルの接合は図5に示されている通りである。
前記先入先出のキューが空であること、又は前記テールポインタ内のキャッシュユニットが既に満杯に書き込まれていることを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、上位ビットから下位ビットの順序で前記セルをフリーアドレスに書き込むことと、
前記先入先出のキューが空ではないこと、又は前記テールポインタ内のキャッシュユニットが満杯に書き込まれていないことを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、エンキューサブポインタの位置に基づいて、上位ビットから下位ビットの順序で、前記セルのM個のグループの分割データを書き込み、エンキューサブポインタの位置に、セルの最上位ビットに位置付けられている1つのグループの分割データを書き込み、エンキューサブポインタから1を引いたものである前記フリーアドレスの番号のキャッシュユニットに、前記セルの最後の1つのグループの分割データを書き込むことと、含む。
一つの実施例において、前記キャッシングモジュール71は、セルの入力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することは、
前記キャッシングモジュール71は、セルの入力ポート番号に基づいて、前記入力ポート番号に対応している先入先出のキューのテールポインタ、エンキューサブポインタ及びフリーアドレスを取得し、前記セルを、長さがアドレス毎に占用されるキャッシュユニットの数であることに基づいて、前記先入先出のキューに記憶し、前記セルに占用される有効のキャッシュユニットを読み込み、前記有効のキャッシュユニットがフリーアドレスを占有していない場合、前記先入先出のキューのエンキューサブポインタを更新し、前記フリーアドレスを解放し、前記セルに占用される有効のキャッシュユニットがフリーアドレスを占有している場合、前記先入先出のキューのテールポインタ及びエンキューサブポインタを更新することをを含む。
前記キャッシングモジュール71は、前記先入先出のキューが空であること、又は前記テールポインタ内のキャッシュユニットが既に満杯に書き込まれていることを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、上位ビットから下位ビットの順序で前記セルをフリーアドレスに書き込むことと、
前記先入先出のキューが空ではないこと、又は前記テールポインタ内のキャッシュユニットが満杯に書き込まれていないことを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、エンキューサブポインタの位置に基づいて、上位ビットから下位ビットの順序で、前記セルのM個のグループの分割データを書き込み、エンキューサブポインタの位置に、セルの最上位ビットに位置付けられている1つのグループの分割データを書き込み、エンキューサブポインタから1を引いたものである前記フリーアドレスの番号のキャッシュユニットに、前記セルの最後の1つのグループの分割データを書き込むことと、含む。
前記処理モジュール72が、デキューポート番号に基づいて、対応する先入先出のキューのヘッダポインタ、従ヘッダポインタ及びデキューサブポインタを取得し、前記キュー内のデキュー待ちのセルに占用されるキャッシュユニットの数及びデキューサブポインタに基づいて、読み込もうとしているキャッシュユニットの番号範囲及び個数を計算し、前記デキュー待ちのセルに占用されるキャッシュユニット内のデータを一つのセルに再構成し、デキューサブポインタを、元デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算後の値に更新し、前記加算後の値がNより大きい場合、前記加算後の値からNを引いた値に更新し、デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算後の値がNより大きくない場合、ヘッダポインタを更新する必要がなく、デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算結果がNより大きい場合、ヘッダポインタを前記従ヘッダポインタに更新することを含む。ここで、前記デキュー待ちのセルが前記先入先出のキューの先頭のセルである。
前記処理モジュール72が、レジスタセット内の書き込みポインタを取得し、前記デキュー待ちのセルに占用される接合ユニットの実際の数に基づいて、前記セルを前記書き込みポインタに対応するレジスタ内に記憶し、前記レジスタに有効のセルを含む場合、接合ユニットを単位として、前記デキュー待ちのセルを前記有効のセルと接合し、セルの接合情報を記録し、書き込みポインタを、前記デキュー待ちのセルに占用される接合ユニットの数と元書き込みポインタの加算後の値に更新し、前記加算後の値がY以上である場合、前記加算後の値からYを引いて、新たな書き込みポインタとすることを含む。ここで、前記書き込みポインタが接合ユニットをステッピング値とする。
前記還元モジュール81が、前記データに含まれているセルの接合情報に基づいて、セル接合の方式で接合されているデータを別々のセルに還元する。
前記記憶モジュール82は、セルの出力ポート番号に基づいて、前記出力ポート番号に対応している先入先出のキューのテールポインタ、エンキューサブポインタ及びフリーアドレスを取得し、前記セルを、長さがアドレス毎に占用されるキャッシュユニットの数であることに基づいて、前記先入先出のキューに記憶し、前記セルに占用される有効のキャッシュユニットを読み込み、前記有効のキャッシュユニットがフリーアドレスを占有していない場合、前記先入先出のキューのエンキューサブポインタを更新し、前記フリーアドレスを解放し、前記セルに占用される有効のキャッシュユニットがフリーアドレスを占有している場合、前記先入先出のキューのテールポインタ及びエンキューサブポインタを更新する。
前記記憶モジュール82が、前記先入先出のキューが空であること、又は前記テールポインタ内のキャッシュユニットが既に満杯に書き込まれていることを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、上位ビットから下位ビットの順序で前記セルをフリーアドレスに書き込むことと、
前記記憶モジュール82が、前記先入先出のキューが空ではないこと、又は前記テールポインタ内のキャッシュユニットが満杯に書き込まれていないことを確定した場合、前記セルを、上位ビットから下位ビットに、前記キャッシュユニットのビット幅と同じビット幅のM個のグループの分割データに分け、また、エンキューサブポインタの位置に基づいて、上位ビットから下位ビットの順序で、前記セルのM個のグループの分割データを書き込み、エンキューサブポインタの位置に、セルの最上位ビットに位置付けられている1つのグループの分割データを書き込み、エンキューサブポインタから1を引いたものである前記フリーアドレスの番号のキャッシュユニットに、前記セルの最後の1つのグループの分割データを書き込むことと、含む。
前記スケジューリングモジュール83は、デキューポート番号に基づいて、対応する先入先出のキューのヘッダポインタ、従ヘッダポインタ及びデキューサブポインタを取得し、前記キュー内のデキュー待ちのセルに占用されるキャッシュユニットの数及びデキューサブポインタに基づいて、読み込もうとしているキャッシュユニットの番号範囲及び個数を計算し、前記デキュー待ちのセルに占用されるキャッシュユニット内のデータを一つのセルに再構成してバスに伝送し、デキューサブポインタを、元デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算後の値に更新し、前記加算後の値がNより大きい場合、前記加算後の値からNを引いた値に更新し、デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算後の値がNより大きくない場合、ヘッダポインタを更新する必要がなく、デキューサブポインタと前記セルに占用されるキャッシュユニットの数の加算結果がNより大きい場合、ヘッダポインタを前記従ヘッダポインタに更新することを含む。ここで、前記デキュー待ちのセルが前記先入先出のキューの先頭のセルである。
Claims (13)
- データキャッシング方法であって、
セルの入力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングし、前記デキュー待ちのセルに占用される接合ユニットの数の実際値を取得し、前記デキュー待ちのセルをセル接合の方式でバスのビット幅と同じビット幅のレジスタに記憶することと、含み、
前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第1背圧カウント値が第1プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第1背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第1背圧カウント値によって得られ、Kが正の整数である、
前記データキャッシング方法。 - 前記セルの入力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶する前に、前記セルに含まれているセルの長さ情報とセルのバージョン情報を抽出し、前記セルの長さ情報とセルのバージョン情報に基づいて、前記セルに占用されるキャッシュユニットの数を取得すること、
をさらに含む、請求項1に記載のデータキャッシング方法。 - 前記セルの入力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することは、
セルの入力ポート番号に基づいて、前記入力ポート番号に対応している先入先出のキューのテールポインタ、エンキューサブポインタ及びフリーアドレスを取得し、前記セルを、長さがアドレス毎に占用されるキャッシュユニットの数であることに基づいて、前記先入先出のキューに記憶し、前記セルに占用される有効のキャッシュユニットを読み込み、前記有効のキャッシュユニットがフリーアドレスを占有していない場合、前記先入先出のキューのエンキューサブポインタを更新し、前記フリーアドレスを解放し、前記セルに占用される有効のキャッシュユニットがフリーアドレスを占有している場合、前記先入先出のキューのテールポインタ及びエンキューサブポインタを更新すること、
を含む、請求項1又は2に記載のデータキャッシング方法。 - 前記デキュー待ちのセルをデキューするようスケジューリングした後に、
前記デキュー待ちのセルに占用される接合ユニットの実際の数、及び前記デキュー待ちのセルに占用されるキャッシュユニットの数に基づいて、前記第1背圧カウント値に対して校正を行うこと、
をさらに含む、請求項2に記載のデータキャッシング方法。 - 前記デキュー待ちのセルをセル接合の方式でバスのビット幅と同じビット幅のレジスタに記憶することは、
書き込みポインタを探し出し、前記デキュー待ちのセルに占用される接合ユニットの実際の数に基づいて、前記セルを前記書き込みポインタに対応するレジスタに記憶し、前記レジスタに有効のセルが含まれている場合、接合ユニットを単位として前記デキュー待ちのセルを前記有効のセルと接合し、セルの接合情報を記録し、書き込みポインタを更新すること、
を含む、請求項1又は2に記載のデータキャッシング方法。 - データキャッシング装置であって、
セルの入力ポート番号に基づいて前記セルを対応する先入先出のキューに記憶するように構成されるキャッシングモジュールと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングし、前記デキュー待ちのセルに占用される接合ユニットの数の実際値を取得し、データの伝送を行うために、前記デキュー待ちのセルをセル接合の方式でバスのビット幅と同じビット幅のレジスタに記憶するように構成される処理モジュールと、含み、
前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第1背圧カウント値が第1プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第1背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第1背圧カウント値によって得られ、Kが正の整数である、
前記データキャッシング装置。 - 前記セルに含まれているセルの長さ情報とセルのバージョン情報を抽出し、前記セルの長さ情報とセルのバージョン情報に基づいて、前記セルに占用されるキャッシュユニットの数を取得するように構成される取得モジュール、
をさらに含む、請求項6に記載のデータキャッシング装置。 - 前記デキュー待ちのセルに占用される接合ユニットの実際の数、及び前記デキュー待ちのセルに占用されるキャッシュユニットの数に基づいて、前記第1背圧カウント値に対して校正を行うように構成される校正モジュール、
をさらに含む、請求項7に記載のデータキャッシング装置。 - データキャッシング方法であって、
セル接合の方式で接合されているデータを別々のセルに還元することと、
セルの出力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶することと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、前記デキュー待ちのセルをデキューするようスケジューリングすることと、を含み、
前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第2背圧カウント値が第2プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第2背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第2背圧カウント値によって得られ、Kが正の整数である、
前記データキャッシング方法。 - セル接合の方式で接合されているデータを別々のセルに還元することは、
前記データに含まれているセルの接合情報に基づいて、セル接合の方式で接合されているデータを別々のセルに還元すること、
を含む、請求項9に記載のデータキャッシング方法。 - データキャッシング装置であって、
セル接合の方式で接合されているデータを別々のセルに還元するように構成される還元モジュールと、
セルの出力ポート番号に基づいて、前記セルを対応する先入先出のキューに記憶するように構成される記憶モジュールと、
現在のK番目のサイクルで、デキュー待ちのセルをデキュー可能であると確定し、デキュー待ちのセルをデキューするようスケジューリングするように構成されるスケジューリングモジュールと、を含み、
前記デキュー待ちのセルをデキュー可能であると確定することは、K−1番目のサイクルの第2背圧カウント値が第2プリセット閾値の値以下であることに基づいて行われ、前記K−1番目のサイクルの第2背圧カウント値が、前回のデキューセルをデキューする時に占用された接合ユニットの数の推定値、サイクル毎のバスで伝送可能な接合ユニットの数、及びK−2番目のサイクルの第2背圧カウント値によって得られ、Kが正の整数である、
前記データキャッシング装置。 - コンピュータ記憶媒体であって、
請求項1〜5のいずれか1項に記載のデータキャッシング方法を実行するためのコンピュータ実行可能な命令を記憶している、
前記コンピュータ記憶媒体。 - コンピュータ記憶媒体であって、
請求項9〜10のいずれか1項に記載のデータキャッシング方法を実行するためのコンピュータ実行可能な命令を記憶している、
前記コンピュータ記憶媒体。
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| CN201410542710.7 | 2014-10-14 | ||
| CN201410542710.7A CN105573711B (zh) | 2014-10-14 | 2014-10-14 | 一种数据缓存方法及装置 |
| PCT/CN2015/077639 WO2016058355A1 (zh) | 2014-10-14 | 2015-04-28 | 一种数据缓存方法、装置及存储介质 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2017532908A true JP2017532908A (ja) | 2017-11-02 |
| JP6340481B2 JP6340481B2 (ja) | 2018-06-06 |
Family
ID=55746060
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2017520382A Active JP6340481B2 (ja) | 2014-10-14 | 2015-04-28 | データキャッシング方法、装置及び記憶媒体 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US10205673B2 (ja) |
| EP (1) | EP3206123B1 (ja) |
| JP (1) | JP6340481B2 (ja) |
| CN (1) | CN105573711B (ja) |
| WO (1) | WO2016058355A1 (ja) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN106130930B (zh) * | 2016-06-24 | 2019-04-19 | 西安电子科技大学 | 一种数据帧预入队处理的装置及方法 |
| US10785348B2 (en) * | 2017-08-29 | 2020-09-22 | Hewlett Packard Enterprise Development Lp | Segment size determination |
| CN110554852B (zh) * | 2018-05-31 | 2021-11-12 | 赛灵思公司 | 数据拼接结构、方法及其片上实现 |
| US11237960B2 (en) * | 2019-05-21 | 2022-02-01 | Arm Limited | Method and apparatus for asynchronous memory write-back in a data processing system |
| CN111522643B (zh) * | 2020-04-22 | 2024-06-25 | 杭州迪普科技股份有限公司 | 基于fpga的多队列调度方法、装置、计算机设备及存储介质 |
| CN113312385B (zh) * | 2020-07-07 | 2025-02-28 | 阿里巴巴集团控股有限公司 | 缓存操作方法、装置及系统,存储介质和操作设备 |
| CN114185513B (zh) * | 2022-02-17 | 2022-05-20 | 沐曦集成电路(上海)有限公司 | 数据缓存装置和芯片 |
| CN115348218B (zh) * | 2022-10-18 | 2022-12-27 | 井芯微电子技术(天津)有限公司 | 一种队列调度方法及装置 |
| CN119497096B (zh) * | 2024-11-25 | 2025-10-31 | 中国移动通信集团浙江有限公司 | Pci规划方法、装置、电子设备及存储介质 |
Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000022716A (ja) * | 1998-07-06 | 2000-01-21 | Nec Corp | バックプレッシャ制御方法およびその装置 |
| JP2003018186A (ja) * | 2001-06-28 | 2003-01-17 | Fujitsu Ltd | 通信装置及び通信制御方法 |
| JP2003258899A (ja) * | 2002-02-27 | 2003-09-12 | Nec Corp | パケット処理システム |
| JP2006253790A (ja) * | 2005-03-08 | 2006-09-21 | Fujitsu Ltd | パケット伝送装置及びパケット伝送方法 |
| JP2006324861A (ja) * | 2005-05-18 | 2006-11-30 | Konica Minolta Photo Imaging Inc | プリント情報設定装置、カメラ及びプリンタ |
| WO2009124164A1 (en) * | 2008-04-02 | 2009-10-08 | Qualcomm Incorporated | System and method for memory allocation in embedded or wireless communication systems |
Family Cites Families (13)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05183528A (ja) * | 1990-08-17 | 1993-07-23 | Toshiba Corp | コンカチネーション多重化合成装置 |
| US5602994A (en) * | 1992-09-25 | 1997-02-11 | The United States Of America As Represented By The United States Department Of Energy | Method and apparatus for high speed data acquisition and processing |
| IL133922A (en) | 1999-02-01 | 2005-03-20 | Ciba Sc Holding Ag | Compositions comprising polyolefins produced by polymerization over a metallocene catalyst and a stabilizer mixture and a method for stabilizing said polyolefins |
| US6977930B1 (en) | 2000-02-14 | 2005-12-20 | Cisco Technology, Inc. | Pipelined packet switching and queuing architecture |
| EP1168725B1 (en) | 2000-06-19 | 2005-06-15 | Broadcom Corporation | Switch fabric with path redundancy |
| IL155742A0 (en) | 2003-05-04 | 2006-12-31 | Teracross Ltd | Method and apparatus for fast contention-free, buffer management in a muti-lane communication system |
| CN100428724C (zh) | 2005-07-11 | 2008-10-22 | 普天信息技术研究院 | 动态时分交换装置及方法 |
| CN101222444B (zh) | 2008-02-04 | 2011-11-09 | 华为技术有限公司 | 缓存数据处理方法、装置及系统 |
| CN101770356A (zh) | 2008-12-30 | 2010-07-07 | 陈海红 | 一种定长信元交换中的数据位宽的转换装置和方法 |
| CN101605100B (zh) | 2009-07-15 | 2012-04-25 | 华为技术有限公司 | 队列存储空间的管理方法和设备 |
| CN101964751B (zh) * | 2010-09-30 | 2013-01-16 | 华为技术有限公司 | 数据包的传输方法及装置 |
| CN102065014B (zh) | 2010-12-29 | 2014-12-31 | 中兴通讯股份有限公司 | 数据信元处理方法和装置 |
| JP5863076B2 (ja) * | 2011-08-17 | 2016-02-16 | ▲ホア▼▲ウェイ▼技術有限公司 | パケットを再構築し再順序付けするための方法、装置、およびシステム |
-
2014
- 2014-10-14 CN CN201410542710.7A patent/CN105573711B/zh active Active
-
2015
- 2015-04-28 JP JP2017520382A patent/JP6340481B2/ja active Active
- 2015-04-28 WO PCT/CN2015/077639 patent/WO2016058355A1/zh not_active Ceased
- 2015-04-28 EP EP15850914.1A patent/EP3206123B1/en active Active
- 2015-04-28 US US15/519,073 patent/US10205673B2/en active Active
Patent Citations (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000022716A (ja) * | 1998-07-06 | 2000-01-21 | Nec Corp | バックプレッシャ制御方法およびその装置 |
| JP2003018186A (ja) * | 2001-06-28 | 2003-01-17 | Fujitsu Ltd | 通信装置及び通信制御方法 |
| JP2003258899A (ja) * | 2002-02-27 | 2003-09-12 | Nec Corp | パケット処理システム |
| JP2006253790A (ja) * | 2005-03-08 | 2006-09-21 | Fujitsu Ltd | パケット伝送装置及びパケット伝送方法 |
| JP2006324861A (ja) * | 2005-05-18 | 2006-11-30 | Konica Minolta Photo Imaging Inc | プリント情報設定装置、カメラ及びプリンタ |
| WO2009124164A1 (en) * | 2008-04-02 | 2009-10-08 | Qualcomm Incorporated | System and method for memory allocation in embedded or wireless communication systems |
| JP2011521313A (ja) * | 2008-04-02 | 2011-07-21 | クゥアルコム・インコーポレイテッド | 組込みまたは無線通信システムにおけるメモリ割当てのためのシステムおよび方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| EP3206123A4 (en) | 2017-10-04 |
| WO2016058355A1 (zh) | 2016-04-21 |
| EP3206123B1 (en) | 2020-04-29 |
| JP6340481B2 (ja) | 2018-06-06 |
| EP3206123A1 (en) | 2017-08-16 |
| US20170237677A1 (en) | 2017-08-17 |
| CN105573711A (zh) | 2016-05-11 |
| CN105573711B (zh) | 2019-07-19 |
| US10205673B2 (en) | 2019-02-12 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP6340481B2 (ja) | データキャッシング方法、装置及び記憶媒体 | |
| CN112084136B (zh) | 队列缓存管理方法、系统、存储介质、计算机设备及应用 | |
| JP5863076B2 (ja) | パケットを再構築し再順序付けするための方法、装置、およびシステム | |
| US7751404B2 (en) | Method, system, and computer program product for high performance bonding resequencing | |
| JP6077125B2 (ja) | データ処理方法及び装置 | |
| JP7074839B2 (ja) | パケット処理 | |
| CN106302238A (zh) | 一种队列管理方法及装置 | |
| CN105573922B (zh) | 一种实现数据格式转换的方法和装置 | |
| WO2020142867A1 (zh) | 一种流量整形方法及相关设备 | |
| Oveis-Gharan et al. | Efficient dynamic virtual channel organization and architecture for NoC systems | |
| EP1508100B1 (en) | Inter-chip processor control plane | |
| CN105516023A (zh) | 一种报文转发方法和装置 | |
| EP3461085B1 (en) | Method and device for queue management | |
| CN111181874B (zh) | 一种报文处理方法、装置及存储介质 | |
| CN101661429B (zh) | 一种统计信息的存储方法及设备 | |
| CN104052831A (zh) | 一种基于队列的数据传输方法、装置及通信系统 | |
| CN117499351A (zh) | 报文转发装置及方法、通信芯片及网络设备 | |
| CN102681970B (zh) | 信号处理器的配置方法及信号处理器 | |
| CN110096456A (zh) | 一种高速率大容量缓存方法与装置 | |
| CN107526643A (zh) | 一种消息延迟发送的方法及系统 | |
| JP6060050B2 (ja) | 通信装置、及び、パケット処理方法 | |
| CN121262154B (zh) | 一种用于rdma智能网卡的多路流量调度方法 | |
| CN102684846B (zh) | 信道解调过程中数据处理方法、装置及网络设备 | |
| CN121125664A (zh) | 一种报文处理方法、装置及存储系统 | |
| CN121691179A (zh) | 一种流量控制方法、装置、电子设备、存储介质和程序 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20170414 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20180313 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20180417 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20180514 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 6340481 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |