JPH03234039A - レイアウトパターン検証装置 - Google Patents
レイアウトパターン検証装置Info
- Publication number
- JPH03234039A JPH03234039A JP2030396A JP3039690A JPH03234039A JP H03234039 A JPH03234039 A JP H03234039A JP 2030396 A JP2030396 A JP 2030396A JP 3039690 A JP3039690 A JP 3039690A JP H03234039 A JPH03234039 A JP H03234039A
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- Japan
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- error
- cell
- layout data
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- Testing Or Measuring Of Semiconductors Or The Like (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＩＣのレイアウトパターンを検証する装置に
関するものである。
関するものである。
第４図は従来のレイアウトパターン検証装置を示す構成
図である。同図において、１はデイスプレィ、２はデイ
スプレィ１にデータを出力するための処理を行なう画面
出力部、３はディスク装置、４はレイアウトデータをユ
ーザの与えたルールに従って図形演算処理するレイアウ
トデータ処理部、５はレイアウトデータ処理部４によっ
て作成されたレイアウトデータをもとに、ユーザの与え
たデザインルールに従って、ディスク装置３に記憶され
たレイアウトパターンのチェックを行ない、エラー線分
を抽出するデザインルールチェック部である。
図である。同図において、１はデイスプレィ、２はデイ
スプレィ１にデータを出力するための処理を行なう画面
出力部、３はディスク装置、４はレイアウトデータをユ
ーザの与えたルールに従って図形演算処理するレイアウ
トデータ処理部、５はレイアウトデータ処理部４によっ
て作成されたレイアウトデータをもとに、ユーザの与え
たデザインルールに従って、ディスク装置３に記憶され
たレイアウトパターンのチェックを行ない、エラー線分
を抽出するデザインルールチェック部である。
次に動作について説明する。まず、ディスク装置３に格
納されたレイアウトデータとデザインルールをチェック
するために必要なレイアウトデータを生成する図形演算
処理用ルールファイルとをレイアウトデータ処理部４が
読み込み、上記ルールファイルのルールに従い、図形演
算処理を行ない、新規にレイアウトデータを作成し、デ
ィスク装置３に格納する。次いで、デザインルールチェ
ック部５は、エラー線分を抽出するためのデザインルー
ルを定義したデザインルールファイルに記述されたデザ
インルールに従い、ディスク装置３に格納されたレイア
ウトデータおよびレイアウトデータ処理部４によって作
成されたレイアウトデータとをチェックする。そして、
デザインルールを満足していないレイアウトデータのエ
ラ一部分のレイヤ名、座標値、ルールナンバを抽出する
。
納されたレイアウトデータとデザインルールをチェック
するために必要なレイアウトデータを生成する図形演算
処理用ルールファイルとをレイアウトデータ処理部４が
読み込み、上記ルールファイルのルールに従い、図形演
算処理を行ない、新規にレイアウトデータを作成し、デ
ィスク装置３に格納する。次いで、デザインルールチェ
ック部５は、エラー線分を抽出するためのデザインルー
ルを定義したデザインルールファイルに記述されたデザ
インルールに従い、ディスク装置３に格納されたレイア
ウトデータおよびレイアウトデータ処理部４によって作
成されたレイアウトデータとをチェックする。そして、
デザインルールを満足していないレイアウトデータのエ
ラ一部分のレイヤ名、座標値、ルールナンバを抽出する
。
次に、抽出したエラーデータを画面出力部２が読み込み
、画面出力データに変換する。また、レイアウトデータ
処理部４によって作成され、ディスク装置３に格納され
ているレイアウトデータも読み込み、画面出力データに
変換する。そして、デイスプレィｌ上に、変換したエラ
ーデータおよびレイアウトデータを出力する。これによ
って、利用者はレイアウトのエラ一部のチェックをデイ
スプレィ１上で行なう。
、画面出力データに変換する。また、レイアウトデータ
処理部４によって作成され、ディスク装置３に格納され
ているレイアウトデータも読み込み、画面出力データに
変換する。そして、デイスプレィｌ上に、変換したエラ
ーデータおよびレイアウトデータを出力する。これによ
って、利用者はレイアウトのエラ一部のチェックをデイ
スプレィ１上で行なう。
従来のレイアウトパターン検証装置は以上のように構成
されているので、デザインルールチェック部５で出力し
たエラーをすべて人手によってチェックしなければなら
ず、多数のエラーがある場合、チェック時間が長くなり
、また、チェックもれが発生するなどの問題があった。
されているので、デザインルールチェック部５で出力し
たエラーをすべて人手によってチェックしなければなら
ず、多数のエラーがある場合、チェック時間が長くなり
、また、チェックもれが発生するなどの問題があった。
本発明はこのような点に鑑みてなされたものであり、そ
の目的とするところは、人手によるデザインルールエラ
ーのチェック時間を短縮できるとともに、エラーのチェ
ックもれを減少することができるレイアウトパターン検
証装置を得ることにある。
の目的とするところは、人手によるデザインルールエラ
ーのチェック時間を短縮できるとともに、エラーのチェ
ックもれを減少することができるレイアウトパターン検
証装置を得ることにある。
このような目的を達成するために本発明は、ＩＣのレイ
アウトパターンが設計基準を満足しているかどうかをチ
ェックする際に、設計基準を満足していないとして出力
されるエラーをエラーの含まれるセルおよびセル内の位
置によってグループ分けし、各エラーにグループナンバ
を付加するエラー線分解析部を設けるようにしたもので
ある。
アウトパターンが設計基準を満足しているかどうかをチ
ェックする際に、設計基準を満足していないとして出力
されるエラーをエラーの含まれるセルおよびセル内の位
置によってグループ分けし、各エラーにグループナンバ
を付加するエラー線分解析部を設けるようにしたもので
ある。
本発明によるレイアウトパターン検証装置のエラー線分
解析部は、各エラー線分の属しているセル名とセル内で
の座標値の情報とを抽出し、その情報が一致するエラー
線分に対して同一のグループナンバを割り当てる。
解析部は、各エラー線分の属しているセル名とセル内で
の座標値の情報とを抽出し、その情報が一致するエラー
線分に対して同一のグループナンバを割り当てる。
以下、本発明の一実施例を図について説明する。
第１図は本発明によるレイアウトパターン検証装置の一
実施例を示す構成図である。同図において、１はデイス
プレィ、２はデイスプレィ１に出力するデータを作成す
る画面出力部、３はディスク装置、４はレイアウトデー
タをユーザの与えたルールに従って図形演算処理するレ
イアウトデータ処理部、５はレイアウトデータ処理部４
によって作成されたレイアウトデータをもとに、ユーザ
の与えたデザインルールに従って、レイアウトパターン
のチェックを行ない、エラー線分を抽出するデザインル
ールチェック部、６はデザインルールチェック部５によ
って抽出されたエラー線分をセル名とセル内の座標値に
よってグループ分けを行ない、各エラー線分に対してグ
ループナンバを情報として付加するエラー線分解析部で
ある。
実施例を示す構成図である。同図において、１はデイス
プレィ、２はデイスプレィ１に出力するデータを作成す
る画面出力部、３はディスク装置、４はレイアウトデー
タをユーザの与えたルールに従って図形演算処理するレ
イアウトデータ処理部、５はレイアウトデータ処理部４
によって作成されたレイアウトデータをもとに、ユーザ
の与えたデザインルールに従って、レイアウトパターン
のチェックを行ない、エラー線分を抽出するデザインル
ールチェック部、６はデザインルールチェック部５によ
って抽出されたエラー線分をセル名とセル内の座標値に
よってグループ分けを行ない、各エラー線分に対してグ
ループナンバを情報として付加するエラー線分解析部で
ある。
次に動作について説明する。まず、レイアウトデータ処
理部４は、ディスク装置３に格納されたレイアウトデー
タを読み込み、処理対象のセルがら順次階層的に上位セ
ルでの配置情頼（座標値、回転角度）を記述したフォー
マット（第５図）のファイルを作成する（第２図のステ
ップ２１）。
理部４は、ディスク装置３に格納されたレイアウトデー
タを読み込み、処理対象のセルがら順次階層的に上位セ
ルでの配置情頼（座標値、回転角度）を記述したフォー
マット（第５図）のファイルを作成する（第２図のステ
ップ２１）。
第５図で、１０は階層番号、１１はセル名、１２は座標
値、１３は回転角度、１４はミラー反転有無である。
値、１３は回転角度、１４はミラー反転有無である。
次に、レイアウトデータ処理部４は、読み込んだレイア
ウトデータをユーザの定義した検証ルールに従い、図形
演算処理を行ない、新規にレイアウトデータを作成しく
第２図のステップ２２）、ディスク装置３に格納する。
ウトデータをユーザの定義した検証ルールに従い、図形
演算処理を行ない、新規にレイアウトデータを作成しく
第２図のステップ２２）、ディスク装置３に格納する。
次いで、デザインルールチェック部５は、デザインルー
ルファイルに記述されたデザインルールに従い、ディス
ク装置３に格納されたレイアウトデータおよびレイアウ
トデータ処理部４によって作成されたレイアウトデータ
をチェックする（第２図のステップ２３）。そして、デ
ザインルールチェック部５は、デザインルールを満足し
ていないレイアウトデータのエラ一部分のレイヤ名、座
標値、ルールナンバを抽出する。
ルファイルに記述されたデザインルールに従い、ディス
ク装置３に格納されたレイアウトデータおよびレイアウ
トデータ処理部４によって作成されたレイアウトデータ
をチェックする（第２図のステップ２３）。そして、デ
ザインルールチェック部５は、デザインルールを満足し
ていないレイアウトデータのエラ一部分のレイヤ名、座
標値、ルールナンバを抽出する。
次に、抽出したエラーデータとレイアウトデータ処理部
４によって作成されたセル配置情報とをエラー線分解析
部６が読み込み、エラー線分が属しているセル名とセル
内での座標値とをエラー線分情報に付加する（第２図の
ステップ２４）。エラー線分情報は、第６図に示すよう
に、１つのエラー情報が、デザインルールナンバ１５、
座標値１６、グループナンバ１７、そのエラーが属する
スヘてのセル名１８およびそのセル内での１ Ｉ （ｉ
１９によって構成されている。そして、エラー線分解析
部６は、その各エラー線分のセル名とセル内での座標値
を比較し、一致すれば同一のグループナンバをエラー線
分情報に付加しく第２図のステップ２５）、一致するも
のがなければ独自のグループナンバをエラー線分情報に
付加する。
４によって作成されたセル配置情報とをエラー線分解析
部６が読み込み、エラー線分が属しているセル名とセル
内での座標値とをエラー線分情報に付加する（第２図の
ステップ２４）。エラー線分情報は、第６図に示すよう
に、１つのエラー情報が、デザインルールナンバ１５、
座標値１６、グループナンバ１７、そのエラーが属する
スヘてのセル名１８およびそのセル内での１ Ｉ （ｉ
１９によって構成されている。そして、エラー線分解析
部６は、その各エラー線分のセル名とセル内での座標値
を比較し、一致すれば同一のグループナンバをエラー線
分情報に付加しく第２図のステップ２５）、一致するも
のがなければ独自のグループナンバをエラー線分情報に
付加する。
次に、エラー線分解析部６が出力するエラー線分情報を
画面出力部２が読み込み、画面出力用情報に変換する。
画面出力部２が読み込み、画面出力用情報に変換する。
その時、エラー線分情報のグループナンバをチェックし
、同一のグループナンバを持つエラー線分は、１組のエ
ラー線分情報のみを画面出力用情報に変換し、他のエラ
ー線分情報は無視する。また、レイアウトデータ処理部
４によって作成され、ディスク装置３に格納されている
レイアウトデータも読み込み、画面出力用情報に変換す
る。そして、デイスプレィｌ上に、変換したエラーデー
タおよびレイアウトデータを出力する（第２図のステッ
プ２６）。これによって、利用者はレイアウトのエラ一
部のチェックをデイスプレィ１上で行なう。
、同一のグループナンバを持つエラー線分は、１組のエ
ラー線分情報のみを画面出力用情報に変換し、他のエラ
ー線分情報は無視する。また、レイアウトデータ処理部
４によって作成され、ディスク装置３に格納されている
レイアウトデータも読み込み、画面出力用情報に変換す
る。そして、デイスプレィｌ上に、変換したエラーデー
タおよびレイアウトデータを出力する（第２図のステッ
プ２６）。これによって、利用者はレイアウトのエラ一
部のチェックをデイスプレィ１上で行なう。
なお、上記実施例では出力データをデイスプレィ１に出
力するものを示したが、出力データをブロック装置によ
ってプロット出力してもよい。また、エラー情報をプリ
ンタ装置によってリスト出力してもよい。これを第２図
に示す。
力するものを示したが、出力データをブロック装置によ
ってプロット出力してもよい。また、エラー情報をプリ
ンタ装置によってリスト出力してもよい。これを第２図
に示す。
以上説明したように本発明は、各エラー線分の属してい
るセル名とセル内での座標値の情報とを抽出し、その情
報が一致するエラー線分に対して同一のグループナンバ
を割り当てるようにしたことにより、出力エラー情報を
削減することができるので、人手によるエラーのチェッ
ク時間を削減できると共に、エラーのチェックもれを削
減できる効果がある。
るセル名とセル内での座標値の情報とを抽出し、その情
報が一致するエラー線分に対して同一のグループナンバ
を割り当てるようにしたことにより、出力エラー情報を
削減することができるので、人手によるエラーのチェッ
ク時間を削減できると共に、エラーのチェックもれを削
減できる効果がある。
第１図は本発明によるレイアウトパターン検証装置の一
実施例を示す構成図、第２図は本発明の他の実施例を示
す構成図、第３図は第１図の装置の動作を説明するため
のフローチャート、第４図は従来のレイアウトパターン
検証装置を示す構成図、第５図は第１図の装置における
セルの階層構造ファイルの例を示す説明図、第６図は第
１図の装置におけるデザインルールエラーの線分情報の
例を示す説明図である。 １・・・デイスプレィ、２・・・画面出力部、３・・・
ディスク装置、４・・・レイアウトデータ処理部、５・
・・デザインルールチェック部、６・・・エラー線分解
析部。 第１図 第２図
実施例を示す構成図、第２図は本発明の他の実施例を示
す構成図、第３図は第１図の装置の動作を説明するため
のフローチャート、第４図は従来のレイアウトパターン
検証装置を示す構成図、第５図は第１図の装置における
セルの階層構造ファイルの例を示す説明図、第６図は第
１図の装置におけるデザインルールエラーの線分情報の
例を示す説明図である。 １・・・デイスプレィ、２・・・画面出力部、３・・・
ディスク装置、４・・・レイアウトデータ処理部、５・
・・デザインルールチェック部、６・・・エラー線分解
析部。 第１図 第２図
Claims (1)
- ＩＣのレイアウトパターンが設計基準を満足しているか
どうかをチェックする際に、設計基準を満足していない
として出力されるエラーをエラーの含まれるセルおよび
セル内の位置によってグループ分けし、各エラーにグル
ープナンバを付加するエラー線分解析部を備えたことを
特徴とするレイアウトパターン検証装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2030396A JPH03234039A (ja) | 1990-02-09 | 1990-02-09 | レイアウトパターン検証装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2030396A JPH03234039A (ja) | 1990-02-09 | 1990-02-09 | レイアウトパターン検証装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03234039A true JPH03234039A (ja) | 1991-10-18 |
Family
ID=12302768
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2030396A Pending JPH03234039A (ja) | 1990-02-09 | 1990-02-09 | レイアウトパターン検証装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03234039A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102006006782A1 (de) * | 2006-02-14 | 2007-08-23 | Infineon Technologies Ag | Verfahren zum Behandeln von Designfehlern eines Layouts einer integrierten Schaltung |
-
1990
- 1990-02-09 JP JP2030396A patent/JPH03234039A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE102006006782A1 (de) * | 2006-02-14 | 2007-08-23 | Infineon Technologies Ag | Verfahren zum Behandeln von Designfehlern eines Layouts einer integrierten Schaltung |
| DE102006006782B4 (de) * | 2006-02-14 | 2008-04-03 | Infineon Technologies Ag | Verfahren zum Behandeln von Designfehlern eines Layouts einer integrierten Schaltung |
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