JPH04330533A - 中央処理装置 - Google Patents
中央処理装置Info
- Publication number
- JPH04330533A JPH04330533A JP3006932A JP693291A JPH04330533A JP H04330533 A JPH04330533 A JP H04330533A JP 3006932 A JP3006932 A JP 3006932A JP 693291 A JP693291 A JP 693291A JP H04330533 A JPH04330533 A JP H04330533A
- Authority
- JP
- Japan
- Prior art keywords
- microprogram
- ras
- error
- test mode
- central processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
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- Test And Diagnosis Of Digital Computers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】［発明の目的］
【０００２】
【産業上の利用分野】本発明は、情報処理システム等に
利用される中央処理装置に関する。
利用される中央処理装置に関する。
【０００３】
【従来の技術】近年、中央処理装置（ＣＰＵ）において
は、信頼性の向上を図るため、ＲＡＳ（ｒｅｌｉａｂｉ
ｌｉｔｙ，ａｖａｉｌａｂｉｌｉｔｙ，ｓｅｒｖｉｃｅ
ａｂｉｌｉｔｙ ）機能の充実が図られている。図２は
、このようなＲＡＳ機能部を有するマイクロプログラム
方式の従来の中央処理装置の構成を示すもので、図にお
いて、１は制御ＲＡＭ、２は命令レジスタ、３はマイク
ロプログラムアドレス設定部、４はデコーダ、５はテス
トモードレジスタ、６はＲＡＳ機能部である。
は、信頼性の向上を図るため、ＲＡＳ（ｒｅｌｉａｂｉ
ｌｉｔｙ，ａｖａｉｌａｂｉｌｉｔｙ，ｓｅｒｖｉｃｅ
ａｂｉｌｉｔｙ ）機能の充実が図られている。図２は
、このようなＲＡＳ機能部を有するマイクロプログラム
方式の従来の中央処理装置の構成を示すもので、図にお
いて、１は制御ＲＡＭ、２は命令レジスタ、３はマイク
ロプログラムアドレス設定部、４はデコーダ、５はテス
トモードレジスタ、６はＲＡＳ機能部である。
【０００４】制御ＲＡＭ１は、マイクロプログラムを格
納しており、マイクロプログラムアドレス設定部３が示
す値をリードアドレスとして、命令レジスタ２にマイク
ロ命令がロードされる。命令レジスタ２にロードされた
マイクロ命令は、デコーダ４によってデコードされ、各
制御部を動作させる。
納しており、マイクロプログラムアドレス設定部３が示
す値をリードアドレスとして、命令レジスタ２にマイク
ロ命令がロードされる。命令レジスタ２にロードされた
マイクロ命令は、デコーダ４によってデコードされ、各
制御部を動作させる。
【０００５】また、ＲＡＳ機能部６は各エラー検出を行
っており、エラーが検出されるとマイクロプログラムア
ドレス設定部３に対するエラー検出信号１０１をアクテ
ィブにする。そして、マイクロプログラムアドレス設定
部３は、ＲＡＳ機能部６によってエラーが検出されると
、次に実行するマイクロ命令アドレスとしてエラー処理
ルーチンヘ分岐するアドレスを示し、マイクロ命令はそ
の後エラー処理ルーチンに分岐する。
っており、エラーが検出されるとマイクロプログラムア
ドレス設定部３に対するエラー検出信号１０１をアクテ
ィブにする。そして、マイクロプログラムアドレス設定
部３は、ＲＡＳ機能部６によってエラーが検出されると
、次に実行するマイクロ命令アドレスとしてエラー処理
ルーチンヘ分岐するアドレスを示し、マイクロ命令はそ
の後エラー処理ルーチンに分岐する。
【０００６】上記構成の従来の中央処理装置において、
ＲＡＳ機能部６のＲＡＳ機能を診断する場合、マイクロ
命令はまずテストモードレジスタ５にテストモードを示
す値をセットし、ＲＡＳ機能部６のＲＡＳ機能を診断で
きる状態にする。（エラー検出回路において、エラーを
故意に発生させる状態にする。）その後、ＲＡＳ機能が
働くマイクロ命令を実行すると、ＲＡＳ機能部６はテス
トモード信号１０２がアクティブであることと、ＲＡＳ
機能を動作させるマイクロ命令信号１０３がアクティブ
であることで、マイクロプロクラムアドレス設定部３へ
のエラー検出信号１０１をアクティブにする。
ＲＡＳ機能部６のＲＡＳ機能を診断する場合、マイクロ
命令はまずテストモードレジスタ５にテストモードを示
す値をセットし、ＲＡＳ機能部６のＲＡＳ機能を診断で
きる状態にする。（エラー検出回路において、エラーを
故意に発生させる状態にする。）その後、ＲＡＳ機能が
働くマイクロ命令を実行すると、ＲＡＳ機能部６はテス
トモード信号１０２がアクティブであることと、ＲＡＳ
機能を動作させるマイクロ命令信号１０３がアクティブ
であることで、マイクロプロクラムアドレス設定部３へ
のエラー検出信号１０１をアクティブにする。
【０００７】マイクロプロクラムアドレス設定部３は、
エラー検出信号１０１がアクティブになったことでＲＡ
Ｓ機能部６によるエラー検出を知り、次に実行するマイ
クロ命令のアドレスに、エラー処理ルーチンヘ分岐する
アドレスを示す。マイクロ命令はその後エラー処理ルー
チンに分岐し、テストモードであることとその対象とな
るステータスフラグをチェックすることでＲＡＳ機能の
診断を行う。
エラー検出信号１０１がアクティブになったことでＲＡ
Ｓ機能部６によるエラー検出を知り、次に実行するマイ
クロ命令のアドレスに、エラー処理ルーチンヘ分岐する
アドレスを示す。マイクロ命令はその後エラー処理ルー
チンに分岐し、テストモードであることとその対象とな
るステータスフラグをチェックすることでＲＡＳ機能の
診断を行う。
【０００８】
【発明が解決しようとする課題】しかしながら、上述し
た従来の中央処理装置では、複数のＲＡＳ機能を診断す
る場合、各々のＲＡＳ機能毎にエラー処理ルーチンヘ分
岐してしまい、マイクロプログラムが複雑で容量の大き
いものになる等の問題があった。
た従来の中央処理装置では、複数のＲＡＳ機能を診断す
る場合、各々のＲＡＳ機能毎にエラー処理ルーチンヘ分
岐してしまい、マイクロプログラムが複雑で容量の大き
いものになる等の問題があった。
【０００９】本発明は、かかる従来の事情に対処してな
されたもので、複数のＲＡＳ機能を同時に継続して診断
することができ、診断ルーチンにおけるマイクロプログ
ラムの簡素化および小容量化を図ることのできる中央処
理装置を提供しようとするものである。
されたもので、複数のＲＡＳ機能を同時に継続して診断
することができ、診断ルーチンにおけるマイクロプログ
ラムの簡素化および小容量化を図ることのできる中央処
理装置を提供しようとするものである。
【００１０】［発明の構成］
【００１１】
【課題を解決するための手段】すなわち、本発明の中央
処理装置は、マイクロプログラムを格納する制御ＲＡＭ
と、エラーの検出を行うＲＡＳ機能部と、マイクロ命令
シ−ケンスを制御し、前記ＲＡＳ機能部でエラーが検出
されると前記マイクロプログラムをエラー処理ルーチン
に分岐させるマイクロプログラムアドレス設定部と、前
記ＲＡＳ機能部のテストを実行するテストモードを設定
するためのテストモードレジスタと、前記テストモード
レジスタがテストモードとされている場合は、前記エラ
ー処理ルーチンへの分岐を禁止する手段とを具備したこ
とを特徴とする。
処理装置は、マイクロプログラムを格納する制御ＲＡＭ
と、エラーの検出を行うＲＡＳ機能部と、マイクロ命令
シ−ケンスを制御し、前記ＲＡＳ機能部でエラーが検出
されると前記マイクロプログラムをエラー処理ルーチン
に分岐させるマイクロプログラムアドレス設定部と、前
記ＲＡＳ機能部のテストを実行するテストモードを設定
するためのテストモードレジスタと、前記テストモード
レジスタがテストモードとされている場合は、前記エラ
ー処理ルーチンへの分岐を禁止する手段とを具備したこ
とを特徴とする。
【００１２】
【作用】上記構成の本発明の中央処理装置では、ＲＡＳ
機能の診断時においては、ＲＡＳ機能部でエラーが検出
されても、エラー処理ルーチンヘの分岐は行われない。 したがって、複数のＲＡＳ機能を同時に継続して診断す
ることができ、診断ルーチンにおけるマイクロプログラ
ムの簡素化および小容量化を図ることができる。
機能の診断時においては、ＲＡＳ機能部でエラーが検出
されても、エラー処理ルーチンヘの分岐は行われない。 したがって、複数のＲＡＳ機能を同時に継続して診断す
ることができ、診断ルーチンにおけるマイクロプログラ
ムの簡素化および小容量化を図ることができる。
【００１３】
【実施例】以下、本発明の中央処理装置の一実施例を図
面を参照して説明する。
面を参照して説明する。
【００１４】図１は、本発明の一実施例の中央処理装置
の構成を示すもので、図において、１１は制御ＲＡＭ、
１２は命令レジスタ、１３はマイクロプログラムアドレ
ス設定部、１４はデコーダ、１５はテストモードレジス
タ、１６はＲＡＳ機能部、１７はアンドゲートである。
の構成を示すもので、図において、１１は制御ＲＡＭ、
１２は命令レジスタ、１３はマイクロプログラムアドレ
ス設定部、１４はデコーダ、１５はテストモードレジス
タ、１６はＲＡＳ機能部、１７はアンドゲートである。
【００１５】制御ＲＡＭ１１は、マイクロプログラムを
格納しており、マイクロプログラムアドレス設定部１３
が示す値をリードアドレスとして、命令レジスタ１２に
マイクロ命令がロードされる。命令レジスタ１２にロー
ドされたマイクロ命令は、デコーダ１４によってデコー
ドされ、各制御部を動作させる。
格納しており、マイクロプログラムアドレス設定部１３
が示す値をリードアドレスとして、命令レジスタ１２に
マイクロ命令がロードされる。命令レジスタ１２にロー
ドされたマイクロ命令は、デコーダ１４によってデコー
ドされ、各制御部を動作させる。
【００１６】また、ＲＡＳ機能部１６は各エラー検出を
行っており、エラーが検出されるとマイクロプログラム
アドレス設定部１３に対するエラー検出信号２０１をア
クティブにする。そして、マイクロプログラムアドレス
設定部１３は、ＲＡＳ機能部１６によってエラーが検出
されると、次に実行するマイクロ命令アドレスとしてエ
ラー処理ルーチンヘ分岐するアドレスを示し、マイクロ
命令はその後エラー処理ルーチンに分岐する。
行っており、エラーが検出されるとマイクロプログラム
アドレス設定部１３に対するエラー検出信号２０１をア
クティブにする。そして、マイクロプログラムアドレス
設定部１３は、ＲＡＳ機能部１６によってエラーが検出
されると、次に実行するマイクロ命令アドレスとしてエ
ラー処理ルーチンヘ分岐するアドレスを示し、マイクロ
命令はその後エラー処理ルーチンに分岐する。
【００１７】また、ＲＡＳ機能部１６のＲＡＳ機能の診
断を行う際には、マイクロ命令はまずテストモードレジ
スタ１５にテストモードを示す値をセットし、１ つの
ＲＡＳ機能を診断できる状態（故意にエラー状態）にす
る。その後、そのＲＡＳ機能が働くマイクロ命令を実行
する。この時ＲＡＳ機能部１６内にはその対象となるス
テータスフラグがセットされる。
断を行う際には、マイクロ命令はまずテストモードレジ
スタ１５にテストモードを示す値をセットし、１ つの
ＲＡＳ機能を診断できる状態（故意にエラー状態）にす
る。その後、そのＲＡＳ機能が働くマイクロ命令を実行
する。この時ＲＡＳ機能部１６内にはその対象となるス
テータスフラグがセットされる。
【００１８】ＲＡＳ機能部１６は、テストモードを示す
テストモード信号２０２とＲＡＳ機能を動作させるマイ
クロ命令信号２０３がアクティブであることで、エラー
検出信号２０１をアクティブにする。しかしながら、こ
の時テストモード信号２０２もアクティブであるため、
アンドゲ−ト１７の作用によりマイクロプログラムアド
レス設定部１３に入力されるエラー分岐信号２０４は、
インアクティブのままとなる。このため、マイクロプロ
グラムアドレス設定部１３は、エラー処理ルーチンヘ分
岐することなく、インクリメントした次のアドレスを示
す。
テストモード信号２０２とＲＡＳ機能を動作させるマイ
クロ命令信号２０３がアクティブであることで、エラー
検出信号２０１をアクティブにする。しかしながら、こ
の時テストモード信号２０２もアクティブであるため、
アンドゲ−ト１７の作用によりマイクロプログラムアド
レス設定部１３に入力されるエラー分岐信号２０４は、
インアクティブのままとなる。このため、マイクロプロ
グラムアドレス設定部１３は、エラー処理ルーチンヘ分
岐することなく、インクリメントした次のアドレスを示
す。
【００１９】次のマイクロ命令はテストモードレジスタ
１５にテストモードを示す値をセットし、別のＲＡＳ機
能を診断できる状態（故意にエラー状態）にし、そのＲ
ＡＳ機能が働くマイクロ命令を実行する。以後、同様な
動作がＲＡＳ機能分繰返される。そして最終的にＲＡＳ
機能部１６内にあるステータスフラグをチェックするこ
とで、全てのＲＡＳ機能の診断を行う。
１５にテストモードを示す値をセットし、別のＲＡＳ機
能を診断できる状態（故意にエラー状態）にし、そのＲ
ＡＳ機能が働くマイクロ命令を実行する。以後、同様な
動作がＲＡＳ機能分繰返される。そして最終的にＲＡＳ
機能部１６内にあるステータスフラグをチェックするこ
とで、全てのＲＡＳ機能の診断を行う。
【００２０】このように、本実施例の中央処理装置では
、ＲＡＳ機能の診断時においては、ＲＡＳ機能部１６で
エラーが検出されても、エラー処理ルーチンヘの分岐は
行われない。したがって、複数のＲＡＳ機能を同時に継
続して診断することができ、診断ルーチンにおけるマイ
クロプログラムの簡素化および小容量化を図ることがで
きる。
、ＲＡＳ機能の診断時においては、ＲＡＳ機能部１６で
エラーが検出されても、エラー処理ルーチンヘの分岐は
行われない。したがって、複数のＲＡＳ機能を同時に継
続して診断することができ、診断ルーチンにおけるマイ
クロプログラムの簡素化および小容量化を図ることがで
きる。
【００２１】
【発明の効果】以上説明したように、本発明の中央処理
装置によれば、複数のＲＡＳ機能を同時に継続して診断
することができ、診断ルーチンにおけるマイクロプログ
ラムの簡素化および小容量化を図ることができる。
装置によれば、複数のＲＡＳ機能を同時に継続して診断
することができ、診断ルーチンにおけるマイクロプログ
ラムの簡素化および小容量化を図ることができる。
【図面の簡単な説明】
【図１】本発明の一実施例の中央処理装置の構成を示す
図である。
図である。
【図２】従来の中央処理装置の構成を示す図である。
１１ 制御ＲＡＭ
１２ 命令レジスタ
１３ マイクロプログラムアドレス設定部１４ デ
コーダ １５ テストモードレジスタ １６ ＲＡＳ機能部 １７ アンドゲート
コーダ １５ テストモードレジスタ １６ ＲＡＳ機能部 １７ アンドゲート
Claims (1)
- 【請求項１】 マイクロプログラムを格納する制御Ｒ
ＡＭと、エラーの検出を行うＲＡＳ機能部と、マイクロ
命令シ−ケンスを制御し、前記ＲＡＳ機能部でエラーが
検出されると前記マイクロプログラムをエラー処理ルー
チンに分岐させるマイクロプログラムアドレス設定部と
、前記ＲＡＳ機能部のテストを実行するテストモードを
設定するためのテストモードレジスタと、前記テストモ
ードレジスタがテストモードとされている場合は、前記
エラー処理ルーチンへの分岐を禁止する手段とを具備し
たことを特徴とする中央処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3006932A JPH04330533A (ja) | 1991-01-24 | 1991-01-24 | 中央処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3006932A JPH04330533A (ja) | 1991-01-24 | 1991-01-24 | 中央処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04330533A true JPH04330533A (ja) | 1992-11-18 |
Family
ID=11652026
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3006932A Withdrawn JPH04330533A (ja) | 1991-01-24 | 1991-01-24 | 中央処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04330533A (ja) |
-
1991
- 1991-01-24 JP JP3006932A patent/JPH04330533A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19980514 |