JPH05346772A - Crt表示装置 - Google Patents

Crt表示装置

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Publication number
JPH05346772A
JPH05346772A JP15488092A JP15488092A JPH05346772A JP H05346772 A JPH05346772 A JP H05346772A JP 15488092 A JP15488092 A JP 15488092A JP 15488092 A JP15488092 A JP 15488092A JP H05346772 A JPH05346772 A JP H05346772A
Authority
JP
Japan
Prior art keywords
crt
bus
data
cpu
vram
Prior art date
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Withdrawn
Application number
JP15488092A
Other languages
English (en)
Inventor
Hiroya Watabe
博也 渡部
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NEC Yamagata Ltd
Original Assignee
NEC Yamagata Ltd
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Filing date
Publication date
Application filed by NEC Yamagata Ltd filed Critical NEC Yamagata Ltd
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Abstract

(57)【要約】 【目的】CRT表示装置に於いて、表示データ書き替え
時の画面に発生するノイズを防止する。 【構成】VRAMをCPUでアクセスする場合に、CR
Tの非表示期間を利用しVRAMのデータを書き替える
タイミングを調停するバス切替調停ユニットを追加し、
表示画面にノイズが発生するのを防止する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はCRT表示装置に係わ
り、特にマイクロコンピュータにより作画を行なうCR
T表示装置に関する。
【0002】
【従来の技術】従来のCRT表示装置は、図2に示すよ
うにCPUユニットとVRAMのデータのやり取りを行
なうCPUバス1と、CRT表示制御ユニットがビデオ
RAM(以下VRAMと称す)からデータを読み出す為
のCRT表示バス2と、VRAMのデータを転送するV
RAMバス3と、CRTに映像を表示するビデオ信号4
を有している。
【0003】次に、動作について説明する。
【0004】CRTに映像を表示している状態では、バ
ス切替ユニットがCRT表示バス2とVRAMバス3を
接続しており、順次VRAMのデータをCRT表示ユニ
ットに読み出す。CRT表示制御ユニットでは、読み出
したデータに同期信号などを付加し、ビデオ信号に変換
し、CRTに出力する。
【0005】CRTに表示しているデータを変更する場
合は、バス切替ユニットを切替えCRT表示バス2とC
PUバス1を接続し、VRAMのデータの読み出し、又
は書き込みを行なう。
【0006】
【発明が解決しようとする課題】この従来のCRT表示
装置では、CRTで表示しているデータを変更する時に
強制的にバス切替ユニットでVRAMバスをCPUバス
に切替える為、その間CRT表示制御ユニットにデータ
を読み出せなくなり、CRT上にノイズが発生したり表
示している文字の1部が欠けるなど問題点があった。
【0007】
【課題を解決するための手段】本発明のCRT表示装置
では、CRTの非表示中期間のみバス切替を行なうバス
切替調停回路を備えている。
【0008】すなわち本発明の特徴は、VRAMからデ
ータを順次読み出しCRTに表示するCRT表示制御ユ
ニットの動作タイミングと、CRTの表示データを変更
する為に前記VRAMのデータを読み込み又は書き込み
を行なうCPUユニットの動作タイミングとがお互いに
重なった場合に、優先順位をつけ調停する回路を備えた
CRT表示装置にある。
【0009】
【実施例】次に本発明について図面を参照して説明す
る。
【0010】図1(A)は、本発明の一実施例のCRT
表示装置のブロック図である。CRTが映像を表示して
いる状態では、バス切替ユニットがCRTバス2とVR
AMバス3を接続しており順次VRAMのデータをCR
T表示ユニットに読み出す。CRT表示制御ユニットで
は読み出したデータに同期信号などを付加しビデオ信号
に変換しCRTに表示する。
【0011】CRTの表示データを変更する場合は、C
PUユニットがバス切替えタイミング6をバス切替調停
ユニットが検出し、CRT表示タイミングがアクティブ
の場合は、CPU待ち合わせ信号7をCPUユニットに
送りCPUの動作を一時停止させる。又、非表示中の場
合はバス切替信号8をバス切替ユニットに出力し、CP
Uバス1とVRAMバス3を接続する。
【0012】図1(B)は、ビデオ信号4の波形を示し
たもので、CRT表示中9の場合は、CPU待ち合わせ
を行ない、CRT非表示中10の場合にバスを切替えV
RAのデータを変更する。
【0013】
【発明の効果】以上説明したように本発明は、CRTの
非表示期間のみVRAMデータの書き替えを行なうので
表示画面にノイズが出ないという効果を有する。
【図面の簡単な説明】
【図1】本発明の一実施例のCRT表示装置を示す図で
あり、(A)はブロック図、(B)はビデオ信号の信号
波形図である。
【図2】従来技術のCRT表示装置を示すブロック図で
ある。
【符号の説明】
1 CPUバス 2 CRTバス 3 VRAMバス 4 ビデオ信号 5 CRT表示タイミング 6 バス切替タイミング 7 CPU待ち合わせ信号 8 バス切替信号 9 CRT表示中 10 CRT非表示中

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 ビデオRAMからデータを順次読み出し
    CRTに表示するCRT表示制御ユニットの動作タイミ
    ングと、CRTの表示データを変更する為に前記ビデオ
    RAMのデータの読み込み又は書き込みを行なうCPU
    ユニットの動作タイミングとがお互いに重なった場合
    に、優先順位をつけ調停する回路を備えることを特徴と
    するCRT表示装置。
JP15488092A 1992-06-15 1992-06-15 Crt表示装置 Withdrawn JPH05346772A (ja)

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JP15488092A JPH05346772A (ja) 1992-06-15 1992-06-15 Crt表示装置

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JP15488092A JPH05346772A (ja) 1992-06-15 1992-06-15 Crt表示装置

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JPH05346772A true JPH05346772A (ja) 1993-12-27

Family

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JP15488092A Withdrawn JPH05346772A (ja) 1992-06-15 1992-06-15 Crt表示装置

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