JPH0555197U - Electronic musical instrument - Google Patents
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- JPH0555197U JPH0555197U JP113291U JP11329191U JPH0555197U JP H0555197 U JPH0555197 U JP H0555197U JP 113291 U JP113291 U JP 113291U JP 11329191 U JP11329191 U JP 11329191U JP H0555197 U JPH0555197 U JP H0555197U
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Abstract
(57)【要約】
【目的】 CPUなどを含む制御側と音源側の両者のイ
ニシャルクリアを常に適正に行ない、安定したイニシャ
ルクリアおよびその後の通常の動作が保証される電子楽
器を提供することを目的とする。
【構成】 制御側でイニシャルクリア信号を受けたとき
から所定の時間が経過した後にイニシャルクリア解除信
号を音源側に向けて送出するようにする。
(57) [Abstract] [Purpose] To provide an electronic musical instrument in which initial clear is always performed properly on both the control side including the CPU and the sound source side, and stable initial clear and subsequent normal operation are guaranteed. To aim. [Structure] An initial clear cancellation signal is sent to the sound source side after a lapse of a predetermined time from when the control side receives the initial clear signal.
Description
【0001】[0001]
この考案は、音源のイニシャルクリアおよびイニシャルクリア解除を適正に行 なうことができる電子楽器に関する。 The present invention relates to an electronic musical instrument capable of properly performing initial clear and cancellation of initial clear of a sound source.
【0002】[0002]
近年の電子楽器では、全体の高機能化にともない、各回路部分をそれぞれ独立 した集積回路などで構成することが多い。独立した各回路部分はそれぞれ独立し た機能を果たすようになっている。例えば、大きくCPU側と音源側に回路を分 けて構成し、全体の動作制御(特に音源への発音指示など)はCPU側に、CP Uからの指示を受けて行なわれる発音処理は音源側に役割分担させる電子楽器が ある。 In recent years, electronic musical instruments are often configured with independent integrated circuits, etc., in accordance with the higher functionality of the whole. Each independent circuit part has an independent function. For example, a circuit is roughly divided into a CPU side and a sound source side, and overall operation control (especially sound generation instruction to the sound source) is to the CPU side, and sound generation processing performed in response to an instruction from the CPU is the sound source side There are electronic musical instruments that divide the roles.
【0003】 このような電子楽器では、電源投入時(あるいは電源投入した後でのリセット 時)に、CPU側と音源側の両方をイニシャルクリアしなければならない。イニ シャルクリアとは、電子楽器を電子楽器としての通常の動作を行なう状態に設定 するための初期設定の動作をいう。イニシャルクリアは、ハードウエア的なリセ ットのほかに、音色をデフォルト値に設定するなどの動作も含む。In such an electronic musical instrument, both the CPU side and the sound source side must be initially cleared when the power is turned on (or at the time of resetting after the power is turned on). Initial clear refers to the initial setting operation for setting the electronic musical instrument to a state in which it normally operates as an electronic musical instrument. Initial clear includes not only hardware reset but also operation such as setting tone to default value.
【0004】 図4(a)は、従来の電子楽器におけるイニシャルクリア(IC)信号生成回 路を示す。図4(b)は、図4(a)の回路における各信号のタイムチャートを 示す。この図において、電源投入されVCCが立上がるとインバータ42にはCR 回路41のC値およびR値により規定される時定数で立上がる入力信号が入力す る。したがって、インバータ42は電源投入以前は「0」でVCCの立上がり時点 (電源オン)で所定値に至り徐々に「0」に至る信号を出力する。このインバー タ42の出力信号をアンプ43で整形して図4(b)に示すイニシャルクリア信 号ICのパルスを出力する。FIG. 4A shows an initial clear (IC) signal generation circuit in a conventional electronic musical instrument. FIG. 4B shows a time chart of each signal in the circuit of FIG. In this figure, when power is turned on and VCC rises, an input signal which rises with a time constant defined by the C value and R value of the CR circuit 41 is input to the inverter 42. Therefore, the inverter 42 outputs a signal which is "0" before the power is turned on, reaches a predetermined value at the rising time of VCC (power on), and gradually reaches "0". The output signal of the inverter 42 is shaped by the amplifier 43 and the pulse of the initial clear signal IC shown in FIG. 4B is output.
【0005】 一方、インバータ42の出力信号はCR回路44を介して所定時間遅延せられ た後、アンプ45で整形されて出力される。これが、図4(b)に示すイニシャ ルクリア解除信号ICKとなる。このようにアナログ回路を用いてイニシャルク リア信号ICとイニシャルクリア解除信号ICKを生成し、後者を遅延させて、 その遅延時間の間(図4(b)の付番46の区間)にCPUおよび音源のイニシ ャルクリアを行なっていた。On the other hand, the output signal of the inverter 42 is delayed by the CR circuit 44 for a predetermined time, then shaped by the amplifier 45 and output. This becomes the initial clear cancellation signal ICK shown in FIG. 4 (b). In this way, the analog clear circuit is used to generate the initial clear signal IC and the initial clear cancellation signal ICK, the latter is delayed, and the CPU and the CPU are delayed during the delay time (section numbered 46 in FIG. 4B). I was initially clearing the sound source.
【0006】[0006]
上述のようなイニシャルクリアの方式では、イニシャルクリアの時間はCR回 路44における遅延時間で決定される。ところが、アナログ回路で実現している ため、この遅延時間にはばらつきがある。CPUのイニシャルクリアと音源のイ ニシャルクリアとでは、通常音源のイニシャルクリアのほうが時間がかかる。し たがって、音源のイニシャルクリアが終了しないうちにイニシャルクリア解除信 号が送出されることがあり、動作が不安定となることがあるという問題点があっ た。 In the initial clear method as described above, the initial clear time is determined by the delay time in the CR circuit 44. However, since it is realized by an analog circuit, this delay time varies. Regarding the initial clear of the CPU and the initial clear of the sound source, the initial clear of the normal sound source takes more time. Therefore, there is a problem that the initial clear cancel signal may be sent before the initial clear of the sound source is completed, and the operation may become unstable.
【0007】 この考案は、上述の従来例における問題点に鑑み、CPUなどを含む制御側と 音源側の両者のイニシャルクリアを常に適正に行ない、安定したイニシャルクリ アおよびその後の通常の動作が保証される電子楽器を提供することを目的とする 。In view of the problems in the above-mentioned conventional example, the present invention always properly performs the initial clear on both the control side including the CPU and the sound source side, and guarantees a stable initial clear and normal operation thereafter. The purpose is to provide an electronic musical instrument.
【0008】[0008]
この目的を達成するため、この考案に係る電子楽器は、イニシャルクリア信号 を受けて自己のイニシャルクリアを行ない、かつイニシャルクリア解除信号を受 けて自己の通常動作を可能にするとともに、通常動作時は楽音の発音指示を受け て楽音を発生する楽音形成手段と、同じくイニシャルクリア信号を受けて自己の イニシャルクリアを行なうとともに、前記楽音形成手段に発音指示を与える制御 手段とを備え、前記制御手段は、イニシャルクリア信号を受けた時点から所定時 間の後にイニシャルクリア解除信号を前記楽音形成手段に向けて送出することを 特徴とする。 To achieve this object, the electronic musical instrument according to the present invention receives an initial clear signal to perform its own initial clear, and also receives an initial clear release signal to enable its own normal operation, and at the time of normal operation. Is provided with a tone forming means for generating a tone in response to a tone generation instruction and a control means for similarly receiving an initial clear signal to perform its own initial clear and giving a tone instruction to the tone forming means. Is characterized in that an initial clear cancellation signal is sent to the musical tone forming means after a predetermined time from the time of receiving the initial clear signal.
【0009】 イニシャルクリア信号は、電源のオン/オフスイッチやリセットスイッチから 直接作成してもよいし、特にこれらのスイッチのオン/オフを検出してイニシャ ルクリア信号を生成する手段を設けてもよい。また、電源の供給を行なう電源供 給手段からの信号入力に基づいてイニシャルクリア信号を発生するようにしても よい。The initial clear signal may be directly generated from an on / off switch or a reset switch of a power source, and in particular, means for detecting on / off of these switches to generate an initial clear signal may be provided. . Further, the initial clear signal may be generated based on the signal input from the power supply means for supplying the power.
【0010】[0010]
制御手段は、イニシャルクリア信号を受けた時点から所定時間の後に楽音形成 手段へのイニシャルクリア解除信号を生成出力する。制御手段においてはかなり 正確に時間を測定することができるので、イニシャルクリア解除信号を生成出力 するまでの時間は、正確に制御できる。したがって、楽音形成手段におけるイニ シャルクリアの処理が適正に終了する程度の時間を確保した後、イニシャルクリ ア解除信号が楽音形成手段へ入力するようにできる。 The control means generates and outputs an initial clear cancellation signal to the musical tone forming means after a predetermined time from the time of receiving the initial clear signal. Since the control means can measure the time fairly accurately, the time until the initial clear release signal is generated and output can be accurately controlled. Therefore, it is possible to input the initial clear cancellation signal to the musical tone forming means after securing a time for the initial clear processing in the musical tone forming means to be properly finished.
【0011】[0011]
以下、図面を用いてこの考案の実施例を説明する。 図1は、この考案の一実施例に係る電子楽器の全体のブロック構成を示す。こ の電子楽器は、制御部1、スイッチ2、スイッチイベント検出回路3、鍵盤4、 キーイベント検出回路5、プログラムメモリ(ROM)6、ポート7、音源8、 サウンドシステム9、およびバスライン17を備えている。 An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 shows an overall block configuration of an electronic musical instrument according to an embodiment of the present invention. This electronic musical instrument includes a control unit 1, a switch 2, a switch event detection circuit 3, a keyboard 4, a key event detection circuit 5, a program memory (ROM) 6, a port 7, a sound source 8, a sound system 9, and a bus line 17. I have it.
【0012】 制御部1は、この電子楽器の全体の動作を制御するとともに音源8に対して楽 音の発音を指示する。制御部1は、時間を測定するためのタイマ11、タイマ1 1の時間測定結果信号に基づいてタイマ割込信号を生成出力する割込コントロー ラ12、中央処理装置(CPU)13、および種々のレジスタなどに用いるRA M14を有する。CPU13が実行するプログラムは、プログラムメモリ6に格 納されている。The control unit 1 controls the entire operation of the electronic musical instrument and instructs the sound source 8 to generate musical tones. The control unit 1 includes a timer 11 for measuring time, an interrupt controller 12 that generates and outputs a timer interrupt signal based on a time measurement result signal of the timer 11, a central processing unit (CPU) 13, and various types. It has a RAM 14 used for a register or the like. The program executed by the CPU 13 is stored in the program memory 6.
【0013】 スイッチ2は、電源のオン/オフスイッチや音色選択のためのスイッチなどで ある。これらのスイッチについてのイベントは、スイッチイベント検出回路3に よって検出される。スイッチイベント検出回路3は、スイッチ2のイベント検出 結果をバスライン17を介してCPU13に送出する。CPU13はスイッチ2 のイベントに応じて、例えば音色の選択であれば所定の音色パラメータを音源8 に送出する処理などを行なう。The switch 2 is, for example, a power on / off switch or a switch for selecting a tone color. Events for these switches are detected by the switch event detection circuit 3. The switch event detection circuit 3 sends the event detection result of the switch 2 to the CPU 13 via the bus line 17. In response to the event of the switch 2, the CPU 13 performs, for example, a process of transmitting a predetermined tone color parameter to the tone generator 8 when selecting a tone color.
【0014】 鍵盤4の各鍵(キー)についてのイベントは、キーイベント検出回路5で検出 される。キーイベント検出回路5は、キーイベント検出結果をバスライン17を 介してCPU13に送出する。CPU13は、そのキーイベント検出結果に応じ て、発音指示を音源8に送出する処理などを行なう。An event for each key of the keyboard 4 is detected by the key event detection circuit 5. The key event detection circuit 5 sends the key event detection result to the CPU 13 via the bus line 17. The CPU 13 performs a process of transmitting a sounding instruction to the sound source 8 according to the result of the key event detection.
【0015】 ポート7はリセット信号RESETを入力して「0」または「1」を保持する 。また、ポート7はCPU13から書換えることもできる。ポート7が保持して いる値は、イニシャルクリア信号ICとして音源8に入力する。また、ポート7 が保持している値をインバータ15で反転した値は、イニシャルクリア解除信号 ICKとして音源8に入力する。リセット信号RESETは、電源がオンされた とき発生される1パルスの信号である。リセット信号RESETの発生回路は従 来より周知の回路を用いればよい。The port 7 inputs the reset signal RESET and holds “0” or “1”. The port 7 can also be rewritten by the CPU 13. The value held by the port 7 is input to the sound source 8 as an initial clear signal IC. A value obtained by inverting the value held by the port 7 by the inverter 15 is input to the sound source 8 as the initial clear cancellation signal ICK. The reset signal RESET is a 1-pulse signal generated when the power is turned on. As a circuit for generating the reset signal RESET, a conventionally known circuit may be used.
【0016】 音源8は、イニシャルクリア信号ICが「0」から「1」に立上がったとき、 内部のイニシャルクリアを実行する。このイニシャルクリアは、内部のレジスタ の初期化などの処理である。音源8は、イニシャルクリア解除信号ICKが「0 」から「1」に立上がると、それ以降は通常の音源としての動作例えばCPU1 3からの指示に基づく楽音発音処理などを行なう。サウンドシステム9は、音源 8からの指示に基づき実際に楽音を放音する。The sound source 8 executes internal initial clear when the initial clear signal IC rises from “0” to “1”. This initial clear is processing such as initialization of internal registers. When the initial clear cancellation signal ICK rises from "0" to "1", the sound source 8 performs an operation as a normal sound source, for example, a musical sound generation process based on an instruction from the CPU 13. The sound system 9 actually emits a musical sound based on an instruction from the sound source 8.
【0017】 図2は、この電子楽器の音源8の詳細なブロック構成を示す。音源8は、RA M16のほか、位相発生回路(PG)21、アドレス発生回路(ADR)22、 波形メモリ(WM)23、エンベロープジェネレータ(EG)24、掛け算器2 5、累算器(ACC)26、AND回路27、インバータ28、およびディジタ ル/アナログ変換器(DAC)29を備えている。FIG. 2 shows a detailed block configuration of the sound source 8 of this electronic musical instrument. The sound source 8 is, in addition to the RAM 16, a phase generation circuit (PG) 21, an address generation circuit (ADR) 22, a waveform memory (WM) 23, an envelope generator (EG) 24, a multiplier 25, an accumulator (ACC). 26, an AND circuit 27, an inverter 28, and a digital / analog converter (DAC) 29.
【0018】 RAM16は、CPU13から送出されたキーオンパルスKONP、キーオフ パルスKOFP、キーコード(音高)KCおよびベロシティ(音量)VELを記 憶可能な領域を複数有し、このRAM16に記憶された各データを所定タイミン グで順次読出して音源8の所定の回路に供給することにより、楽音信号を生成す る。位相発生回路21は、キーオンパルスKONPおよびキーコードKCに応じ て波形メモリ23の読出し位相情報を形成しアドレス発生回路22に出力する。 アドレス発生回路22は、所定のスタートアドレスに位相発生回路21からの位 相情報を順次累算し、波形メモリ23の読出しアドレスを生成する。その読出し アドレスで波形メモリ23がアクセスされ、所定の音高の波形データが出力され る。The RAM 16 has a plurality of areas in which the key-on pulse KONP, the key-off pulse KOFP, the key code (pitch) KC, and the velocity (volume) VEL sent from the CPU 13 can be stored, and each is stored in the RAM 16. A tone signal is generated by sequentially reading data at a predetermined timing and supplying the data to a predetermined circuit of the sound source 8. The phase generation circuit 21 forms read phase information of the waveform memory 23 according to the key-on pulse KONP and the key code KC, and outputs it to the address generation circuit 22. The address generation circuit 22 sequentially accumulates the phase information from the phase generation circuit 21 at a predetermined start address to generate a read address of the waveform memory 23. The waveform memory 23 is accessed at the read address, and waveform data having a predetermined pitch is output.
【0019】 エンベロープジェネレータ24は、キーオンパルスKONP、キーオフパルス KOFP、キーコードKCおよびベロシティVELに応じて所定のエンベロープ 波形を生成出力する。掛け算器25は、波形メモリ23からの波形データにエン ベロープジェネレータ24からのエンベロープ波形を掛けて、エンベロープが付 与された波形データを出力する。この実施例の電子楽器は複数の発音チャンネル を有し、各チャンネルの処理は時分割で行なわれるようになっている。時分割で 順次掛け算器25から出力される各チャンネルの波形データは、累算器26で累 算される。The envelope generator 24 generates and outputs a predetermined envelope waveform according to the key-on pulse KONP, the key-off pulse KOFP, the key code KC and the velocity VEL. The multiplier 25 multiplies the waveform data from the waveform memory 23 by the envelope waveform from the envelope generator 24, and outputs the waveform data to which the envelope is added. The electronic musical instrument of this embodiment has a plurality of tone generation channels, and the processing of each channel is performed in a time division manner. Waveform data of each channel output from the multiplier 25 sequentially by time division is accumulated in an accumulator 26.
【0020】 累算後の楽音波形データは、AND回路27を介してディジタル/アナログ変 換器29に入力し、ディジタル/アナログ変換されて、後段のサウンドシステム 9に入力する。これにより、所定の楽音が放音される。The accumulated musical tone waveform data is input to the digital / analog converter 29 via the AND circuit 27, subjected to digital / analog conversion, and input to the sound system 9 in the subsequent stage. As a result, a predetermined musical sound is emitted.
【0021】 ポート7からのイニシャルクリア信号ICおよびイニシャルクリア解除信号I CKは、位相発生回路21、アドレス発生回路22、エンベロープジェネレータ 24、および累算器26に入力する。これらの各回路21,22,24,26は 、イニシャルクリア信号ICが「0」から「1」に立上がったとき、自己のイニ シャルクリアを実行する。また、イニシャルクリア解除信号ICKが「0」から 「1」に立上がると、それ以降は通常の動作を行なうようになっている。The initial clear signal IC and the initial clear cancel signal I CK from the port 7 are input to the phase generation circuit 21, the address generation circuit 22, the envelope generator 24, and the accumulator 26. Each of these circuits 21, 22, 24, and 26 executes its own initial clear when the initial clear signal IC rises from "0" to "1". When the initial clear cancellation signal ICK rises from "0" to "1", normal operation is performed thereafter.
【0022】 さらに、イニシャルクリア信号ICはインバータ28により反転されてAND 回路27に入力する。AND回路27には、もう1つの入力として累算器26か らの楽音波形データが入力している。したがって、イニシャルクリア信号ICが 「1」のときは、イニシャルクリアの処理が行なわれているとしてAND回路2 7が閉じられ、楽音波形データは後段のディジタル/アナログ変換器29に入力 しない。一方、イニシャルクリア信号ICが「0」のときは、イニシャルクリア の処理が終了したとしてAND回路27が開き、楽音波形データは後段のディジ タル/アナログ変換器29に入力するようになっている。これはイニシャルクリ アの処理時の誤動作を防止するためである。Further, the initial clear signal IC is inverted by the inverter 28 and input to the AND circuit 27. The AND circuit 27 receives the musical tone waveform data from the accumulator 26 as another input. Therefore, when the initial clear signal IC is "1", the AND circuit 27 is closed because the initial clear process is being performed, and the tone waveform data is not input to the digital / analog converter 29 in the subsequent stage. On the other hand, when the initial clear signal IC is "0", the AND circuit 27 is opened because the initial clear processing is completed, and the tone waveform data is input to the digital / analog converter 29 in the subsequent stage. This is to prevent malfunction during processing of the initial clear.
【0023】 次に、図3のフローチャートを参照して、図1および図2の電子楽器の電源投 入からの動作を説明する。この電子楽器で電源が投入されると、前述したように リセット信号RESET(図1)が生成されCPU13およびポート7に入力す る。CPU13は、これによりリセット(イニシャルクリア)される。ポート7 は入力したリセット信号RESETを保持し続ける。すなわちポート7は「1」 を保持し続ける。Next, the operation of the electronic musical instrument shown in FIGS. 1 and 2 after the power is turned on will be described with reference to the flowchart of FIG. When the electronic musical instrument is powered on, the reset signal RESET (FIG. 1) is generated and input to the CPU 13 and the port 7 as described above. The CPU 13 is reset (initial clear) by this. Port 7 continues to hold the input reset signal RESET. That is, port 7 keeps holding "1".
【0024】 このポート7からの信号「1」は、イニシャルクリア信号ICとして音源8に 入力する。また、ポート7からの信号「1」は、インバータ15で反転され「0 」となって、イニシャルクリア解除信号ICKとして音源8に入力する。図2の 音源8では、イニシャルクリア信号ICが「1」、イニシャルクリア解除信号I CKが「0」であるので、イニシャルクリアの実行すなわち各回路21,22, 24,26の初期設定などを開始する。The signal “1” from the port 7 is input to the sound source 8 as an initial clear signal IC. The signal "1" from the port 7 is inverted by the inverter 15 to become "0" and is input to the sound source 8 as the initial clear cancellation signal ICK. In the sound source 8 of FIG. 2, since the initial clear signal IC is “1” and the initial clear cancellation signal I CK is “0”, execution of initial clear, that is, initialization of each circuit 21, 22, 24, 26 is started. To do.
【0025】 このときイニシャルクリア信号ICは「1」であるので、インバータ28でこ れを反転した「0」がAND回路27に入力し、AND回路27は閉じられる。 したがって、楽音波形データがディジタル/アナログ変換器29に入力すること はなく、イニシャルクリアが適正に行なわれる前に誤動作(誤発音)することが 防止される。At this time, since the initial clear signal IC is “1”, “0” which is inverted by the inverter 28 is input to the AND circuit 27, and the AND circuit 27 is closed. Therefore, the musical tone waveform data is not input to the digital / analog converter 29, and malfunction (erroneous sound) is prevented before the initial clear is properly performed.
【0026】 CPU13はイニシャルクリア後、図3のフローチャートにしたがって処理を 進める。まず、音源8のRAM16やRAM14のレジスタの初期設定などを行 なう(ステップS1)。次に、CPU13は他の回路の初期設定を指示する(ス テップS2)。そして、タイマ11により電源オンからの時間を計測し所定時間 が経過するまで待つ(ステップS2)。この所定時間は、上述した音源8および 他の回路のイニシャルクリアが終了する程度の時間としておく。これにより、こ の所定時間経過後は音源8を含めて各部のイニシャルクリアが終了していること が保証される。After the initial clear, the CPU 13 advances the processing according to the flowchart of FIG. First, the RAM 16 of the sound source 8 and the registers of the RAM 14 are initialized (step S1). Next, the CPU 13 gives an instruction to initialize other circuits (step S2). Then, the timer 11 measures the time from power-on and waits until a predetermined time elapses (step S2). This predetermined time is set to such a time that the above-described initial clear of the sound source 8 and other circuits is completed. As a result, it is guaranteed that the initial clear of each unit including the sound source 8 is completed after the lapse of this predetermined time.
【0027】 次に、CPU13はポート7に「0」を出力する。ポート7は、以後「0」を 保持する。これにより、ポート7からイニシャルクリア信号ICとして「0」が 出力される。また、これを反転した「1」が、イニシャルクリア解除信号ICK として出力される。音源8では、イニシャルクリア信号ICが「0」、イニシャ ルクリア解除信号ICKが「1」となるので、以後は音源としての通常の動作が 実行されるようになる。Next, the CPU 13 outputs “0” to the port 7. Port 7 holds "0" thereafter. As a result, "0" is output from the port 7 as the initial clear signal IC. Further, the inverted "1" is output as the initial clear cancellation signal ICK. In the sound source 8, since the initial clear signal IC is "0" and the initial clear cancellation signal ICK is "1", the normal operation as the sound source will be performed thereafter.
【0028】 なお、このときイニシャルクリア信号ICは「0」であるので、インバータ2 8でこれを反転した「1」がAND回路27に入力し、AND回路27は開く。 したがって、楽音波形データがディジタル/アナログ変換器29に入力するよう になる。Since the initial clear signal IC is “0” at this time, “1” which is the inverted value of the inverter 28 is input to the AND circuit 27 and the AND circuit 27 is opened. Therefore, the musical tone waveform data is input to the digital / analog converter 29.
【0029】 次に、キーイベント処理でキーイベントを検出して楽音発生を行なう処理をし (ステップS5)、その他の処理(ステップS6)を行なって、ステップS5に 戻る。以後はステップS5、S6を繰返す。ステップS5、S6が繰返されてい るときは、イニシャルクリア信号ICが「0」、イニシャルクリア解除信号IC Kが「1」となっており、音源8は音源としての通常動作を行なう。 なお、上記の実施例では波形メモリ読出し方式の音源を有する電子楽器に本考 案を適用した例を説明したが、これに限ることはない。本考案は、CPUなどを 含む制御部と楽音形成を行なう音源部とを有する電子楽器であれば、どのような 方式のものにでも適用可能である。Next, in the key event process, a key event is detected to generate a musical tone (step S5), other processes (step S6) are performed, and the process returns to step S5. After that, steps S5 and S6 are repeated. When steps S5 and S6 are repeated, the initial clear signal IC is "0", the initial clear cancel signal ICK is "1", and the sound source 8 performs a normal operation as a sound source. It should be noted that although the above-described embodiment describes an example in which the present invention is applied to an electronic musical instrument having a sound source of a waveform memory reading system, the present invention is not limited to this. The present invention can be applied to any type of electronic musical instrument as long as it is an electronic musical instrument having a control unit including a CPU and the like and a sound source unit for forming a musical tone.
【0030】[0030]
以上説明したように、この考案によれば、イニシャルクリア解除信号を制御部 の制御のもとで発生させて楽音形成手段に入力するようにしているので、安定し たイニシャルクリアの動作が保証され、電源投入時やリセット時の動作およびそ の後の通常の動作が安定する。 As described above, according to the present invention, the initial clear cancellation signal is generated under the control of the control unit and input to the tone forming means, so that a stable initial clear operation is guaranteed. , Operation at power-on or reset and normal operation after that are stable.
【図1】 この考案の一実施例に係る電子楽器のブロッ
ク構成図FIG. 1 is a block diagram of an electronic musical instrument according to an embodiment of the present invention.
【図2】 実施例の電子楽器の音源の詳細なブロック構
成図FIG. 2 is a detailed block diagram of a sound source of the electronic musical instrument according to the embodiment.
【図3】 実施例の電子楽器のCPUの処理フローチャ
ート図FIG. 3 is a processing flowchart of the CPU of the electronic musical instrument of the embodiment.
【図4】 従来のイニシャルクリア信号生成回路図およ
び信号図FIG. 4 is a conventional initial clear signal generation circuit diagram and signal diagram.
1…制御部、2…スイッチ、3…スイッチイベント検
出回路、4…鍵盤、5…キーイベント検出回路、6…プ
ログラムメモリ(ROM)、7…ポート、8…音源、9
…サウンドシステム、11…タイマ、12…割込コント
ローラ、13…中央処理装置(CPU)、14,16…
RAM、15…インバータ、17…バスライン。1 ... Control unit, 2 ... Switch, 3 ... Switch event detection circuit, 4 ... Keyboard, 5 ... Key event detection circuit, 6 ... Program memory (ROM), 7 ... Port, 8 ... Sound source, 9
... sound system, 11 ... timer, 12 ... interrupt controller, 13 ... central processing unit (CPU), 14, 16 ...
RAM, 15 ... Inverter, 17 ... Bus line.
Claims (1)
ニシャルクリアを行ない、かつイニシャルクリア解除信
号を受けて自己の通常動作を可能にするとともに、通常
動作時は楽音の発音指示を受けて楽音を発生する楽音形
成手段と、 同じくイニシャルクリア信号を受けて自己のイニシャル
クリアを行なうとともに、前記楽音形成手段に発音指示
を与える制御手段とを備え、 前記制御手段は、イニシャルクリア信号を受けた時点か
ら所定時間の後にイニシャルクリア解除信号を前記楽音
形成手段に向けて送出することを特徴とする電子楽器。1. An initial clear signal is received to perform an initial clear of itself, and an initial clear release signal is received to enable a normal operation of the self. At the time of normal operation, a musical tone is generated in response to a musical tone generation instruction. And a control means for receiving the initial clear signal to perform its own initial clear, and for giving a sounding instruction to the musical sound forming means, the control means is provided with a predetermined timing from the time of receiving the initial clear signal. An electronic musical instrument characterized in that an initial clear cancellation signal is sent to the musical sound forming means after a lapse of time.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP113291U JPH0555197U (en) | 1991-12-28 | 1991-12-28 | Electronic musical instrument |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP113291U JPH0555197U (en) | 1991-12-28 | 1991-12-28 | Electronic musical instrument |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0555197U true JPH0555197U (en) | 1993-07-23 |
Family
ID=33524336
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP113291U Pending JPH0555197U (en) | 1991-12-28 | 1991-12-28 | Electronic musical instrument |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0555197U (en) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5872224A (en) * | 1981-10-27 | 1983-04-30 | Nec Home Electronics Ltd | Initial malfunction preventing circuit for microprocessor system |
| JPS62148997A (en) * | 1985-12-23 | 1987-07-02 | ヤマハ株式会社 | State information processing for key and operating element for electronic musical apparatus |
-
1991
- 1991-12-28 JP JP113291U patent/JPH0555197U/en active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5872224A (en) * | 1981-10-27 | 1983-04-30 | Nec Home Electronics Ltd | Initial malfunction preventing circuit for microprocessor system |
| JPS62148997A (en) * | 1985-12-23 | 1987-07-02 | ヤマハ株式会社 | State information processing for key and operating element for electronic musical apparatus |
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Legal Events
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