JPS58200284A - 画像表示メモリアクセス用アドレス発生装置 - Google Patents
画像表示メモリアクセス用アドレス発生装置Info
- Publication number
- JPS58200284A JPS58200284A JP57084249A JP8424982A JPS58200284A JP S58200284 A JPS58200284 A JP S58200284A JP 57084249 A JP57084249 A JP 57084249A JP 8424982 A JP8424982 A JP 8424982A JP S58200284 A JPS58200284 A JP S58200284A
- Authority
- JP
- Japan
- Prior art keywords
- image display
- display memory
- address
- display
- adder
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は画像表示メモリアクセス用アドレスの発生装置
に関するものである。
に関するものである。
従来の画像表示メモリアクセス用のアドレスは順次出力
されるので画像表示メモリは順番に１つづつアクセスさ
れて行くように構成されている。
されるので画像表示メモリは順番に１つづつアクセスさ
れて行くように構成されている。
第１図は画像表示メモリに９６文字分の容量な２〆−ジ
持つメモリを用い、表示装置に６×７文字表示できる表
示装置を用いた場合において、０３番地から画像表示メ
モリをアクセスした場合の画像表示メモリの内容（６）
と表示装置・表示（ロ）の対応状態を示している。この
図から明らかなようＫ、従来の画像メモリのアクセス方
法では、画像表示メモリと表示の対応がとれていない。
示装置を用いた場合において、０３番地から画像表示メ
モリをアクセスした場合の画像表示メモリの内容（６）
と表示装置・表示（ロ）の対応状態を示している。この
図から明らかなようＫ、従来の画像メモリのアクセス方
法では、画像表示メモリと表示の対応がとれていない。
たとえば画像表示メモリ０６番地には２というデータが
あり、その下には３というデータがあるが、表示ではＺ
の下にＫと表示されている。
あり、その下には３というデータがあるが、表示ではＺ
の下にＫと表示されている。
このように画像表示メモリと表示装置の表示とが非対応
であれば画面の表示形式を変更したすする場合に、十分
に注意しておかないと、予期していない場所に画像が表
示されたりすることになる。
であれば画面の表示形式を変更したすする場合に、十分
に注意しておかないと、予期していない場所に画像が表
示されたりすることになる。
またスクロール動作を考えた場合、たて方向にしかスク
ロールさせることができない欠点がある。
ロールさせることができない欠点がある。
たとえば第１図において、第２行目の第１番目の文字の
Ｆという表示を一行分たてにスクロールさ □
せて第一行目の第一文字目に表示することは画像表示メ
モリの内容を全く変更せずに、画像表示メ３ベージ モリのアクセスを開始するアドレスを０３番地から０ム
番地に変更するだけで実現することができる。しかし、
第２行目の第１番目の文字のＦという表示を、−文字分
横にスクロールさせて第２行目の第２番目の文字に表示
することは画像表示メモリの内容を変更しなければ実現
できない０本発明は上述した従来のように画像表示メモ
リと表示との対応がとれないことに起因する欠点を除去
することを目的としたものであり、以下にその実施例と
ともに説明する。
Ｆという表示を一行分たてにスクロールさ □
せて第一行目の第一文字目に表示することは画像表示メ
モリの内容を全く変更せずに、画像表示メ３ベージ モリのアクセスを開始するアドレスを０３番地から０ム
番地に変更するだけで実現することができる。しかし、
第２行目の第１番目の文字のＦという表示を、−文字分
横にスクロールさせて第２行目の第２番目の文字に表示
することは画像表示メモリの内容を変更しなければ実現
できない０本発明は上述した従来のように画像表示メモ
リと表示との対応がとれないことに起因する欠点を除去
することを目的としたものであり、以下にその実施例と
ともに説明する。
第２図は画像表示メモリアクセス用アドレス発生装置の
構成を示すものである。
構成を示すものである。
同図において、１は１行分の表示の終°了を知らせる表
示終了信号ａの入力にともなって保持動作を行なう保持
回路、２は設定された加算入力と、保持回路１の出力を
被加算入力とする加算器である０なお保持回路１と加算
器゛２とで計数回路６を構成している。３は表示終了信
号が加わると計数を開始する計数回路、４は計数回路６
，３の出力を加算し、画像表示メモリ６をアクセスする
アドレスを発生する加算器である。
示終了信号ａの入力にともなって保持動作を行なう保持
回路、２は設定された加算入力と、保持回路１の出力を
被加算入力とする加算器である０なお保持回路１と加算
器゛２とで計数回路６を構成している。３は表示終了信
号が加わると計数を開始する計数回路、４は計数回路６
，３の出力を加算し、画像表示メモリ６をアクセスする
アドレスを発生する加算器である。
次にこの実施例の動作を説明する。保持回路１は加算器
２の出力を１行分の表示の終了を知らせる表示終了信号
ａが入力されるたびに保持し、加算器２の被加数人力と
なる。たとえば加算器２の加数人力が３に固定され、保
持回路１がＯを出力していたとすれば、加算器２の出力
は３＋Ｏ＝３となる。次に表示終了信号ａが入力される
と、保持回路１は加算器２の出力３を保持するので加算
器２は３＋３＝６を出力する。つまり保持回路１と加算
器２は加算器２の加数人力に設定された値をステップと
する計数回路６を構成している。また計数回路３の出力
と計数回路６の出力は加算器４で加算され、画像表示メ
モリ６をアクセスするアドレスとなる。
２の出力を１行分の表示の終了を知らせる表示終了信号
ａが入力されるたびに保持し、加算器２の被加数人力と
なる。たとえば加算器２の加数人力が３に固定され、保
持回路１がＯを出力していたとすれば、加算器２の出力
は３＋Ｏ＝３となる。次に表示終了信号ａが入力される
と、保持回路１は加算器２の出力３を保持するので加算
器２は３＋３＝６を出力する。つまり保持回路１と加算
器２は加算器２の加数人力に設定された値をステップと
する計数回路６を構成している。また計数回路３の出力
と計数回路６の出力は加算器４で加算され、画像表示メ
モリ６をアクセスするアドレスとなる。
今、計数回路６のステップ数を１０とし、計数回路３は
表示終了信号ａが入力されると３がプリセットされるよ
うにしておけば、画像表示メモリをアクセスするアドレ
ス１ｄｏ３１０４１ ｏｔｓ ＋・・・・・・０９，１
３，１４．・・・・・・と変化する。このアト６ページ レスで第１図（イ）に示した画像表示メモリをアクセス
した場合の画像表示メモリと表示装置による表示の対応
を示したのが第３図（イ）、←）である。
表示終了信号ａが入力されると３がプリセットされるよ
うにしておけば、画像表示メモリをアクセスするアドレ
ス１ｄｏ３１０４１ ｏｔｓ ＋・・・・・・０９，１
３，１４．・・・・・・と変化する。このアト６ページ レスで第１図（イ）に示した画像表示メモリをアクセス
した場合の画像表示メモリと表示装置による表示の対応
を示したのが第３図（イ）、←）である。
上記実施例よシ明らかなように、本発明によれば画像表
示メモリの内容と表示装置による表示の対応がとれてい
るために、表示形式の変更の際に予期せ広場所に画像が
表示されたりすることがない上に、画像表示メモリのア
クセスを開始するアドレスを変更するだけで、たて、横
、斜めとすべての方向へスクロールさせることが容易に
実現できる効果が得られる。
示メモリの内容と表示装置による表示の対応がとれてい
るために、表示形式の変更の際に予期せ広場所に画像が
表示されたりすることがない上に、画像表示メモリのア
クセスを開始するアドレスを変更するだけで、たて、横
、斜めとすべての方向へスクロールさせることが容易に
実現できる効果が得られる。
第１図（イ）、（ロ）は従来の画像表示メモリの内容と
表示装置による表示画面を示す図、第２図は本発明の一
実施例による画像表示メモリアクセス用アドレス発生装
置のブロック図、第３図（イ）、（ロ）は画像表示メモ
リの内容と表示装置による表示画面を示す図である。 ３・・・・・・計数回路、４・・・・・・加算器、６・
・・・・・画像表示メモリ、７・・・・・・計数回路。 第１図 １イ） 第２図 ｎ Ｌ Ｊ第
３図 （イ） ５２５−
表示装置による表示画面を示す図、第２図は本発明の一
実施例による画像表示メモリアクセス用アドレス発生装
置のブロック図、第３図（イ）、（ロ）は画像表示メモ
リの内容と表示装置による表示画面を示す図である。 ３・・・・・・計数回路、４・・・・・・加算器、６・
・・・・・画像表示メモリ、７・・・・・・計数回路。 第１図 １イ） 第２図 ｎ Ｌ Ｊ第
３図 （イ） ５２５−
Claims (1)
- 所定の表示終了を知ら五る終了信号によシ計数が制御さ
れる第１．第２の計数回路およびこれらの２つの計数回
路の出力を加算し、画像表示メモリをアクセスするため
のアドレスを発生する加算器を設け、上記第１．第２の
計数回路の計数方式を設定することにより上記画像表示
メモリの°記憶番地と表示装置による表示位置とを対応
させたことを特徴とする画像表示メモリアクセス用アド
レス発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57084249A JPS58200284A (ja) | 1982-05-18 | 1982-05-18 | 画像表示メモリアクセス用アドレス発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57084249A JPS58200284A (ja) | 1982-05-18 | 1982-05-18 | 画像表示メモリアクセス用アドレス発生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58200284A true JPS58200284A (ja) | 1983-11-21 |
Family
ID=13825183
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57084249A Pending JPS58200284A (ja) | 1982-05-18 | 1982-05-18 | 画像表示メモリアクセス用アドレス発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58200284A (ja) |
-
1982
- 1982-05-18 JP JP57084249A patent/JPS58200284A/ja active Pending
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