JPS5973499A - 化合物半導体の成長方法 - Google Patents

化合物半導体の成長方法

Info

Publication number
JPS5973499A
JPS5973499A JP57179865A JP17986582A JPS5973499A JP S5973499 A JPS5973499 A JP S5973499A JP 57179865 A JP57179865 A JP 57179865A JP 17986582 A JP17986582 A JP 17986582A JP S5973499 A JPS5973499 A JP S5973499A
Authority
JP
Japan
Prior art keywords
grown
layer
semiconductor
gaas
group
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP57179865A
Other languages
English (en)
Other versions
JPS614799B2 (ja
Inventor
Masahiro Akiyama
秋山 正博
Yoshihiro Kawarada
河原田 美裕
Toshimasa Ishida
俊正 石田
Katsuzo Uenishi
上西 勝三
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
National Institute of Advanced Industrial Science and Technology AIST
Original Assignee
Agency of Industrial Science and Technology
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Agency of Industrial Science and Technology filed Critical Agency of Industrial Science and Technology
Priority to JP57179865A priority Critical patent/JPS5973499A/ja
Publication of JPS5973499A publication Critical patent/JPS5973499A/ja
Publication of JPS614799B2 publication Critical patent/JPS614799B2/ja
Granted legal-status Critical Current

Links

Classifications

    • CCHEMISTRY; METALLURGY
    • C30CRYSTAL GROWTH
    • C30BSINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B25/00Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
    • C30B25/02Epitaxial-layer growth
    • C30B25/18Epitaxial-layer growth characterised by the substrate
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/29Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by the substrates
    • H10P14/2901Materials
    • H10P14/2902Materials being Group IVA materials
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3202Materials thereof
    • H10P14/3214Materials thereof being Group IIIA-VA semiconductors
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/32Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials characterised by intermediate layers between substrates and deposited layers
    • H10P14/3202Materials thereof
    • H10P14/3214Materials thereof being Group IIIA-VA semiconductors
    • H10P14/3221Arsenides
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/34Deposited materials, e.g. layers
    • H10P14/3402Deposited materials, e.g. layers characterised by the chemical composition
    • H10P14/3414Deposited materials, e.g. layers characterised by the chemical composition being group IIIA-VIA materials
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10PGENERIC PROCESSES OR APPARATUS FOR THE MANUFACTURE OR TREATMENT OF DEVICES COVERED BY CLASS H10
    • H10P14/00Formation of materials, e.g. in the shape of layers or pillars
    • H10P14/20Formation of materials, e.g. in the shape of layers or pillars of semiconductor materials
    • H10P14/34Deposited materials, e.g. layers
    • H10P14/3402Deposited materials, e.g. layers characterised by the chemical composition
    • H10P14/3414Deposited materials, e.g. layers characterised by the chemical composition being group IIIA-VIA materials
    • H10P14/3421Arsenides

Landscapes

  • Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • General Chemical & Material Sciences (AREA)
  • Engineering & Computer Science (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Materials Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Crystals, And After-Treatments Of Crystals (AREA)
  • Recrystallisation Techniques (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、 Si、Geなどの■族半導体上に■−V
族半導体を成長させる化合物半導体の成長方法に関する
ものである。
従来、 Si、Geなどのダイヤモンド型結晶の上に閃
亜鉛鉱形結晶であるGaP、GaAsなどの■−■族半
導体をエピタキシャル成長させる場合、Si  とGa
P 、 GeとGaAsは格子定数が近く、これらの組
み合わせでは容易に成長させることができる。
しかしながら、たとえばGe  上にGaAsを成長さ
せる場合は、 Ge上の一つの原子層に、まずGaが結
合した場所とAsが結合した場所ができ、以後これを核
としてGaAsが成長するため、エピタキシャル成長は
するものの5成長した層は完全な単結晶ではなく、Ge
の成長させた面と同一の配向性をもつ多結晶となる。た
とえばGeの100面にGaAs を成長させると、成
長条件によっても異なるが、100μR程度の互いに直
交した細かいドメインに分れ、そのドレインは互いに直
交した100面をもっている。このような成長膜は各ド
メインの境界に多くのトラップを含み、このために電子
の移動度は小さく、素子をこの化合物半導体曹、V長層
に製作しても化合物の特徴を生かした高味トの素子を得
ることはできない。また、このよi’) rx成長層の
表面の平担性は一般に悪く5細かいパターンを製作する
には適していない。
この発明は上記の点に鑑みなされたもので、Ge。
Siなどの■族半導体上に完全に単結晶となった良質の
I−V族半導体を成長させることができる化金物半導体
の成長方法を提供することを目的とする。
以下この発明の実施例を図面を参照して説明する。実施
例は■族半導体として100面のGe1目的とするIl
[−V族半導体としてGaAsを用いる場合である。図
面において、1はGe単結晶基板、2はGaAs 2 
aとGaAsに近い格子定数のAlGaAs 2bとを
前記基板1上に数百Aつつ交互に複数層成長させてなる
中間層、3はその上に成長させたGaAs層である。
これより明らかなように、実施例では、成長を目的とす
るGaAsと、このGaAsと格子定数の近い他のI−
V族半導体AlGaAsとを交互に成長させた中間層2
をまずGe単結晶基板1上に成長させ、しかる後この中
間層2上に目的とするGaAs層3を成長させる。この
場合、中間層2の膜厚が鮭距A以上であれば、GaAs
層3を大面積にわた朋゛て単結晶とすることができる。
実例として5500’Jk fp GaAs 2 aと
600XのAlo、zGao、5Asfi 2 bとr
交互に成長をくり返して中間層2全体の厚さを約500
0A  した場合、l−以上の面積にわたって平担な表
面の完全な単結晶を得た。
一方、この中間層2としてGaAs 2 aとAlGa
As2bを交互に成長させず、単にAlo、zGao、
sAs Nのみを約5oooX成長させた場合には、 
Ge上にGaAs を直接成長させた場合と比較すると
多結晶のドレインが幾分大きくなるが、前記のような大
面積にわたって単結晶化はおこらない。
なお、中間層2として使用する交互に成長させた2種類
のi[−V族半導体(化合物半導体)の各層の厚みは必
ずしも同一である必要はなく 、 ioo。
λ程度以下(中間層2が厚くなってもかまわない場合は
100OA  以上でもよい)の厚みの適当な組み合わ
せでもかまわない。このように成長を目的としたI−V
族半導体を含む2種類の■−V族半導体を交互に成長さ
せた中間層を導入したことにより、その上に方向の揃っ
た単結晶のI−V族半導体の成長が得られる理由は不明
であるが、中間層を形成する2種類のI−v族半導体の
各層が1つの層から他の層へかわるたびに、初期の多結
晶の+9優性なドメインが他の劣性なドメインを駆逐し
ていくものと思う。
なお、上記実施例はGe上にGaAsを成長させる場合
を説明しだが、その他の場合にもこの発明を適用できる
、たとえばSi上にGaPを成長させる場合であシ、そ
の場合はGaPとQaAlP  を交互に成長させてな
る中間層をSi上に成長させた後、その中間層上にGa
Pを成長させればよい。
以上詳述したようにこの発明の化合物半導体の成長方法
は、成長を目的とするI−V族半導体と5このIII−
V族半導体と格子定数の近い他の■−■族半導体を交互
に成長させた中間層を基板の■族半導体上に成長させた
後、この中間層上に目的とするl−V族半導体を成長さ
せるようにしたので、IV族半導捧上に完全に単結晶と
なった良質の■−V族半導体を成長させることができる
。したがって、化合物半導体の素子を製作するのに対し
て基板として■族半導体を使用することができるように
なる。
【図面の簡単な説明】
図面はこの発明の化合物半導体の成長方法の実施例を示
す断面図である。 l・・・Ge単結晶基板、2・・・中間層、2a・・G
aAs 。 b ”’ AlGaAs 、  3 ”’ GaAs 
m特許出願人  工業技術院長 手 続 補 正 書(自発) 昭和イp年♂月73日 特許庁長官殿 1、事件の聚示 昭和57年特許願第179865号 2、発明の名称 化合物半導体の成長方法 3、補正をする者 4、補正の対象 明細書全文及び図面 明細書(全文訂正) ■1発明の名称 化合物半導体の成長方法 2、特許請求の範囲 ■族半導体を基板として、その士に中間層を成長させ、
その中間層上に目的とする■−V族半導体を成長させる
化合物半導体の成長方法において、前記中間層として、
目的とする前記■−■族半導体、格子定数がそのI”V
族半導体に近似した他の3元以上の■−■族半導体の順
に、少くとも各層を1層ずつ交互に成長させることを特
徴とした化合物半導体の成長方法。 3、発明の詳細な説明 (技術分野) この発明は、St、Geなどの■族半導体上に■−■族
半導体を成長させる化合物半導体の成長方法に関するも
のである。 (従来技術) 従来、S’ r Geなとのダイヤモンド型結晶の上に
閃亜鉛鉱形結晶であるGaP 、 GaAsなどの■−
■族半導体をエピタキシャル成長させる場合、StとG
aP。 GeとGaAsは格子定数が近く、これらの組み合わせ
ドは容易に成長させることができる。 しかしながら、たとえば(100)面または(110)
lOGe上にGaAgを成長させる場合は、Ge上の一
つの原子層に、まずGaが結合した場所とAsが結合し
た場所ができ、以後これを核としてGaAsが成長する
ため、エピタキシャル成長はするものの、成長した層は
完全な単結晶ではなく、Geの成長させた面と同一の配
向性をもつ多結晶となる。たとえばGeの(100)面
にGaAsを成長させると、成長条件によっても異なる
が、100μm2程度の互いに直交した細かいドメイン
に分れ、そのドメインは互いに直交した100面をもっ
ている。このような成長膜は各ドメインの境界に多くの
トラップを含み、このために電子の移動度は小さく、素
子をこの化合物半導体の成長層に製作しても化合物の特
徴を生かした高性能の素子を得ることはできない。また
、このような成長層の表面の平坦性は一般に悪く、細か
いパターンを製作するのには適していない。 (発明の目的) この発明は上記の点に鑑みなされたもので、Ge。 Siなどの■族半導体上に完全に単結晶となった良質の
■−V族半導体を成長させることができる化合物半導体
の成長方法を提供することを目的とする。 (実施例) 以下、この発明の第1の実施例を第1図を参照して説明
する。実施例は■族半導体として(100)トのGe、
目的とするIII−V族半導体としてGaAsを用いる
場合である。図面において、1はGe単結晶基板、2は
GaAs 2aとGaAsに近い格子定数のAノGaA
s2bとを前記基板1上にGaAs 、 GaAj!A
sの順に数百久ずつ交互に複数層成長させてなる中間層
、3はその上に成長させたGaAs層である。 これより明らかなように、実施例では、成長を目的とす
るGaAsと、とのGaAsと格子定数の近い他の■−
■族半導体A/、GaAsとを交互に成長させた中間層
2をまずGe単結晶基板1上に成長させ、しかる後この
中間層2土に目的とするGaAs層3を成長させる。こ
うすることにより、GaAs層3を大面積にわたって単
結晶とすることができる。実例として、500XのGa
As 2.aと600XのAノo、2G a o、a 
A 8層2bとを交互に成長をくり返して中間層2全体
の厚さを約5000Xした場合、1crn2以上の面積
にわたって平坦な表面の完全な単結晶を得た。 一方、この中間層2としてGaAa 2 aとAノGa
As 2bを交互に成長させず、単にAノ。、2GIL
 o、B AB層のみを約5000久成長させた場合に
は、Ge上K GILAllを直接成長させた場合と比
較すると多結晶のドメインが幾分大きくなるが、前記の
ような大面積にわたつ、tC単結晶化はおこらない。 第2の実施例として中間層を構成するGaAs層とCa
AJAa層を各1層とした時の例を第2図に示す。 この場合はGe基板1′上にGaAs層2a’ 、 G
aAfAs層2b’をこの順に成長させて中間層2′を
構成し、その上に目的とするGaAs層3′を成長させ
る。この場合にも第1の実施例と同様に単一のドメイン
のGaAs成長層が得られた。この場合、Ge基板1′
上にまず成長させるGaAs層2a′の膜厚は100〜
300久で実験を行ったが有意差はなかった。しかしな
がらこの膜厚が数千X以上になると表面のGaAs層3
′は単一のドメインにならなかった。またGa A1A
s層2b’の膜厚は数10Xから3000Xの範囲で実
験を行ったが有意差はな(、GaAj!As層2b′の
膜厚は単一のドメインになるためには直接関係しない。 またGaA)A8層のMの量にもあまり関係しない。 しかしながら、GaA1As層2b’を完全なりA8で
置きかえた場合には単一のドメインの成長層は得られな
い。 第1の実施例および第2の実施例からGe(100)基
板上に単一のドメインのGaAs層を成長させるために
は、基板上にまず数百X以下のGaAsを成長させ、そ
の上にGaAノAsとGaAsを交互に成長させた中間
層!介してやればよい。この場合、GaMAs層の厚さ
1W任意である。また実施例2で述べたように中間をそ
の土に成長させることができるが、多層に交互に成長さ
せた中間層の方が表面の平坦性のよいGaAs成長層を
得やすい。さらに成長温度はGaAs層、G’a AA
A s層を各1層で構成した中間層の場合にも、多層で
構成した場合にも比較的高い成長温度の方が単一のドメ
インになりやすい。既述の実施例はGa (CN3 )
 3 +んg(CN3)3 + ABHsを用いる気相
成長(MO−CVD法)で行ったが、この場合には70
0℃前後のGaAS(100)面の成長としては比較的
高温の成長温度で良好な結果が得られた。さらに高温に
すると成長させたGaAs表面にピットが多くなシ、逆
に600℃程度の低温で成長させると、実施例で述べた
中間層を導入しても単一のドメインのGaAg成長層は
得られなかった。 こうして得たGe上の単一のドメインとなったGaAs
成長層は同時に成長したGaAs基板上の成長層と電気
的特性を比較した結果、Geのウェファからのオートド
ーピングにより電子濃度は基板によらず1016cn3
前後となり、室温の移動度についても5.000〜6,
000crI?/i、s、と、同等の特性を示した。 版の値は中間層の層数によらなかった。単一のドメイン
になっていない場合には、電子濃度は単−堵メインにな
った時と同等であるが、移動度は同寸にGaAs上に成
長させたGaAs層と比較して2/3以−〇低い値を示
す。 以上説明したように成長を目的とする■−V族半導体の
薄膜と、三元以上の■−■族半導体薄膜を、基′板から
この順に少くともそれぞれの薄膜を1層以上成長させた
中間層を介しすることによシ格子定数の近い■族半導体
上に単一のドメインの高品質■−■族半導体が成長させ
ることができるが、その理由は不明である。しかし二元
の結晶から三元以上の結晶に移る時に結晶構成上自由度
があること、組成が変化している時に基板と完全に格子
整合する点があり得ること等も関係して、初期の多結晶
のよシ優性なドメインが他の劣性なドメインを駆逐して
いくものと思う。 なお、上記実施例はGa上にGaAsを成長させる場合
を説明したが、その他の場合にもこの発明を適用できる
。たとえばSt上にGaPを成長させる場合であり、そ
の場合はGaPとGaAJPを基板からGa P rQ
aAj!Pの順に少くともそれぞれの層を1層以上交互
に成長させてなる中間層をSt上に成長させた後、(発
明の効果) 以上詳述したように、この発明の化合物半導体菟成長方
法は、成長を目的とする■−■族半導体とtの■−■族
半導体と格子定数の近い他の三元以上−〇■−■族半導
体を目的とする■−V族半導体と三元″以上のm−■族
半導体の順に少くともそれぞれの薄膜を1層以上交互に
成長させた中間層を基板の■族滲導体上に成長させた後
、との中間層上に目的とする■−■族半導体を成長させ
るようにしたので、■族半導体上に完全に単結晶となっ
た良質の■−v族半導体を成長させることができる。し
たがって、化合物半導体の素子を製作するのに対して基
板として■族半導体を使用することができるようになる
。 4、図面の簡単な説明 第1図および第2図はこの発明の化合物半導体の成長方
法の実施例を示す断面図である。 1 、1’ ・−Ga単結晶基板、2 、2’−・・中
°間層、2g、2a’−GaAs、2 b 、 2 b
’ ・・−Aj!GaAs、3.3′・・・GaAs層

Claims (1)

    【特許請求の範囲】
  1. ■族半導体上に■−■族半導体を成長させる場合に、成
    長を目的とするI−V族半導体と、この1−V族半導体
    と格子定数の近い他のI−V族半導体を交互に成長させ
    た中間層をまず基板のfV族半導体上に成長させ、しか
    る後この中間層上に自溶とする■−■族半導体を成長さ
    せることを特徴止する化合物半導体の成長方法。
JP57179865A 1982-10-15 1982-10-15 化合物半導体の成長方法 Granted JPS5973499A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57179865A JPS5973499A (ja) 1982-10-15 1982-10-15 化合物半導体の成長方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP57179865A JPS5973499A (ja) 1982-10-15 1982-10-15 化合物半導体の成長方法

Publications (2)

Publication Number Publication Date
JPS5973499A true JPS5973499A (ja) 1984-04-25
JPS614799B2 JPS614799B2 (ja) 1986-02-13

Family

ID=16073258

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57179865A Granted JPS5973499A (ja) 1982-10-15 1982-10-15 化合物半導体の成長方法

Country Status (1)

Country Link
JP (1) JPS5973499A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4561916A (en) * 1983-07-01 1985-12-31 Agency Of Industrial Science And Technology Method of growth of compound semiconductor
US4963508A (en) * 1985-09-03 1990-10-16 Daido Tokushuko Kabushiki Kaisha Method of making an epitaxial gallium arsenide semiconductor wafer using a strained layer superlattice
JP2020038890A (ja) * 2018-09-03 2020-03-12 国立大学法人 筑波大学 半導体装置とその製造方法および光電変換装置

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4561916A (en) * 1983-07-01 1985-12-31 Agency Of Industrial Science And Technology Method of growth of compound semiconductor
US4963508A (en) * 1985-09-03 1990-10-16 Daido Tokushuko Kabushiki Kaisha Method of making an epitaxial gallium arsenide semiconductor wafer using a strained layer superlattice
JP2020038890A (ja) * 2018-09-03 2020-03-12 国立大学法人 筑波大学 半導体装置とその製造方法および光電変換装置

Also Published As

Publication number Publication date
JPS614799B2 (ja) 1986-02-13

Similar Documents

Publication Publication Date Title
US6515335B1 (en) Method for fabrication of relaxed SiGe buffer layers on silicon-on-insulators and structures containing the same
US6469357B1 (en) Article comprising an oxide layer on a GaAs or GaN-based semiconductor body
EP0475378A1 (de) Verfahren zur Herstellung von Substraten für elektronische, elektrooptische und optische Bauelemente
JPS5983997A (ja) エピタキシヤル多成分材料を含むヘテロ構造の形成方法
JPH11162850A (ja) 炭化珪素基板およびその製造方法、並びに炭化珪素基板を用いた半導体素子
EP0177903A2 (en) Semiconductor device having a gallium arsenide crystal layer grown on a silicon substrate and method for producing it
JPS5946414B2 (ja) 化合物半導体装置
JPH04315419A (ja) 元素半導体基板上の絶縁膜/化合物半導体積層構造
US5364468A (en) Method for the growth of epitaxial metal-insulator-metal-semiconductor structures
US5529640A (en) Epitaxial metal-insulator-metal-semiconductor structures
JPS5973499A (ja) 化合物半導体の成長方法
JPS6362313A (ja) 半導体装置の製造方法
JPS61189621A (ja) 化合物半導体装置
JPS61189620A (ja) 化合物半導体装置
JP2747823B2 (ja) ガリウムヒ素層の製造方法及びガリウムヒ素・アルミニウムガリウムヒ素積層体の製造方法
JP3985288B2 (ja) 半導体結晶成長方法
JPS61189619A (ja) 化合物半導体装置
JPS6232609B2 (ja)
JP2771635B2 (ja) Ca▲下1▼―▲下x▼Sr▲下x▼F▲下2▼膜の形成方法
JP3485601B2 (ja) 超電導複合薄膜の製造方法
JPS62219614A (ja) 化合物半導体の成長方法
JPH0234600A (ja) 結晶薄膜多層構造とその製作方法
JPH0543109Y2 (ja)
JPS62158313A (ja) 半導体積層体
JPH01162324A (ja) 半導体装置及びその製造方法