JPS6122342U - 半導体装置 - Google Patents
半導体装置Info
- Publication number
- JPS6122342U JPS6122342U JP1984106293U JP10629384U JPS6122342U JP S6122342 U JPS6122342 U JP S6122342U JP 1984106293 U JP1984106293 U JP 1984106293U JP 10629384 U JP10629384 U JP 10629384U JP S6122342 U JPS6122342 U JP S6122342U
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor equipment
- chip
- semiconductor
- chip mounting
- fixed
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
- H10W90/736—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked lead frame, conducting package substrate or heat sink
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/756—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink
Landscapes
- Die Bonding (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【図面の簡単な説明】
第1図とリードフレームに半導体チップが実装された状
態を示す断面図、第2図a, bは、本考案の一実施例
に用いるリードフレーム平面図と断面図である。 1・・・・・・リードフレーム本体、11・・・・・・
外部引出し用のリード、12・・・・・・チップ搭載部
、13・・・・・・凹部、14・・・・・・半導体チッ
プ、15・・・・・・樹脂。
態を示す断面図、第2図a, bは、本考案の一実施例
に用いるリードフレーム平面図と断面図である。 1・・・・・・リードフレーム本体、11・・・・・・
外部引出し用のリード、12・・・・・・チップ搭載部
、13・・・・・・凹部、14・・・・・・半導体チッ
プ、15・・・・・・樹脂。
Claims (1)
- リードフレームの一部をチップ搭載部に半導体チップが
固着され、少なくともこの半導体チップおよび前記チッ
プ搭載部に樹脂封止が施こされた半導体装置において、
前記チップ搭載部の一表面に凹部を有し、その凹部内に
前記半導体チップが固着されていることを特徴とする半
導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1984106293U JPS6122342U (ja) | 1984-07-12 | 1984-07-12 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1984106293U JPS6122342U (ja) | 1984-07-12 | 1984-07-12 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6122342U true JPS6122342U (ja) | 1986-02-08 |
Family
ID=30665586
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1984106293U Pending JPS6122342U (ja) | 1984-07-12 | 1984-07-12 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6122342U (ja) |
-
1984
- 1984-07-12 JP JP1984106293U patent/JPS6122342U/ja active Pending
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