JPS6211185B2 - - Google Patents
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- JPS6211185B2 JPS6211185B2 JP52086773A JP8677377A JPS6211185B2 JP S6211185 B2 JPS6211185 B2 JP S6211185B2 JP 52086773 A JP52086773 A JP 52086773A JP 8677377 A JP8677377 A JP 8677377A JP S6211185 B2 JPS6211185 B2 JP S6211185B2
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- turned
- pair
- spark
- switch mechanisms
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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Classifications
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02P—IGNITION, OTHER THAN COMPRESSION IGNITION, FOR INTERNAL-COMBUSTION ENGINES; TESTING OF IGNITION TIMING IN COMPRESSION-IGNITION ENGINES
- F02P15/00—Electric spark ignition having characteristics not provided for in, or of interest apart from, groups F02P1/00 - F02P13/00 and combined with layout of ignition circuits
- F02P15/10—Electric spark ignition having characteristics not provided for in, or of interest apart from, groups F02P1/00 - F02P13/00 and combined with layout of ignition circuits having continuous electric sparks
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02P—IGNITION, OTHER THAN COMPRESSION IGNITION, FOR INTERNAL-COMBUSTION ENGINES; TESTING OF IGNITION TIMING IN COMPRESSION-IGNITION ENGINES
- F02P7/00—Arrangements of distributors, circuit-makers or -breakers, e.g. of distributor and circuit-breaker combinations or pick-up devices
- F02P7/02—Arrangements of distributors, circuit-makers or -breakers, e.g. of distributor and circuit-breaker combinations or pick-up devices of distributors
Landscapes
- Engineering & Computer Science (AREA)
- Chemical & Material Sciences (AREA)
- Combustion & Propulsion (AREA)
- Mechanical Engineering (AREA)
- General Engineering & Computer Science (AREA)
- Ignition Installations For Internal Combustion Engines (AREA)
Description
【発明の詳細な説明】
本発明は内燃機関に用いるスパーク点火装置に
関する。
関する。
元来内燃機関は、アイドリング時など低速運転
時における正規点火後スパーク持続時間相当のク
ランク軸回転角度が極めて小さく、低速運転時の
燃焼性が悪いことが知られているが、この問題を
解決する一方法としてスパーク時間を延長するこ
とが知られている。たとえば昭和47年特許出願公
告第856号に、一方のトランスによるスパークが
終了しないうちに他方のトランスによるスパーク
を開始する構成が提案されている。この場合、そ
れぞれのトランスの一次巻線がオンされる瞬間は
同時であるが、オフされる瞬間が異なるためそれ
ぞれのトランスに於ける電流パルスの持続時間が
異なることから、電流パルスによりトランスの巻
線が加熱され、これによる熱損失の差異が生じ長
時間通電している方のトランスの総熱損失が必要
以上に大きくなるという欠点がある。このこと
は、２つのトランス間の温度差を大きくし、ひい
ては点火動作を困難にする。
時における正規点火後スパーク持続時間相当のク
ランク軸回転角度が極めて小さく、低速運転時の
燃焼性が悪いことが知られているが、この問題を
解決する一方法としてスパーク時間を延長するこ
とが知られている。たとえば昭和47年特許出願公
告第856号に、一方のトランスによるスパークが
終了しないうちに他方のトランスによるスパーク
を開始する構成が提案されている。この場合、そ
れぞれのトランスの一次巻線がオンされる瞬間は
同時であるが、オフされる瞬間が異なるためそれ
ぞれのトランスに於ける電流パルスの持続時間が
異なることから、電流パルスによりトランスの巻
線が加熱され、これによる熱損失の差異が生じ長
時間通電している方のトランスの総熱損失が必要
以上に大きくなるという欠点がある。このこと
は、２つのトランス間の温度差を大きくし、ひい
ては点火動作を困難にする。
また、２次巻線が直列に接続されており、電流
が流れている状態であるため、該２次巻線の総イ
ンダクタンスはそれぞれのトランスの２次巻線の
インダクタンスの２倍となる。従つて、それぞれ
のスイツチがオフした時の電流の１次側からの変
換率は減少し、点火ミスの原因となる点火電圧の
低下をひき起す。さらに、直列接続の場合、スパ
ークを発生する毎に各１次巻線、２次巻線で熱損
失が発生するので、結果としてエネルギー損失が
はなはだしく多くなる。
が流れている状態であるため、該２次巻線の総イ
ンダクタンスはそれぞれのトランスの２次巻線の
インダクタンスの２倍となる。従つて、それぞれ
のスイツチがオフした時の電流の１次側からの変
換率は減少し、点火ミスの原因となる点火電圧の
低下をひき起す。さらに、直列接続の場合、スパ
ークを発生する毎に各１次巻線、２次巻線で熱損
失が発生するので、結果としてエネルギー損失が
はなはだしく多くなる。
本発明の目的は内燃機関の燃焼を完全にし排気
ガス中の未燃焼有害ガス成分をなくすことであ
り、前記した点火コイル（トランス）の総熱損失
をおされ、２つのトランス間の温度差を生じない
ようにすることであり、さらなる目的は総インダ
クタンスの低い内燃機関のスパーク点火装置を提
供することにある。
ガス中の未燃焼有害ガス成分をなくすことであ
り、前記した点火コイル（トランス）の総熱損失
をおされ、２つのトランス間の温度差を生じない
ようにすることであり、さらなる目的は総インダ
クタンスの低い内燃機関のスパーク点火装置を提
供することにある。
本発明の点火装置はその構造が一対のインダク
タンス・コイル（以下単にコイルと称す）と、電
流が遮断されると該各コイルに蓄えられた電気エ
ネルギーを点火回路に伝達する手段と、それぞれ
該コイルと関係しかつ電流を制御する一対の半導
体スイツチ機構と、該スイツチ機構の制御回路と
からなり、該制御回路は通常スパークの場合には
該スイツチ機構の一方をオンし、後にオフさせる
のに対し、長いスパーク時間を必要となる場合は
両者のスイツチ機構がオンした後、点火している
間は交互にオン・オフを繰り返すごとくなしたこ
とを特徴とするものである。
タンス・コイル（以下単にコイルと称す）と、電
流が遮断されると該各コイルに蓄えられた電気エ
ネルギーを点火回路に伝達する手段と、それぞれ
該コイルと関係しかつ電流を制御する一対の半導
体スイツチ機構と、該スイツチ機構の制御回路と
からなり、該制御回路は通常スパークの場合には
該スイツチ機構の一方をオンし、後にオフさせる
のに対し、長いスパーク時間を必要となる場合は
両者のスイツチ機構がオンした後、点火している
間は交互にオン・オフを繰り返すごとくなしたこ
とを特徴とするものである。
制御回路は長いスパーク時間の場合は該スイツ
チ機構の両者に初めのオンの時期に遅延を起こさ
せ、そして一方の該スイツチ機構がスパーク時期
が開始するときのオフの後再びオンすると、他方
のスイツチ機構がオフするように構成されてい
る。該遅延の長さはスイツチ機構の前者が最初に
オフしその後オンする長さ（持続時間）と同じと
する。
チ機構の両者に初めのオンの時期に遅延を起こさ
せ、そして一方の該スイツチ機構がスパーク時期
が開始するときのオフの後再びオンすると、他方
のスイツチ機構がオフするように構成されてい
る。該遅延の長さはスイツチ機構の前者が最初に
オフしその後オンする長さ（持続時間）と同じと
する。
また、前記電気エネルギーを点火回路に伝達す
る手段において、点火回路にダイオードによつて
接続された一対の昇圧トランスを有することを特
徴とする。
る手段において、点火回路にダイオードによつて
接続された一対の昇圧トランスを有することを特
徴とする。
本発明の実施例を図面に従つて以下に詳述す
る。
る。
本発明は一次巻線１０ａ，１１ａを有しそれぞ
れ供給レールに及び一対の第１トランジスタであ
るNPN電力トランジスタ１３，１４を接続され
た２個の点火用トランス１０，１１を具備してい
る。該トランジスタ１３，１４のエミツタは接地
され、ベースはそれぞれ抵抗１５，１６を介して
接地されており、また、抵抗１７，１８を介して
トランジスタを制御する信号発生回路１９の出力
端子Ｘ，Ｙに接続される。
れ供給レールに及び一対の第１トランジスタであ
るNPN電力トランジスタ１３，１４を接続され
た２個の点火用トランス１０，１１を具備してい
る。該トランジスタ１３，１４のエミツタは接地
され、ベースはそれぞれ抵抗１５，１６を介して
接地されており、また、抵抗１７，１８を介して
トランジスタを制御する信号発生回路１９の出力
端子Ｘ，Ｙに接続される。
さらに２個の第１トランジスタであるNPNト
ランジスタ２０，２１のベース回路１９の端子
X′，Y′に抵抗２２，２３を介して接続されてい
る。それぞれのコレクタはトランジスタ１３，１
４のベースに接続され、エミツタは接地されてい
る。トランジスタ２０，２１のベースは抵抗２
４，２５を介して接地されている。
ランジスタ２０，２１のベース回路１９の端子
X′，Y′に抵抗２２，２３を介して接続されてい
る。それぞれのコレクタはトランジスタ１３，１
４のベースに接続され、エミツタは接地されてい
る。トランジスタ２０，２１のベースは抵抗２
４，２５を介して接地されている。
信号発生回路は演算回路２６でもつて制御さ
れ、該演算回路はエンジン速度、エンジン、クラ
ンク角、スロツトル角、マニフオールド低下、温
度等に感応する変換器の如き複数個のエンジン・
パラメータ変換器からの制御入力部を有してい
る。
れ、該演算回路はエンジン速度、エンジン、クラ
ンク角、スロツトル角、マニフオールド低下、温
度等に感応する変換器の如き複数個のエンジン・
パラメータ変換器からの制御入力部を有してい
る。
該演算回路はスパークを発生させる瞬時を決定
したり、巻線１０ａ，１１ａに流れる電流をいつ
生ぜしめるか、またあるエンジン状態においては
いつスパーク時間を拡げるかを表わす信号を供給
するものである。
したり、巻線１０ａ，１１ａに流れる電流をいつ
生ぜしめるか、またあるエンジン状態においては
いつスパーク時間を拡げるかを表わす信号を供給
するものである。
正常運転の際は、前記トランス１０及びトラン
ジスタ１３のみが使われる。この運転ではトラン
ジスタ１３は回路１９の端子Ｘでの各パルスの開
始時期と終了時期にそれだけオン・オフに切換え
られる。これを第３ａ図に示す。
ジスタ１３のみが使われる。この運転ではトラン
ジスタ１３は回路１９の端子Ｘでの各パルスの開
始時期と終了時期にそれだけオン・オフに切換え
られる。これを第３ａ図に示す。
一方、長いスパーク時間の場合には、両トラン
ジスタ１３及び１４はオンし（但し、トランジス
タ１４のスイツチングをやや遅らす）、トランス
に電気エネルギーを与えることが可能となる。
ジスタ１３及び１４はオンし（但し、トランジス
タ１４のスイツチングをやや遅らす）、トランス
に電気エネルギーを与えることが可能となる。
スパークを生じさせる時期において、回路１９
内にあるパルス発生器がトランジスタ２０をオン
し、トランジスタ１３をオフさせる。このオン・
オフ間の長さでトランジスタ１３及び１４間の最
初のオンの遅延を行う。そして、しばらくした後
トランジスタ２０は再びオフするがトランジスタ
２１はオンする。端子X′、Y′のパルスによりト
ランジスタ２０，２１のオン・オフを行わせるの
は端子Ｘ、Ｙにおける信号が終了するまで続く。
内にあるパルス発生器がトランジスタ２０をオン
し、トランジスタ１３をオフさせる。このオン・
オフ間の長さでトランジスタ１３及び１４間の最
初のオンの遅延を行う。そして、しばらくした後
トランジスタ２０は再びオフするがトランジスタ
２１はオンする。端子X′、Y′のパルスによりト
ランジスタ２０，２１のオン・オフを行わせるの
は端子Ｘ、Ｙにおける信号が終了するまで続く。
信号発生回路１９の詳細を第２図に示す。該回
路にはCON及びEXTで表示される演算回路から
導かれる二個の入力部が設けてある。第３ａ図及
び第３ｂ図に示すようにCON端子の信号は通常
は低レベルであるが、コイル電流が流れると高く
なり、スパーク時には低レベルに復旧する。
EXT端子での信号は通常は低く、長いスパーク
時間の場合にはCON端子の信号が高レベルとな
つたのち、または長いスパーク時間の最終に再び
低レベルとなつたのち直ちに高レベルとなる。
路にはCON及びEXTで表示される演算回路から
導かれる二個の入力部が設けてある。第３ａ図及
び第３ｂ図に示すようにCON端子の信号は通常
は低レベルであるが、コイル電流が流れると高く
なり、スパーク時には低レベルに復旧する。
EXT端子での信号は通常は低く、長いスパーク
時間の場合にはCON端子の信号が高レベルとな
つたのち、または長いスパーク時間の最終に再び
低レベルとなつたのち直ちに高レベルとなる。
回路１９の出力ＸはORゲート３１（例えば1/4
RCA CD 4071B COMS 集積回路）から出る。
該ゲート３１はCON及びEXT端子にそれぞれ接
続された２個の入力端子を有しかつＸ端子に接続
される出力端子を有している。
RCA CD 4071B COMS 集積回路）から出る。
該ゲート３１はCON及びEXT端子にそれぞれ接
続された２個の入力端子を有しかつＸ端子に接続
される出力端子を有している。
出力ＹはEXT入力端子から約300μＳのパルス
巾をもつ単安定回路３２（CD 4047A）とフリツ
プフロツプ３３（1/2CD 4027B）を介して出力
される。単安定回路３２は端子EXTに接続の入
力（ピン８）と、抵抗３４及びコンデンサ３５で
相互に接続のタイミングピン（１，２，３）と、
フリツプ・フロツプ３３のCLOCK端子に接続の
出力Ｑ（ピン１１）とを有している。フリツプ・
フロツプ３３（ピン６）の入力端子Ｊは端子
EXTに接続され、入力端子Ｒ（ピン４）はイン
バータ３６（1/6CD 4049A）を介して端子EXT
に接続される。フリツプ・フロツプ３３の出力端
子Ｑは端子Ｙに接続される。これら接続により、
端子EXTにおける信号の立上りと端子Ｙにおけ
る信号の立上り間に遅延を出じさせるもので、こ
の遅延は両トランジスタ１３及び１４が使用され
る時に両者をおおむね同一間隔で確実にオンさせ
る。
巾をもつ単安定回路３２（CD 4047A）とフリツ
プフロツプ３３（1/2CD 4027B）を介して出力
される。単安定回路３２は端子EXTに接続の入
力（ピン８）と、抵抗３４及びコンデンサ３５で
相互に接続のタイミングピン（１，２，３）と、
フリツプ・フロツプ３３のCLOCK端子に接続の
出力Ｑ（ピン１１）とを有している。フリツプ・
フロツプ３３（ピン６）の入力端子Ｊは端子
EXTに接続され、入力端子Ｒ（ピン４）はイン
バータ３６（1/6CD 4049A）を介して端子EXT
に接続される。フリツプ・フロツプ３３の出力端
子Ｑは端子Ｙに接続される。これら接続により、
端子EXTにおける信号の立上りと端子Ｙにおけ
る信号の立上り間に遅延を出じさせるもので、こ
の遅延は両トランジスタ１３及び１４が使用され
る時に両者をおおむね同一間隔で確実にオンさせ
る。
インバータ３６は端子EXTの信号が低レベル
になるとフリツプ・ブロツプ３３を復旧する。
になるとフリツプ・ブロツプ３３を復旧する。
X′信号は端子CON及びEXTからの信号により
ゲートされた発振器CMOSから出る。この発振器
は端子EXTに接続の一個の入力端子と、端子
CONにインバータ３８（1/6CD 4049A）を介し
て接続の第２入力端子並びに正帰還をもたらすよ
うに接続の第３端子とから構成される。NANDゲ
ート３７の出力端子は端子X′に接続の出力端子
をもつたインバータ３８（1/6CD 4049A）の入
力端子に接続される。直列接続のコンデンサ３９
及び抵抗４０はインバータ３８の出力端子を
NANDゲート３７の第３入力端子へ接続し、抵抗
４１はNANDゲート３７の出力端子とコンデンサ
３９及び抵抗４０との接続点間で接続される。抵
抗４０，４１は第１及び第２入力端子における信
号が高いとき、すなわち、CON信号が低く、
EXT信号が高いときにリニア状態で動作するよ
うにNANDゲート３７に負帰還を与える。しか
し、インバータ３８の出力部からコンデンサ３９
を介して行う正帰還は入力EXTを高レベルにし
たままの状態でCON入力が低くなるや否や高レ
ベルになるX′出力をもつ配列をく形波発振器に
変換する。
ゲートされた発振器CMOSから出る。この発振器
は端子EXTに接続の一個の入力端子と、端子
CONにインバータ３８（1/6CD 4049A）を介し
て接続の第２入力端子並びに正帰還をもたらすよ
うに接続の第３端子とから構成される。NANDゲ
ート３７の出力端子は端子X′に接続の出力端子
をもつたインバータ３８（1/6CD 4049A）の入
力端子に接続される。直列接続のコンデンサ３９
及び抵抗４０はインバータ３８の出力端子を
NANDゲート３７の第３入力端子へ接続し、抵抗
４１はNANDゲート３７の出力端子とコンデンサ
３９及び抵抗４０との接続点間で接続される。抵
抗４０，４１は第１及び第２入力端子における信
号が高いとき、すなわち、CON信号が低く、
EXT信号が高いときにリニア状態で動作するよ
うにNANDゲート３７に負帰還を与える。しか
し、インバータ３８の出力部からコンデンサ３９
を介して行う正帰還は入力EXTを高レベルにし
たままの状態でCON入力が低くなるや否や高レ
ベルになるX′出力をもつ配列をく形波発振器に
変換する。
EXT信号が高くかつ発振器３７，３８が動作
しているときには必らずY′出力信号はX′信号の
論理反転になるようにすることが必要である。こ
の終りに、Y′出力はANDゲート４２（1/4CD
4081B）から誘導される。該ANDゲート４２はイ
ンバータ４３（1/6CD 4049A）を介して出力端
子X′に接続の入力端子と、NORゲート４４（1/4
CD 4001A）の出力端子に接続の入力端子とを有
している。このNORゲート４４はＲ〜Ｓフリツ
プ・フロツプのように別のNORゲート４５（1/4
CD 4001A）と交叉して接続さされており、該
NORゲート４５にはインバータ３８からの入力
端子を有し、該NORゲート４４はNORゲート４
４，４５により形成されるフリツプ・フロツプを
セツト及びリセツトするインバータ３６からの入
力端子を有している。かようにフリツプ・フロツ
プはEXT信号が高くなつたのち端子X′での最初
の高レベルによりセツトされ；その後、フリツ
プ・フロツプがEXT信号の低下によりリセツト
されるまでゲート４２に反転X′信号をパスさせ
る。
しているときには必らずY′出力信号はX′信号の
論理反転になるようにすることが必要である。こ
の終りに、Y′出力はANDゲート４２（1/4CD
4081B）から誘導される。該ANDゲート４２はイ
ンバータ４３（1/6CD 4049A）を介して出力端
子X′に接続の入力端子と、NORゲート４４（1/4
CD 4001A）の出力端子に接続の入力端子とを有
している。このNORゲート４４はＲ〜Ｓフリツ
プ・フロツプのように別のNORゲート４５（1/4
CD 4001A）と交叉して接続さされており、該
NORゲート４５にはインバータ３８からの入力
端子を有し、該NORゲート４４はNORゲート４
４，４５により形成されるフリツプ・フロツプを
セツト及びリセツトするインバータ３６からの入
力端子を有している。かようにフリツプ・フロツ
プはEXT信号が高くなつたのち端子X′での最初
の高レベルによりセツトされ；その後、フリツ
プ・フロツプがEXT信号の低下によりリセツト
されるまでゲート４２に反転X′信号をパスさせ
る。
トランス１０，１１の２次巻線はダイオード２
７，２８を介して点火分配器２９の共通端子に並
列に接続され、該分配器２９はスパーク・プラグ
３０を点火装置に接続する。
７，２８を介して点火分配器２９の共通端子に並
列に接続され、該分配器２９はスパーク・プラグ
３０を点火装置に接続する。
更に、第３図ｂに基づいて、長いスパーク時間
の場合の作動を説明する。尚、第３図ｂの各信号
波形は第３図ａに示した信号名CON、EXT、
Ｘ、Ｙ、X′、Y′に対応している。
の場合の作動を説明する。尚、第３図ｂの各信号
波形は第３図ａに示した信号名CON、EXT、
Ｘ、Ｙ、X′、Y′に対応している。
まず、時刻t0において、コンピユータ２６の出
力CONが“Ｈ”レベルとなることにより、イン
ダクタンス１０ａにエネルギーが蓄積され、この
時は、信号発生回路１９よりの信号Ｘは“Ｈ”、
X′は“Ｌ”、Ｙは“Ｌ”そして“Y′”は“Ｌ”で
ある。
力CONが“Ｈ”レベルとなることにより、イン
ダクタンス１０ａにエネルギーが蓄積され、この
時は、信号発生回路１９よりの信号Ｘは“Ｈ”、
X′は“Ｌ”、Ｙは“Ｌ”そして“Y′”は“Ｌ”で
ある。
時刻t0ないし、t1の期間は遅延期間であり、信
号CONとEXTが同時に“Ｈ”レベルとなる場合
に動作不良が発生するのを防止するためにあり、
したがつて信号EXTは適宜の遅延時間後に
“Ｈ”レベルとなるようになつている。
号CONとEXTが同時に“Ｈ”レベルとなる場合
に動作不良が発生するのを防止するためにあり、
したがつて信号EXTは適宜の遅延時間後に
“Ｈ”レベルとなるようになつている。
時刻t2と時刻t1の間隔は約300μＳに設定されて
いる。これは、時刻t2において信号ＸとＹにより
トランジスタ１３，１４を共にオン状態にするた
めに設定されており、いわゆるトランジスタのス
イツチングスピードに基づいて決定されている。
いる。これは、時刻t2において信号ＸとＹにより
トランジスタ１３，１４を共にオン状態にするた
めに設定されており、いわゆるトランジスタのス
イツチングスピードに基づいて決定されている。
時刻t3において、信号CONが“Ｌ”レベルとな
る。これにより、第２図中の発振回路よりの出力
信号X′が発生すると共に、時刻t4からはその信号
X′と逆位相の信号Y′が発生する。したがつて時
刻t3ないし時刻t4では、トランジスタ２０がオン
となり、その結果としてトランジスタ１３はオフ
となりスパークが発生する。このスパークは変流
が消滅するまでインダクタンス１０ａによつて発
生され、次に、インダクタンス１１ａに蓄積され
たエネルギーがギツプへ放出されることとなり、
スパークは消えずに継続される。
る。これにより、第２図中の発振回路よりの出力
信号X′が発生すると共に、時刻t4からはその信号
X′と逆位相の信号Y′が発生する。したがつて時
刻t3ないし時刻t4では、トランジスタ２０がオン
となり、その結果としてトランジスタ１３はオフ
となりスパークが発生する。このスパークは変流
が消滅するまでインダクタンス１０ａによつて発
生され、次に、インダクタンス１１ａに蓄積され
たエネルギーがギツプへ放出されることとなり、
スパークは消えずに継続される。
以後、信号EXT、Ｘ、Ｙが“Ｌ”レベルとな
る時刻t5までは、信号X′、Y′は発振器の出力に基
づいて、相互に逆位相の矩形信中となつて繰り返
し発生される。
る時刻t5までは、信号X′、Y′は発振器の出力に基
づいて、相互に逆位相の矩形信中となつて繰り返
し発生される。
設定されたスパーク放電を保持するに必要な電
圧はスパーク開始時の電圧より低いためコイル１
１はコイル１０よりも小さく構成しても良く、関
係する半導体構成要素への電圧電流や電力割合を
低くおさえても良いことが理解出来る。発振器３
７，３８のマーク／スペース比は１以下にしても
良い。
圧はスパーク開始時の電圧より低いためコイル１
１はコイル１０よりも小さく構成しても良く、関
係する半導体構成要素への電圧電流や電力割合を
低くおさえても良いことが理解出来る。発振器３
７，３８のマーク／スペース比は１以下にしても
良い。
必要に応じ単一の長いスパークを発生させるか
わりに、一連の任意スパークを発生させても良
い。その効果はスパーク時間を拡張することとな
る。
わりに、一連の任意スパークを発生させても良
い。その効果はスパーク時間を拡張することとな
る。
以上のようにすることによつて、点火コイル
（トランス）の温度上昇に起因する総熱損失をお
さえ、２つの１次巻線の等しい温度上昇を得るこ
とができ、また、インダクタンスが低くなるので
プラグに供給される電流の変換率を増すことがで
き、エネルギー損失を減少させることができる。
（トランス）の温度上昇に起因する総熱損失をお
さえ、２つの１次巻線の等しい温度上昇を得るこ
とができ、また、インダクタンスが低くなるので
プラグに供給される電流の変換率を増すことがで
き、エネルギー損失を減少させることができる。
第１図は本発明装置の回路図を示す。第２図は
本発明装置の一部を形成する信号発生回路図を示
す。第３ａ図、第３ｂ図は該回路の各部の波形図
である。 図中符号：１０，１１……点火用トランス、１
２……供給レール、１３，１４……NPN電力ト
ランジスタ、１５，１６，１７，１８，２２，２
３，２４，２５……抵抗、１９……信号発生回
路、２０，２１……NPN電力トランジスタ、２
６……演算回路、２７，２８……ダイオード、２
９……分配器、３１……ORゲート、３２……単
安定回路、３３……クリツプ・フロツプ、３４…
…抵抗、３５，３９……コンデンサ、NANDゲー
ト、３６，３８，４３……インバータ、４２……
ANDゲート、４４，４５……NORゲート。
本発明装置の一部を形成する信号発生回路図を示
す。第３ａ図、第３ｂ図は該回路の各部の波形図
である。 図中符号：１０，１１……点火用トランス、１
２……供給レール、１３，１４……NPN電力ト
ランジスタ、１５，１６，１７，１８，２２，２
３，２４，２５……抵抗、１９……信号発生回
路、２０，２１……NPN電力トランジスタ、２
６……演算回路、２７，２８……ダイオード、２
９……分配器、３１……ORゲート、３２……単
安定回路、３３……クリツプ・フロツプ、３４…
…抵抗、３５，３９……コンデンサ、NANDゲー
ト、３６，３８，４３……インバータ、４２……
ANDゲート、４４，４５……NORゲート。
Claims (1)
- 【特許請求の範囲】 １ 一対のインダクタンス・コイルと、 該インダクタンス・コイルに流れる電流が遮断
されると夫々のインダクタンス・コイルに蓄積さ
れているエネルギーをスパーク回路へ伝達させる
手段と、 該夫々のコイルに接続され、夫々のコイルに流
れる電流を制御する一対の半導体スイツチ機構
と、 複数のエンジン・パラメータ変換器よりの入力
信号に基づいて該半導体スイツチ機構のオン・オ
フ動作を制御する制御手段とを具備し、 該制御回路は、通常スパーク時においては、所
定の周期で前記一方の半導体スイツチ機構のみを
オン・オフ制御し、長いスパーク時間の必要な時
においては、該一対のスイツチ機構を所定時間の
ずれをもつて夫々オンにした後、該一対のスイツ
チ機構を相互に逆位相の関係で繰り返しオン・オ
フ動作させることを特徴とする内燃機関のスパー
ク点火装置。 ２ 前記半導体スイツチ機構は、前記夫々のイン
ダクタンス・コイルの一端に直列に接続するコレ
クタ・エミツタ間接点を有する一対の第１トラン
ジスタと、夫々の第１トランジスタのベースに接
続される更に１対の第２トランジスタを有するこ
とを特徴とする特許請求の範囲第１項記載の内燃
機関のスパーク点火装置。 ３ 前記制御回路は、前記第１、第２の夫々のト
ランジスタにベース電流を供給することによりオ
ン・オフ動作を制御する信号発生回路と、前記複
数のエンジン・パラメータに基づいて該信号発生
回路の作動を制御する信号を発生する演算回路と
を具備したことを特徴とする特許請求の範囲第１
項又は第２項記載の内燃機関のスパーク点火装
置。 ４ 前記第１トランジスタが交互にオン・オフ動
作する場合において、該第１トランジスタがオン
のとき該第１トランジスタにベース電流を供給
し、オフのとき該ベース電流を供給しないように
前記第２トランジスタが作動するように接続され
ていることを特徴とする特許請求の範囲第２項又
は第３項記載の内燃機関のスパーク点火装置。 ５ 前記信号発生回路は、前記第１トランジスタ
へのベース電流供給を制御するための第１の論理
回路と、前記第２トランジスタを交互にスイツチ
オン及びオフ動作させるための発振器とを備えて
おり、前記発振器は通常のスパークが必要な時ス
イツチオン及びオフされる第１トランジスタ側の
第２のトランジスタのベースに接続されており、
更に第２の論理回路が前記第２のトランジスタの
他方の側に接続されており前記発振器の排他論理
出力を供給することを特徴とする特許請求の範囲
第４項に記載の内燃機関のスパーク点火装置。 ６ １次巻線がインダクタンス・コイルを形成し
ダイオード手段により共通のスパーク回路に２次
巻線が並列接続されている一対の昇圧トランス
と、該１次巻線と結合され該１次巻線に流れる電
流を制御する一対の半導体スイツチ機構と、複数
個のエンジン・パラメータ変換器からの入力が印
加されており前記スイツチ機構を制御する制御回
路とを具備し、該制御回路は通常スパーク時では
前記スイツチ機構の一方のみをオンしその後オフ
にしおよび長いスパーク時間が必要であるときで
は前記一対のスイツチ機構をオンにしその後一方
の前記スイツチ機構をオフにしその次にオンにす
ると同時に他方のスイツチ機構をオフにして両ス
イツチ機構にオン・オフを繰り返させることを特
徴とする特許請求の範囲第１項記載の内燃機関の
スパーク点火装置。
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| GB30987/76A GB1588118A (en) | 1976-07-24 | 1976-07-24 | Spark ignition systems for internal combustion engines |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5314243A JPS5314243A (en) | 1978-02-08 |
| JPS6211185B2 true JPS6211185B2 (ja) | 1987-03-11 |
Family
ID=10316213
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8677377A Granted JPS5314243A (en) | 1976-07-24 | 1977-07-21 | Spark ignition apparatus for internal combustion engine |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4183340A (ja) |
| JP (1) | JPS5314243A (ja) |
| DE (1) | DE2733400C2 (ja) |
| FR (1) | FR2359287A1 (ja) |
| GB (1) | GB1588118A (ja) |
| IT (1) | IT1080057B (ja) |
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-
1976
- 1976-07-24 GB GB30987/76A patent/GB1588118A/en not_active Expired
-
1977
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- 1977-07-22 IT IT50397/77A patent/IT1080057B/it active
- 1977-07-22 FR FR7723358A patent/FR2359287A1/fr active Granted
- 1977-07-23 DE DE2733400A patent/DE2733400C2/de not_active Expired
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