JPS62130470A - 画像処理装置 - Google Patents

画像処理装置

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JPS62130470A
JPS62130470A JP27201385A JP27201385A JPS62130470A JP S62130470 A JPS62130470 A JP S62130470A JP 27201385 A JP27201385 A JP 27201385A JP 27201385 A JP27201385 A JP 27201385A JP S62130470 A JPS62130470 A JP S62130470A
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JP
Japan
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processing
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Pending
Application number
JP27201385A
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English (en)
Inventor
Shigeo Fujimura
藤村 成男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
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Publication of JPS62130470A publication Critical patent/JPS62130470A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、ディジタル化された画像データを加工処理
して画像解析を容易にする画像処理装置に関するもので
ある。
〔従来の技術〕
第2図は、従来のこの種の画像処理装置を示す図である
。第2図におりで、(1)けディジタル化された画像デ
ータを記憶する画像メモリであり1画面分の記憶容量を
備えている。(2)はこの画像メモ1月1)の画像デー
タのカロエ処理を行う画像処理部。
(3)は上記画像メモ1月1)より出力される画像デー
タから画像表示信号を作成する表示インタフェース。
(4)はこの表示インタフェース(3)から出力される
画像表示信号によって画像を表示する表示部、(51は
上記画像メモ1月1)と外部との間で画1オデータの入
出力を行うための外部入出力インタフェース、(6)は
この外部入出力インタフェース(5)、上記i1!II
像メモリ(11,画像処理部(2)及び表示インタフェ
ース(3)の入出力又は処理の動作タイミングを作成し
てこれらのハードウェア制御を行う制御信号作成部。
(7)は汎用的な各種の演算処理機能、情報の記憶及び
入出力機能を備え、上記外部入出力インタフェース(5
)及び制御信号作成部(6)と制御情報の入出力を行い
、装置の動作全体を制御・管理するプロセッサ、(81
はこのプロセッサ(71にオペレータが画像処理内容な
どの制御メニューを指示するだめの操作部である。
次に動作につAて駒間する。画像処理は、まず画像メモ
リ(1)から処理すべき画像データを画像処理部(2)
に続出し1画像処理部(2)で所定の画像データの加工
処理を行い、処理後の画像データを画像メモ1月11に
返送書込みするとめう手順で行われる。
〔発明が解決しようとする問題点〕
従来の画像処理装置は以上のように構成されているので
、1つの画像メモリに対し、処理すべき画像データの読
出[と魯込みを行なわなければなちす1画像処理時間が
この読出しと曹込みの双方の時(IAlの和で制限され
、また画像メモリ、表示インタフェース及び表示部が1
系統のみのため処理前後の画像を同時表示できず、処理
前後の画像の比較解析が容易にできないという問題点が
あった。
この発明は上記のような問題点を解消するためになされ
たもので2画像処理時間を短縮できるとともに、処理前
後の画像の同時表示が可能な画像処理装置を得ることを
目的としている。
〔問題点を解決するための手段〕
この発明に係る画像処理装置は、複数の画像メモリを備
え1画像処理部を1つの画像メモリと他の画像メモリと
の間で画像データの受渡し可能な位置に設置し、更に上
記画像メモリから出力される画像データから画像表示信
号を作成する表示インタフェース、画像表示信号によっ
て画像を表示する表示部、および上記画像メモI19表
示インタフェースのハードウェア制御を行う制御(i号
作成部の各々を、上記各画像メモリに対応[て複数個備
えるとともに1画像メモリと外部との間で画像データの
入出力を行なう外部入出力インタフェース処理像処理操
作を行う操作部及び装置の全体を制御管理するプロセッ
サを備えたものである。
〔作用〕
この発明において、 10工処理すべき画像データは、
1つの画像メモリから画像処理部に供給され。
この画像処理部により加工処理された画像データは他の
画像メモリに転送記憶する。従って、この発明の構成に
おいては、〃ロエ処理すべき画像データの読出しき加工
処理した画像データの書込みを別々の画像メモリに対し
て行うため2次に加工処理すべき画像データの読出しと
力ロエ処理後の画像データの書込みを同時に行うことか
でき、また加工処理前の画像データを保存することがで
きるので、各画像メモリに対応して設置されている表示
インタフェース及び表示部によって処理前後の画像を同
時表示することが可能である。
〔実施例〕
第1図は、この発明の一実施例を示す画像処理装置のブ
ロック図である。第1図において(1人)(1B)はデ
ィジタル化された画像データを記憶する画像メモリであ
り各々1画面分の記憶容量分備えている。(2)はこれ
らの画像メモIJ (IA)(IB)の間に設置し、刀
0工処理すべき画像データの入力。
画像データの加工処理、加工処理後の画像データの出力
の各動作を次々と同時実行可能な画像処2哩部、  (
3A)(3B)は、各々上記画像メモリ(I A)(1
13)から出力される画像データから画像表示信号を作
成する表示インタフェース、  (4A)(4B)は各
々この表示インタフェース(5A)(3B)がち出力さ
れる画像表示信号によって画像を表示する表示部、(5
)は上記画像メモIJ(IAIと外部との間で画像デー
タの入出力を行うための外部入出力イン不フェース、 
 (6k)はこの外部入出力インタフェース(5)。
上記画像メモ+7 (IAI 、  及び表示インタフ
ェース(3A)の入出力又は処理の動作タイミングを作
成してこれらのハードウェア制御を行う1lli制御信
号制御部、  (<5B1は上記画像メモIJ(1B)
及び表示インタフェース(3B)の入出力又は処理の動
作タイミングを作成してこれらのハードウェア制御を行
う制御信号作成部、(71は汎用的な各種の演算処理機
能、情報の記憶及び入出力機能を備え、上記画像処理部
(2)、外部入出力インタフェース(5)及び制御信号
作成部(6A)(6B)と制御情報の入出力を行い、装
置の動作全体を制御・管理するプロセッサ。
181 u コのプロセッサ(71にオペレータが画像
処理内容などの制御メニューを指示するための操作部で
ある。
上記のように構成された画像処理装置においては1例え
ば画像メモIJ(IA)に刀0工処理前の画像データが
記憶されていbと仮定すると1画像処理はまずこの画像
メモIJ (IA)からの画像データの続出しから始ま
り、読出された画像データは1面像処理部(21に供給
されあらかじめプロセッサ(7)によって指示されてい
る所定の画像データの加工処理を行った後2画像メモ+
7(IB)へ書込み記憶する。
画像メモ+7(IA)からの画像データの読出しと画像
メモII(jB)への画像データの書込みは、各々に設
置された制御信号作成部(+5A)(6B)の制御によ
って独立に行うので1画像メモIJ(IA)から次々と
!1fii像データを連続して読出し2画像処理部(2
)で刀ロエ処理りながら、処理後の画像データを画像メ
モ17 (IB)K次々と連続[て書込み記憶すること
ができる。すなわち、加工処理すべき画像データの読出
し、加工処理、処理後の画像データの書込みf各々のハ
ードウェアで独立して次々と連続に行うので画像処理時
間を短縮できる。また、処理前の画像データは画像メモ
リ(1A)に、処理後の画像データは画像メモ’J(I
B)に記憶されることになり1画像メモIJ (IA)
(IB)の各々に対応して備えてbる表示インタフェー
ス(3A)(3B)及び表示部(4A)(4B)によっ
て処理前後の画詠を同時表示することができる。
〔発明の効果〕
以上のように、この発明によれば複数の画像メモリを備
え9画像処理部を1つの1面像メモIJ カら他の画像
メモリへ画像データを転送する過程で画像データの加工
処理が可能な位置に設置するように構成したので9画像
処理時間を短縮でき、また各画像メモリに対応して備え
た表示インタフェース及び表示部によって処理前後の画
像を同時表示できるという効果がある。
【図面の簡単な説明】
第1図はこの発明の画像処理装置の一実施例を示す図、
第2図は従来の画像処理装置を示す図である。 図において、 ill (IA)(IB)はLi1li
像メモリ、+21ij画像処理部、 +31 (3A)
(3B)は表示インタフェース。 f4+ (4A)(4B)は表示部、(5)は外部入出
力インタフェース、(6)(6k)(6B)は制御信号
作成部、(71けプロセッサ、(81は操作部である。 なお、各図中同一符号は同一または相当部分を示すもの
とする。

Claims (1)

    【特許請求の範囲】
  1. ディジタル化された画像データを記憶する複数の画像メ
    モリと、これらの画像メモリの1つから他の画像メモリ
    へ画像データを転送する過程で画像処理を行う画像処理
    部と、上記各画像メモリに対応して設置し画像メモリよ
    り出力される画像データから画像表示信号を作成する複
    数の表示インタフェースと、これらの表示インタフェー
    スに対応して設置され、表示インタフェースから出力さ
    れる画像表示信号により画像を表示する複数の表示部と
    、上記画像メモリと外部との間で画像データの入出力を
    行う外部入出力インタフェースと、上記各画像メモリに
    対応して設置し各画像メモリおよび上記各表示インタフ
    ェースのハードウェア制御を行う制御信号作成部と、上
    記各部を制御管理するプロセッサと、オペレータがこの
    プロセッサに処理内容を指示するための操作部とを備え
    たことを特徴とする画像処理装置。
JP27201385A 1985-12-03 1985-12-03 画像処理装置 Pending JPS62130470A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP27201385A JPS62130470A (ja) 1985-12-03 1985-12-03 画像処理装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP27201385A JPS62130470A (ja) 1985-12-03 1985-12-03 画像処理装置

Publications (1)

Publication Number Publication Date
JPS62130470A true JPS62130470A (ja) 1987-06-12

Family

ID=17507915

Family Applications (1)

Application Number Title Priority Date Filing Date
JP27201385A Pending JPS62130470A (ja) 1985-12-03 1985-12-03 画像処理装置

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JP (1) JPS62130470A (ja)

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