JPS6251837A - 伝送デ−タの再生中継器 - Google Patents

伝送デ−タの再生中継器

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Publication number
JPS6251837A
JPS6251837A JP19134185A JP19134185A JPS6251837A JP S6251837 A JPS6251837 A JP S6251837A JP 19134185 A JP19134185 A JP 19134185A JP 19134185 A JP19134185 A JP 19134185A JP S6251837 A JPS6251837 A JP S6251837A
Authority
JP
Japan
Prior art keywords
clock
circuit
phase synchronization
phase
data signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP19134185A
Other languages
English (en)
Inventor
Makoto Shibata
誠 柴田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP19134185A priority Critical patent/JPS6251837A/ja
Publication of JPS6251837A publication Critical patent/JPS6251837A/ja
Pending legal-status Critical Current

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  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は伝送路からのデータを位相調整して再生出力
させる伝送データの再生中継器に関する。
〔従来の技術〕
第3図は従来の再生中継器を示すブロック接続図であり
、図において、(1)は伝送路、(2)は伝送路(1)
上の入力データ信号を符号等化する等化回路、■は上記
入力データ信号をタイミングクロックとデータ信号とに
分離するクロック分離回路、α2はタイミングクロック
を位相同期させる、例えばフェーズ・ロックド・ループ
構成の位相同期回路、(13は位相同期をとったタイミ
ングクロックを用いてデータ信号を識別し、新しく再生
したデータとして伝送路に送出する識別再生回路である
次に動作について説明する。
先ず、伝送路(1)からの入力データ信号は符号等化さ
れてクロック分離回路a1Jに入力され、ここでタイミ
ングクロックとデータ信号とに分離されて、データ信号
は識別再生回路a:Iにそのまま入力される。一方、分
離されたタイミングクロックは、これの送出時に生じる
位相ジッタによって、これをそのtまタイミングパルス
として用いると正確なデータの識別を行えないので、位
相同期回路azに入力して位相同期をとる。この位相同
期によって位相のずれが修正され、この修正したタイミ
ングクロックにより識別回路a=においてデータ信号を
識別し、新しく再生したデータ信号を伝送路へ送出する
〔発明が解決しようとする問題点〕
従来の伝送データの再生中継口は以上のように構成され
ているので、位相同期回路azで同期がとられている最
中は、電圧制御発振器の同期のとれていない不安定なり
ロックパルスが送出され、この期間中にも不安定な上記
クロックパルスにより、データの識別、再生が行なわれ
ていることになり、データ信号の正確な識別、判定がで
きなくなるなどの問題点があった。
との発明は、上記のような問題点を解消するためKなさ
れたもので、位相同期時間中は位相同期作業中の不安定
なタイミングクロックの送出を防止し、その間は入力基
準信号を送出し、同期がとられた後はその正確なりロッ
クパルスを送出する様にし、正しいデータの識別、再生
ができる伝送デニタの再生中継装置を得ることを目的と
する。
〔問題点を解決するための手段〕
この発明にかかる伝送データの再生中継器は、伝送路の
入力データ信号をクロック分離回路によってタイミング
クロックとデータ信号とに分離し、このうちタイミング
クロックを位相同期回路にて位置同期させ、上記入力デ
ータ信号のキャリアを中ヤリア検出器で検出し、このキ
ャリア検出後、上記位相同期がとられたことを位相同期
検出回路にて検出し、クロック選択回路により上記位相
同期をとっている最中は、上記クロック分離回路からの
タイミングクロックを出力させ、位相同期に入ったとき
は、その位相同期クロックを出力させ、上記データ信号
を上記タイミングクロックおよび位相同期クロックによ
り識別して識別再生回路から伝送路へ再生出力するよう
に構成したものである。
〔作用〕
この発明におけるキャリア検出回路および位相同期検出
回路は伝送路にキャリアが現れた時、これを検知し、位
相の同期がとれるまで不安定クロックの送出を防止し、
同期がとられた時点で、クロック選択回路により、入力
データ信号のタイミングクロックから位相同期のとれた
位相同期クロックに切り換え、不安定なりロックパルス
の送出を防止するように作用する。
〔実施例〕
以下、この発明の一実施例を図について説明する。第1
図において、α4はクロック選択回路、傾は伝送路口)
からのデータ入力信号中の中ヤリアを検出するキャリア
検出回路、(IIはタイミングクロックの位相同期状態
を検出する位相同期検出回路である。なお、クロック選
択回路α養は位相同期回路υと識別再生回路α3との間
に接続されている。
次に動作について説明する。先ず、伝送路(1)から入
力されたデータ入力信号は等化回路(2)で符号等化さ
れ、タイミング送出部αυにおいてタイミングクロック
とデータ信号とに分解される。このうちデータ信号は直
接、識別再生回路α国に送られるが、もう一方のタイミ
ングクロックは、送出時に位相のズレ(ジッタ)が生じ
ているため、位相同期回路@により同期をとった後、ク
ロック選択回路a4を通して出力され、識別再生回路α
謙によりその位相同期クロックでデータの識別再生が行
なわれる。
一方、再生中継器は位相同期回路を含んでいるため、そ
のクロックの同期時間が問題となる。つまり、同期時間
中は、その位相同期回路αり中の電圧制御発振器が出力
する不安定な出力波形が、識別再生回路α湯に入力され
このままでは、正確なデータ識別タイミングが得られな
い可能性がある。
そこで、伝送路(1)から送られてきたデータ入力信号
中のキャリアを、キャリア検出回路a!9で検出し、上
記タイミングクロックの位相同期状態を位相同期検出回
路αeにより検出し、キャリアが検出された後位相同期
がとられるまでの時間は、クロック選択回路(14を制
御して、クロック分離回路aDが出力するタイミングク
ロックをそのまま識別再生回路Q3に送出し、位相同期
がとれたときは、その位相同期クロックを送出させ、こ
れによりデータ信号を識別して、新しく再生したデータ
を伝送路へ送出する。
第2図はこの回路各部の波形を示すタイムチャートであ
る。第2図G)はクロック分離回路lIυが出力するタ
イミングクロックで、上記キャリア検出回路によるキャ
リア検出開始時t、からタイミングクロックの位相同期
がとれる時t2までの同期作業期間Tでは、位相同期回
路aりに入力する未処理の上記タイミングクロックを、
第2図(b)に示すようにそのまま識別再生回路lυに
出力し、同期がとれた時点t2を経過した後は、その位
相同期のとれた第2図(C)に示す位相同期クロックを
識別再生回路Uに出力する状況を、それぞれ示している
〔発明の効果〕
以上のように、この発明によれば、タイミングクロック
の位相同期を行う際に、入力データ信号のキャリア検出
時からそのタイミングクロックの位相同期がとれるまで
の期間中は、位置同期回路の入力側のタイミングクロッ
クによりデータを識別再生し、位相同期がとれた後ば、
この位相同期クロックによって同様にデータを識別再生
するように構成したので、上記位相同期の作業中のタイ
ミングクロックに位相ジッタが生じても、同期がとれた
データを新しく再生して、これを伝送路に高精度で送出
できるものが得られる効果がある。
【図面の簡単な説明】
第1図はとの発明の一実施例による伝送データの再生中
継器を示すブロック接続図、第2図はこのブロック接続
図各部の信号のタイムチャート、第3図は従来の再生中
継器を示すブロック接続図である。 (1)は伝送路、αυはクロック分離回路、a3は位相
同期回路、(Isは識別再生回路、Iはクロック選択回
路、α9はキャリア検出回路、翰は位相同期検出回路。 なお、図中、同一符号は同一、または相当部分を示す。 特許出願人  三菱電機株式会社 第1図 第2図 (a)1 =

Claims (1)

    【特許請求の範囲】
  1. 伝送路からの入力データ信号をタイミングクロックとデ
    ータ信号に分離するクロック分離回路と、分離した上記
    タイミングクロックを位相同期させるフェーズ・ロック
    ド・ループ構成の位相同期回路と、上記入力データ信号
    のキャリアを検出するキャリア検出回路と、このキャリ
    アの検出後上記位相同期がとられたことを検出する位相
    同期検出回路と、上記位相同期をとつている最中は上記
    クロック分離回路からのタイミングクロックを出力させ
    、位相同期が検出されたときはこの位相同期クロックを
    上記タイミングクロックに代えて出力させるクロック選
    択回路と、上記クロック分離回路(11)が出力するデ
    ータ信号を上記クロック選択回路が出力するタイミング
    クロックおよび位相同期クロックにより識別して上記伝
    送路へ再生出力する識別再生回路とを備えた伝送データ
    の再生中継器。
JP19134185A 1985-08-30 1985-08-30 伝送デ−タの再生中継器 Pending JPS6251837A (ja)

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JP19134185A JPS6251837A (ja) 1985-08-30 1985-08-30 伝送デ−タの再生中継器

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JP19134185A JPS6251837A (ja) 1985-08-30 1985-08-30 伝送デ−タの再生中継器

Publications (1)

Publication Number Publication Date
JPS6251837A true JPS6251837A (ja) 1987-03-06

Family

ID=16272950

Family Applications (1)

Application Number Title Priority Date Filing Date
JP19134185A Pending JPS6251837A (ja) 1985-08-30 1985-08-30 伝送デ−タの再生中継器

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JP (1) JPS6251837A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5561404A (en) * 1995-03-28 1996-10-01 Ross Video Limited Amplified serial digital cable equalizer circuit having a high return loss

Cited By (1)

* Cited by examiner, † Cited by third party
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US5561404A (en) * 1995-03-28 1996-10-01 Ross Video Limited Amplified serial digital cable equalizer circuit having a high return loss

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