JPS6297107A - 磁気記憶装置のプレシフト回路 - Google Patents
磁気記憶装置のプレシフト回路Info
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- JPS6297107A JPS6297107A JP23711285A JP23711285A JPS6297107A JP S6297107 A JPS6297107 A JP S6297107A JP 23711285 A JP23711285 A JP 23711285A JP 23711285 A JP23711285 A JP 23711285A JP S6297107 A JPS6297107 A JP S6297107A
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- Japan
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- preshift
- pattern
- circuit
- signal
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- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
Landscapes
- Digital Magnetic Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（Ｍ業上の利用分野）
本発明は磁気記憶装置に関し、特に磁気記憶装置に使用
されるプレシフト回路に関する。
されるプレシフト回路に関する。
（従来の技術）
従来技術による磁気記憶装置に使用されるプレシフト回
路は、第２図に示すような構成を有していた。第２図に
おいて、ｌはシフトレジスタ回路、１１．１２はそ几ぞ
ｎパターンデコーダ回路、 １１１，１１２はそれぞ
ｎディレィ回路、３はＯＲゲートである。
路は、第２図に示すような構成を有していた。第２図に
おいて、ｌはシフトレジスタ回路、１１．１２はそ几ぞ
ｎパターンデコーダ回路、 １１１，１１２はそれぞ
ｎディレィ回路、３はＯＲゲートである。
第２図において、信号線１０１上にはプレシフトの対象
となる直列なシリアルコード信号が選出され、シフトレ
ジスタ回路１では上記シリアルコード信号を並列なパラ
レルコード信号に変換して信号線１０３上に送出する。
となる直列なシリアルコード信号が選出され、シフトレ
ジスタ回路１では上記シリアルコード信号を並列なパラ
レルコード信号に変換して信号線１０３上に送出する。
次に、パラレルコード信号から特定のプレシフトパター
ンをパターンデコーダ回路１１．１２によって検出し、
該”当プレシフトパターンであったときにはプレシラト
信号乞信号線１０５１ 、１０５２上に出力する。
ンをパターンデコーダ回路１１．１２によって検出し、
該”当プレシフトパターンであったときにはプレシラト
信号乞信号線１０５１ 、１０５２上に出力する。
ディレィ回路１１１ 、１１２はそれぞｎ、信号線１０
５１ 、１０５２上のプレシフト信号に特定の遅延時間
を与え、そルぞれ信号線１０６１ 、１０６２上へディ
レイドプレシフト信号を出力する。ＯＲゲート３は信号
線１０６１ 、１０６２上のディレイドプレシフト信号
の論理和をとり、ディレイドビット信号を信号線１０７
上に出力する。
５１ 、１０５２上のプレシフト信号に特定の遅延時間
を与え、そルぞれ信号線１０６１ 、１０６２上へディ
レイドプレシフト信号を出力する。ＯＲゲート３は信号
線１０６１ 、１０６２上のディレイドプレシフト信号
の論理和をとり、ディレイドビット信号を信号線１０７
上に出力する。
゛すなわち、信号線１０７上のディレイドピット信号は
信号線１０１上のシリアルコード信号にプレシフトをか
け友信号となる。
信号線１０１上のシリアルコード信号にプレシフトをか
け友信号となる。
通常、パターンデコーダ回路は検出すべきプレシフトパ
ターン数と同数だけ作成し、ディレィ回路はパターンデ
コーダ回路と同数だけ作成して、そｎぞれのプレシフト
パターンで決定される遅延時間ｔプレシフト信号に与え
る。
ターン数と同数だけ作成し、ディレィ回路はパターンデ
コーダ回路と同数だけ作成して、そｎぞれのプレシフト
パターンで決定される遅延時間ｔプレシフト信号に与え
る。
ところで、プレシフトパターンとプレシフト量とはデー
タ′ｌｊｔｇ出す磁気記憶媒体の特性と記録ビット密度
とに依存する。
タ′ｌｊｔｇ出す磁気記憶媒体の特性と記録ビット密度
とに依存する。
（発明が解決しようとする問題点）
上述した従来技術による磁気記憶装置のプレシフト回路
では、代表的な磁気記憶媒体の特性と記録ビット密度に
対応したプレシフトパターンとプレシフト量との設定を
行っている。しかし、代表的な磁気記憶媒体と実際に読
出す磁気記憶媒体との間に特性の差があったり、代表的
な記録ビット密度と実際に読出す記憶ピット密度との間
に差があると、実際に絖出すデータに対してプレシフト
パターンとプレシフト量とは、プレシフト回路で設定し
友値とは異なった値ｔと９、最適なプレシフトが与えら
れないと云り欠点がある。
では、代表的な磁気記憶媒体の特性と記録ビット密度に
対応したプレシフトパターンとプレシフト量との設定を
行っている。しかし、代表的な磁気記憶媒体と実際に読
出す磁気記憶媒体との間に特性の差があったり、代表的
な記録ビット密度と実際に読出す記憶ピット密度との間
に差があると、実際に絖出すデータに対してプレシフト
パターンとプレシフト量とは、プレシフト回路で設定し
友値とは異なった値ｔと９、最適なプレシフトが与えら
れないと云り欠点がある。
本発明の目的は、読出しを行うシリンダの記録ビット密
度と、読出しｔ行う磁気記憶媒体の特性とに対厄し几最
適なプレシフトパターンを設定することにより上記欠点
火除去し、最適なプレシフト量！与えることができるよ
うに構成した磁気記憶装置のプレシフト回路を提供する
ことにある。
度と、読出しｔ行う磁気記憶媒体の特性とに対厄し几最
適なプレシフトパターンを設定することにより上記欠点
火除去し、最適なプレシフト量！与えることができるよ
うに構成した磁気記憶装置のプレシフト回路を提供する
ことにある。
（問題点を解決するための手段）
本発明による磁気記憶装置のプレシフト回路は、ｄ出さ
ｎた磁気記憶データに対して磁界の相互干渉のために読
出し波形がずれて生ずるピークシフト現象を低減させる
几め、あらかじめ書込みデータを上記すれとは逆方間に
ずらせる之めのものであって、シフトレジスタ回路と、
パターンセレクタ回路と、Ｈ［！ｄ以上のパターンデコ
ーダ回路と、１個以上のディレィ回路と、ＯＲゲートと
を具備して構成し友ものである。
ｎた磁気記憶データに対して磁界の相互干渉のために読
出し波形がずれて生ずるピークシフト現象を低減させる
几め、あらかじめ書込みデータを上記すれとは逆方間に
ずらせる之めのものであって、シフトレジスタ回路と、
パターンセレクタ回路と、Ｈ［！ｄ以上のパターンデコ
ーダ回路と、１個以上のディレィ回路と、ＯＲゲートと
を具備して構成し友ものである。
シフトレジスタ回路は、プレシフトの対象となる直列ビ
ット列乞並列ピット列に変換するためのものである。
ット列乞並列ピット列に変換するためのものである。
パターンセレクタ回路は、磁気ヘッドの位置と磁気ヘッ
ドの番号とによつ′Ｃ決定されるプレシフトパターンを
選択するためのものである。
ドの番号とによつ′Ｃ決定されるプレシフトパターンを
選択するためのものである。
１個以上のパターンデコーダ回路は、パターンセレクタ
回路の出力信号によって制御され、並列ビット列から特
定のパターンを検出するためのものである。
回路の出力信号によって制御され、並列ビット列から特
定のパターンを検出するためのものである。
１個以上のディレィ回路は、１個以上のパターンデコー
ダ回路の出力信号にそｎぞれ特定の遅延時間を与えるた
めのものである。
ダ回路の出力信号にそｎぞれ特定の遅延時間を与えるた
めのものである。
ＯＲゲートは、１個以上のディレィ回路の出力信号の論
理和を求めるためのものである。
理和を求めるためのものである。
（実 施 例）
次に、本発明について図面！参照して説明する。
第１図は、本発明による磁気記憶装置のプレシフト回路
の一実施例を示すブロック図である。
の一実施例を示すブロック図である。
第１図において、１はシフトレジスタ回路、１１゜１２
、２１ 、２２はそれぞれパターンデコーダ回路、１
１１ 、１１２ 、１２１ 、１２２はそれぞれディレ
ィ回路、２はパターンセレクタ回路、３［ＯＲゲートで
ある。 − 第１図において、シフトレジスタ回路１は磁気記憶装置
回路（図示していない）から信号線１０１上に送出され
るシリアルコード信号を入力し、パラレルコード信号を
信号線１０３上に出力する。パターンセレクタ回路２は
磁気記憶制御回路（図示していない）から信号線１０２
上へ送出返れる位置情報信号と信号線１０８上へ送出さ
れるヘッド情報信号とを入力し、信号線１０４１、ま友
は信号線１０４２上にセレクトデコーダ信号を出力する
。パターンデコーダ回路１１ 、１２は双方とも信号線
１０３上のパラレルコード信号と信号線１０４１上のセ
レクトデコーダ信号とを入力し、それぞれプレシフト信
号を信号線１０５１ 。
、２１ 、２２はそれぞれパターンデコーダ回路、１
１１ 、１１２ 、１２１ 、１２２はそれぞれディレ
ィ回路、２はパターンセレクタ回路、３［ＯＲゲートで
ある。 − 第１図において、シフトレジスタ回路１は磁気記憶装置
回路（図示していない）から信号線１０１上に送出され
るシリアルコード信号を入力し、パラレルコード信号を
信号線１０３上に出力する。パターンセレクタ回路２は
磁気記憶制御回路（図示していない）から信号線１０２
上へ送出返れる位置情報信号と信号線１０８上へ送出さ
れるヘッド情報信号とを入力し、信号線１０４１、ま友
は信号線１０４２上にセレクトデコーダ信号を出力する
。パターンデコーダ回路１１ 、１２は双方とも信号線
１０３上のパラレルコード信号と信号線１０４１上のセ
レクトデコーダ信号とを入力し、それぞれプレシフト信
号を信号線１０５１ 。
１０５２上に出力する。パターンデコーダ回路２１゜２
２は双方とも、信号線１０３上のパラレルコード信号と
信号線１０４２上のセレクトデコーダ信号とＺ入力し、
それぞｎプレシフト信号を信号線１０５３ 、１０５４
上に出力する。ディレィ回路１１１ 、１１２ 、１２
１ 、１２２は、それぞれ信号線１０５１〜１０５４か
らプレシフト信ＭＹ入力し、そｎぞれ信号線１０６１〜
１０６４上にディレイドブレシフト信号ケ出力する。Ｏ
Ｒゲート３はディレイドプレシフト信号を信号線１０６
１〜１０６４から入力し、ディレイドピット信号ｌ信号
線１０７上に出力して磁気ディスク読出し／書込み制御
回路（図示していない）へ供給する。
２は双方とも、信号線１０３上のパラレルコード信号と
信号線１０４２上のセレクトデコーダ信号とＺ入力し、
それぞｎプレシフト信号を信号線１０５３ 、１０５４
上に出力する。ディレィ回路１１１ 、１１２ 、１２
１ 、１２２は、それぞれ信号線１０５１〜１０５４か
らプレシフト信ＭＹ入力し、そｎぞれ信号線１０６１〜
１０６４上にディレイドブレシフト信号ケ出力する。Ｏ
Ｒゲート３はディレイドプレシフト信号を信号線１０６
１〜１０６４から入力し、ディレイドピット信号ｌ信号
線１０７上に出力して磁気ディスク読出し／書込み制御
回路（図示していない）へ供給する。
次に、上記プレシフト回路の動作ケ説明する。
シフトレジスタ回路１は直列なビット列信号であるシリ
アルコード信号を並列なビット列信号であるパラレルコ
ード信号に変換する。
アルコード信号を並列なビット列信号であるパラレルコ
ード信号に変換する。
プレシフトパターンおよびプレシフト量は、読出すトラ
ックのピット密度、すなわち抗出すシリンダ番号、およ
び読出す磁気記憶媒体の特性、すなわち読出す磁気ヘッ
ド番号によってそれぞｎ決定される。従ってパターンセ
レクタ回路２は信号線１０２上でシリンダ番号７表わす
シリンダ信号と、信号線１０８上でヘッド番号を表わす
ヘッド信号とから使用するプレシフトパターンＺ判断し
、信号線１０４１ 、あるいは信号線１０４２上のセレ
クトデコーダ信−ｗｊｔアクティブにし、パターンデコ
ーダ回路１１．１２またはパターンデコーダ回路２１
、２２のうちの片方の対ン選択する。
ックのピット密度、すなわち抗出すシリンダ番号、およ
び読出す磁気記憶媒体の特性、すなわち読出す磁気ヘッ
ド番号によってそれぞｎ決定される。従ってパターンセ
レクタ回路２は信号線１０２上でシリンダ番号７表わす
シリンダ信号と、信号線１０８上でヘッド番号を表わす
ヘッド信号とから使用するプレシフトパターンＺ判断し
、信号線１０４１ 、あるいは信号線１０４２上のセレ
クトデコーダ信−ｗｊｔアクティブにし、パターンデコ
ーダ回路１１．１２またはパターンデコーダ回路２１
、２２のうちの片方の対ン選択する。
パターンデコーダ回路１１ 、１２は信号線１０４１上
のセレクトデコーダ信号がアクティブのときに動作し、
パターンデコーダ回路２１．２２は信号線１０４２上の
セレクトデコーダ信号がアクティブのときに動作する。
のセレクトデコーダ信号がアクティブのときに動作し、
パターンデコーダ回路２１．２２は信号線１０４２上の
セレクトデコーダ信号がアクティブのときに動作する。
信号線１０３上のパラレルコード信号がパターンデコー
ダ回路ｔｒ’、１２ 。
ダ回路ｔｒ’、１２ 。
２１．２２で規定されるプレシフトパターンであると、
信号線１０５１ 、１０５２上のプレシフト信号、また
は信号線１０５３ 、１０５４上のプレシフト信号をそ
ｎぞれアクティブにする。
信号線１０５１ 、１０５２上のプレシフト信号、また
は信号線１０５３ 、１０５４上のプレシフト信号をそ
ｎぞれアクティブにする。
ディレィ回路１１１ 、１１２ 、１２１ 、１２２は
、そルぞｎ信号線１０５１〜１０５４上のプレシフト信
号に、プレシフトパターンで決定されるプレシフト量を
与え、そｎぞｎ信号線１０６１〜１０６４上にディレイ
ドブレシフト信号乞出力する。
、そルぞｎ信号線１０５１〜１０５４上のプレシフト信
号に、プレシフトパターンで決定されるプレシフト量を
与え、そｎぞｎ信号線１０６１〜１０６４上にディレイ
ドブレシフト信号乞出力する。
ＯＲゲート３は、信号線１０６１〜１０６４上のディレ
イドプレシフト信号の論理和乞と９、ディレイドピット
信号ｌ信号線１０７上に出力する。
イドプレシフト信号の論理和乞と９、ディレイドピット
信号ｌ信号線１０７上に出力する。
すなわち、読出し乞行うシリンダのそｎぞれのビット密
度に対応するとともに、読出しを行う磁気記憶媒体のそ
れぞｎの特性にも対応したパターンデコーダ回路とディ
レィ回路とを必要な数だけ付加することにより、最適な
プレシフト量を与えることができる。
度に対応するとともに、読出しを行う磁気記憶媒体のそ
れぞｎの特性にも対応したパターンデコーダ回路とディ
レィ回路とを必要な数だけ付加することにより、最適な
プレシフト量を与えることができる。
（発明の効果）
以上説明し友ように本発明は、読出しを行うシリンダの
記憶ピット密度と、読出しを行う磁気記憶媒体の特性と
に対応した最適なプレシフトパターンを設定することに
より、最適なプレシフト量を与え、胱出しデータの信頼
性ケ高めることができると云う効果がある。
記憶ピット密度と、読出しを行う磁気記憶媒体の特性と
に対応した最適なプレシフトパターンを設定することに
より、最適なプレシフト量を与え、胱出しデータの信頼
性ケ高めることができると云う効果がある。
第１図は、本発明による磁気記憶装置のプレシフト回路
の一実施例を示すブロック図である。 第２図は、従来の技術による磁気記憶装置のプレシフト
回路の一例乞示すブロック図である。 １…シフトレジスタ回路 ２・・・パターンセレクタ回路 ３・・・ＯＲゲート １１．１２，２１．２２・・・パターンデコーダ回路１
１１ 、１１２ 、１２１．１２２…ディレィ回路１０
１〜１０３．１０４１．１０４２．１０５１−１０５４
。
の一実施例を示すブロック図である。 第２図は、従来の技術による磁気記憶装置のプレシフト
回路の一例乞示すブロック図である。 １…シフトレジスタ回路 ２・・・パターンセレクタ回路 ３・・・ＯＲゲート １１．１２，２１．２２・・・パターンデコーダ回路１
１１ 、１１２ 、１２１．１２２…ディレィ回路１０
１〜１０３．１０４１．１０４２．１０５１−１０５４
。
Claims (1)
- 読出された磁気記憶データに対して磁界の相互干渉のた
めに読出し波形がずれて生ずるピークシフト現象を低減
させるため、あらかじめ書込みデータを前記ずれとは逆
方向にずらせるためのプレシフト回路において、前記プ
レシフトの対象となる直列ビット列を並列ビット列に変
換するためのシフトレジスタ回路と、磁気ヘッドの位置
と磁気ヘッドの番号とによつて決定されるプレシフトパ
ターンを選択するためのパターンセレクタ回路と、前記
パターンセレクタ回路の出力信号によつて制御され、前
記並列ビット列から特定のパターンを検出するための１
個以上のパターンデコーダ回路と、前記１個以上のパタ
ーンデコーダ回路の出力信号にそれぞれ特定の遅延時間
を与えるための１個以上のデイレイ回路と、前記１個以
上のデイレイ回路の出力信号の論理和を求めるためのＯ
Ｒゲートとを具備して構成したことを特徴とする磁気記
憶装置のプレシフト回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23711285A JPS6297107A (ja) | 1985-10-23 | 1985-10-23 | 磁気記憶装置のプレシフト回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23711285A JPS6297107A (ja) | 1985-10-23 | 1985-10-23 | 磁気記憶装置のプレシフト回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6297107A true JPS6297107A (ja) | 1987-05-06 |
Family
ID=17010589
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23711285A Pending JPS6297107A (ja) | 1985-10-23 | 1985-10-23 | 磁気記憶装置のプレシフト回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6297107A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02249106A (ja) * | 1989-03-03 | 1990-10-04 | Magnetic Peripherals Inc | 適応書き込み補償方法及び装置 |
| JPH0358306A (ja) * | 1989-07-26 | 1991-03-13 | Nec Corp | ライトプリシフト回路 |
-
1985
- 1985-10-23 JP JP23711285A patent/JPS6297107A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02249106A (ja) * | 1989-03-03 | 1990-10-04 | Magnetic Peripherals Inc | 適応書き込み補償方法及び装置 |
| JPH0358306A (ja) * | 1989-07-26 | 1991-03-13 | Nec Corp | ライトプリシフト回路 |
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