JPS6322758B2 - - Google Patents

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JPS6322758B2
JPS6322758B2 JP19460782A JP19460782A JPS6322758B2 JP S6322758 B2 JPS6322758 B2 JP S6322758B2 JP 19460782 A JP19460782 A JP 19460782A JP 19460782 A JP19460782 A JP 19460782A JP S6322758 B2 JPS6322758 B2 JP S6322758B2
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JP
Japan
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circuit
output
detection circuit
variable length
number information
Prior art date
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Application number
JP19460782A
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English (en)
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JPS5985194A (ja
Inventor
Hideo Kuroda
Naoki Takegawa
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NTT Inc
Original Assignee
Nippon Telegraph and Telephone Corp
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Publication date
Application filed by Nippon Telegraph and Telephone Corp filed Critical Nippon Telegraph and Telephone Corp
Priority to JP19460782A priority Critical patent/JPS5985194A/ja
Publication of JPS5985194A publication Critical patent/JPS5985194A/ja
Publication of JPS6322758B2 publication Critical patent/JPS6322758B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N7/00Television systems
    • H04N7/24Systems for the transmission of television signals using pulse code modulation
    • H04N7/52Systems for transmission of a pulse code modulated video signal with one or more other pulse code modulated signals, e.g. an audio signal or a synchronizing signal
    • H04N7/54Systems for transmission of a pulse code modulated video signal with one or more other pulse code modulated signals, e.g. an audio signal or a synchronizing signal the signals being synchronous
    • H04N7/56Synchronising systems therefor
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N19/00Methods or arrangements for coding, decoding, compressing or decompressing digital video signals
    • H04N19/50Methods or arrangements for coding, decoding, compressing or decompressing digital video signals using predictive coding

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Facsimile Image Signal Circuits (AREA)

Description

【発明の詳細な説明】 本発明は伝送エラーに強い画像符号化方式に関
するものである。
画像信号符号化の代表的な方式に予測符号化方
式がある。この方式は、符号化済みの画素値から
算出した予測値を現信号から減算し、得られた予
測誤差信号を量子化して、その量子化出力を符号
化している。
通常、量子化出力には出力値の発生頻度に偏り
があるため、この性質を利用して、頻繁に発生す
る出力値には短かい符号を割当て、時々しか発生
しない出力値には長い符号を割当てることにより
平均符号語長を短かくして符号化効率を上げてい
る。ただし、情報発生が不均一となるため、可変
長符号化出力を一旦速度平滑用のバツフアメモリ
に記憶し、記憶したデータを一定の速さで読み出
してデイジタル伝送路に送出している。
しかしながら、デイジタル伝送路においてエラ
ーが生じると、予測符号化では復号画像に大きな
劣化を生じる。即ち、伝送エラーを含むデータが
受信側において復号される時は、送信側で送出し
た符号とは異なつた符号に見なされる。この場
合、可変長符号を用いているため、長さの異なる
他の符号に見なされて復号されることがあり、以
後のワード同期が乱れてしまうことになる。
このエラーの影響をある時点で消去することを
目的として画像のラインの先頭において同期パタ
ンを伝送する方法がある。この同期パタンは他の
時点では発生し得ない符号を割当てる。受信側に
おいては、この同期パタンを検出することによ
り、以後のワード同期が復帰する。
しかし、伝送路エラーの影響で他の符号が前記
の同期パタンと一致してしまつた場合、受信側に
おいてはこれを復号した時点をラインの先頭と見
なして、以後の復号を行うため受信側の速度平滑
用バツフアメモリの動作が、送信側の速度平滑用
バツフアメモリの動作と整合がとれなくなる。こ
の結果、受信側速度平滑用バツフアメモリにおい
て、入力される情報がバツフアメモリの記憶容量
以上になつて溢れてしまつたり(オーバフローと
称す)、あるいはバツフアメモリが空になつたり
(アンダフローと称す)することがあり、画像が
正しく再現できなくなる。
このような不都合を除去するため、従来のこの
種の方式では以下に示すような方式をとつてい
る。すなわち、前述した同期パタンの次に1ライ
ン当りのサンプル数を表わす情報を挿入して伝送
し、受信側において、検出したサンプル数情報
と、実際に復号したサンプル数が異なつていた場
合は、エラーの影響と見なして、以後の復号を一
時停止し、次の同期パタンまでのデータを無視す
る。
第1図は従来のフレーム構成の一実施例であ
る。同期パタンは“100000000001”の12ビツトで
表わし、1ライン当りのサンプル数は3ビツトで
表わしている。これらの間の“1”は装置構成を
簡単にするため、4ビツト単位で処理できるよう
にしたものである。
いま、サンプル数情報として“101”すなわち
583サンプル/ラインが復号され、一方実際に復
号したサンプル数は580個だつたとする。この時
はエラーがあつたと見なして、復号を一亘停止
し、次の同期パタンが見つかるまでのデータを無
視してしまう。
このような復号したサンプル数情報と実際に復
号したサンプル数との違いは、次のような場合に
生じる。
サンプル数情報を表わすデータ自身にエラー
が発生 画像データにエラーが発生したため、にせの
同期パタンが発生 同期パタン以前のデータにエラーが発生した
ためワード同期が乱れ復号サンプル数が狂つた ,の場合は同期パタン以前にエラーが発生
したものでワード同期も乱れているが、の場合
はワード同期は正しい状態にある。
このように従来方式では、ワード同期が乱れて
いないの場合においても1ライン分のデータを
無視してしまうため、必要以上に再現画像が劣化
する欠点があつた。
本発明はこのような欠点を除去するため、サン
プル数情報を表わすデータの符号割当てに工夫を
することによりエラーの影響を改善し、エラーに
よる画品質の劣化を軽減した符号化方式を提供す
るものである。
以下、図面を参照して本発明について詳細に説
明する。
第2図は本発明の実施例であつて、1は画像入
力端子、2はA/D変換回路、3は予測符号化回
路、4は可変長符号化回路、5は水平同期検出回
路、6はクロツク発生回路、7,23はカウン
タ、8は多重化回路、9,15はバツフアメモ
リ、10,14はデイジタルインタフエース、1
1はデータ出力端子、12はデイジタル伝送路、
13はデータ入力端子、16は同期パタン検出回
路、17はサンプル数情報検出回路、18は可変
長復号化回路、19は予測復号化回路、20は
D/A変換回路、21は画像出力端子、22はク
ロツク再生回路、24はバツフア読出し制御回路
である。
画像入力端子1より入力される信号はA/D変
換回路2においてアナログ信号からのデイジタル
信号に変換された後、予測符号化回路3におい
て、所定の予測符号化処理が施され、更に可変長
符号化回路4において、長さの異なる符号を割当
てられる。
水平同期検出回路5は入力された画像信号の水
平同期信号を検出し、その開始時点において水平
同期パタン“100000000001”を発生し、多重化回
路8に供給する。また、カウンタ7にリセツト用
信号を供給する。
クロツク発生回路6はサンプリングクロツクを
発生し、符号化のために必要な回路にそれぞれ供
給する。カウンタ7はこのサンプリングクロツク
を1ライン期間カウントし、1ライン当りのサン
プル数を表わすサンプル数情報を多重化回路8に
供給し、水平同期検出回路5から供給されるリセ
ツト用信号によりカウンタ出力をリセツトする。
多重化回路8は1ライン毎にフレームを構成し
て可変長符号化回路4、水平同期検出回路5、及
びカウンタ7の出力を多重化する。この場合のフ
レーム構成の実施例を第3図に示す。同期パタン
は12ビツトで表わし、サンプル数情報は4ビツト
で表わす。この4ビツトの内の1ビツトにエラー
が発生した場合、他のサンプル数情報として解読
されないように符号を割当てる。
多重化回路8の出力はバツフアメモリ9におい
て速度平滑された後、デイジタルインタフエース
10において伝送路上の信号形式に変換され、デ
ータ出力端子11を介してデイジタル伝送路12
に出力される。
受信側において、データ入力端子13を介して
受信されたデータはデイジタルインタフエース1
4において終端された後、バツフアメモリ15及
びクロツク再生回路22に供給される。バツフア
メモリ15において一旦記憶されたデータは同期
パタン検出回路16、サンプル数情報検出回路1
7および可変長復号化回路18により読出し速度
を制御される。読出されたデータは同期パタン検
出回路16により同期パタンが検出・分岐され、
その他のデータは通過してサンプル数情報検出回
路17に供給される。
サンプル数情報検出回路17は第3図に示した
ように同期パタン12ビツトに続く4ビツトを検出
してこれを分岐し、その他の可変長符号を可変長
復号化回路18に供給する。
可変長復号化回路18で復号化されたデータは
予測復号化回路19において所定の復号処理が施
された後、D/A変換回路20によりアナログ信
号に変換されて画像出力端子21に出力される。
一方、クロツク再生回路22は、デイジタルイ
ンタフエース14の出力を受けてサンプリングク
ロツクを再生し、カウンタ23及び復号化に必要
な各回路に供給する。
カウンタ23はクロツク再生回路22の出力を
受けて、これを1ライン期間カウントし、その結
果をバツフア読出し制御回路24に供給した後、
同期パタン検出回路16の出力によりリセツトさ
れる。
本発明の特徴であるバツフア読出し制御回路2
4はサンプル数情報検出回路17の出力とカウン
タ23の出力を比較し、両者が一致した場合は正
常に復号し、不一致の場合には可変長復号化回路
18からのバツフアメモリ読出し制御を禁止し、
同期パタン検出回路16を制御して次の同期パタ
ンを解読させる。又、可変長復号化回路18を制
御して、次の同期パタンが見つかるまでの間復号
を停止する。また、サンプル数情報検出回路17
の出力がエラーのため第3図に示したパタンとは
異つたあり得ないパタンあるいは“1111”を表わ
している時は、上述したバツフアメモリ15、同
期パタン検出回路16および可変長復号化回路1
8の制御は禁止する。
なお、以上の実施例の説明においては、同期パ
タン検出回路16、サンプル数情報検出回路1
7、および可変長復号化回路18を直列的に並べ
て構成する方法について述べたが、これらを並列
的に並べて構成して実施し得ることは明らかであ
る。
以上説明したように、本発明はサンプル数情報
に対する符号割当てをこの情報内の1ビツトエラ
ーが検出できるように行い、この部分でエラーが
検出された場合、バツフアメモリ読出し制御を禁
止するように構成したので、伝送エラーによる画
品質劣化を軽減できる利点がある。
【図面の簡単な説明】
第1図は従来のフレーム構成の一例、第2図は
本発明の実施例、第3図は本発明におけるフレー
ム構成の一例である。 1……画像入力端子、2……A/D変換回路、
3……予測符号化回路、4……可変長符号化回
路、5……水平同期検出回路、6……クロツク発
生回路、7,23……カウンタ、8……多重化回
路、9,15……バツフアメモリ、10,14…
…デイジタルインタフエース、11……データ出
力端子、12……デイジタル伝送路、13……デ
ータ入力端子、16……同期パタン検出回路、1
7……サンプル数情報検出回路、18……可変長
復号化回路、19……予測復号化回路、20……
D/A変換回路、21……画像出力端子、22…
…クロツク再生回路、24……バツフア読出し制
御回路。

Claims (1)

  1. 【特許請求の範囲】 1 送信側が、 入力画像信号を所定の符号化アルゴリズムに基
    づいて符号化する符号化回路、この符号化出力に
    対して可変長符号を割当てる可変長符号化回路、
    入力画像信号における水平同期信号を検出し、映
    像ラインの先頭を表わす同期パタン信号を発生す
    る水平同期検出回路、1ライン当りのサンプル数
    をカウントして、サンプル数情報を出力するカウ
    ンタ、当該カウンタ、前記水平同期検出回路、及
    び前記符号化回路の出力を時分割多重する多重化
    回路、当該多重化回路の出力を速度平滑して一定
    の速度で送出するバツフアメモリを含み、 受信側が、 受信したデータを一時記憶し、記憶した受信デ
    ータを復号化速度に応じて読出すバツフアメモ
    リ、当該バツフアメモリから出力された受信デー
    タ中の同期パタンを検出する同期パタン検出回
    路、前記受信データ中のサンプル数情報を検出す
    るサンプル数情報検出回路、前記受信データ中の
    可変長符号を復号化する可変長復号化回路、当該
    可変長復号化回路の出力を受けて所定の復号化ア
    ルゴリズムに基づいて画像を再現する復号化回
    路、受信側で再生された標本化クロツクを用いて
    1ライン当りのサンプル数をカウントするカウン
    タ、当該カウンタ出力と前記サンプル数情報検出
    回路との出力とを比較し、両者が一致しない時バ
    ツフアメモリの読出しを制御するバツフア読出し
    制御回路を含む画像符号化装置において、 前記サンプル数情報に対する符号割当てをこの
    情報内の1ビツトエラーが検出できるように行
    い、この部分でエラーが検出された場合、前記バ
    ツフア読出し制御回路からのバツフアメモリ読出
    し制御を禁止することを特徴とする画像符号化方
    式。
JP19460782A 1982-11-08 1982-11-08 画像符号化方式 Granted JPS5985194A (ja)

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JPS5985194A JPS5985194A (ja) 1984-05-17
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WO2020122184A1 (ja) * 2018-12-14 2020-06-18 株式会社リクルート 順番管理システム、順番管理装置、およびプログラム

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Publication number Priority date Publication date Assignee Title
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WO2020122184A1 (ja) * 2018-12-14 2020-06-18 株式会社リクルート 順番管理システム、順番管理装置、およびプログラム

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