JPS6447167U - - Google Patents

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JPS6447167U
JPS6447167U JP14283587U JP14283587U JPS6447167U JP S6447167 U JPS6447167 U JP S6447167U JP 14283587 U JP14283587 U JP 14283587U JP 14283587 U JP14283587 U JP 14283587U JP S6447167 U JPS6447167 U JP S6447167U
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JP
Japan
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synchronization signal
polarity
inverter
gate
flip
Prior art date
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JP14283587U
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  • Synchronizing For Television (AREA)

Description

【図面の簡単な説明】
第1図は、本考案の同期極性合わせ回路のブロ
ツク図、第2図は、同上ブロツク図の各部におけ
る信号波形を示す図、第3図は、従来の同期極性
合わせ回路図である。 2……反転用インバーター、3……遅延用イン
バーター、4……ANDゲート、5……アツプカ
ウンター、6……フリツプフロツプ回路、7……
Ex−ORゲート。

Claims (1)

    【実用新案登録請求の範囲】
  1. 水平又は垂直同期信号の極性を反転せしめるイ
    ンバーターと、該インバーターによつて極性を反
    転せしめた反転同期信号を適宜遅延せしめるイン
    バーターと、前記入力同期信号に対する遅延同期
    信号からエツジを検出するANDゲートと、該A
    NDゲートからのパルスをトリガーとしてカウン
    トを開始せしめるカウンターと、該カウンターか
    らの出力並びに入力同期信号によつて極性を安定
    保持せしめるフリツプフロツプ回路と、該フリツ
    プフロツプ回路からの出力と前記入力同期信号と
    から同期信号の出力極性を常に一定に保つための
    Ex−ORゲートとからなることを特徴とするブ
    ラウン管デイスプレーモニターにおける同期極性
    合わせ回路。
JP14283587U 1987-09-17 1987-09-17 Pending JPS6447167U (ja)

Priority Applications (1)

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JP14283587U JPS6447167U (ja) 1987-09-17 1987-09-17

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JP14283587U JPS6447167U (ja) 1987-09-17 1987-09-17

Publications (1)

Publication Number Publication Date
JPS6447167U true JPS6447167U (ja) 1989-03-23

Family

ID=31409118

Family Applications (1)

Application Number Title Priority Date Filing Date
JP14283587U Pending JPS6447167U (ja) 1987-09-17 1987-09-17

Country Status (1)

Country Link
JP (1) JPS6447167U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7432985B2 (en) 2003-03-26 2008-10-07 Canon Kabushiki Kaisha Image processing method

Cited By (1)

* Cited by examiner, † Cited by third party
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