BE1000206A6 - Procede pour l'echange de tranches de temps a multiplets de zeros. - Google Patents

Procede pour l'echange de tranches de temps a multiplets de zeros. Download PDF

Info

Publication number
BE1000206A6
BE1000206A6 BE8701451A BE8701451A BE1000206A6 BE 1000206 A6 BE1000206 A6 BE 1000206A6 BE 8701451 A BE8701451 A BE 8701451A BE 8701451 A BE8701451 A BE 8701451A BE 1000206 A6 BE1000206 A6 BE 1000206A6
Authority
BE
Belgium
Prior art keywords
byte
zeros
test
sequences
group
Prior art date
Application number
BE8701451A
Other languages
English (en)
Inventor
Steve Gorshe
Original Assignee
Gte Comm Systems Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Gte Comm Systems Corp filed Critical Gte Comm Systems Corp
Application granted granted Critical
Publication of BE1000206A6 publication Critical patent/BE1000206A6/fr

Links

Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04J—MULTIPLEX COMMUNICATION
    • H04J3/00—Time-division multiplex systems
    • H04J3/02—Details
    • H04J3/04—Distributors combined with modulators or demodulators
    • H04J3/047—Distributors with transistors or integrated circuits
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00—Arrangements for synchronising receiver with transmitter
    • H04L7/0079—Receiver details
    • H04L7/0083—Receiver details taking measures against momentary loss of synchronisation, e.g. inhibiting the synchronisation, using idle words or using redundant clocks

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Communication Control (AREA)

Abstract

Le procédé est un schéma en vue de supprimer des quantités excessives de zéros logiques transmis via des installations de lignes supports T entre des systèmes de commutation ou des groupes de canaux. Ce schéma assure une suppression appropriée de bits de zéros en vue de signaler une inversion alternée de marque (AMI). Ce schéma assure l'encodage et le décodage d'un groupe d'octets à 4 séquences d'une superséquence étendue. Des ''uns'' logiques sont introduits dans des octets qui, dans d'autres conditions, violeraient les règles de signalisation AMI. Ces ''uns'' logiques sont ensuite éliminés par le système récepteur et ils sont remplacés par les octets indiqués ne comportant que des zéros avant d'etre acheminés au traitement suivant. Ce schéma assure un tamponnage minimum au système d'encodage, ce qui facilite la détection des erreurs et la correction par le système de décodage.

Description


   <Desc/Clms Page number 1> 
 



  Procédé pour l'échange de tranches de temps ä multiplets de zéros. 



  Fondement de l'invention 
La présente invention concerne le trans- fert de données entre des systèmes de commutation et de transmission et, plus particulièrement, une structure de lignes pour   l'rechange   de tranches de temps   ä   multiplets de zéros répondant aux condi- tions requises pour la suppression des zéros de lignes Tl. 



   Les installations de lignes de transmission
Tl fonctionnent ä 1, 544M bit par seconde. Dans les installations de transmission de lignes Tl, on utilise un schéma de signalisation d'inversion alternative de marques   (AMI). Ce si nalAMI ne contient   pas plus de 15 positions de bits zéros consécutifs dans un train de bits Tl particulier. Cette condi- tion selon laquelle on ne doit pas avoir plus de
15 bits zéros dans une chaine binaire résulte de la mise en service de répéteurs dans des systemes de lignes de transmission Tl. Les répéteurs habi- tuellement utilisés ne peuvent fonctionner dans les normes de cette spécification si plus de 15 zéros consécutifs sont transmis. La synchronisation des répéteurs ne peut être garantie pour des trains de bits comportant plus de 15 zéros consécutifs. 



   Une technique adoptée pour la suppression de bits 0 de lignes Tl est une substitution bipolaire avec 8 zeros (B8ZS). La technique B8ZS fait 

 <Desc/Clms Page number 2> 

 appel à deux configurations spéciales de codage contenant des violations bipolaires qui sont substituées aux   chaises   binaires de 8 zéros dans le train de signaux d'entrée. Lors de la detection de violations bipolaires avec l'une ou l'autre des deux configurations spéciales, le récepteur place 8 bits de zéros dans les positions correspondantes dans le train de bits de sortie. 



   Un inconvénient technique de la technique B8ZS réside dans le fait qu'elle viole la norme de signalisation AMI sur les lignes Tl. Etant donné que des violations bipolaires indiquent normalement des erreurs de transmission, l'introduction délibérée de ces erreurs de transmission par la signalisation   B8ZS   réduit l'efficacité de la determination d'erreurs reelles qui sont détectées par le schéma de signalisation AMI. Un autre incon-   venaient   de la technique B8ZS reside dans le fait qu'elle détecte des chalnes binaires de 8 zeros et qu'elle substitue les configurations spéciales de violations plus fréquement que ne l'exige la mise en service spécifiée des lignes Tl.

   Outre ces inconvénients, les configurations B8ZS ne se propageront pas ä travers les installations Tl protégées ou les installations DS1 dérivant de multiplexeurs normalisés. 



   On se heurte   ä   de sérieux inconvénients économiques pour l'introduction de la technique B8ZS dans le réseau de transmission de l'Amérique du Nord. Cette introduction nécessiterait un remplacement global des multiplexeurs existants, des commutateurs automatiques de protection, des dispositifs électroniques   =.   de montage croise   (DACS), un materiel   de connexion de commutateurs numériques et tout autre element du réseau avec controle et élimination 

 <Desc/Clms Page number 3> 

 des viölations   (\MR).   Une telle introduction de la technique B8ZS implique d'importants investissements déraisonnables pour modifier le matériel du réseau. 



  Sommaire de   l'inventiön  
Un système de transmission de données comprend un premier et un second système de commutation numériques. Ces systemes de commutation sont raccordés via des installations de lignes supports T pour la transmission bidirectionnelle de données. Chacun des systèmes de commutation implique une méthode pour l'échange de tranches de temps   a   multiplets de zéros (ZBTSI). 



   En premier lieu, la methode d'échange de tranches de temps ä multiplets de zeros examine 
 EMI3.1 
 un octet (quantité 8 bits) d'un . e de sgquences :de données. Ensuite, selon cette méthode, on vérifie cet octet afin de determiner s'il est un octet ne comportant que des zéros. Un octet ne comportant que des zéros est un octet dans lequel 8 bits de zéros en constituent la teneur. 



   Si un octet ne comportant que des zéros est   détecté.   l'adresse de cet octet est placée dans le contenu de cette position d'octet ne comportant que des zeros. On procède ä un autre essai afin de déterminer si l'octet détecté ne comportant que des zéros est un premier octet ne comportant que des zéros choisi'parmi le groupe de séquences. 



  Si cet octet est un premier octet détecté ne comportant que des zéros parmi le groupe de séquences, un bit indicateur de premier octet ne comportant que des zéros est positionné dans le contenu de l'octet actuel ne comportant que des zéros. Enfin, chacune des étapes mentionnées ci-dessus est répétée   jusqu'ä ce   que chacun des octets du groupe de séquences de donnees ait été examiné pour une teneur 

 <Desc/Clms Page number 4> 

 
 EMI4.1 
 en zeros. 



  Brève description des dessins
La figure 1 est un traci de. structure spécifique de données de séouences T1. la figure 2 est un schéma bloc de systèmes de télécommunications interconnects ; les figures 3A et 3B illustrent un train de donnees à 96 canaux respectivement avant et après l'application du procédé d'échange de tranches de temps à multiplets de zéros ; la figure 4 est un schéma logique du procédé d'encodage. 



  Description de la forme de   réalisation     préférée  
La configuration de la structure de lignes T1 est basée sur la structure normalisée de signaux numériques DS1 à 1,544M bit par seconde. Cette configuration est illustrée en figure 1. La séquence DS1 contient 193 bits    d'1nformations.. Ces   informations sont organisées en un seul bit de synchronisation ou de données de mise en séquence plus 192 bits de données de charge utile. Les 192 bits de données de charge utile sont organisés en 24 canaux, chaque canal contenant 8 bits et 
 EMI4.2 
 pouvant être appelé 
Dans la signalisation DS1, le bit de poids faible, PCM 7, de chaque octet de chaque sixième sequence est'habituellement utilise comme bit de signalisation vole ou dérobé pour indiquer les états de signalisation des canaux actifs. 



  Ces bits de signalisation sont transmis   ä   raison de 24 bits par 6 séquences ou de 4 bits par sequence. 



   Chaque canal (octet) est constitue de 8 bits, PCMO-PCM7. PCMO est un bit de signe. 



  Les bits PCM1-PCM7 donnent l'amplitude de   1'6chan-   tillon vocal. Le bit PCM1 peut également   entre   

 <Desc/Clms Page number 5> 

 utilise pour acheminer des indications   d'alarme.   



  Le bit PCM7 est utilisé pour acheminer des informations de supervision au cours des sequences 6 et 12. 



   Vingt-quatre canaux sont organisés ensemble avec un bit S pour former une séquence. Chaque échantillon vocal de la séquence est associé à un canal de conversation (ou de données). Les canaux sont   numérotés   de 0   ä   23. Le bit S achemine une configuration périodique qui, lorsqu'elle est détectée, est utilisée pour identifier le début de chaque séquence de données. Douze séquences de données sont organisées pour former une "superséquence". Au cours des séquences 6 et 12 de la superséquence, le bit PCM7 est utilisé pour acheminer des informations de supervision associées à chacun des 24 canaux. La configuration periodique de données, qui est acheminee par le bit S, permet également d'identifier les sequences individuelles 
 EMI5.1 
 d'une superséquence. 



   La configuration acheminée par le bit S est la suivante (le premier bit est associé la séquence 0) : "100011011100". On peut constater qu'au cours des séquences impaires, le bit S forme une configuration alternee de "1" et de "0", c'est- à-dire "101010". Cette configuration alternée est appelée "configuration TS" et elle est utilisée pour identifier la position de départ des séquences. 



  Au cours des sequences paires, le bit S achemine la   configuration 1100111011 dans   laquelle le premier "1" indique le début de la séquence 6. Cette configuration est appelée"configuration FS"et elle 
 EMI5.2 
 est utilisée pour identifier la position occupée ä l'interieur 

 <Desc/Clms Page number 6> 

 d'une supersequence.L'examen de bits FS est un procédé analogue à celui des bits TS, avec cette exception que 1'on ne procède   ä   aucune vérification pour les bits FS apparaissant au cours des séquences 2 et 8. 



   En figure 2, le système 1 est raccordé au système 2. Le systeme 1 qui peut être un système de commutation de télécommunications ou un ensemble de canaux, est raccorde ä un multiplexeur 3. Cette connexion est effectuée par une ligne de transmission faisant appel à une transmission   Tl   ou DS1. 



  La vitesse de transmission d'une ligne de trans- 
 EMI6.1 
 mission Tl ou DS1 est de 1, par seconde. 



  De   theme,   comme le montre cette figure, le système 2 est raccordé, via une autre ligne de transmission DS1, à un mutiplexeur 4. Les multiplexeurs 3 et 4 peuvent être raccordés via une ligne de transmission à grande vitesse telle qu'une ligne de transmission DS3. La ligne de transmission DS3 transmet des données à peu près   ä   raison de 45   mégabits   par seconde. 



   La superséquence normalisée du type représenté en figure 1   contient 12 sequenees   d'informations. Pour cette méthode, on suppose que l'on emploiera une   supersequence   étendue. 



  Cette   supersequence   étendue comprend 24 séquences d'informations. 



   Afin d'obtenir des multiplexeurs tels que les multiplexeurs 3 et 4, ainsi que des répéteurs comportant la densité correcte de données   de "uns" ("1" logique)   sur la ligne de transmission, il convient que la condition ci-après soit remplie. 



  Au maximum, 15 bits consécutifs de zéros peuvent apparaitre dans une chaîne de donnees transmise. 



   Le procédé d'échange de tranches de temps 

 <Desc/Clms Page number 7> 

   ä   multiplets de zéros de la présente invention (ZBTSI) permet d'indiquer, pour chaque groupe de quatre séquences (ou 96 octets), les violations de   l'une   ou l'autre des conditions mentionnées ci-dessus. Par exemple, si le système 1 transmettait des informations au système 2, la logique du système 1 structurerait un groupe particulier de quatre sequences de la maniere décrite par ce procédé. Ce groupe de quatre séquences de données serait transmis au Systeme 2 via des multiplexeurs 3 et 4.

   Etant donné que les multiplexeurs 3 et 4 et n'importe quel circuit intermédiaire de répéteur (non représenté) sont des équipements normalisés disponibles dans le commerce, le procédé ZBTSI fournirait la densité appropriée   de"un"   en inhibant la production de tout octet de zéros violant la règle des zéros consécutifs sans modifier tout equipement de transmission   dejä   en place. 



  Les données nouvellement structurées seraient transparentes pour tous les multiplexeurs et répéteurs, étant donné qu'elles auraient la densité appropriée de "uns". A la reception des quatre séquences d'informations, le systeme 2 tamponnerait les 96 octets et selon cette methode, il reconstruirait n'importe quel octet ne comportant que des zéros. 



   Un octet   nè   comportant que des zéros viole la règle mentionnée ci-dessus et est appelé "octet ne comportant que des zéros" (AZO). La   supersequence   étendue est constituée de 24 séquences. A l'intérieur de cette superséquence, les bits de mise en séquence (TS ou FS) des séquences   4, 8,   12, 16 et 24 fournissent la configuration de mise en séquence. Les bits de mise en séquence des sequences 2,6, 10, 14,18 et 22 fournissent les bits de code CRC6. Les bits de mise en séquence 

 <Desc/Clms Page number 8> 

 
 EMI8.1 
 t des séquences l, 5, 9, 13, 17 et 21 sont utilises pour fournir les indications de traitement d'échange de tranches de temps a multiplets de zéros confor- miment ä cette méthode. 



   Ces bits indicateurs de traitement (bits de mise en séquence) sont positionnés   ä   un 1 logi- que si aucun traitement d'échange de tranches de temps à multiplets de zéros n'est requis au cours de l'intervalle de quatre séquences.. En revanche, ces bits indicateurs de traitement sont positionnes ä un 0 logique si cette méthode a été utilisée pour modifier l'une ou l'autre donnée AZO avant la transmission via le système. 



   Ce procédé d'échange de tranches de temps   ä   multiplets de zéros ne nécessite qu'une tempori- sation de 2 octets dans le système d'encodage et une temporisation de 96 octets dans le   Systeme   de décodage. Un octet supplémentaire de temporisa- tion de"uns"est ajoute aux deux systèmes afin d'examiner des octets adjacents. Afin qu'un emplacement d'octet donné soit marque par ce procédé comme AZO, cet octet doit avoir été un octet de zéros. Le tamponnement au décodeur constitue un procédé dans lequel une détection et une correction d'erreurs ont lieu plus aisément qu'un tamponnage du type effectué à l'encodeur. 



   Dans les figures 3A et 3B, on représente des chaines de données d'essai. La. figure 3A illustre un groupe de quatre séquences d'octets transmis initialement sans utiliser le procédé d'échange de tranches de temps à multiplets de zeros. Cette chaine initiale de données comprend plusieurs octets qui sont des AZO. Ces octets portent les numéros 1, 2, 3,25, 60,61, 62, 72, 73 et 84. Les numéros d'octets sont indiqués et 

 <Desc/Clms Page number 9> 

 leurs contenus respectifs sont indiques en dessous (entre les signes
La figure 3B illustre la chaine de données   ä   4 séquences obtenue suite ä l'application du procédé ZBTSI au train initial de données de la figure 3A. 



   En figure 3B, plusieurs notations et marquages sont indiqués en dessous de la ligne   representant   les bits de données. Ces marquages ont les significations suivantes. Le premier groupe de marquages comprend un numéro suivi d'un Y ou d'un N indiquant le contenu d'un octet particulier. 



  La partie numérique de cet   ment   indicateur est l'adresse qui est renfermée dans le contenu de l'octet auquel est attribué   l'element indicateur.   



  Cette adresse est contenue dans les bits PCM7 & PCM1. Le huitième bit ou PCMO indique l'élément indicateur du dernier bit ne comportant que des zéros pour le groupe de 4 séquences. 



   La. lettre Y ou N indique si le dernier bit ne comportant que des zéros est positionné ou non. Un Y indique que le bit est positionne avec un 1 logique et un N indique qu'¯il est remis à zéro avec un 0 logique. 



     L'autre element   indicateur de la figure 3B est constitue d'un   OV   suivi   dedeuxsignations   numériques.   OV   indique un decalage sur chacun des octets dans l'intervalle des deux chiffres qui suivent   OV.   Par-exemple, en figure 3B, OV 4-24 indique que les octets 4 à 24 sont   décalés ¯   vers le bas ou vers la gauche d'une position d'octet. 



  En outre, le bit de mise en séquence F5 est entouré d'un cercle, indiquant ainsi qu'il y a des octets ne comportant que des zéros dans le groupe de 4 séquences et que ce bit de mise en séquence est 

 <Desc/Clms Page number 10> 

 positionné pour indiquer qu'il en est ainsi. 



   Le procédé ZBTSI est représenté en. figure 4. Lorsque le système de transmission comporte la chalne de quatre sequences de données comme représenté en figure 3A, la logique du système effectue alors le procédé ZBTSI en passant   ä   la case 402. Dans la case 402, l'octet suivant de données est examiné. Dans ce cas, le procédé démarre avec l'octet   no 1.   Ensuite, intervient la case 404. Dans la case 404, il est déterminé si l'octet est un octet ne comportant que des zéros.(AZO). Si cet octet ne comporte pas uniquement des zéros, le parcours N est alors suivi et la case 402 intervient pour examiner l'octet suivant. Si cet octet est un octet ne comportant que des zeros, comme c'est le cas pour l'octet   1,   le traitement se poursuit et la case 406 intervient via le parcours Y venant de la case 404. 



   Dans la case 406, il est déterminé si l'octet suivant est un octet ne   comportant   que des zéros (AZO). Par exemple, étant donné que l'octet   nU 2   est un octet ne comportant que des zeros, il sera repondu à cette question par l'affirmative et le contr81e serait transféré ä la case 408 via le parcours Y. Dans la case 408, l'adresse de cet octet ne comportant que des zéros (octet   n"l) est placée   dans le contenu de ce dernier (octet   n      1),   ce qui signifie que l'adresse du premier octet ne comportant que des zéros que l'on rencontre (octet   1)     sera flache dans   le contenu de   l'octet l.

   Etant donne   que toutes les adresses   d'octets 1 à 96   comportent au moins un 1 logique, le contenu de ces octets comportant leur adresse propre ne sera pas un octet ne comportant que 

 <Desc/Clms Page number 11> 

 
 EMI11.1 
 des zéros. En conséquence, l'octet contiendra l'adresse 1 en bits PCM 1 ä 7 et i1 ne violera pas les règles de transmission AMI. 



   Si l'octet suivant n'est pas un octet ne comportant que des zéros, la case 406 transférera 
 EMI11.2 
 le contr8le a la case 410 via le parcours N. 



  La case 410 elimine l'octet ne comportant que des zeros et elle ducale tous les'octets restants vers le bas ou vers la gauche d'une position d'octet. La case 412 positionne alors un indicateur interne pour un dernier octet ne comportant que des zéros dans une chaine et il sauvegarde l'adresse correspondante de cet octet ne comportant que des zéros. La case 412 transférera alors le contrôle ä la case 414. 



   Lorsque le bloc 408 a place l'adresse 
 EMI11.3 
 d'un AZO dans le contenu de l'AZO particulier, il transférera le contr8le a la case 414. Cette case 414 détermine si cet octet particulier est le premier AZO dans la chaîne de données ä quatre séquences S'il question par est repondu à cettel'affirmative, la case 414 transfère le contrôle ä la case 416 via le parcours    Y.   La case 416 place l'adresse de cet AZO dans le contenu de celui-ci et il positionne également l'indicateur   FAZOI.   



   L'indicateurFAZOI estl'indicateurdu 
 EMI11.4 
 p t ne or-ta. r e mi e r o c t eq u e d e s z é r o s . L'indicateur FAZOI est placé dans le bit PCMO. La localisation de ce bit indique que l'octet particulier pour lequel l'indicateur est positionné, est le premier octet ne comportant que des zéros du groupe de quatre séquences et que le système de décodage peut   l'iden-   

 <Desc/Clms Page number 12> 

 tifier'comme dernier AZO   ä   traiter dans le groupe de quatre sequences. 



   La case 416 transfère le   controle     ä   la case 418. Si la case 414 détermine que cet AZO n'était pas le premier octet ne comportant que des zéros parmi le groupe de quatre sequences, le contrôle est transféré ä la case 418 via le parcours N. 



   La case 418 determine si l'indicateur interne du dernier octet ne comportant que des zéros est positionné. Si cet indicateur interne est   positionne, le controle   est transféré de la case 418 ä la case 420 via le parcours Y. La case 420 place l'adresse de l'octet précédent ne comportant que des zéros dans le contenu de ce dernier. 



  Par exemple, étant donné qu'en figure 3B, l'octet n  3 est le dernier octet ne comportant que des zéros parmi la serie de tous les octets ne comportant que des zéros   (1,   2 et 3), l'adresse de l'octet 3 est placée dans le contenu de l'octet   nO 25.   



  11 est   ä   noter que le contenu de l'octet 25 apparaît alors dans la position d'octet 24 étant donné que l'octet n  3 a été éliminé et que tous les autres octets suivants ont été décalés vers le bas d'une position   d'octet.   La case 420 transfère alors le   controle     ä   la case 422. 



   Si l'indicateur interne du dernier octet ne comportant que des zeros   n'est   pas positionné, la case 418 transfère le contr81e   ä   la case 422. 



  La case 422 determine si tous les octets du groupe de 4 sequences ont été examines. Si tous les octets   n'ont   pas été examinés, le parcours N est suivi   ä   partir de la case 422 et le contrôle est transféré ä la case 402 où l'octet suivant est examine. 



  Si le dernier octet du groupe de 4 séquences a été 

 <Desc/Clms Page number 13> 

 
 EMI13.1 
 examine, le contrôle passe de la case 422 à la case 424. Ensuite, la case 424 transmet les données et met ensuite un terme au processus d'rechange I de tranches de temps à Cette méthode peut être mise en oeuvre multiplets da zéros.à l'intervention d'une microprogrammation contenue dans un processeur à signaux numériques. On peut utiliser un processeur   ä   signaux numériques   "Fujitsu",   n  MB-8764-DSP. 



   Bien que l'on ait illustre la forme de réalisation préférée de l'invention et que cette forme de réalisation ait été décrite en détail, l'homme de métier comprendra aisément que diverses modifications peuvent y être apportées sans se départir de l'esprit de l'invention ou du cadre des revendications ci-apres.

Claims (9)

  1. REVENDICATIONS 1. Système de transmission de données comportant un premier et un second système de commutation numériques raccordes via des installations de lignes supports T pour la transmission bidirec- EMI14.1 tionnelle de données, de ces systemes de commutation de ce procede & examiner un octet (8 bits) d'un"groupe séquences de donnés soumettre cet octet à un premier essai en vue de déterminer s'il s'agit d'un octet ne comportant que des zéros, ce dernier étant un octet contenant 8 bits de zeros ; placer tout d'abord une adresse correspondante de cet octet détecté ne comportant que des zéros dans un contenu de cette position d'octet ne comportant que des zeros ;
    soumettre cet octet détecté ne comportant que des zéros à un second essai en vue de determiner un état de premier octet ne comportant que des zéros parmi le groupe de sequences ; positionner tout d'abord un indicateur de premier octet ne comportant que des zéros dans le premier octet détecté ne comportant que des zéros afin d'indiquer le premier octet ne comportant que des zéros parmi le groupe de séquences, ce positionnement étant effectué en réponse au premier octet détecté ne comportant que des zeros ; et répéter les étapes consistant à examiner, effectuer un premier essai, effectuer un premier placement, effectuer un second essai et effectuer <Desc/Clms Page number 15> un premier positionnement pour chacun des octets de ce groupe de sequences.
  2. 2. Procédé ZBTSI selon la revendication 1, caractérisé en ce qu'il comprend, en outre, 1 étape consistant à soumettre un octet suivant à un troisième essai en vue de déterminer un état d'octet ne comportant que des zeros. ce troisième essai étant effectué en réponse à la détection de cet octet ne comportant que des zeros suite val l'étampe consistant ä effectuer un premier essai.
  3. 3. Procédé ZBTSI selon la revendication EMI15.1 2, l'sstape L me essai consistant ä : éliminer, du groupe de séquences, l'octet suivant ne comportant que des zéros ; et décaler tous les octets restants du groupe de séquences dans la direction de cet octet éliminé ne comportant que des zéros, tout en maintenant une position relative de ces octets restants entre eux.
  4. 4. Procédé ZBTSI selon la revendication EMI15.2 3, l'étape du troisième".. essai consistant, en outre, effectuer un deuxième positionnement d'un indicateur interne indiquant que l'octet éliminé ne comportant que des zéros est un dernier octet. ne comportant que des zeros choisi parmi un groupe faisant partie du groupe de sequences ; sauvegarder une adresse correspondant a cet octet élimine ne comportant que des zéros et procéder au deuxième. essai.
  5. 5. procédé ZBTSI selon. la revendication 4, caractérisE en ce qu'il comprend, en outre, l'etape consistant ä effectuer un quatrième essai <Desc/Clms Page number 16> en vue de déterminer si l'indicateur du dernier octet ne comportant que des zéros est positionne.
  6. 6. Procédé ZBTSI selon la revendication 5. l'étape du quatrième essai consistant à effectuer un deuxième placement de l'adresse sauvegardée de l'octet éliminé ne comportant que des zéros dans le contenu d'un octet actuel ne comportant que des zeros, cette étape de second placement etant effectuée en réponse ä une detection de l'état positionne de l'indicateur du dernier octet ne comportant que des zéros.
  7. 7. Procédé ZBTSI selon la revendication 6, caractérisé en ce qu'il comprend, en outre, l'étape consistant ä transmettre les données contenues dans le groupe de séquences.
  8. 8. Procédé ZBTSI selon la revendication 7, l'étape du premier positionnement consistant effectuer un troisième placement d'une adresse d'un octet actuel ne comportant que des zéros dans le contenu de ce dernier, cette étape de troisieme placement étant effectuée en réponse ä une détection de l'étant du premier octet ne comportant que des zeros.
  9. 9. Procédé ZBTSI selon la revendication 8, caractérisé en ce qu'il comprend, en outre, l'étape consistant ä effectuer un troisième posi- tionnement d'un indicateur de bits de mise en séquence en réponse à une détection d'au moins un octet ne comportant que des zéros.
BE8701451A 1986-12-22 1987-12-17 Procede pour l'echange de tranches de temps a multiplets de zeros. BE1000206A6 (fr)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
US06/944,090 US4757500A (en) 1986-12-22 1986-12-22 Method for zero byte time slot interchange

Publications (1)

Publication Number Publication Date
BE1000206A6 true BE1000206A6 (fr) 1988-08-23

Family

ID=25480772

Family Applications (1)

Application Number Title Priority Date Filing Date
BE8701451A BE1000206A6 (fr) 1986-12-22 1987-12-17 Procede pour l'echange de tranches de temps a multiplets de zeros.

Country Status (4)

Country Link
US (1) US4757500A (fr)
BE (1) BE1000206A6 (fr)
CA (1) CA1281108C (fr)
IT (1) IT1223247B (fr)

Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5051988A (en) * 1988-11-02 1991-09-24 Mitsubishi Denki Kabushiki Kaisha Transmission line encoding/decoding system
US5404355A (en) * 1992-10-05 1995-04-04 Ericsson Ge Mobile Communications, Inc. Method for transmitting broadcast information in a digital control channel
DE4409157C1 (de) * 1994-03-17 1995-02-23 Ant Nachrichtentech Verfahren und Multiplexer zum Zusammenfassen sowie Verfahren und Demultiplexer zum Auftrennen einer Mehrzahl von digitalisierten Daten
US5687176A (en) * 1995-06-09 1997-11-11 Hubbell Incorporated Zero byte substitution method and apparatus for telecommunications equipment

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS536546A (en) * 1976-07-07 1978-01-21 Fujitsu Ltd Information transfer system
IT1212437B (it) * 1980-06-30 1989-11-22 Sits Soc It Telecom Siemens Circuito di trasmissione per sistemi pcm.

Also Published As

Publication number Publication date
CA1281108C (fr) 1991-03-05
IT1223247B (it) 1990-09-19
US4757500A (en) 1988-07-12
IT8722931A0 (it) 1987-12-10

Similar Documents

Publication Publication Date Title
CA1220866A (fr) Methode et dispositif d&#39;interface
US5172376A (en) Sdh rejustification
BE1000207A6 (fr) Procede pour l&#39;echange de tranches de temps a multiplets de zeros.
US5553103A (en) Circuit including a subtractor, an adder, and first and second clocked registers connected in series
US4750167A (en) Digital audio transmission system
CN1017859B (zh) 同步数字多级网络传输分系统单元链宽带数字信号的方法
US4398290A (en) Process and apparatus for digital data communication using packet switching
EP0669732A2 (fr) Procédé et dispositif pour dériver une différence de phase et un circuit de filtrage numérique
BE1000230A6 (fr) Procede pour l&#39;echange de tranches de temps a multiplets de zeros.
EP0405577A2 (fr) Circuit de conversion de trame
EP0229738B1 (fr) Procédé et dispositif de régénération de l&#39;intégrité du débit binaire dans un réseau plésiochrone
US4888768A (en) Frame format for video codec
GB1336542A (en) System for tranferring information
US4757500A (en) Method for zero byte time slot interchange
EP0196979A1 (fr) Procédé et dispositif d&#39;insertion d&#39;un signal numérique sur une voie à débit plus élevé
US6198755B1 (en) Time multiplexing/demultiplexing method
EP0642242B1 (fr) Méthode de transmission de données, émetteur et récepteur à ambiguité réduite
CA2312039A1 (fr) Procede de construction d&#39;une trame de signal numerique, et station de base de radiocommunication mettant en oeuvre un tel procede
CA2040671C (fr) Transmission serie a auto-synchronisation de bits de signalisation dans un commutateur numerique
WO1984003598A1 (fr) Procede et dispositifs de transcodage d&#39;informations binaires pour transmission multiplexe temporelle
EP0231202A1 (fr) Agencement de circuit permettant l&#39;alignement, les uns par rapport aux autres, de groupes mic entrant en un point de branchement de communication
JPH0738628B2 (ja) データ多重化装置および多重化データ分離装置
BE880776A (fr) Reseau de commutation numerique a division du temps bit a bit
JPS6012837A (ja) デ−タ伝送方式
JPH0193227A (ja) シグナリング挿入回路

Legal Events

Date Code Title Description
RE Patent lapsed

Owner name: GTE COMMUNICATION SYSTEMS CORP.

Effective date: 19901231