JP2000077417A - 半導体素子の配線形成方法 - Google Patents
半導体素子の配線形成方法Info
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- Electrodes Of Semiconductors (AREA)
Abstract
(57)【要約】
【課題】障壁金属層に残留したフッ素を除去することに
より、信頼性及び量産性を向上し得る半導体素子の配線
形成方法を提供する。 【解決手段】不純物領域１１を有する半導体基板１０の
上面に第１絶縁層２０を形成する工程と、不純物領域１
１の上面にある第１絶縁層２０を、不純物領域１１の上
面の一部が露出するように除去して第１コンタクトホー
ル２１を形成する工程と、第１コンタクトホール２１の
内側面と第１絶縁層２０の上面に第１障壁金属層３０を
形成する工程と、第１障壁金属層３０の上面に第１金属
層４０を形成する工程と、第１金属層４０の一部を除去
して、第１コンタクトホール２１に第１金属層プラグ４
１を形成する工程と、露出した第１障壁金属層３０に水
素プラズマ処理と窒素プラズマ処理を施す工程と、を順
次行い、半導体素子の配線を形成する。
より、信頼性及び量産性を向上し得る半導体素子の配線
形成方法を提供する。 【解決手段】不純物領域１１を有する半導体基板１０の
上面に第１絶縁層２０を形成する工程と、不純物領域１
１の上面にある第１絶縁層２０を、不純物領域１１の上
面の一部が露出するように除去して第１コンタクトホー
ル２１を形成する工程と、第１コンタクトホール２１の
内側面と第１絶縁層２０の上面に第１障壁金属層３０を
形成する工程と、第１障壁金属層３０の上面に第１金属
層４０を形成する工程と、第１金属層４０の一部を除去
して、第１コンタクトホール２１に第１金属層プラグ４
１を形成する工程と、露出した第１障壁金属層３０に水
素プラズマ処理と窒素プラズマ処理を施す工程と、を順
次行い、半導体素子の配線を形成する。
Description
【０００１】
【発明の属する技術分野】本発明は、半導体素子の配線
形成方法に係るもので、詳しくは、信頼性及び量産性を
向上し得る半導体素子の配線形成方法に関する。
形成方法に係るもので、詳しくは、信頼性及び量産性を
向上し得る半導体素子の配線形成方法に関する。
【０００２】
【従来の技術】一般に、半導体素子の配線は、外部から
（又は、半導体素子の各単位パート間に）供給される信
号（電流）の流れる通路をいい、パート毎に各機能が適
切に作動することが要求される。また、半導体素子が高
集積化されるに伴い、配線間の線幅も漸次狭くなってい
るため、量産性の向上（生産性の向上、スループット
（throughput）の向上、工程の単純化及び生産コストの
低減）及び信頼性の向上を図ることができる半導体素子
の配線形成技術が必要となっている。
（又は、半導体素子の各単位パート間に）供給される信
号（電流）の流れる通路をいい、パート毎に各機能が適
切に作動することが要求される。また、半導体素子が高
集積化されるに伴い、配線間の線幅も漸次狭くなってい
るため、量産性の向上（生産性の向上、スループット
（throughput）の向上、工程の単純化及び生産コストの
低減）及び信頼性の向上を図ることができる半導体素子
の配線形成技術が必要となっている。
【０００３】例えば、DRAMには、ワードライン、ビット
ライン、コンタクト及びプラグのような配線を有する
が、ワードラインは、ゲートに信号を伝達してトランジ
スタが作動するようにドーピングされたポリシリコンを
用いて形成されており、また、プラグは、各配線間を連
結するもので、主にタングステン（Ｗ）を用いて形成さ
れる。
ライン、コンタクト及びプラグのような配線を有する
が、ワードラインは、ゲートに信号を伝達してトランジ
スタが作動するようにドーピングされたポリシリコンを
用いて形成されており、また、プラグは、各配線間を連
結するもので、主にタングステン（Ｗ）を用いて形成さ
れる。
【０００４】なお、タングステン（Ｗ）は、既存のWSi2
に比べ、比抵抗が1/5以下と小さいため、同様なデザイ
ンルール下では、ビットラインの厚さを既存のWSi2製の
ビットラインの1/5にすることが可能になって、平坦化
及び高集積化を図り得るという利点がある。
に比べ、比抵抗が1/5以下と小さいため、同様なデザイ
ンルール下では、ビットラインの厚さを既存のWSi2製の
ビットラインの1/5にすることが可能になって、平坦化
及び高集積化を図り得るという利点がある。
【０００５】そして、配線の接着剤層としては、段差被
覆性（Step coverage）に優れるCVD TiNが主に利用さ
れる。配線とシリコン（Ｓｉ）基板とを連結する部分を
接触部というが、この接触部は、半導体の素子の特性に
重要な影響を与える。半導体の素子の特性を向上させる
為には、接触部における電流-電圧特性が、オーム接触
（Ohmic）特性を有し、接触抵抗が低く、接触部におけ
る電気的及び科学的特性が安定していることが必要とな
る。かかる特性を有する接触部を得る為には、接触部が
形成されるシリコン基板の上面にシリサイドを形成する
方法が通常使用されている。また、シリサイドを形成す
る過程においては、熱処理条件が重要な役割を占める。
覆性（Step coverage）に優れるCVD TiNが主に利用さ
れる。配線とシリコン（Ｓｉ）基板とを連結する部分を
接触部というが、この接触部は、半導体の素子の特性に
重要な影響を与える。半導体の素子の特性を向上させる
為には、接触部における電流-電圧特性が、オーム接触
（Ohmic）特性を有し、接触抵抗が低く、接触部におけ
る電気的及び科学的特性が安定していることが必要とな
る。かかる特性を有する接触部を得る為には、接触部が
形成されるシリコン基板の上面にシリサイドを形成する
方法が通常使用されている。また、シリサイドを形成す
る過程においては、熱処理条件が重要な役割を占める。
【０００６】また、半導体素子の集積度が高くなるに従
い、コンタクトホールの縦横比（aspect ratio rat
e）が増加し、現在のクーリメイティド（Collimated）
スパッタリング技術では、段差被覆性に優れる薄膜を蒸
着することが不可能であるため、縦横比の大きいコンタ
クトホールを埋め立てることが困難である。
い、コンタクトホールの縦横比（aspect ratio rat
e）が増加し、現在のクーリメイティド（Collimated）
スパッタリング技術では、段差被覆性に優れる薄膜を蒸
着することが不可能であるため、縦横比の大きいコンタ
クトホールを埋め立てることが困難である。
【０００７】このような従来の半導体素子の配線形成方
法について、図面を用いて説明する。まず、図4(A)に示
したように、不純物領域2を上部に有する半導体基板1の
上面に、BPSG（Boron Phosphorous Silicate Glas
s）を塗布して、絶縁層3を形成し、不純物領域2が露出
するように、不純物領域２の上面にある絶縁層３を除去
してコンタクトホール3aを形成する。
法について、図面を用いて説明する。まず、図4(A)に示
したように、不純物領域2を上部に有する半導体基板1の
上面に、BPSG（Boron Phosphorous Silicate Glas
s）を塗布して、絶縁層3を形成し、不純物領域2が露出
するように、不純物領域２の上面にある絶縁層３を除去
してコンタクトホール3aを形成する。
【０００８】次いで、図4(B)に示したように、前記コン
タクトホール3aの内側面と前記絶縁層3の上面に、Ti/Ti
N又はTiNを塗布して障壁金属層4を形成し、前記障壁金
属層4の上面に、前記コンタクトホール3aが十分に埋め
立てられるようにタングステン層5を形成した後、図4
(C)に示したように、前記タングステン層5を前記障壁金
属層4の上面が露出するまで、エッチバックしてタング
ステン層プラグ5aをコンタクトホール３ａの内部に形成
する。
タクトホール3aの内側面と前記絶縁層3の上面に、Ti/Ti
N又はTiNを塗布して障壁金属層4を形成し、前記障壁金
属層4の上面に、前記コンタクトホール3aが十分に埋め
立てられるようにタングステン層5を形成した後、図4
(C)に示したように、前記タングステン層5を前記障壁金
属層4の上面が露出するまで、エッチバックしてタング
ステン層プラグ5aをコンタクトホール３ａの内部に形成
する。
【０００９】このとき、前記タングステン層5は、フッ
素成分を包含するソースガス（例えば、WF6）を用いて
化学気相蒸着法により形成され、前記エッチバック工程
は、フッ素成分を包含するエッチングガス（例えば、SF
6）を用いて施す。
素成分を包含するソースガス（例えば、WF6）を用いて
化学気相蒸着法により形成され、前記エッチバック工程
は、フッ素成分を包含するエッチングガス（例えば、SF
6）を用いて施す。
【００１０】この場合、露出した障壁金属層4の表面上
の結晶粒界には、図5に示したように、前記タングステ
ン層プラグ5aを形成するときに用いたソースガス（例え
ば、WF 6）及びエッチングガス（例えば、SF6）によりフ
ッ素成分が発生して残留する。
の結晶粒界には、図5に示したように、前記タングステ
ン層プラグ5aを形成するときに用いたソースガス（例え
ば、WF 6）及びエッチングガス（例えば、SF6）によりフ
ッ素成分が発生して残留する。
【００１１】
【発明が解決しようとする課題】しかしながら、このよ
うな従来の半導体素子の配線形成方法においては、障壁
金属層の表面上の結晶粒界に残留したフッ素により、蒸
着される配線層との接着界面にボイドが発生し、これに
より、接着力が弱化して、配線層の剥離現象（Peelin
g）を招来し、配線の信頼性及び量産性が低下するとい
う問題がある。
うな従来の半導体素子の配線形成方法においては、障壁
金属層の表面上の結晶粒界に残留したフッ素により、蒸
着される配線層との接着界面にボイドが発生し、これに
より、接着力が弱化して、配線層の剥離現象（Peelin
g）を招来し、配線の信頼性及び量産性が低下するとい
う問題がある。
【００１２】そこで、本発明は、このような従来の課題
に鑑みてなされたもので、障壁金属層に残留したフッ素
を除去することにより、上記課題を解決した半導体素子
の配線形成方法を提供することを目的とする。
に鑑みてなされたもので、障壁金属層に残留したフッ素
を除去することにより、上記課題を解決した半導体素子
の配線形成方法を提供することを目的とする。
【００１３】
【課題を解決するための手段】請求項１に係る発明は、
半導体基板の上面に障壁金属層を形成する工程と、フッ
素成分を包含するソースガスを用いて化学気相蒸着法を
施し、前記障壁金属層の上面に金属層を形成する工程
と、前記金属層をエッチングして金属層パターンを形成
する工程と、水素プラズマ処理を施して、前記障壁金属
層に残留したフッ素を除去する工程と、を順次行うこと
を特徴とする。
半導体基板の上面に障壁金属層を形成する工程と、フッ
素成分を包含するソースガスを用いて化学気相蒸着法を
施し、前記障壁金属層の上面に金属層を形成する工程
と、前記金属層をエッチングして金属層パターンを形成
する工程と、水素プラズマ処理を施して、前記障壁金属
層に残留したフッ素を除去する工程と、を順次行うこと
を特徴とする。
【００１４】請求項２に係る発明は、半導体基板の上面
に障壁金属層を形成する工程と、フッ素成分を包含する
ソースガスを用いて化学気相蒸着法を施し、前記障壁金
属層の上面に金属層を形成する工程と、フッ素成分を包
含するエッチングガスを用いて、前記金属層をエッチン
グし、金属層パターンを形成する工程と、水素プラズマ
処理及び窒素プラズマ処理を施して、前記障壁金属層に
残留したフッ素を除去し、該障壁金属層内に窒素を充填
する工程と、を順次行うことを特徴とする。
に障壁金属層を形成する工程と、フッ素成分を包含する
ソースガスを用いて化学気相蒸着法を施し、前記障壁金
属層の上面に金属層を形成する工程と、フッ素成分を包
含するエッチングガスを用いて、前記金属層をエッチン
グし、金属層パターンを形成する工程と、水素プラズマ
処理及び窒素プラズマ処理を施して、前記障壁金属層に
残留したフッ素を除去し、該障壁金属層内に窒素を充填
する工程と、を順次行うことを特徴とする。
【００１５】請求項３に係る発明は、不純物領域が形成
された半導体基板の上面に第１絶縁層を形成する工程
と、前記不純物領域の上面にある第１絶縁層を、該不純
物領域の上面の一部が露出するように除去して第１コン
タクトホールを形成する工程と、該第１コンタクトホー
ルの内側面と前記第１絶縁層の上面に第１障壁金属層を
形成する工程と、該第１障壁金属層の上面に、フッ素成
分を包含するソースガスを用いて化学気相蒸着法を施
し、該第１コンタクトホールが十分に埋め立てられるよ
うに第１金属層を蒸着形成する工程と、該第１金属層を
前記第１絶縁層上の第１障壁金属層が露出される厚さ分
除去して、該第１コンタクトホールに第１金属層プラグ
を形成する工程と、前記第１障壁金属層に、水素プラズ
マ処理及び窒素プラズマ処理のうち、少なくとも水素プ
ラズマ処理を施す工程と、を順次行うことを特徴とす
る。
された半導体基板の上面に第１絶縁層を形成する工程
と、前記不純物領域の上面にある第１絶縁層を、該不純
物領域の上面の一部が露出するように除去して第１コン
タクトホールを形成する工程と、該第１コンタクトホー
ルの内側面と前記第１絶縁層の上面に第１障壁金属層を
形成する工程と、該第１障壁金属層の上面に、フッ素成
分を包含するソースガスを用いて化学気相蒸着法を施
し、該第１コンタクトホールが十分に埋め立てられるよ
うに第１金属層を蒸着形成する工程と、該第１金属層を
前記第１絶縁層上の第１障壁金属層が露出される厚さ分
除去して、該第１コンタクトホールに第１金属層プラグ
を形成する工程と、前記第１障壁金属層に、水素プラズ
マ処理及び窒素プラズマ処理のうち、少なくとも水素プ
ラズマ処理を施す工程と、を順次行うことを特徴とす
る。
【００１６】請求項４に係る発明は、前記第１障壁金属
層は、TiN、Ti/TiN、TiWのうちいずれか１つから構成さ
れていることを特徴とする。請求項５に係る発明は、前
記第１金属層は、タングステンを用いることを特徴とす
る。
層は、TiN、Ti/TiN、TiWのうちいずれか１つから構成さ
れていることを特徴とする。請求項５に係る発明は、前
記第１金属層は、タングステンを用いることを特徴とす
る。
【００１７】請求項６に係る発明は、前記第１金属層プ
ラグを形成する工程は、前記第１金属層をフッ素成分を
包含するエッチングガスを用いて施すエッチバック又は
化学的機械研磨をして除去することを特徴とする。
ラグを形成する工程は、前記第１金属層をフッ素成分を
包含するエッチングガスを用いて施すエッチバック又は
化学的機械研磨をして除去することを特徴とする。
【００１８】請求項７に係る発明は、不純物領域が形成
された半導体基板の上面に第１絶縁層を形成する工程
と、前記不純物領域の上面にある第１絶縁層を、該不純
物領域の上面の一部が露出するように除去して第１コン
タクトホールを形成する工程と、該第１コンタクトホー
ルの内側面と前記第１絶縁層の上面に第１障壁金属層を
形成する工程と、該第１障壁金属層の上面に、該第１コ
ンタクトホールが十分に埋め立てられるように第１金属
層を形成する工程と、該第１金属層の上面に、第２コン
タクトホールを有する第２絶縁層を形成する工程と、該
第２コンタクトホールの内側面と該第２絶縁層の上面
に、第２障壁金属層を形成する工程と、該第２障壁金属
層の上面に、フッ素成分を包含するソースガスを用いて
化学気相蒸着法を施し、該第２コンタクトホールが十分
に埋め立てられるように第２金属層を蒸着形成する工程
と、該第２金属層を前記第２絶縁層上の第２障壁金属層
が露出される厚さ分除去して、該第２コンタクトホール
に第２金属層プラグを形成する工程と、前記第２障壁金
属層に、水素プラズマ処理及び窒素プラズマ処理のう
ち、少なくとも水素プラズマ処理を施す工程と、を順次
行うことを特徴とする。
された半導体基板の上面に第１絶縁層を形成する工程
と、前記不純物領域の上面にある第１絶縁層を、該不純
物領域の上面の一部が露出するように除去して第１コン
タクトホールを形成する工程と、該第１コンタクトホー
ルの内側面と前記第１絶縁層の上面に第１障壁金属層を
形成する工程と、該第１障壁金属層の上面に、該第１コ
ンタクトホールが十分に埋め立てられるように第１金属
層を形成する工程と、該第１金属層の上面に、第２コン
タクトホールを有する第２絶縁層を形成する工程と、該
第２コンタクトホールの内側面と該第２絶縁層の上面
に、第２障壁金属層を形成する工程と、該第２障壁金属
層の上面に、フッ素成分を包含するソースガスを用いて
化学気相蒸着法を施し、該第２コンタクトホールが十分
に埋め立てられるように第２金属層を蒸着形成する工程
と、該第２金属層を前記第２絶縁層上の第２障壁金属層
が露出される厚さ分除去して、該第２コンタクトホール
に第２金属層プラグを形成する工程と、前記第２障壁金
属層に、水素プラズマ処理及び窒素プラズマ処理のう
ち、少なくとも水素プラズマ処理を施す工程と、を順次
行うことを特徴とする。
【００１９】請求項８に係る発明は、前記第１障壁金属
層及び第２障壁金属層は、TiN、Ti/TiN、TiWのうちいず
れか１つから構成されていることを特徴とする。請求項
９に係る発明は、前記第１金属層及び第２金属層は、タ
ングステンを用いることを特徴とする。
層及び第２障壁金属層は、TiN、Ti/TiN、TiWのうちいず
れか１つから構成されていることを特徴とする。請求項
９に係る発明は、前記第１金属層及び第２金属層は、タ
ングステンを用いることを特徴とする。
【００２０】請求項１０に係る発明は、前記第２金属層
プラグを形成する工程は、前記第２金属層をフッ素成分
を包含するエッチングガスを用いて施すエッチバック又
は化学的機械研磨をして除去することを特徴とする。
プラグを形成する工程は、前記第２金属層をフッ素成分
を包含するエッチングガスを用いて施すエッチバック又
は化学的機械研磨をして除去することを特徴とする。
【００２１】
【発明の効果】本発明によれば、水素プラズマ処理を施
すことにより、気体のフッ化水素（HF）を生成して、障
壁金属層（第１障壁金属層又は第２障壁金属層）に残留
していたフッ素成分を除去することができるので、後に
蒸着される配線層と障壁金属層との接着界面においてボ
イドの発生を抑制することができ、その結果、配線層と
障壁金属層間との接着力を向上させて、配線の信頼性及
び量産性を図り得るという効果がある。
すことにより、気体のフッ化水素（HF）を生成して、障
壁金属層（第１障壁金属層又は第２障壁金属層）に残留
していたフッ素成分を除去することができるので、後に
蒸着される配線層と障壁金属層との接着界面においてボ
イドの発生を抑制することができ、その結果、配線層と
障壁金属層間との接着力を向上させて、配線の信頼性及
び量産性を図り得るという効果がある。
【００２２】また、水素プラズマ処理を施すことによ
り、フッ化水素（HF）を生成して、障壁金属層（第１障
壁金属層又は第２障壁金属層）に残留していたフッ素成
分を除去した後、窒素プラズマ処理を施して障壁金属層
の表面上の結晶粒界に窒素成分を充填させるので、障壁
金属層を一層安定化及び緻密化し得るという効果があ
り、ひいては配線層と障壁金属層間との接着力をより向
上させて、配線の信頼性及び量産性を図り得るという効
果がある。
り、フッ化水素（HF）を生成して、障壁金属層（第１障
壁金属層又は第２障壁金属層）に残留していたフッ素成
分を除去した後、窒素プラズマ処理を施して障壁金属層
の表面上の結晶粒界に窒素成分を充填させるので、障壁
金属層を一層安定化及び緻密化し得るという効果があ
り、ひいては配線層と障壁金属層間との接着力をより向
上させて、配線の信頼性及び量産性を図り得るという効
果がある。
【００２３】
【発明の実施の形態】以下、本発明の実施の形態につい
て、図面に基づいて説明する。本発明に係る半導体素子
の配線形成方法の第1の実施の形態を説明すると、次の
ようである。
て、図面に基づいて説明する。本発明に係る半導体素子
の配線形成方法の第1の実施の形態を説明すると、次の
ようである。
【００２４】まず、図１(A)に示したように、不純物領
域11を上部に有する半導体基板10の上面に、第1絶縁層2
0を形成し、不純物領域11の上面の一部が露出するよう
に、第1絶縁層20をフォトエッチングして、第1コンタク
トホール21を形成する。
域11を上部に有する半導体基板10の上面に、第1絶縁層2
0を形成し、不純物領域11の上面の一部が露出するよう
に、第1絶縁層20をフォトエッチングして、第1コンタク
トホール21を形成する。
【００２５】このとき、第１絶縁層20には、ホウ素又は
燐がドーピングされたBPSG（BoronPhosphorous Silica
te Glass）、SOG（Spin On glass）、PE-TEOS（PE-T
etra Ethyl Ortho Silicate）などを用いて形成す
る。
燐がドーピングされたBPSG（BoronPhosphorous Silica
te Glass）、SOG（Spin On glass）、PE-TEOS（PE-T
etra Ethyl Ortho Silicate）などを用いて形成す
る。
【００２６】次いで、図1(B)に示したように、第1コン
タクトホール21の内面と第1絶縁層20の上面に第1障壁金
属層30を形成し、第1障壁金属層30の上面に第１コンタ
クトホール２１が十分に埋め立てられるように第1金属
層40を蒸着した後、第1絶縁層20上の第1障壁金属層30が
露出するまで、第1金属層40をエッチバック又は化学的
機械研磨をして、金属層プラグ（第1プラグ）41を第１
コンタクトホール２１の内部に形成する。
タクトホール21の内面と第1絶縁層20の上面に第1障壁金
属層30を形成し、第1障壁金属層30の上面に第１コンタ
クトホール２１が十分に埋め立てられるように第1金属
層40を蒸着した後、第1絶縁層20上の第1障壁金属層30が
露出するまで、第1金属層40をエッチバック又は化学的
機械研磨をして、金属層プラグ（第1プラグ）41を第１
コンタクトホール２１の内部に形成する。
【００２７】このとき、第1障壁金属層30には、TiN、Ti
/TiN、TiWなどを用いて形成される。また、第1金属層40
は、タングステン（Ｗ）を用いて、主にフッ素成分を包
含するソースガスにより化学気相蒸着法を施して蒸着形
成されるので、前述のエッチバックは、フッ素成分を包
含するエッチングガスを用いて施す。前記ソースガスと
しては、WF6が、前記エッチングガスとしては、SF6が夫
々多用される。
/TiN、TiWなどを用いて形成される。また、第1金属層40
は、タングステン（Ｗ）を用いて、主にフッ素成分を包
含するソースガスにより化学気相蒸着法を施して蒸着形
成されるので、前述のエッチバックは、フッ素成分を包
含するエッチングガスを用いて施す。前記ソースガスと
しては、WF6が、前記エッチングガスとしては、SF6が夫
々多用される。
【００２８】ここで、金属層プラグ41を形成すると、図
3に示したように、露出した第1障壁金属層30の表面上の
結晶粒界には、フッ素成分を包含するソースガス（例え
ば、WF6）及びエッチングガス（例えば、SF6）を夫々利
用してタングステン（Ｗ）からなる第１金属層４０を蒸
着及びエッチングするとき発生したフッ素が残留する。
3に示したように、露出した第1障壁金属層30の表面上の
結晶粒界には、フッ素成分を包含するソースガス（例え
ば、WF6）及びエッチングガス（例えば、SF6）を夫々利
用してタングステン（Ｗ）からなる第１金属層４０を蒸
着及びエッチングするとき発生したフッ素が残留する。
【００２９】そこで、この残留フッ素成分を除去するた
め、配線層を蒸着する前に、第1障壁金属層30の表面に
水素プラズマ処理を施すと、残留フッ素成分が水素と化
学反応を起こし、気体のフッ化水素になって揮発するの
で、容易に除去できる。その後、窒素プラズマ処理を施
すと、第１障壁金属層30の表面上の結晶粒界に窒素がス
タッピングされて、結晶組織が緻密化される。
め、配線層を蒸着する前に、第1障壁金属層30の表面に
水素プラズマ処理を施すと、残留フッ素成分が水素と化
学反応を起こし、気体のフッ化水素になって揮発するの
で、容易に除去できる。その後、窒素プラズマ処理を施
すと、第１障壁金属層30の表面上の結晶粒界に窒素がス
タッピングされて、結晶組織が緻密化される。
【００３０】以下、本発明に係る半導体素子の配線形成
方法の第2の実施の形態について説明する。まず、図2
(A)に示したように、第1の実施の形態と同様に、第1絶
縁層20及び第1コンタクトホール21を夫々半導体基板１
０及び不純物領域１１の上面に形成する。
方法の第2の実施の形態について説明する。まず、図2
(A)に示したように、第1の実施の形態と同様に、第1絶
縁層20及び第1コンタクトホール21を夫々半導体基板１
０及び不純物領域１１の上面に形成する。
【００３１】次いで、図2(B)に示したように、前記第1
コンタクトホール21の内面と第1絶縁層20の上面に第1障
壁金属層30を形成し、該第1障壁金属層30の上面に、第
１コンタクトホール２１が十分に埋め立てられるように
タングステン（Ｗ）の第1金属層40を主にWF6のソースガ
スを利用する化学気相蒸着法を施して蒸着形成する。
コンタクトホール21の内面と第1絶縁層20の上面に第1障
壁金属層30を形成し、該第1障壁金属層30の上面に、第
１コンタクトホール２１が十分に埋め立てられるように
タングステン（Ｗ）の第1金属層40を主にWF6のソースガ
スを利用する化学気相蒸着法を施して蒸着形成する。
【００３２】次いで、図2(C)に示したように、前記第1
金属層40の上面に、第２コンタクトホール51を有する第
2絶縁層50を形成し、第2コンタクトホール51の内側面と
第2絶縁層50の上面に第2障壁金属層60を形成し、第2障
壁金属層60の上面に第2金属層70を第２コンタクトホー
ル５１が十分に埋め立てられるように形成した後、前記
第2絶縁層50上の第2障壁金属層60の上面が露出するよう
に、第2金属層70をエッチバック又は化学的機械研磨を
して、第2コンタクトホール51の内部に第２金属層プラ
グ（第2プラグ）71を形成する。
金属層40の上面に、第２コンタクトホール51を有する第
2絶縁層50を形成し、第2コンタクトホール51の内側面と
第2絶縁層50の上面に第2障壁金属層60を形成し、第2障
壁金属層60の上面に第2金属層70を第２コンタクトホー
ル５１が十分に埋め立てられるように形成した後、前記
第2絶縁層50上の第2障壁金属層60の上面が露出するよう
に、第2金属層70をエッチバック又は化学的機械研磨を
して、第2コンタクトホール51の内部に第２金属層プラ
グ（第2プラグ）71を形成する。
【００３３】このとき、前記第2障壁金属層60には、Ti
N、Ti/TiN、TiW等を用いて形成され、第2金属層70に
は、タングステンＷを用いて、主にWF6のソースガスを
利用する化学気相蒸着を施して蒸着形成される。
N、Ti/TiN、TiW等を用いて形成され、第2金属層70に
は、タングステンＷを用いて、主にWF6のソースガスを
利用する化学気相蒸着を施して蒸着形成される。
【００３４】また、前述のエッチバックは、フッ素成分
を包含するSF6をエッチングガスとして用い、第2金属層
70をエッチングした後、パターニングを行う。更に、第
２金属層プラグ71を第２コンタクトホール５１の内部に
形成した後、露出した第2障壁金属層60の表面上の結晶
粒界にはフッ素成分が残留するが、第1の実施の形態と
同様の方法を施して除去することができる。
を包含するSF6をエッチングガスとして用い、第2金属層
70をエッチングした後、パターニングを行う。更に、第
２金属層プラグ71を第２コンタクトホール５１の内部に
形成した後、露出した第2障壁金属層60の表面上の結晶
粒界にはフッ素成分が残留するが、第1の実施の形態と
同様の方法を施して除去することができる。
【図１】本発明に係る半導体素子の配線形成方法の第1
の実施の形態を示した工程縦断面図
の実施の形態を示した工程縦断面図
【図２】本発明に係る半導体素子の配線形成方法の第2
の実施の形態を示した工程縦断面図
の実施の形態を示した工程縦断面図
【図３】図1(B)及び図2(C)のB部分の拡大縦断面図
【図４】従来の半導体素子の配線形成方法を示した工程
縦断面図
縦断面図
【図５】図4(C)のA部分の拡大縦断面図
10：半導体基板 11：不純物領域 20：第1絶縁層（第1絶縁膜） 21：第1コンタクトホール 30：第1障壁金属層 40：第1金属層 41：第1金属層プラグ（第1プラグ） 50：第2絶縁層（第2絶縁膜） 51：第2コンタクトホール 60：第2障壁金属層 70：第2金属層 71：第2金属層プラグ（第2プラグ）
Claims (10)
- 【請求項１】半導体基板の上面に障壁金属層を形成する
工程と、 フッ素成分を包含するソースガスを用いて化学気相蒸着
法を施し、前記障壁金属層の上面に金属層を形成する工
程と、 前記金属層をエッチングして金属層パターンを形成する
工程と、 水素プラズマ処理を施して、前記障壁金属層に残留した
フッ素を除去する工程と、を順次行うことを特徴とする
半導体素子の配線形成方法。 - 【請求項２】半導体基板の上面に障壁金属層を形成する
工程と、 フッ素成分を包含するソースガスを用いて化学気相蒸着
法を施し、前記障壁金属層の上面に金属層を形成する工
程と、 フッ素成分を包含するエッチングガスを用いて、前記金
属層をエッチングし、金属層パターンを形成する工程
と、 水素プラズマ処理及び窒素プラズマ処理を施して、前記
障壁金属層に残留したフッ素を除去し、該障壁金属層内
に窒素を充填する工程と、を順次行うことを特徴とする
半導体素子の配線形成方法。 - 【請求項３】不純物領域が形成された半導体基板の上面
に第１絶縁層を形成する工程と、 前記不純物領域の上面にある第１絶縁層を、該不純物領
域の上面の一部が露出するように除去して第１コンタク
トホールを形成する工程と、 該第１コンタクトホールの内側面と前記第１絶縁層の上
面に第１障壁金属層を形成する工程と、 該第１障壁金属層の上面に、フッ素成分を包含するソー
スガスを用いて化学気相蒸着法を施し、該第１コンタク
トホールが十分に埋め立てられるように第１金属層を蒸
着形成する工程と、 該第１金属層を前記第１絶縁層上の第１障壁金属層が露
出される厚さ分除去して、該第１コンタクトホールに第
１金属層プラグを形成する工程と、 前記第１障壁金属層に、水素プラズマ処理及び窒素プラ
ズマ処理のうち、少なくとも水素プラズマ処理を施す工
程と、を順次行うことを特徴とする半導体素子の配線形
成方法。 - 【請求項４】前記第１障壁金属層は、TiN、Ti/TiN、TiW
のうちいずれか１つから構成されていることを特徴とす
る請求項３に記載の半導体素子の配線形成方法。 - 【請求項５】前記第１金属層は、タングステンを用いる
ことを特徴とする請求項３又は請求項４に記載の半導体
素子の配線形成方法。 - 【請求項６】前記第１金属層プラグを形成する工程は、
前記第１金属層をフッ素成分を包含するエッチングガス
を用いて施すエッチバック又は化学的機械研磨をして除
去することを特徴とする請求項３〜請求項５のいずれか
1つに記載の半導体素子の配線形成方法。 - 【請求項７】不純物領域が形成された半導体基板の上面
に第１絶縁層を形成する工程と、 前記不純物領域の上面にある第１絶縁層を、該不純物領
域の上面の一部が露出するように除去して第１コンタク
トホールを形成する工程と、 該第１コンタクトホールの内側面と前記第１絶縁層の上
面に第１障壁金属層を形成する工程と、 該第１障壁金属層の上面に、該第１コンタクトホールが
十分に埋め立てられるように第１金属層を形成する工程
と、 該第１金属層の上面に、第２コンタクトホールを有する
第２絶縁層を形成する工程と、 該第２コンタクトホールの内側面と該第２絶縁層の上面
に、第２障壁金属層を形成する工程と、 該第２障壁金属層の上面に、フッ素成分を包含するソー
スガスを用いて化学気相蒸着法を施し、該第２コンタク
トホールが十分に埋め立てられるように第２金属層を蒸
着形成する工程と、 該第２金属層を前記第２絶縁層上の第２障壁金属層が露
出される厚さ分除去して、該第２コンタクトホールに第
２金属層プラグを形成する工程と、 前記第２障壁金属層に、水素プラズマ処理及び窒素プラ
ズマ処理のうち、少なくとも水素プラズマ処理を施す工
程と、を順次行うことを特徴とする半導体素子の配線形
成方法。 - 【請求項８】前記第１障壁金属層及び第２障壁金属層
は、TiN、Ti/TiN、TiWのうちいずれか１つから構成され
ていることを特徴とする請求項７に記載の半導体素子の
配線形成方法。 - 【請求項９】前記第１金属層及び第２金属層は、タング
ステンを用いることを特徴とする請求項７又は請求項８
に記載の半導体素子の配線形成方法。 - 【請求項１０】前記第２金属層プラグを形成する工程
は、前記第２金属層をフッ素成分を包含するエッチング
ガスを用いて施すエッチバック又は化学的機械研磨をし
て除去することを特徴とする請求項７〜請求項９のいず
れか1つに記載の半導体素子の配線形成方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR35701/1998 | 1998-08-31 | ||
| KR1019980035701A KR100284283B1 (ko) | 1998-08-31 | 1998-08-31 | 반도체소자의배선형성방법 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2000077417A true JP2000077417A (ja) | 2000-03-14 |
| JP3160811B2 JP3160811B2 (ja) | 2001-04-25 |
Family
ID=19549041
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24537299A Expired - Fee Related JP3160811B2 (ja) | 1998-08-31 | 1999-08-31 | 半導体素子の配線形成方法 |
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| Country | Link |
|---|---|
| JP (1) | JP3160811B2 (ja) |
| KR (1) | KR100284283B1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7371680B2 (en) | 2004-08-26 | 2008-05-13 | Elpida Memory Inc. | Method of manufacturing semiconductor device |
Families Citing this family (3)
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|---|---|---|---|---|
| US6650205B2 (en) | 2001-03-29 | 2003-11-18 | Clarisay, Inc. | Wafer-scale package for surface acoustic wave circuit and method of manufacturing the same |
| KR101315880B1 (ko) | 2008-07-23 | 2013-10-08 | 삼성전자주식회사 | 금속 배선 구조물 및 그 제조 방법 |
| KR102821639B1 (ko) * | 2020-12-23 | 2025-06-18 | 주식회사 원익아이피에스 | 반도체 소자 제조 방법 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2836529B2 (ja) * | 1995-04-27 | 1998-12-14 | 日本電気株式会社 | 半導体装置の製造方法 |
-
1998
- 1998-08-31 KR KR1019980035701A patent/KR100284283B1/ko not_active Expired - Fee Related
-
1999
- 1999-08-31 JP JP24537299A patent/JP3160811B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7371680B2 (en) | 2004-08-26 | 2008-05-13 | Elpida Memory Inc. | Method of manufacturing semiconductor device |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3160811B2 (ja) | 2001-04-25 |
| KR100284283B1 (ko) | 2001-04-02 |
| KR20000015664A (ko) | 2000-03-15 |
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