JP2002305202A - シリコンエピタキシャルウエーハおよびその製造方法 - Google Patents
シリコンエピタキシャルウエーハおよびその製造方法Info
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Abstract
入する前の状態で、エピ層のヘイズ、LPD等の欠陥レ
ベルが低減され、かつ酸素析出が制御されたシリコンエ
ピタキシャルウエーハならびにその製造方法を提供す
る。 【解決手段】 シリコン単結晶をスライスして得られる
シリコンウエーハ表面にエピタキシャル層を形成するシ
リコンエピタキシャルウエーハの製造方法において、少
なくともシリコン単結晶インゴットをスライスする際に
生じた加工歪層を除去した後にエピタキシャル成長を行
い、次に酸素析出熱処理を施し、その後にエピタキシャ
ル層の表面を鏡面研磨することを特徴とするシリコンエ
ピタキシャルウエーハの製造方法ならびにこの方法によ
り製造されたエピタキシャルウエーハ。
Description
ャルウエーハおよびその製造方法に関する。
バイスプロセスが低温・短時間化している。さらに、近
い将来の直径300mmシリコンウエーハ時代において
は、ウエーハ自重によるスリップ転位の発生を抑制する
ためにも、低温・短時間化されたデバイスプロセスが必
須となりつつある。そうなると、これまでのようなデバ
イスプロセス中での熱処理によるBMD(Bulk M
icro Defect、酸素析出物による内部微小欠
陥)の形成や成長によるゲッタリング効果は期待できな
い。従って、低温・短時間化されたデバイスプロセスに
投入する前に、酸素析出熱処理を予めウエーハに施して
BMD密度を増加させておくことによりゲッタリング効
果を付与することが重要である。この処理をウエーハメ
ーカーが行えば、デバイスメーカーの受けるメリットは
極めて大きい。
い、半導体ウエーハ中の結晶欠陥、特に表面および表面
近傍の結晶欠陥の低減が重要になってきている。このた
め、結晶欠陥の少ないエピタキシャルウエーハ(以下、
エピウエーハと略記する場合がある)の需要は年々高ま
っている。そこで酸素析出を促進する熱処理を施したエ
ピウエーハの需要が高まることが予想されるが、従来は
例えば図2に示したようなフローで製造されていた。
リコン単結晶インゴットをスライス(a)し、次いで化
学エッチング(b)工程にかけて化学エッチドウエーハ
(Chemical Eched Wafer、以下、
CWと略記することがある)とし、鏡面研磨(f)を施
して鏡面研磨ウエーハ(Mirror Polishe
d Wafer、以下、PWと略記することがある)を
得た後、酸素析出熱処理(d)(以下、HTと略記する
ことがある)を行い、最後にエピタキシャル成長(c)
(Epitaxial Growth、以下EPと略記
することがある)工程を行い、シリコンエピタキシャル
ウエーハを作製していた。
シャルウエーハを作製すると、酸素析出熱処理工程にお
いて、ウエーハ中に欠陥が誘起され、この上に成長させ
るエピタキシャル層(以下、エピ層ということがある)
に伝播し、エピ層欠陥となってしまうことがあった。特
に、結晶に窒素をドープすると微小酸素析出物が高密度
に形成されるため(例えば、1999年春季第46回応
用物理学関係連合講演会 予稿集No.1,p.46
9,29a−ZB−5,相原他 参照)、BMDの形
成、成長によるゲッタリングには有利であるが、このエ
ピ層欠陥の問題が大きくなってきた。
PW→EP→HTという工程順も考えられるが、EP工
程後に熱処理を行うことにより、表面のヘイズ(集光ラ
ンプでウエーハ表面を照射した時に白っぽく見える表面
状態)やLPD(LightPoint Defec
t、光散乱法による欠陥の総称)レベルが悪化すること
があるため、積極的にこの工程を採用するには至らなか
った。
題点に鑑みてなされたもので、低温・短時間化されたデ
バイスプロセスに投入する前の状態で、エピ層のヘイ
ズ、LPD等の欠陥レベルが低減され、かつ酸素析出が
制御されたシリコンエピタキシャルウエーハを提供する
ことを主たる目的としている。
め、本発明に係るシリコンエピタキシャルウエーハの製
造方法は、シリコン単結晶をスライスして得られるシリ
コンウエーハ表面にエピタキシャル層を形成するシリコ
ンエピタキシャルウエーハの製造方法において、少なく
ともシリコン単結晶インゴットをスライスする際に生じ
た加工歪層を除去した後にエピタキシャル成長を行い、
次に酸素析出熱処理を施し、その後にエピタキシャル層
の表面を鏡面研磨することを特徴とするものである(請
求項1)。
ウエーハを製造すれば、ウエーハ表面にエピ層を成長し
た後に酸素析出熱処理を行うので、熱処理により誘起さ
れる基板の欠陥がエピ層に発生することはない。すなわ
ち、熱処理により基板であるシリコンウエーハ中に欠陥
が発生したとしても、これがデバイス活性層やエピ層表
面まで伝搬することはない。従って、エピ層欠陥の少な
いエピウエーハが得られる。また、主に高抵抗基板を用
いる場合に、設計通りの基板抵抗率を達成するには、基
板に酸素ドナーキラー熱処理を施す必要があるが、これ
は前記酸素析出熱処理に含ませることが出来るため、生
産性の向上、コストダウンを図ることができる。勿論E
P工程前にドナーキラー熱処理を行っても良いことは言
うまでもない。さらに、最終工程としてエピ層表面にP
W工程を行うため、酸素析出熱処理で悪化したヘイズ、
LPDレベルが鏡面研磨ウエーハと同等レベルに改善さ
れるため、酸素析出熱処理後のヘイズ、LPDの悪化を
心配する必要がない。従って、エピ層のヘイズ、LPD
等の欠陥を低減し、かつ酸素析出が制御された高品質の
シリコンエピタキシャルウエーハを製造することができ
る。
グで行うことが好ましい(請求項2)。最終工程として
PW工程を行うので、EP工程を行う基板は加工歪層さ
え除去されていればよいので、化学エッチングウエーハ
で十分対応することができる。
結晶を窒素ドープしたシリコン単結晶とすることができ
る(請求項3)。このように特に窒素ドープしたシリコ
ン単結晶を基板に用いて、前記工程順に従ってEP工程
後に酸素析出熱処理を行えば、既に表面はエピ層なので
エピ層に欠陥は発生しない。すなわち、基板中に欠陥が
発生したとしても、これがデバイス活性層やエピ層表面
まで伝搬することはなく、結果として、エピ層欠陥が極
めて少なく、かつ十分なBMD密度を有するエピウエー
ハを得ることができる。
って作製されたエピ層のヘイズ、LPD等の欠陥を低減
し、かつ酸素析出が制御された高品質のシリコンエピタ
キシャルウエーハが提供される(請求項4)。
を図面を参照しながら説明するが、本発明はこれらに限
定されるものではない。図1は、本発明に係るシリコン
エピタキシャルウエーハの製造方法の一実施形態の概要
を示すフロー図である。図1において、先ず引上げたシ
リコン単結晶インゴットをスライス(a)し、少なくと
もスライスする際に生じた加工歪層を化学エッチング
(b)で除去した後に、エピタキシャル成長(c)を行
い、次に酸素析出熱処理(d)を施し、その後にエピタ
キシャル層の表面を鏡面研磨(e)するという工程を行
うものである。
る。まずシリコン単結晶を引上げ、単結晶インゴットを
スライスし、この時に生じた加工歪を除去するためにラ
ッピング、ウエーハ周辺の面取りおよびエッチング等を
行う。これらの方法はいずれも従来技術によれば良く、
例えば単結晶引上げは、CZ法、MCZ法、ECZ法、
EMCZ法、FZ法等いずれの方法を用いても良い。
素、炭素等の不純物の添加についても特に限定されな
い。これらのドーパントを添加する場合、ドープする濃
度はユーザー仕様通りにすれば良いが、前述のように高
抵抗基板を用いる場合には、必須のドナーキラー熱処理
を、酸素析出熱処理と兼ねて行うことができるため、ド
ナーキラー熱処理工程の省略による生産性の向上とコス
トダウンを図ることができる。このため、本発明を高抵
抗基板を用いたエピウエーハの製造に適用すればより一
層効果的である。
mm(12インチ)以上の大口径ウエーハを用いる場
合、半導体素子の高集積化やウエーハ自重によるスリッ
プ転位の発生を抑制するために、デバイスプロセスが低
温・短時間化している。このため、従来のようなデバイ
スプロセス中でのBMDの形成や成長によるゲッタリン
グ効果は期待できないため、本発明の効果が顕著に得ら
れる。
(a)も既知の内周刃、外周刃を用いる方法、ワイヤー
ソー等いずれの方法でスライスしても良い。面取りも従
来のダイヤモンド砥石による面取り加工でも良いし、面
取り部からの発塵低減に適した鏡面面取り加工を施して
も良い。ラッピングも平行定盤間にラップ液を流して研
削する従来技術が適用されるし、平面研削盤を用いても
よい。
グ、面取り等の機械加工プロセスを行った際に生じた加
工歪層を除去することを目的としており、化学エッチン
グで完全に除去することができる。このエッチング液に
はフッ酸、硝酸、酢酸から成る混酸を水で希釈した酸エ
ッチング液が用いられる。また、NaOHやKOH等を
用いたアルカリエッチングで行ってもよいし、酸エッチ
ングと組み合せて使用することもできる。
(c)させる。EP工程も従来の方法で行えばよく、エ
ピタキシャル成長前に行う水素ベークやHClエッチン
グの有無等に限定されない。また、エピタキシャル成長
も常圧、減圧成長等にも限定されず、エピリアクターも
バッチ式、枚葉式等に限定されるものではない。原料ガ
スもSiCl4 、SiHCl3 、SiH2 Cl2 、Si
H4 等、一般的に用いられるものの全てを用いることが
できる。なお、エピ層の厚さは「ユーザー仕様+PW工
程で研磨される厚さ」とすることが必要である。
の酸素析出熱処理は酸素析出を制御する熱処理であり、
例えば、450〜800℃での酸素析出核を形成する熱
処理と、800℃以上での酸素析出物を成長させる熱処
理のような2段熱処理を用いることが一般的であるが、
これに限定されるものではない。また、この酸素析出熱
処理にドナーキラー熱処理を含めることができる。そう
すれば、高抵抗基板の場合にEP工程前にドナーキラー
熱処理を行う必要はない。また、この酸素析出熱処理条
件は、ユーザーから求められるBMDサイズ、密度等を
考慮してそれらに適したものにすれば良い。熱処理装置
もまた従来の装置を使用すればよく、抵抗加熱を用いた
バッチ式の炉や、枚葉式の急速加熱・急速冷却装置:R
TA(Rapid Thermal Anneale
r)等が一般的であるが、これらに限定されるものでは
ない。
行えば、前述のように、窒素ドープの有無に関わらず、
既に表面はエピ層になっているのでエピ層に欠陥が発生
することはない。すなわち、仮に基板に欠陥が発生した
としても、これがデバイス活性層やエピ層表面に伝播す
ることはない。HT工程後、エピタキシャル層表面の鏡
面研磨(e)を行う。これも従来の方法によれば良く、
このようにEP工程後にエピ層表面の鏡面研磨工程を行
うため、フラットネス、マイクロラフネス、ヘイズに代
表されるような表面品質は鏡面ウエーハと同等になり、
エピウエーハの表面品質がより一層改善される。また、
LPDレベルやクラウン(EP工程でウエーハ周辺部に
シリコンが異常成長したもの)もエピ層表面を研磨する
ことにより同時に改善されるという効果もある。
明を具体的に説明するが、本発明はこれらに限定される
ものではない。 (実施例1)直径200mm(8インチ)、ボロン添
加、抵抗率0.01Ω・cm、初期酸素濃度16ppm
a[JEIDA(Japan Electronic
Industry Development and
Association:日本電子工業振興協会)の換
算係数を使用]の結晶をCZ法により引上げ、ワイヤー
ソーによりスライスし、ラッピング、鏡面面取りを行
い、フッ酸、硝酸、酢酸の混酸液による化学エッチング
を行った。その後、化学エッチング面上に1130℃で
エピ層(ボロン添加、抵抗率10Ω・cm)を22μm
堆積した。次いで、800℃/4Hr+1000℃/1
6Hrの酸素析出熱処理行った後、エピ層表面の鏡面研
磨工程を行った。
加、抵抗率10Ω・cmのダミーウエーハを用意して、
上記と同様の研磨を行った。静電容量式非接触厚さ計C
L−250(小野測器社製)により測定した研磨前後で
のウエーハ厚さの差から、今回の研磨代を12μmと見
積もった。また、FT−IR法(フーリエ変換赤外分光
法)によるエピ層厚さ測定(測定器:OS−300、ア
クセント オプティカル テクノロジーズ社製)によ
り、抵抗率0.01Ω・cmのウエーハ上のエピ層厚さ
は10μmであり、エピ層が十分残っていることを確認
した。
1(KLAテンコール社製)によるエピ層表面の測定で
は、LPD(サイズ0.09μm以上)は0個/ウエー
ハであった。SP−1によるヘイズは平均値で0.07
6ppm(Narrowモード)であり、これは通常の
鏡面ウエーハと同レベルである。また、静電容量式のフ
ラットネス測定器:ウルトラスキャン9650(ADE
社製)でフラットネスを測定し、ウエーハ内最大値を1
0枚のウエーハで平均したところ、SFQR(Site
Front least sQares<site>
Range)で0.20μm(20mmx20mmサイ
ト)であり、通常の鏡面研磨ウエーハ並であった。
チ)、ボロン添加、抵抗率10Ω・cm、初期酸素濃度
16ppma−JEIDA、窒素濃度4×1013/cm
3 の結晶をMCZ法により引上げ、ワイヤーソーにより
スライスし、ラッピングし、面取りを行い、水酸化ナト
リウム水溶液による化学エッチングを行った。その後、
化学エッチング面上に1130℃でエピ層(ボロン添
加、抵抗率10Ω・cm)を22μm堆積した。次い
で、800℃/4Hr+1000℃/16Hrの熱処理
(急速降温によるドナーキラー熱処理を兼ねる)を行っ
た後、両面研磨・平坦化研磨および鏡面面取りを行っ
た。両面研磨および平坦化研磨それぞれでの研磨代か
ら、今回の表面側の研磨代を12μmと見積もった。ま
た、非接触厚さ計CL−250により測定したEP工程
前のウエーハ厚さとエピ層鏡面研磨工程後のウエーハ厚
さの差から、基板上に堆積しているエピ層厚さは10μ
mと見積もられたため、エピ層が残っていることが確認
できた。
定では、LPD(サイズ0.09μm以上)は0個/ウ
エーハであった。SP−1によるヘイズは平均値で0.
049ppm(Narrowモード)であり、これは通
常の鏡面研磨ウエーハと同レベルである。また、静電容
量式のフラットネス測定器:AFS(Advanted
Flatness System) −3220(AD
E社製)でフラットネスを測定したところ、SFQD
(Site Front least sQares<
site>Deviation)のウエーハ面内の平均
値で0.036μm(26mmx32mmサイト)であ
り、通常の鏡面研磨ウエーハ並であった。
チ)、ボロン添加、抵抗率0.01Ω・cm、初期酸素
濃度16ppma−JEIDAの結晶をCZ法により引
上げ、ワイヤーソーによりスライスし、ラッピング、鏡
面面取りを行い、混酸液による化学エッチングを行っ
た。その後800℃/4Hr+1000℃/16Hrの
熱処理行い、鏡面研磨を施し、その鏡面上に1130℃
でエピ層(ボロン添加、抵抗率10Ω・cm)を10μ
m堆積して、エピタキシャルウエーハを得た。
タ:SPー1により測定したところ、62個/ウエーハ
のLPD(サイズ0.09μm以上)が検出され、ヘイ
ズは平均値で0.324ppm(Narrowモード)
であった。ウルトラスキャン9650によるフラットネ
スはSFQRで0.24μmであった。これら全ての品
質特性が、実施例1に比べて明らかに劣化していた。
チ)、ボロン添加、抵抗率0.01Ω・cm、初期酸素
濃度16ppm−JEIDAの結晶をCZ法により引上
げ、ワイヤーソーによりスライスし、ラッピング、鏡面
面取りを行い、混酸液による化学エッチングを行った
後、鏡面加工を行った。その後、1130℃でエピ層
(ボロン添加、抵抗率10Ω・cm)を10μm堆積し
た。次いで、800℃/4Hr+1000℃/16Hr
の酸素析出熱処理行った。
タ:SPー1により測定したところ、124個/ウエー
ハのLPD(サイズ0.09μm以上)が検出され、ヘ
イズは平均値で0.238ppm(Narrowモー
ド)であった。ウルトラスキャン9650によるフラッ
トネスはSFQRで0.22μmであった。これら全て
の品質特性が、実施例1に比べて明らかに劣化してい
た。
チ)、ボロン添加、抵抗率10Ω・cm、初期酸素濃度
16ppm−JEIDA、窒素濃度4×1013/cm3
の結晶をMCZ法により引上げ、ワイヤーソーによりス
ライスし、ラッピング、面取りを行い、水酸化ナトリウ
ム水溶液によるアルカリエッチングを行った。その後、
800℃/4Hr+1000℃/16Hrの熱処理(急
速降温によるドナーキラー熱処理を兼ねる)を施した
後、両面研磨・平坦化研磨および鏡面面取りを行った。
次いで、1130℃でエピ層(ボロン添加、抵抗率10
Ω・cm)を10μm堆積した。
タ:SPー1による測定では、141個/ウエーハのL
PD(サイズ0.09μm以上)が検出され、ヘイズは
平均値で0.303ppm(Narrowモード)であ
った。また、フラットネス測定器ASF−3220でフ
ラットネスを測定したところ、SFQDで0.045μ
mであった。これら全ての品質特性が、実施例2に比べ
明らかに劣化していた。
チ)、ボロン添加、抵抗率10Ω・cm、初期酸素濃度
16ppm−JEIDA、窒素濃度4×1013/cm3
の結晶をMCZ法により引上げ、ワイヤーソーによりス
ライスし、ラッピング、面取りを行い、水酸化ナトリウ
ム水溶液によるアルカリエッチングを行った。その後、
両面研磨・平坦化研磨および鏡面面取りを行った後、1
130℃でエピ層(ボロン添加、抵抗率10Ω・cm)
を10μm堆積した。次いで、800℃/4Hr+10
00℃/16Hrの熱処理(急速降温によるドナーキラ
ー熱処理を兼ねる)を施した。
タ:SPー1による測定では、337個/ウエーハのL
PD(サイズ0.09μm以上)が検出され、ヘイズは
平均値で0.183ppm(Narrowモード)であ
った。また、フラットネス測定器:ASF−3220で
フラットネスを測定したところ、SFQDで0.042
μmであった。これら全ての品質特性が、実施例2に比
べ明らかに劣化していた。
るものではない。上記実施形態は、例示であり、本発明
の特許請求の範囲に記載された技術的思想と実質的に同
一な構成を有し、同様な作用効果を奏するものは、いか
なるものであっても本発明の技術的範囲に包含される。
00mm(8インチ)および300mm(12インチ)
のシリコン単結晶ウエーハからエピタキシャルウエーハ
を作製する場合につき例を挙げて説明したが、本発明は
これには限定されず、直径100〜400mm(4〜1
6インチ)あるいはそれ以上のシリコン単結晶にも適用
できる。
ば、低温・短時間化されたデバイスプロセスに投入する
前の状態で、エピ層にヘイズ、LPD等の欠陥レベルが
低減され、かつ酸素析出が制御されたシリコンエピタキ
シャルウエーハを提供することができる。
一例を示すフロー図である。
例を示すフロー図である。
Claims (4)
- 【請求項1】 シリコン単結晶をスライスして得られる
シリコンウエーハ表面にエピタキシャル層を形成するシ
リコンエピタキシャルウエーハの製造方法において、少
なくともシリコン単結晶インゴットをスライスする際に
生じた加工歪層を除去した後にエピタキシャル成長を行
い、次に酸素析出熱処理を施し、その後にエピタキシャ
ル層の表面を鏡面研磨することを特徴とするシリコンエ
ピタキシャルウエーハの製造方法。 - 【請求項2】 前記加工歪層の除去を化学エッチングで
行うことを特徴とする請求項1に記載のシリコンエピタ
キシャルウエーハの製造方法。 - 【請求項3】 前記スライスするシリコン単結晶は、窒
素ドープしたシリコン単結晶とすることを特徴とする請
求項1または請求項2に記載のシリコンエピタキシャル
ウエーハの製造方法。 - 【請求項4】 請求項1ないし請求項3のいずれか1項
に記載の製造方法によって製造されたことを特徴とする
シリコンエピタキシャルウエーハ。
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| JP2001109172A JP3965931B2 (ja) | 2001-04-06 | 2001-04-06 | シリコンエピタキシャルウエーハの製造方法 |
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| JP2002305202A true JP2002305202A (ja) | 2002-10-18 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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-
2001
- 2001-04-06 JP JP2001109172A patent/JP3965931B2/ja not_active Expired - Fee Related
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| JP3965931B2 (ja) | 2007-08-29 |
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