JP2012043983A - 多層膜形成方法およびそれに用いる成膜装置 - Google Patents

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Abstract

【課題】多層膜における膜厚のばらつきを抑制し製品品質を安定化させると共に、装置および製造に係るコストを低減できる多層膜形成方法および成膜装置を提供する。
【解決手段】基板の少なくとも一方の面に原料ガスの組成が異なる3以上の層を気相化学反応により形成する多層膜形成方法であって、前記基板の搬送経路に沿って第1及び第2の成膜部110,120を有し、前記搬送経路の各端に前記基板の供給/回収部101,102を有する成膜装置100を準備するステップと、前記基板を前記搬送経路に沿って第1の速度で連続的に搬送しつつ、前記各成膜部に相互に組成が近い第1および第2の原料ガスを同時に供給して第1及び第2層を含む複数の層を積層形成する第1の搬送・成膜ステップと、前記第1の搬送・成膜ステップの前または後で、前記第1および第2層と組成が異なる第3層を形成する第2の搬送・成膜ステップと、を含む。
【選択図】図1

Description

本発明は多層膜形成方法に関し、さらに詳しくは、薄膜光電変換素子など、膜厚の異なる多くの層を含む多層膜形成方法およびそれに用いる成膜装置に関するものである。
薄膜光電変換素子の製造方法としては、基板上に非結晶シリコンを主材料とした光電変換層を含む多層膜を形成する方法が公知である。基板にはガラス基板などの枚葉基板が使用されることが多いが、プラスチックフィルムあるいは金属薄板からなる長尺帯状の可撓性基板が使用される場合もある。
成膜装置の構成としては、共通室に設置されたロボットアームで基板(枚葉基板)を把持し、その周囲に配設された成膜室に搬入して成膜する構成のもの、複数の成膜室または成膜領域が基板(枚葉基板または長尺基板)の搬送経路に沿って配設され、基板を搬送しつつ成膜する構成のもの(インライン方式)がある。後者のインライン方式は、前者の方式と比べてプロセスの自由度は低下するが、搬送に必要な時間が短縮される点で優れている。
インライン方式の成膜装置には、基板を所定ピッチで間欠的に搬送しその停止期間中に成膜を行うステップ成膜方式と、基板を所定速度で連続的に搬送しながら成膜する連続成膜方式のものがある。
ステップ成膜方式の成膜装置では、例えば特許文献1に示されるように成膜室を開閉式とするか、成膜室間にゲートバルブなどを設置することで、成膜領域間におけるガスの混合を抑制し、また、各成膜領域における成膜時間を別々に制御できるので、膜質や膜厚の異なる複数の層を含む多層膜形成に適している。特許文献2には成膜室間にガスゲートを設置することが開示されている。しかし、これらシール構造を設置するのにコストを要するうえ、形成すべき層の数に応じて成膜室を設ける必要があり、装置が大型化する問題がある。
一方、連続成膜方式の成膜装置では、搬送時間と成膜時間を別にとる必要がないため、膜質および膜厚が一様な層を成膜する場合には、高い生産性が得られる。しかし、膜質や膜厚の異なる複数の層を含む多層膜形成では、原料ガスを入れ替えて各層毎に成膜する必要があるうえ、不純物の拡散を抑制するために、特許文献3、4に記載されるように、ガス入れ替え時に成膜工程とは別に残留ガスの除去工程を実施する必要がある。
しかも、形成すべき層の厚さは成膜時間に依存し、成膜時間は搬送速度により決定されるので、各層の厚さ(成膜時間)に合わせて搬送速度を変更する必要がある。薄い層は相対的に速い搬送速度で成膜し、厚い層は相対的に遅い搬送速度で成膜する必要がある。そうした場合、特に、薄膜太陽電池のように膜質や膜厚の異なる複数の層を含む多層膜形成においては、搬送速度の可変レンジを広く取る必要があり、装置コストが高くなる。搬送速度を可変にするために、モータの回転速度を可変にする種々の速度制御方式が存在するが、多くの場合、速度制御の精度はモータの回転速度に依存している。そのため、搬送速度の可変レンジが広くなると、その分、搬送速度制御の精度が低下し、膜厚のバラツキが大きくなり、製品の特性が低下することも懸念される。
特開平11−145060号公報 特許第3255903号公報 特開平10−22518号公報 特開2000−183380号公報
本発明は、従来技術の上記のような問題点に鑑みてなされたものであり、その目的は、膜厚の異なる多くの層を含む多層膜における膜厚のばらつきを抑制し、製品品質を安定化させると共に、装置および製造に係るコストを低減できる多層膜形成方法およびそれに用いる成膜装置を提供することにある。
上記課題を解決するために、本発明者が鋭意検討したところ、次のような知見を得て本発明に想到した。膜質や膜厚の異なる多数の層を含む多層膜は、その機能を決定する基本的な層と、それらの間に必要に応じて追加される付加的な層(界面層など)で構成される場合が多く、通常、基本的な層に比べて付加的な層は薄く、隣接した層間で原料ガスの組成が近い場合が多い。多層膜形成における前述の課題は、このような膜質や膜厚の多様性に起因したものであるが、(a)上記付加的な層では、ごく微量であれば、隣接層間でガスの相互拡散を生じても多層膜の本質的機能は損なわれない、(b)このような微量の相互拡散による本質的機能への影響は、成膜条件の平準化による製品品質の向上によって充分に凌駕され得る。
すなわち、本発明は、基板の少なくとも一方の面に、原料ガスの組成が異なる3以上の層を気相化学反応により形成する多層膜形成方法において、
前記基板の搬送経路に沿って少なくとも第1および第2の成膜部を有し、前記搬送経路の各端に前記基板の供給/回収部を有する成膜装置を準備するステップと、
前記基板を前記搬送経路に沿って第1の速度で連続的に搬送しつつ、搬送経路上の異なる成膜部により、異なる膜を順次積層する過程で、前記第1および第2の各成膜部に、相互に組成が近い第1および第2の原料ガスを同時に供給して、相互に組成が近い第1および第2層を含む複数の層を積層形成する第1の搬送・成膜ステップと、
前記第1の搬送・成膜ステップの前または後で、前記基板を前記搬送経路に沿って第2の速度で連続的に搬送しつつ前記第1および第2の各成膜部に、前記第1および第2の原料ガスと組成が異なりかつ相互に実質的に組成が同一である第3の原料ガスを供給して、前記第1および第2層と組成が異なる第3層を形成する第2の搬送・成膜ステップと、
を含む、多層膜形成方法を採用したことにある。
本発明に係る多層膜形成方法では、上記のように、第1の搬送・成膜ステップで、相互に原料ガスの組成が近い層(第1および第2層を含む複数の層)を同時に積層形成することで、第1層と第2層を含む複数の層を基板上に順次積層形成される一方、それらと原料ガスの組成が異なる第3層を、別の第2の搬送・成膜ステップで形成することにより、それぞれの搬送・成膜ステップ毎の成膜時間および搬送速度が平準化され、第1層、第2層そして第3層の各層すべてを個別に成膜する場合に比べて、第1の速度(第1の搬送・成膜ステップの搬送速度)と第2の速度(第2の搬送・成膜ステップの搬送速度)の差、すなわち、搬送速度の可変レンジを小さくでき、装置コストを低減できる。また、搬送速度の可変レンジが小さくなることで、搬送速度制御の精度が向上され、膜厚や膜質などの製品品質を安定化させることができる。さらに、基板を間欠的にステップ送りし各停止期間中に各層を順次成膜する場合のように成膜装置の規模が過大にならずに済み、また、各層を個別に成膜する場合に比べて、搬送・成膜ステップの数を削減でき、搬送・成膜ステップ間でのガス入れ替え工程の頻度や、搬送経路端部の基板の供給/回収部の動作頻度が低減され、製造工程が簡素化される利点もある。
上記のような観点から、本発明に係る多層膜形成方法は、前記第3の層の膜厚が、前記第1および第2の層を含む前記複数の層を合わせた膜厚よりも大きい場合に有利である。気相化学反応を行う第1および第2の各成膜部に設置される電極対は、汎用性および製造コストを考慮すれば、同規格で構成されることが有利であり、そのような装置構成において、膜厚の大きい第3の層の成膜が、第1および第2の各成膜部を使用して実施されることで、成膜の処理効率を向上できる(電極面積が2倍になれば搬送速度は2倍にでき成膜時間は2分の1にできる)。
また、同様の観点から、本発明に係る多層膜形成方法では、前記第3の層の膜厚が、前記第1および第2の層を含む前記複数の層を合わせた膜厚よりも2倍以上大きい場合に、前記第3層を形成する第2の搬送・成膜ステップが複数回に分けて実施されることが有利である。膜厚差が大きくても搬送速度の可変レンジを拡げずに済み、安定した品質の成膜工程を実施できる。この場合、第2の搬送・成膜ステップが複数回になる分、搬送・成膜ステップの数は増えるが、これらのステップ間ではガス入れ替え工程は不要であり、製造工程が煩雑になることもない。
本発明に係る多層膜形成方法において、前記第1および第2の原料ガスは相互に共通の添加成分を異なる添加量にて含み、前記第3の原料ガスは前記添加成分を含まない場合が想定される。あるいは、前記第1および第2の原料ガスはそれぞれの主ガスの濃度が異なりかつ前記第3層から離れた一方のみが添加成分を含み、前記第3の原料ガスは前記添加成分を含まない場合が想定される。
本発明に係る多層膜形成方法は、前記多層膜が、pin接合構造を有する薄膜光電変換素子であり、前記第1および第2層が、p型半導体層およびp/i界面層であるか、または、n型半導体層およびn/i界面層であり、前記第3層がi型半導体層である場合に特に好適に実施可能である。
pin接合構造を有する薄膜光電変換素子では、発電層となるi型半導体層の膜厚が、他のp型半導体層、n型半導体層の膜厚よりも大きく、p型半導体層、n型半導体層とそれらに隣接したp/i界面層、n/i界面層を合わせた膜厚よりも大きい。また、p/i界面層、n/i界面層は、それぞれに隣接するp型半導体層、n型半導体層と原料ガスの組成が近い。したがって、p型半導体層とp/i界面層、n型半導体層とn/i界面層を、それぞれ、1回の搬送・成膜ステップで同時に積層形成し、膜厚の大きいi型半導体層を別の搬送・成膜ステップで第1および第2の成膜部の両方を用いて形成することにより、膜厚が小さいp型半導体層、p/i界面層、n型半導体層、および、n/i界面層の成膜時における搬送速度(第1の速度)が半減し、かつ、膜厚の大きいi型半導体層の成膜時における搬送速度(第2の速度)が倍増する相乗的な効果により、i型半導体層とそれ以外の各層との膜厚の差が8倍以上あっても、搬送速度の可変レンジ(第1の速度と第2の速度の差)をごく狭い範囲に減縮することができる。
また、本発明に係る多層膜形成方法は、前記多層膜が、pin接合構造を有する薄膜光電変換素子であり、前記第1および第2層が、p型半導体層およびp/i界面層であるか、または、n型半導体層およびn/i界面層であり、前記添加成分が、前記各型に対応したドーピングガスであり、前記第3層がi型半導体層である場合に好適に実施できる。
p型半導体層とそれに隣接するp/i界面層との間、n型半導体層とそれに隣接するn/i界面層との間では、p,n各型に対応したドーピングガスの設定濃度にごく僅かではあるが許容範囲があり、このような許容範囲内での設定濃度の変動よりも、成膜条件の平準化による制御精度の向上とそれに伴う膜分布の均一性による利点が大きい。
本発明に係る多層膜形成方法は、前記第1および第2の搬送・成膜ステップを含む複数の搬送・成膜ステップを、前記搬送経路の各端の供給/回収部の間で、前記基板を往復搬送しながら実施することを含む場合に特に好適である。上述したように、本発明に係る多層膜形成方法は、各搬送・成膜ステップ毎の成膜時間および搬送速度が平準化され、搬送速度の可変レンジが狭いので、基板を往復搬送しながら成膜するのに最適である。
本発明に係る多層膜形成方法において、前記成膜装置を準備するステップは、前記第1および第2の成膜部として、前記基板が通過可能なスリットを介して相互に連通されかつそれぞれの内部に少なくとも1つの成膜用電極対が配設された第1および第2の成膜室を有する成膜装置を準備することを含むことが好適である。この構成により、各成膜部を搬送経路に沿って隣接配置しつつも各成膜部間のガスの拡散が抑制され、かつ、コンダクタンスが低減されるので、良好な成膜工程を実施できる。
さらに、前記成膜装置を準備するステップは、前記第1および第2の成膜室の少なくとも一方の内部に少なくとも2つの成膜用電極対が配設された成膜装置を準備することを含むことが好適である。この構成では、第1層および第2層が、第1および第2の成膜室に割り当てられる場合の他に、成膜室内の各電極対を、第1層または第2層に隣接した組成が近い層、例えば、第2の各型界面層や第2の各型半導体層に割り当てることで、さらに多くの層を同時に形成でき、また、第1層と第2層とに割り当てられる電極対の配分を変更することにより、第1層と第2層の膜厚が異なる場合にも対応できる。
上記のような利点は、前記成膜装置を準備するステップが、前記第1および第2の成膜部として、共通真空室の内部に配設された少なくとも2つの成膜用電極対を有する成膜装置を準備することを含む場合にも得られる。但し、同時成膜できる原料ガスの組み合わせ条件は、スリットを介して連通された複数の成膜室を含む場合に比べて厳しくなる。
すなわち、2つ以上の別の膜を形成する成膜部が隣接する場合であっても、本発明による構成のように、類似するガスを用いる成膜が隣接するような構成としているので、境界がなくても成膜は可能であるが、隣接するスリットを介して連通した成膜部の方が、各層での膜質は良くなる。
本発明に係る多層膜形成方法において、前記基板が帯状基板であり、前記成膜装置を準備するステップは、前記供給/回収部として、前記基板の巻出し/巻取り部を有する成膜装置を準備することを含み、前記各搬送・成膜ステップは、一方の巻出し/巻取り部で前記基板をロールから巻出し、前記各成膜部で成膜された基板を他方の巻出し/巻取り部でロールに巻取ることを含むことが特に好適である。
しかし、本発明に係る多層膜形成方法は、前記基板が枚葉基板であり、前記成膜装置を準備するステップは、前記供給/回収部として、前記基板の集積装置を有する成膜装置を準備することを含み、前記各搬送・成膜ステップは、一方の集積装置にストックされた前記基板を送出し、前記各成膜部で成膜された基板を他方の集積装置に集積することを含む態様としても実施可能である。
本発明は、上述した多層膜形成方法を実施するための成膜装置にも向けられている。すなわち、本発明に係る成膜装置は、
前記基板を正逆双方向に所定の搬送速度で連続的に搬送可能な搬送装置と、
前記基板の搬送経路の第1および第2端に配設され、前記基板を供給しかつ回収可能な第1および第2の供給/回収部と、
前記基板の搬送経路に沿って配設され、前記基板が通過可能なスリットを介して相互に連通された第1および第2の成膜部と、
前記第1および第2の成膜部に原料ガスを個別に供給するためのガス供給手段と、前記第1および第2の成膜部を個別に排気するための真空排気手段と、
を備え、
前記ガス供給手段は、前記第1および第2の成膜部に、相互に組成が近い第1および第2の原料ガスを同時に供給する第1のガス供給モードと、前記第1および第2の成膜部に、前記第1および第2の原料ガスと組成が異なりかつ相互に実質的に組成が同一である第3の原料ガスを供給する第2のガス供給モードと、を切り換える手段を含む。
本発明に係る成膜装置の好適な態様は、前記ガス供給手段は、前記第1および第2の成膜部に原料ガスを供給する第1および第2のガス供給配管と、前記第1および第2のガス供給配管にそれぞれ接続された第1および第2の分岐配管群と、前記第1および第2の分岐配管群に対してガス種ごとに並列接続された多数のガス供給源と、前記第1および第2の分岐配管群の各分岐管に配設された流量制御手段と、前記切換手段として、前記各分岐管を個別に開閉可能なガス供給弁と、を含む。
上記構成により、前記第1および第2の原料ガスに共通のガス種、さらには、それと前記第3の原料ガスに共通であるかまたは濃度のみが異なるガス種(例えば主ガス)には、共通のガス供給源を用いることができ、それに、他のガス種(例えば添加成分)に対応したガス供給源を追加することで、ガス供給源の数を必要最小限にでき、かつ、容易に変更可能である。
本発明に係る成膜装置において、前記基板が長尺帯状の可撓性基板であり、前記第1および第2の供給/回収部は、前記基板をロールから巻出しかつロールに巻取るための第1および第2のコア駆動装置を含み、前記搬送装置は、前記第1の成膜部と前記第1のコア駆動装置との間に配設された第1のフィードロールと、前記第2の成膜部と前記第2のコア駆動装置との間に配設された第2のフィードロールと、前記第1のフィードロールを駆動する第1のモータと、前記第2のフィードロールを駆動する第2のモータと、を含み、前記各モータは、正逆双方向に回転可能かつ回転速度を可変であることが好適である。
上記構成により、本発明に係る多層膜形成方法を、ロールツウロール方式による往復成膜プロセスとして実施可能となり、かつ、従来のステップ成膜方式に比較して少ない数の成膜部で多層膜の成膜装置を構成でき、装置の規模を縮小できる。
本発明に係る成膜装置において、前記搬送装置は、前記基板を縦姿勢で横方向に搬送しながら成膜できるように、前記第1および第2のコア駆動装置、前記第1および第2のフィードロールのそれぞれの回転軸が鉛直上下方向に配向されていることが好適である。
本発明に係る成膜装置は、従来のステップ成膜方式に比較して少ない数の成膜部で成膜装置を構成でき、装置の規模を縮小できることは既に述べた通りであるが、成膜部の数が少ないことで、成膜区間の両側のフィードロール(またはガイドロール)間の搬送スパンが短縮され、それにより、基板を縦姿勢で横方向に搬送する装置構成であっても、自重による基板の垂下や張力皺の発生が抑制され、基板表面が汚染され難い特徴と相俟って、良好な成膜を実施するうえで有利である。
以上述べたように、本発明に係る多層膜形成方法およびそれに用いる成膜装置は、薄膜光電変換素子など、膜厚の異なる多くの層を含む多層膜の形成プロセスを平準化でき、搬送速度の可変レンジが狭まることで、装置への負担が軽減されると共に、搬送速度制御の精度に起因した膜厚のばらつきが抑制され、製品品質を安定化させる上でも有利である。しかも、装置の大型化を抑え比較的簡素な装置構成にて低コストを実現できると共に、装置の汎用性を維持でき、様々な多層膜の形成に適用可能である。
本発明に係る多層膜形成方法を実施する第1実施形態の成膜装置を示す概略的な平断面図である。 本発明に係る多層膜形成方法を実施する第2実施形態の成膜装置を示す概略的な平断面図である。 1つの電極対を示す図1の要部拡大図である。 本発明方法によって形成可能な第1実施形態の多層膜の積層構造を示す模式的な断面図である。 本発明方法によって形成可能な第2実施形態の多層膜の積層構造を示す模式的な断面図である。 本発明に係る第1実施形態の成膜装置のガス供給系および真空排気系を示す図である。
以下、本発明の実施形態について、図面を参照しながら詳細に説明する。なお、以下の説明において、各実施形態に共通または対応する構成には、共通または対応する符号を付すことで説明を省略する場合がある。
(第1実施形態)
図1は、本発明に係る多層膜形成方法を実施する第1実施形態の成膜装置100を示している。成膜装置100は、長手方向の各端に配設された第1および第2の一対の搬送室(供給/回収部)101,102と、それらの間に列設された第1および第2の2つの成膜室110,120とを備え、基板10を、搬送室101,102の一方から他方に向け各成膜室110,120を通過させてインラインで搬送しながら、各成膜室110,120内にそれぞれ並設された平行平板型の電極対111,112および電極対121,122において前記基板10の表面に気相化学反応により薄膜の層を積層形成するように構成されている。
第1実施形態における基板10は、プラスチックフィルムなどの帯状の可撓性基板からなる。搬送室101,102には、一方のコア103(104)の周囲にロール状に巻かれた可撓性基板10を巻出し、他方のコア104(103)に巻取るためのコア駆動装置(103,104)、および、それらの間で可撓性基板10を所定の搬送速度かつ搬送張力にて搬送すべく同期して駆動回転されるフィードロール105,106が配設され、さらに、図示を省略するが、基板10の張力を検知するためのテンションロールや、搬送経路上において可撓性基板10を案内するガイドロールなどが設けられている。これら以外に、基板10の幅方向位置を制御する端部位置制御ロールや、可撓性基板10の幅方向端部を把持するグリップローラが付設されていても良い。
成膜装置100は、両側の搬送室(供給/回収部)101,102間で基板10を双方向に搬送し、往復成膜工程を実施可能となるように、それぞれのコア103,104およびフィードロール105,106はリバーシブルモータによって駆動される。その際、搬送方向に対して下流側に位置したフィードロール(106)のモータをマスターとして速度制御を行い、搬送方向に対して上流側に位置したフィードロール(105)のモータをスレーブとして基板10の搬送張力が一定に維持されるようにトルク制御を行うとともに、各コア103,104のモータを巻出し/巻取り張力が一定に維持されるようにそれぞれトルク制御を行うことで、基板10を所定の搬送速度かつ搬送張力にて連続的に搬送可能である。各フィードロール105,106のモータの可変速運転における速度制御およびトルク制御は、インバータ制御により実施可能である。但し、速度の可変レンジが小さい場合には、閉ループの電圧制御にて実施することもできる。また、DCブラシレスモータを用いることもできる。
なお、以下の説明では、便宜的に第1搬送室101から第2搬送室102に向かう方向を正方向とする。また、図示例では、各成膜室110,120および各電極対111,112,121,122は長手方向に同数、同形状で対称に配置されているが、電極対の設置数や電極面積などが長手方向に非対称に配置されていても良い。但し、様々な成膜工程に対する自由度や適用性という点では、図示例のような対称配置が有利である。また、成膜装置100は、基板10を縦姿勢にて横方向に搬送しながら成膜できるように、前記各コア103,104、フィードロール105,106、テンションロール等の回転軸はいずれも鉛直方向に配向されているが、搬送姿勢や搬送方向はこれに限定されるものではない。例えば、平姿勢で横方向や上下方向に搬送するように装置を構成することもできる。
可撓性基板10としては、例えば、高耐熱性のポリイミドフィルム(PI)が好適であるが、ポリエーテルイミド(PEI)、ポリエーテルニトリル(PEN)、ポリエーテルサルフォン(PES)、ポリアミド(PA)、ポリアミドイミド(PAI)、ポリエーテルエーテルケトン(PEEK)、ポリエチレンテレフタレート(PET)等の他のプラスチックフィルムを用いることもでき、さらには、アルミニウムやステンレスなどの金属箔を用いることもできる。
可撓性基板10の厚さは、特に限定されるものではないが、薄い方が材料費を削減できる点で有利である。しかし、基板が薄すぎると、材料によっては加工費が高くなり、また、応力による変形が大きくなり、搬送が困難になる場合があるので、材料に合わせて適正な厚さに選定される必要がある。後述の実施例では、可撓性基板10として、幅500mm、厚さ50μmのポリイミドフィルムを用いたが、可撓性基板10の幅は、装置コストおよび製造コストの点では、膜の均一性が得られる限り広い方が望ましい。
各成膜室110,120および各搬送室101,102は、相互に気密に結合され、全体として共通室(共通真空室)を構成する一方、それぞれが隔壁によって仕切られ、各室間のコンダクタンスが低減されている。それぞれの隔壁を貫通して基板10を通過可能にするスリット130が設けられ、該スリット130によって各室は相互に連通されているが、各室が個別に排気され、かつ、各室の真空度が略同一に維持されることで、各室相互間におけるガスの流通が抑制されている。スリット130は、例えば、幅500mmの基板10に対して直交する方向に5mmの幅で形成されるが、基板10の搬送精度が高ければより狭くすることができる。但し、各成膜室の圧力が異なると、ガスの相互拡散抑制のためにコストが高いガスゲートなどを用いる必要があるため、圧力は同じものとする。
各成膜室110,120内に配設された電極対111,112および電極対121,122は、それぞれが容量結合型のプラズマCVD装置を構成するものであり、基板10の搬送経路を挟んでその両側に平行に配置されたカソード(高周波電極)113,123とアノード(接地電極)114,124とで構成されている。カソード113,123は、共通室の外部に配置された高周波電源118に接続されている。後述の実施例では、各電極対111,112,121,122は、基板幅500mmに対し、搬送方向に300mm、基板幅方向に500mmの平行平板電極で構成される。
図3は、プラズマCVD装置を構成する電極対111の好適な実施形態を示している。図3において、カソード113は、表面に多数のガス噴出孔を有する多孔板からなるシャワー電極構造をなしており、背後に画成されたガスチャンバー117内に、共通室の外部からガスを供給することで、カソード113のガス噴出孔を通じて、電極対間の放電成膜領域115にガスを導入可能である。また、アノード114にはヒーターが内蔵されており、アノード114に沿って走行する基板10および放電成膜領域115を加熱可能である。
上記のように構成されたカソード113とアノード114との間に高周波電圧を印加することにより、放電成膜領域115にプラズマが形成され、プラズマ中の成膜の前駆体であるラジカルは拡散して、基板10の表面に堆積し、薄膜を形成可能である。このようなシャワー電極構造の電極対111では、ガスの均一な分布が得られるとともに、電極対間の放電成膜領域115に生じるガス流れによって、他の成膜領域で導入されたガスが当該放電成膜領域115に入りにくい。したがって、同一の成膜室110内に設置された他の電極対112において、当該電極対111と組成の近いガスであれば同時に供給し、連続的に成膜可能であり、さらに、成膜時のガス圧力を上昇させることで、成膜室110,120間の隔壁(スリット130)を省略できる場合もある。
図6は、第1実施形態の成膜装置100のガス供給系140および真空排気系170を示している。各成膜室110,120内に配設された電極対111,112,121,122の放電成膜領域115,115,125,125へのガス供給系140は、成膜に使用する原料ガスを貯蔵するガスボンベなどからなる多数のガス供給源141,142,143・・・と、第1および第2の流量制御部150,160で構成されている。
流量制御部150,160は、ガス供給源141,142,143・・・に対応したマスフローコントローラ155,156,165,166とその前後のガス供給弁153,154,157,158,163,164,167,168とを組み合わせた構成であり、開閉弁151,152,161,162を介して各電極対111,112,121,122のガスチャンバー(117)に接続されている。真空排気系170は、開閉弁171および圧力制御弁172を介して各成膜室110,120に接続された真空ポンプ173で構成され、電極対111,112,121,122毎に配設されている。
上記構成により、各電極対111,112,121,122に導入すべきガス種に対応したガス供給源141,142,143の配管上のガス供給弁153,154,157,158,163,164,167,168のみを選択的に開くことで、各電極対111,112,121,122に所望の原料ガスを所定の混合比にて流量制御しつつ導入可能である。
次に、図4は、上述した第1実施形態の成膜装置100を用いて本発明方法によって形成可能な多層膜の例としてサブストレート型の薄膜光電変換素子1(薄膜太陽電池)の積層構造を示している。薄膜光電変換素子1は、基板10の上に、金属電極層17、n層16、n/i界面層15、i層14、p/i界面層13、p層12、透明電極層11を順次積層したものであり、1つのpin接合構造1aを含むシングルセルとしての例を示している。
上記のような薄膜光電変換素子1においては、p/i界面層13やn/i界面層15の組成は、真性半導体層であるi層14に比べて、各界面層に隣接したドープ層であるp層12やn層16の組成に近い。アモルファスシリコン(a−Si)半導体膜の場合、p型ドーパントとしてはホウ素(B)が、n型ドーパントとしてはリン(P)が、それぞれ添加され、それらを含むジボラン(B)やホスフィン(PH)などのドーピングガスガスが、主ガスであるシラン(SiH)や希釈ガスである水素に添加されるが、それらの界面層においても、それぞれのドーピングガスを異なる低濃度で混合したガスが用いられる。そのため、多少のガスの相互拡散があっても(中間領域は形成されるものの)、機能面での影響は小さい。
しかも、これら界面層(13,15)やドープ層(12,16)は、いずれも膜厚がi層(14)の数%と極端に薄く、成膜における堆積速度を考慮しても、それぞれの成膜時間は、i層(14)のそれに比べて短い。そこで、成膜装置100の2つの成膜室110,120に異なる組成のガスを同時に供給して、各界面層(13,15)と、それらに隣接したドープ層(12,16)とを各1回の搬送・成膜工程で同時に連続して成膜することで、これらの成膜工程での搬送速度を、個別に成膜する場合の1/2にでき、i層(14)の搬送・成膜工程での搬送速度との差、すなわち、搬送速度の可変レンジを小さく抑えることができる。
例えば、表1は、図4に示したサブストレート型の薄膜光電変換素子1のpin接合構造1aを構成する各層の膜厚(nm)、堆積速度(nm/sec)、成膜時間(sec)、および搬送速度(mm/sec)を示しており、成膜時間は、i層の800(sec)に対して他の層は120(sec)であり、i層の15%に過ぎない。
Figure 2012043983
もし仮に、これらの各層(12,13,15,16)を個別に成膜すると、表1の比較例に示されるように、各搬送・成膜工程における搬送速度は10(mm/sec)に設定され、i層(14)の搬送・成膜工程における搬送速度1.5(mm/sec)の6.7倍になる。つまり、各層(12,13,15,16)の搬送・成膜工程における搬送速度を定格とすれば、その1/6以下の搬送速度で成膜工程を実施しなければならない。この場合、搬送速度のばらつきがフルスケールに対して5%であれば、i層(14)の成膜時における膜厚のばらつきは20%程度にもなる。
これに対して、表1の実施例1に示されるように、各界面層(13,15)と、それらに隣接したドープ層(12,16)とを、各1回の搬送・成膜工程で同時に成膜する場合には、これらの搬送・成膜工程における搬送速度は5(mm/sec)であり、i層(14)の搬送・成膜工程における搬送速度1.5(mm/sec)の3.3倍になり、搬送速度の可変レンジは、個別に成膜する場合の1/2になる。この場合、搬送速度のばらつきが上記同様にフルスケールに対して5%であっても、膜厚のばらつきは4%程度で済む。
さらに、後述する実施例2または4に示されるように、膜厚の大きいi層(14)の搬送・成膜工程を、2〜3回の搬送・成膜工程に分けて実施すれば、i層(14)の各搬送・成膜工程における搬送速度を3〜4.5(mm/sec)に設定でき、これらの場合、搬送速度の可変レンジは1.67〜1.11倍まで減縮される。また、後述する実用的な薄膜光電変換素子では、p層が条件を変えて2層に分けて成膜されるので、このような場合には膜厚のばらつきを一層低減できると言える。
次に、図1に示した第1実施形態の成膜装置100により、図4に示したサブストレート型の薄膜光電変換素子1のpin接合構造1a(光電変換層)を積層形成する具体的な搬送・成膜工程について述べる。なお、この場合、基板10には、先行する成膜工程で、既に、銀(Ag)やアルミニウム(Al)などからなる金属電極層17が形成されており、光電変換層はその上に積層形成される。上述した実施例1のように、各界面層(13,15)と、それらに隣接したドープ層(12,16)とを同一搬送・成膜ステップで連続的に成膜する場合には、pin接合構造1aの成膜に関して、以下のような3つの搬送・成膜ステップを含む。
(第1の搬送・成膜ステップ)
先ず、金属電極層17を形成済みの基板10を、第1搬送室101内のロール10aから巻出し、第2搬送室102に向けて正方向に搬送速度5(mm/sec)で搬送しながら、第1成膜室110の各放電成膜領域115に、例えば、主ガスとしてシラン(SiH)および二酸化炭素(CO)、希釈ガスとして水素(H)を用い、n型ドーピングガスとしてホスフィン(PH)を添加した混合ガスを供給すると同時に、第2成膜室120の各放電成膜領域125に、ドーピングガスを添加せず、二酸化炭素量を減らしかつ低濃度に希釈した主ガスを供給し、第1成膜室110で、プラズマCVD法によりアモルファスシリコンオキサイド(a−SiO)系のn層16を形成し、第2成膜室120では、直前に成膜されたn層16の上にn/i界面層15を積層形成する。このような搬送・成膜ステップの終盤すなわち基板10の終端部では、基板10を走行させたまま、または、基板10を停止した状態で、ドーピングガスを添加せずに、基板10の非成膜領域に対して所定時間の成膜工程を実施し、各成膜室構成部材の少なくとも一部を覆うことで、次プロセスにおけるドーピングガスの部材からの放出を抑制する。
(第2の搬送・成膜ステップ)
次に、金属電極層17の上にn層16とn/i界面層15が積層形成され、第2搬送室102内にロール10bとして巻き取られた基板10を、該ロール10bから巻出し、第1搬送室101に向けて逆方向に搬送速度1.5(mm/sec)で搬送しながら、第1および第2成膜室110,120の各放電成膜領域115,125に、水素希釈したシラン(SiH)を供給し、プラズマCVD法により、アモルファスシリコン(a−Si)のi層14を成膜する。
(第3の搬送・成膜ステップ)
次に、金属電極層17の上にn層16、n/i界面層15、i層14が積層形成され、第1搬送室101内にロール10aとして巻き取られた基板10を、該ロール10aから巻出し、第2搬送室102に向けて正方向に搬送速度5(mm/sec)で搬送しながら、第1成膜室110の各放電成膜領域115に、例えば、主ガスとしてシラン(SiH)および二酸化炭素(CO)、希釈ガスとして水素(H)を用い、低濃度に希釈し、かつ、p型ドーピングガスとしてジボラン(B)を少量添加した混合ガスを供給すると同時に、第2成膜室120の各放電成膜領域125に、主ガスとしてシラン(SiH)および二酸化炭素(CO)、希釈ガスとして水素(H)を用い、p型ドーピングガスとしてジボラン(B)を添加し、かつ、前記よりも主ガスの濃度およびドーピングガスの添加量を上昇させた混合ガスを供給し、第1成膜室110で、プラズマCVD法によりアモルファスシリコンオキサイド(a−SiO)系のp/i界面層13を形成し、第2成膜室120では、直前に成膜されたp/i界面層13の上にp層12を積層形成し、第2搬送室102内のロール1bに巻き取る。
上記第3の搬送・成膜ステップにおいて、第2成膜室120内の各電極対121,122に対応したそれぞれの放電成膜領域125において、p型ドーピングガス(B)の添加量を段階的に上昇させたり、二酸化炭素(CO)の濃度を段階的に減少させたりすることもでき、それらの場合、上記第3の搬送・成膜ステップでは、3種類の層がそれぞれに対応した所定の膜厚で連続的に積層形成されることになる。また、前述したように、i層14の成膜を2回に分けて実施する場合は、上記第2の搬送・成膜ステップを、正逆双方向に搬送速度3(mm/sec)で往復搬送しながら2回実施すれば良い。
上述した第1〜第3の搬送・成膜ステップにおけるガス供給を図6に示した第1実施形態の成膜装置100のガス供給系140で実施する場合、図6には、3系統のガス供給源141〜143のみが図示されているが、同様のガス供給源を、例えば、シラン(SiH)、二酸化炭素(CO)、水素(H)ホスフィン(PH)、および、ジボラン(B)の6系統準備する。
そして、第1〜第3のそれぞれの搬送・成膜ステップにおいて、第1および第2成膜室110,120のそれぞれで使用するガス種に対応したガス供給弁153,154,157,158,163,164、167,168を選択的に開き、対応するマスフローコントローラ155,156,165,166で流量制御を実施することで、原料ガスの種類、濃度および混合比を切換可能である。なお、各ガス供給源に、所定の希釈度に希釈された原料ガスを準備することもできる。
上記第1実施形態では、サブストレート型の薄膜光電変換素子1のpin接合構造1aを積層形成する搬送・成膜工程について述べたが、基板10の上に金属電極層17を形成する先行工程(一次成膜工程)や、pin接合構造1aの上に、透明電極層11を成膜するのに、成膜装置100を使用することもできる。但し、一次成膜工程の後に、金属電極層17を多数の単位セルに分割するレーザスクライビング工程などが入るので、基板10(ロール)は一旦搬送室101または102から搬出される。また、サブストレート型の薄膜光電変換素子1では、基板10の背面(図4における下面)に直列接続用の金属電極層が形成される場合があり、その成膜工程に上記同様に成膜装置100を使用することもできる。
また、上記実施形態では、n層およびn/i界面層、p/i界面層およびp層をそれぞれ同一搬送・成膜ステップで連続的に成膜する場合について述べたが、n層およびn/i界面層、または、p/i界面層およびp層のいずれかのみに実施しても良い。また、pin接合構造を構成するシリコン系材料としては、アモルファスシリコン(a−Si)やアモルファスシリコンオサイド(a−SiO)の他に、アモルファスシリコンカーバイド(a−SiC)、アモルファスシリコンナイトライド(a−SiN)など、周知のシリコン系材料を用いることができ、また、微結晶シリコン(μc−Si)薄膜やアモルファス相を含む微結晶シリコン薄膜等であっても良い。
さらに、上記実施形態では、1つのpin接合構造1aを含むシングルセルとしての例を示したが、2つのpin接合構造を積層した2層タンデムや、3つのpin接合構造を積層したトリプルセルなどの多接合構造であっても良い。それらの場合、上記第1〜第3の搬送・成膜ステップが、必要に応じて原料ガスの組成や成膜条件を変更して反復されるので、多接合構造であるほど、本発明に係る多層膜形成方法による製造工程の簡素化、装置負担の軽減、製品品質を安定化などのメリットが大きくなると言える。
(第2実施形態)
図2は、本発明に係る多層膜形成方法を実施する第2実施形態の成膜装置200を示している。成膜装置200は、ガラス基板などの枚葉基板20をインラインで搬送しながら、上述した第1実施形態と同様の往復搬送・成膜ステップを実施するために、長手方向の各端に配設された第1および第2の一対の搬送室(供給/回収部)201,202と、それらの間に列設された第1および第2の2つの成膜室210,220とを備えている。
この成膜装置200は、各成膜室210,220内に並設された平行平板型の電極対211,212および電極対221,222の構成は第1実施形態と同様であるが、各成膜室210,220には、枚葉基板20を搬送経路に沿って所定ピッチでインライン搬送するために、基板20の幅方向端部を把持して送出するローラコンベアまたはベルトコンベアなどからなる不図示の搬送装置が設けられている。
さらに、各搬送室201,202は、多数の枚葉基板20を重ね合わせた状態にストック(20a,20b)し、かつ、ストックされた基板20を一枚ずつ送り出して搬送装置(搬送経路)に供給可能な集積装置として構成されている。なお、各搬送室201,202(集積装置)および搬送装置は、各枚葉基板20を一枚ずつホルダ(キャリア)に保持した状態でストックし、かつ、搬送・成膜できるように構成されても良い。
また、直線的な搬送経路の途中に、基板20の搬送方向を変更する機構を備えていても良い。さらには、搬送経路の終端(搬送室202)を始端(搬送室201)に循環させ、1つの搬送・成膜ステップを終了した基板20が、次の搬送・成膜ステップを同じ搬送方向にて実施するために、搬送室201に集積されるように構成することもできる。
また、図示例では、各成膜室210,220および各電極対211,212,221,222は長手方向に同数、同形状で対称に配置されているが、第1実施形態の場合同様、電極対の設置数や電極面積などが長手方向に非対称に配置されていても良い。さらに、成膜装置200は、基板20を縦姿勢にて横方向に搬送しながら成膜する構成の他に、平姿勢で横方向や上下方向に搬送しながら成膜する構成としても良い。
上記のように構成された成膜装置200においても、第1実施形態の成膜装置100と同様の搬送・成膜ステップを実施可能であることは、図面からも明らかであるので、ここでは詳細な説明を省略する。また、第2実施形態の成膜装置200は、図4に示したサブストレート型の薄膜光電変換素子1以外に、ガラスなどの透明な枚葉基板を用いたスーパーストレート型の薄膜光電変換素子の搬送・成膜工程に好適に使用可能である。
図5は、第2実施形態の成膜装置200を用いて本発明方法により形成可能なスーパーストレート型の薄膜光電変換素子2(薄膜太陽電池)の積層構造を示している。図5において、薄膜光電変換素子2は、透明な基板20の上に、透明電極層21、p層22、p/i界面層23、i層24、n/i界面層25、n層26、金属電極層27を順次積層したものであり、1つのpin接合構造2aを含むシングルセルとしての例を示している。
このスーパーストレート型の薄膜光電変換素子2は、基板20に対するpin接合構造2a向きがサブストレート型と上下逆であるため、成膜順は逆になるが、各界面層(23,25)と、それらに隣接したドープ層(22,26)とを同一搬送・成膜ステップで連続的に成膜し、i層24を別の搬送・成膜ステップで成膜する点は、第1実施形態と同様である。
すなわち、第1の搬送・成膜ステップで、透明電極層21が形成された基板20を第1搬送室201から第2搬送室202に向けて正方向に搬送しながら、透明電極層21の上にp層22およびp/i界面層23を連続的に積層形成し、次いで、第2の搬送・成膜ステップでは、基板20を逆方向に搬送しながら、p/i界面層23の上にi層24を形成し、さらに、第3の搬送・成膜ステップでは、基板20を再度正方向に搬送しながら、i層24の上にn/i界面層25およびn層26を連続的に積層形成することになる。
次に、本発明に係る各実施例について述べる。以下の実施形態は基本的に前記第1実施形態に基づいてpin接合構造の搬送・成膜ステップを実施したものであるが、上述したような変更を加えることで前記第2実施形態の実施例ともなりうることは容易に理解されよう。
(実施例2)
表2に示す実施例2では、2つの成膜室110,120を合わせた搬送区間(成膜領域)の長さが2mの成膜装置100を用い、以下のような2往復の搬送・成膜ステップ1〜4を実施し、金属電極層および透明電極層が積層形成された基板上にpin接合構造(光電変換層)の多層膜を形成した。
Figure 2012043983
(2.1)搬送・成膜ステップ1
基板10を搬送速度8.4mm/secで正方向に搬送しつつ、第1成膜室110にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)10倍、ドーピングガス添加量(PH/SiH)1%、二酸化炭素添加量(CO/SiH)1倍としてa−SiO系のn層を成膜し、第2成膜室120にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)25倍、ドーピングガス無添加、二酸化炭素添加量(CO/SiH)0.3倍としてn/i層を成膜した。
(2.2)搬送・成膜ステップ2
基板10を搬送速度5.0mm/secで逆方向に搬送しつつ、第1および第2成膜室110,120にて、主ガスSiH:20ml/min、水素希釈度(H/SiH)10倍としてa−Siのi層の1/2を成膜した。
(2.3)搬送・成膜ステップ3
基板10をステップ2と同じ搬送速度5.0mm/secで正方向に搬送しつつステップ2と同じガス条件でa−Siのi層の残余の1/2を成膜した。
(2.4)搬送・成膜ステップ4
基板10を搬送速度8.4mm/secで逆方向に搬送しつつ、第2成膜室120にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)25倍、ドーピングガス添加量(B/SiH)100ppm、二酸化炭素添加量(CO/SiH)0.4倍としてp/i層を成膜し、第1成膜室110の第2電極対112にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)20倍、ドーピングガス添加量(B/SiH)1%、二酸化炭素添加量(CO/SiH)1倍としてa−SiO系のp1層を、第1成膜室110の第1電極対111にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)20倍、ドーピングガス添加量(B/SiH)2%、二酸化炭素添加量(CO/SiH)1倍としてa−SiO系のp2層を成膜した。
上記実施例2では、n層とn/i層を搬送・成膜ステップ1で同時に成膜し、最も膜厚の大きいi層を搬送・成膜ステップ2,3に分けて成膜する一方、p/i層と、その1/2の膜厚を有するp1層およびp2層を、搬送・成膜ステップ4で同時に成膜している。この実施例2では、搬送・成膜ステップ2,3の搬送速度(2.5mm/sec)を、i層を1ステップで成膜する場合の搬送速度(1.25mm/sec)の2倍に設定でき、他の搬送・成膜ステップ1,4との搬送速度の差が小さくなっている。また、搬送・成膜ステップ4では、成膜装置100の成膜領域を、第2成膜室120に対応した1/2領域と、第1成膜室110の各電極対111,112に対応した2つの1/4領域の、3つの領域に分け、3層を同時に成膜している。
(実施例3)
表3に示す実施例3では、実施例2と同様に2つの成膜室110,120を合わせた搬送区間(成膜領域)の長さが2mの成膜装置100を用い、以下のような1.5往復の搬送・成膜ステップ1〜3を実施し、金属電極層および透明電極層が積層形成された基板上にpin接合構造(光電変換層)の多層膜を形成した。
Figure 2012043983
(3.1)搬送・成膜ステップ1
基板10を搬送速度16.6mm/secで正方向に搬送しつつ、第1および第2成膜室110,120にて、主ガスSiH:10ml/min、水素希釈度(H/SiH)25倍、ドーピングガス添加量(PH/SiH)4%、二酸化炭素添加量(CO/SiH)0.25倍としてa−SiO系のn層を成膜した。
(3.2)搬送・成膜ステップ2
基板10を搬送速度5.2mm/secで逆方向に搬送しつつ、第1および第2成膜室110,120にて、主ガスSiH:25ml/min、水素希釈度(H/SiH)15倍としてi層を成膜した。なお、実施例3では、n/i層が省略された代わりに、i層にごく微量(2ppm)のドーピングガスが添加された。
(3.3)搬送・成膜ステップ3
基板10を搬送速度13.3mm/sec正方向に搬送しつつ、第1成膜室110にて、主ガスSiH:10ml/min、水素希釈度(H/SiH)25倍、ドーピングガス添加量(B/SiH)200ppm、二酸化炭素添加量(CO/SiH)0.35倍としてp/i層を成膜し、第2成膜室120の第1電極対121にて、主ガスSiH:10ml/min、水素希釈度(H/SiH)20倍、ドーピングガス添加量(B/SiH)1%、二酸化炭素添加量(CO/SiH)2倍としてp1層を、第2成膜室120の第2電極対122にて、主ガスSiH:10ml/min、水素希釈度(H/SiH)20倍、ドーピングガス添加量(B/SiH)2%、二酸化炭素添加量(CO/SiH)0.9倍としてp2層を成膜した。
上記実施例3では、i層の膜厚が先行する実施例に比べて小さいことから、i層は1回の搬送・成膜ステップで成膜するものとしてステップ数を3回に留め、処理工程の簡素化を図っている。
(実施例4)
表4に示す実施例4では、搬送方向の長さが均等でない3つの成膜室を備え、第1成膜室に2つ、第2成膜室に3つの電極対がそれぞれ並設され、第3成膜室には3つのハーフサイズの電極対が並設され、第1〜第3成膜室を合わせた搬送区間(成膜領域)の長さが3mである成膜装置を用い、以下のような3往復の搬送・成膜ステップ1〜6を実施し、金属電極層および透明電極層が積層形成された基板上にpin接合構造(光電変換層)の多層膜を形成した。
Figure 2012043983
(4.1)搬送・成膜ステップ1
基板を搬送速度15.8mm/secで正方向に搬送しつつ、第1成膜室にて、主ガスSiH:20ml/min、水素希釈度(H/SiH)5倍、ドーピングガス添加量(PH/SiH)4%、二酸化炭素添加量(CO/SiH)1倍としてa−SiO系のn層を成膜し、第2および第3成膜室にて、主ガスSiH:20ml/min(各室10ml/min)、水素希釈度(H/SiH)25倍、ドーピングガスおよび二酸化炭素を添加しないでn/i層を成膜した。
(4.2)搬送・成膜ステップ2
基板を搬送速度25.0mm/secで逆方向に搬送しつつ、第3成膜室の第2第3電極対にて、主ガスSiH:10ml/min、水素希釈度(H/SiH)200倍としてμc−Siのi1層を成膜し、第3成膜室の第1電極対と第2および第1成膜室にて、主ガスSiH:20ml/min、水素希釈度(H/SiH)100倍としてμc−Siのi層の10%を成膜した。
(4.3)搬送・成膜ステップ3
基板を搬送速度10.0mm/secで正方向に搬送しつつ、第1〜第3成膜室にて、主ガスSiH:20ml/min、水素希釈度(H/SiH)100倍としてμc−Siのi層の30%を成膜した。
(4.4)搬送・成膜ステップ4
基板を搬送速度10.0mm/secで逆方向に搬送しつつ、第1〜第3成膜室にて、前記同様に主ガスSiH:20ml/min、水素希釈度(H/SiH)100倍としてμc−Siのi層の30%を成膜した。
(4.5)搬送・成膜ステップ5
基板を搬送速度10.0mm/secで正方向に搬送しつつ、第1〜第3成膜室にて、前記同様に主ガスSiH:20ml/min、水素希釈度(H/SiH)100倍としてμc−Siのi層の残余の30%を成膜した。
(4.6)搬送・成膜ステップ6
基板を搬送速度18.8mm/secで逆方向に搬送しつつ、第3成膜室の第3電極対にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)25倍、ドーピングガス添加量(B/SiH)100ppmとしてp/i層を、第3成膜室の第2および第1電極対にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)20倍、ドーピングガス添加量(B/SiH)1%としてa−Siのp1層を成膜し、第2および1成膜室にて、主ガスSiH:5ml/min、水素希釈度(H/SiH)250倍、ドーピングガス添加量(B/SiH)2%としてμc−Siのp2層を成膜した。
上記実施例4では、n層とn/i層を搬送・成膜ステップ1で同時に成膜し、最も膜厚の大きいi層の10%と、そのn/i層側に介在する相対的に低濃度のi1層とを搬送・成膜ステップ2で同時に成膜し、さらに、i層の残余の90%を搬送・成膜ステップ3〜5に分けて成膜した後、p/i層、p1層およびp2層を、搬送・成膜ステップ6で同時に成膜している。
上記各実施例1〜4の多層膜形成プロセスで得られたpin接合構造の光電変換層の上に透明電極層を形成した光電変換セルは、比較例のように各層を個別に成膜した光電変換層の上に透明電極層を形成した同構造の光電変換セルと比較しても、発電効率等の性能面で差は見られず、その一方で、格段に簡素化された搬送・成膜ステップで効率良く製造可能であるとともに、搬送速度の可変レンジが小さく抑えられたことで、膜厚のばらつきが抑制され、製品品質の安定化が期待できる。
以上、本発明のいくつかの実施形態について述べたが、本発明は上記に限定されるものではなく、上記以外にも本発明の技術的思想に基づいてさらに各種の変形および変更が可能である。
例えば、上記各実施形態では、成膜装置100,200に、容量結合型のプラズマCVDを用いる場合を示したが、表面波プラズマCVD(SWP−CVD)や、触媒CVD(Cat−CVD)、あるいは、電子サイクロトロン共鳴プラズマCVD(ECR−CVD)を利用したものであっても良い。但し、ガスを原料としないスパッタなどの物理蒸着(PVD)は、複数の層を連続的に成膜することに困難はなく、本発明の範囲外である。
本発明に係る多層膜形成方法は、薄膜光電変換素子の製造工程に限定されるものではなく、膜厚の異なる多くの層を含む他の多層膜の製造工程にも利用可能である。
1,2 薄膜光電変換素子
1a,2a pin接合構造
10,20 基板
11,21 透明電極層
12,22 p層
13,23 p/i界面層
14,24 i層
15,25 n/i界面層
16,26 n層
17,27 金属電極層
100,200 成膜装置
101,102,201,202 搬送室
103,104 コア(コア駆動装置)
105,106 フィードロール
110,120,210,220 成膜室
111,112,121,122,211,212,221,222 電極対
113,123,213,223 カソード(高周波電極)
114,124,214,224 アノード(接地電極)
115,125,215,225 放電成膜領域
140 ガス供給系
141,142,143 ガス供給源
150,160 流量制御部
151,152,161,162 開閉弁
153,154,157,158,163,164,167,168 ガス供給弁
155,156,165,166 マスフローコントローラ
170 真空排気系
171 開閉弁
172 圧力制御弁
173 真空ポンプ

Claims (17)

  1. 基板の少なくとも一方の面に、原料ガスの組成が異なる3以上の層を気相化学反応により形成する多層膜形成方法であって、
    前記基板の搬送経路に沿って少なくとも第1および第2の成膜部を有し、前記搬送経路の各端に前記基板の供給/回収部を有する成膜装置を準備するステップと、
    前記基板を前記搬送経路に沿って第1の速度で連続的に搬送しつつ、前記第1および第2の各成膜部に、相互に組成が近い第1および第2の原料ガスを同時に供給して、相互に組成が近い第1および第2層を含む複数の層を積層形成する第1の搬送・成膜ステップと、
    前記第1の搬送・成膜ステップの前または後で、前記基板を前記搬送経路に沿って第2の速度で連続的に搬送しつつ、前記第1および第2の各成膜部に、前記第1および第2の原料ガスと組成が異なりかつ相互に実質的に組成が同一である第3の原料ガスを供給して、前記第1および第2層と組成が異なる第3層を形成する第2の搬送・成膜ステップと、
    を含む、多層膜形成方法。
  2. 前記第3の層の膜厚が、前記第1および第2の層を含む前記複数の層を合わせた膜厚よりも大きい、請求項1に記載の多層膜形成方法。
  3. 前記第3の層の膜厚が、前記第1および第2の層を含む前記複数の層を合わせた膜厚よりも2倍以上大きく、前記第3層を形成する第2の搬送・成膜ステップが、複数回に分けて実施される、請求項1に記載の多層膜形成方法。
  4. 前記第1および第2の原料ガスは相互に共通の添加成分を異なる添加量にて含み、前記第3の原料ガスは前記添加成分を含まない、請求項1に記載の多層膜形成方法。
  5. 前記第1および第2の原料ガスはそれぞれの主ガスの濃度が異なりかつ前記第3層から離れた一方のみが添加成分を含み、前記第3の原料ガスは前記添加成分を含まない、請求項1に記載の多層膜形成方法。
  6. 前記多層膜が、pin接合構造を有する薄膜光電変換素子であり、前記第1および第2層が、p型半導体層およびp/i界面層であるか、または、n型半導体層およびn/i界面層であり、前記第3層がi型半導体層である、請求項1に記載の多層膜形成方法。
  7. 前記多層膜が、pin接合構造を有する薄膜光電変換素子であり、前記第1および第2層が、p型半導体層およびp/i界面層であるか、または、n型半導体層およびn/i界面層であり、前記添加成分が、前記各型に対応したドーピングガスであり、前記第3層がi型半導体層である、請求項4または5に記載の多層膜形成方法。
  8. 前記第1および第2の搬送・成膜ステップを含む複数の搬送・成膜ステップを、前記搬送経路の各端の供給/回収部の間で、前記基板を往復搬送しながら実施することを含む、請求項1に記載の多層膜形成方法。
  9. 前記成膜装置を準備するステップは、前記第1および第2の成膜部として、前記基板が通過可能なスリットを介して相互に連通されかつそれぞれの内部に少なくとも1つの成膜用電極対が配設された第1および第2の成膜室を有する成膜装置を準備することを含む、請求項1に記載の多層膜形成方法。
  10. 前記成膜装置を準備するステップは、前記第1および第2の成膜室の少なくとも一方の内部に少なくとも2つの成膜用電極対が配設された成膜装置を準備することを含む、請求項9に記載の多層膜形成方法。
  11. 前記成膜装置を準備するステップは、前記第1および第2の成膜部として、共通真空室の内部に配設された少なくとも2つの成膜用電極対を有する成膜装置を準備することを含む、請求項1に記載の多層膜形成方法。
  12. 前記基板が帯状基板であり、前記成膜装置を準備するステップは、前記供給/回収部として、前記基板の巻出し/巻取り部を有する成膜装置を準備することを含み、前記各搬送・成膜ステップは、一方の巻出し/巻取り部で前記基板をロールから巻出し、前記各成膜部で成膜された基板を他方の巻出し/巻取り部でロールに巻取ることを含む、請求項8に記載の多層膜形成方法。
  13. 前記基板が枚葉基板であり、前記成膜装置を準備するステップは、前記供給/回収部として、前記基板の集積装置を有する成膜装置を準備することを含み、前記各搬送・成膜ステップは、一方の集積装置から前記基板を送出し、前記各成膜部で成膜された基板を他方の集積装置に集積することを含む、請求項8に記載の多層膜形成方法。
  14. 基板の少なくとも一方の面に、原料ガスの組成が異なる3以上の層を気相化学反応により形成する多層膜形成方法を実施するための成膜装置であって、
    前記基板を正逆双方向に所定の搬送速度で連続的に搬送可能な搬送装置と、
    前記基板の搬送経路の第1および第2端に配設され、前記基板を供給しかつ回収可能な第1および第2の供給/回収部と、
    前記基板の搬送経路に沿って配設され、前記基板が通過可能なスリットを介して相互に連通された第1および第2の成膜部と、
    前記第1および第2の成膜部に原料ガスを個別に供給するためのガス供給手段と、
    前記第1および第2の成膜部を個別に排気するための真空排気手段と、
    を備え、
    前記ガス供給手段は、前記第1および第2の成膜部に、相互に組成が近い第1および第2の原料ガスを同時に供給する第1のガス供給モードと、前記第1および第2の成膜部に、前記第1および第2の原料ガスと組成が異なりかつ相互に実質的に組成が同一である第3の原料ガスを供給する第2のガス供給モードと、を切り換える手段を含む、成膜装置。
  15. 前記ガス供給手段は、前記第1および第2の成膜部に原料ガスを供給する第1および第2のガス供給配管と、前記第1および第2のガス供給配管にそれぞれ接続された第1および第2の分岐配管群と、前記第1および第2の分岐配管群に対してガス種ごとに並列接続された多数のガス供給源と、前記第1および第2の分岐配管群の各分岐管に配設された流量制御手段と、前記切換手段として、前記各分岐管を個別に開閉可能なガス供給弁と、を含む、請求項14に記載の成膜装置。
  16. 前記基板が長尺帯状の可撓性基板であり、
    前記第1および第2の供給/回収部は、前記基板をロールから巻出しかつロールに巻取るための第1および第2のコア駆動装置を含み、
    前記搬送装置は、前記第1の成膜部と前記第1のコア駆動装置との間に配設された第1のフィードロールと、前記第2の成膜部と前記第2のコア駆動装置との間に配設された第2のフィードロールと、前記第1のフィードロールを駆動する第1のモータと、前記第2のフィードロールを駆動する第2のモータと、を含み、
    前記各モータは、正逆双方向に回転可能かつ回転速度を可変である、請求項15に記載の成膜装置。
  17. 前記搬送装置は、前記基板を縦姿勢で横方向に搬送しながら成膜できるように、前記第1および第2のコア駆動装置、前記第1および第2のフィードロールのそれぞれの回転軸が鉛直上下方向に配向されている、請求項16に記載の成膜装置。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014003275A (ja) * 2012-06-14 2014-01-09 Nexpower Technology Corp 薄膜太陽電池及びその製造方法
JP2018532231A (ja) * 2015-10-02 2018-11-01 アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated フレキシブル層スタックを製造するための方法及び装置、並びにフレキシブル層スタック
JP2019019384A (ja) * 2017-07-19 2019-02-07 トヨタ自動車株式会社 処理装置

Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP6047308B2 (ja) * 2012-05-28 2016-12-21 日精エー・エス・ビー機械株式会社 樹脂容器用コーティング装置
CN102877026B (zh) * 2012-09-27 2014-12-24 中国科学院长春光学精密机械与物理研究所 多层膜器件真空沉积装置
US10201623B2 (en) 2013-03-15 2019-02-12 Memorial Sloan Kettering Cancer Center HSP90-targeted cardiac imaging and therapy
WO2020025102A1 (en) * 2018-07-30 2020-02-06 Applied Materials, Inc. Method of coating a flexible substrate with a stack of layers, layer stack, and deposition apparatus for coating a flexible substrate with a stack of layers
NL2021997B1 (nl) * 2018-11-14 2020-05-20 Johannes Hendrikus Lagarde Kevin Systeem en werkwijze voor het deponeren van een eerste en tweede laag op een substraat.
CN111261634A (zh) * 2020-02-10 2020-06-09 无锡拍字节科技有限公司 一种存储器件的制造设备及其方法
CN111739971B (zh) 2020-08-03 2021-02-19 苏州迈正科技有限公司 镀膜设备、方法、系统及太阳能电池、组件、发电系统

Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06132237A (ja) * 1992-10-21 1994-05-13 Canon Inc 機能性堆積膜の連続的製造装置
JP2002009313A (ja) * 2000-06-20 2002-01-11 Fuji Electric Co Ltd 薄膜太陽電池
JP2003007146A (ja) * 2001-06-22 2003-01-10 Fujikura Ltd 酸化物超電導導体及びその製造方法
JP2009094399A (ja) * 2007-10-11 2009-04-30 Fuji Electric Systems Co Ltd 薄膜太陽電池の製造装置

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03255903A (ja) 1990-03-06 1991-11-14 Yokogawa Electric Corp アブソリュート測長器の干渉信号処理方法
JP2824808B2 (ja) * 1990-11-16 1998-11-18 キヤノン株式会社 マイクロ波プラズマcvd法による大面積の機能性堆積膜を連続的に形成する装置
JP3073327B2 (ja) * 1992-06-30 2000-08-07 キヤノン株式会社 堆積膜形成方法
JP3169337B2 (ja) * 1995-05-30 2001-05-21 キヤノン株式会社 光起電力素子及びその製造方法
JPH1022518A (ja) 1996-07-02 1998-01-23 Sharp Corp 化学蒸着装置
JP3475752B2 (ja) 1997-11-06 2003-12-08 富士電機ホールディングス株式会社 薄膜製造装置
JPH11219947A (ja) * 1998-01-29 1999-08-10 Chul-Ju Hwang 半導体素子の薄膜形成方法
JP2000183380A (ja) 1998-12-16 2000-06-30 Toppan Printing Co Ltd 太陽電池成膜装置及び太陽電池成膜方法
TW526545B (en) * 2002-02-05 2003-04-01 Winbond Electronics Corp Method for using pressure to determine the end point of gas cleaning and method of determination thereof
JP4844086B2 (ja) * 2005-10-28 2011-12-21 三菱電機株式会社 半導体製造方法及びサテライト
TWI348730B (en) * 2007-07-17 2011-09-11 Ind Tech Res Inst Method of fabricating polysilicon film

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06132237A (ja) * 1992-10-21 1994-05-13 Canon Inc 機能性堆積膜の連続的製造装置
JP2002009313A (ja) * 2000-06-20 2002-01-11 Fuji Electric Co Ltd 薄膜太陽電池
JP2003007146A (ja) * 2001-06-22 2003-01-10 Fujikura Ltd 酸化物超電導導体及びその製造方法
JP2009094399A (ja) * 2007-10-11 2009-04-30 Fuji Electric Systems Co Ltd 薄膜太陽電池の製造装置

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014003275A (ja) * 2012-06-14 2014-01-09 Nexpower Technology Corp 薄膜太陽電池及びその製造方法
JP2018532231A (ja) * 2015-10-02 2018-11-01 アプライド マテリアルズ インコーポレイテッドApplied Materials,Incorporated フレキシブル層スタックを製造するための方法及び装置、並びにフレキシブル層スタック
JP7023222B2 (ja) 2015-10-02 2022-02-21 アプライド マテリアルズ インコーポレイテッド フレキシブル層スタックを製造するための方法及び装置、並びにフレキシブル層スタック
JP2019019384A (ja) * 2017-07-19 2019-02-07 トヨタ自動車株式会社 処理装置

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