JP2016219785A - 電子部品パッケージ - Google Patents
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Abstract
Description
本願発明者らは、パッケージ技術に関し、以下の如くの問題点・改善点があることを見出し、本開示に係る電子部品パッケージおよびその製造方法を案出した。
[項目1]
第1主面と、前記第1主面と反対側の第2主面とを有する金属パターン層、
前記第1主面上に配置され、前記金属パターン層と電気的に接続された電子部品、
前記第1主面上に配置され、前記金属パターン層と電気的に接続された少なくとも1つの金属部材、
前記第1主面、前記電子部品、および前記少なくとも1つの金属部材上に配置された封止樹脂層、並びに
前記第2主面上に配置された絶縁層を備え、
前記少なくとも1つの金属部材の厚みが前記電子部品の厚みよりも大きく、
平面視において、前記少なくとも1つの金属部材が前記第1主面の端に接する位置にのみ設けられており、
前記少なくとも1つの金属部材の下方の領域に位置する前記金属パターン層の少なくとも一部が、前記絶縁層から露出している、電子部品パッケージ。
[項目2]
前記少なくとも1つの金属部材の厚みが、前記封止樹脂層の厚みの50%以上90%以下である、項目1に記載の電子部品パッケージ。
[項目3]
前記少なくとも1つの金属部材の側面が前記封止樹脂層の端面から露出している、項目1または2に記載の電子部品パッケージ。
[項目4]
前記少なくとも1つの金属部材の前記露出している前記側面と前記封止樹脂層の前記端面とが面一になっている、項目3に記載の電子部品パッケージ。
[項目5]
前記少なくとも1つの金属部材は複数の金属部材を備え、
平面視において、前記複数の金属部材が前記第1主面の端に接する位置にのみ設けられている、項目1から4のいずれかに記載の電子部品パッケージ。
[項目6]
平面視において、前記複数の金属部材が、互いに間隔を空けて前記第1主面の端に沿って配置されている、項目5に記載の電子部品パッケージ。
[項目7]
前記少なくとも1つの金属部材が直方体または立方体の形状を有する、項目1から4のいずれかに記載の電子部品パッケージ。
この場合に、前記直方体および前記立方体の辺および角が丸みを帯びていてもよい。
[項目8]
前記金属パターン層が第1金属層と第2金属層とを含む、項目1から7のいずれかに記載の電子部品パッケージ。
[項目9]
前記絶縁層がソルダーレジスト層である、項目1から8のいずれかに記載の電子部品パッケージ。
[項目10]
(i)電子部品および少なくとも1つの金属部材を粘着性キャリアに貼り付ける工程、
(ii)前記電子部品および前記少なくとも1つの金属部材を覆うように、前記粘着性キャリア上に封止樹脂層を形成し、電子部品パッケージ前駆体を得る工程、
(iii)前記電子部品パッケージ前駆体から前記粘着性キャリアを剥離し、前記封止樹脂層の表面から前記電子部品および前記少なくとも1つの金属部材を露出させる工程、
(iv)前記封止樹脂層の前記表面に金属層を形成する工程、並びに
(v)前記少なくとも1つの金属部材が分割されるようにダイシング処理を行う工程
を含み、
前記少なくとも1つの金属部材の厚みが前記電子部品の厚みよりも大きい、電子部品パッケージの製造方法。
[項目11]
前記工程(i)において、前記電子部品が前記少なくとも1つの金属部材よりも相対的に内側に位置付けられるように、前記電子部品と前記少なくとも1つの金属部材とを前記粘着性キャリアに設ける、項目10に記載の電子部品パッケージの製造方法。
[項目12]
前記少なくとも1つの金属部材が複数の金属部材を備え、
前記工程(i)において、前記複数の金属部材が枠状部材に連結されている、項目10または11に記載の電子部品パッケージの製造方法。
[項目13]
前記複数の金属部材が前記枠状部材の外縁よりも内側に位置付けられるように、前記複数の金属部材と前記枠状部材とが互いに連結されている、項目12に記載の電子部品パッケージの製造方法。
[項目14]
前記複数の金属部材の各々が直方体または立方体の形状を有している、項目12または13に記載の電子部品パッケージの製造方法。
[項目15]
前記ダイシング処理は、前記枠状部材の前記外縁の内側であって、前記複数の金属部材がそれぞれ分割される位置にて行われる、項目13に記載の電子部品パッケージの製造方法。
[項目16]
前記工程(iv)において、乾式めっき法を実施した後、湿式めっき法を実施することによって前記金属層を形成する、項目10から15のいずれかに記載の電子部品パッケージの製造方法。
[項目17]
前記工程(i)で用いられる前記少なくとも1つの金属部材の厚みが、前記工程(ii)で形成する前記封止樹脂層の厚みの50%以上90%以下である、項目9から11のいずれかに記載の電子部品パッケージの製造方法。
まず、本開示に係る電子部品パッケージの製造方法について説明する。図1Aから図1Gおよび図2Aから図2Cは、本開示の製造方法に関連したプロセスを模式的に示している。本開示の製造方法では、まず工程(i)を実施する。即ち、粘着性キャリア10に貼り付けられるように電子部品20および金属部材30を粘着性キャリア10に設ける(図1Aおよび図1B参照)。
本開示では、複数の金属部材30を備えた電子部品パッケージ100を製造してよい。特に「複数の金属部材30が封止樹脂層40の周縁部にのみ位置付けられた電子部品パッケージ100」を製造してよい。
本開示の製造方法に従えば、複数の電子部品パッケージを一括して製造することができる。具体的には、同時に複数個の電子部品パッケージを得るために、工程(i)の金属部材30として、複数個の電子部品パッケージに相当する個数を備えた一体化部材を用いる。
本開示の製造方法では、半田部の形成を付加的に実施してもよい。具体的には、図6Aおよび6Bに示すように、「電子部品パッケージが実装される基板との接続に用いられる半田部70」をダイシング処理後に形成してよい。ここでいう、「基板」とは、二次基板のことを指しており、例えばプリント基板(プリント配線板)などである。
次に、本開示の電子部品パッケージについて説明する。本開示の電子部品パッケージは、上記の本開示の製造方法で得られるパッケージである。
14 支持基材
16 粘着層
20 電子部品
30 金属部材
310 一体化部材
30A 側面
31 枠状部材
32 領域
40 封止樹脂層
40A 端面
50 金属層
51 乾式めっき層
52 湿式めっき層
54 金属パターン層
60 レジスト層
70 半田部
100 電子部品パッケージ
110 電子部品パッケージ前駆体
320 ダイシングライン
420 周縁部
Claims (9)
- 第1主面と、前記第1主面と反対側の第2主面とを有する金属パターン層、
前記第1主面上に配置され、前記金属パターン層と電気的に接続された電子部品、
前記第1主面上に配置され、前記金属パターン層と電気的に接続された少なくとも1つの金属部材、
前記第1主面、前記電子部品、および前記少なくとも1つの金属部材上に配置された封止樹脂層、並びに
前記第2主面上に配置された絶縁層を備え、
前記少なくとも1つの金属部材の厚みが前記電子部品の厚みよりも大きく、
平面視において、前記少なくとも1つの金属部材が前記第1主面の端に接する位置にのみ設けられており、
前記少なくとも1つの金属部材の下方の領域に位置する前記金属パターン層の少なくとも一部が、前記絶縁層から露出している、電子部品パッケージ。 - 前記少なくとも1つの金属部材の厚みが、前記封止樹脂層の厚みの50%以上90%以下である、請求項1に記載の電子部品パッケージ。
- 前記少なくとも1つの金属部材の側面が前記封止樹脂層の端面から露出している、請求項1または2に記載の電子部品パッケージ。
- 前記少なくとも1つの金属部材の前記露出している前記側面と前記封止樹脂層の前記端面とが面一になっている、請求項3に記載の電子部品パッケージ。
- 前記少なくとも1つの金属部材は複数の金属部材を備え、
平面視において、前記複数の金属部材が前記第1主面の端に接する位置にのみ設けられている、請求項1から4のいずれかに記載の電子部品パッケージ。 - 平面視において、前記複数の金属部材が、互いに間隔を空けて前記第1主面の端に沿って配置されている、請求項5に記載の電子部品パッケージ。
- 前記少なくとも1つの金属部材が直方体または立方体の形状を有する、請求項1から4のいずれかに記載の電子部品パッケージ。
- 前記金属パターン層が第1金属層と第2金属層とを含む、請求項1から7のいずれかに記載の電子部品パッケージ。
- 前記絶縁層がソルダーレジスト層である、請求項1から8のいずれかに記載の電子部品パッケージ。
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