JP2017139316A - 半導体装置および製造方法、並びに電子機器 - Google Patents
半導体装置および製造方法、並びに電子機器 Download PDFInfo
- Publication number
- JP2017139316A JP2017139316A JP2016018881A JP2016018881A JP2017139316A JP 2017139316 A JP2017139316 A JP 2017139316A JP 2016018881 A JP2016018881 A JP 2016018881A JP 2016018881 A JP2016018881 A JP 2016018881A JP 2017139316 A JP2017139316 A JP 2017139316A
- Authority
- JP
- Japan
- Prior art keywords
- opening
- core substrate
- insulating layer
- layer
- image sensor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/69—Insulating materials thereof
- H10W70/692—Ceramics or glasses
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0274—Optical details, e.g. printed circuits comprising integral optical means
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/46—Manufacturing multilayer circuits
- H05K3/4602—Manufacturing multilayer circuits characterized by a special circuit board as base or central core whereon additional circuit layers are built or additional circuit boards are laminated
- H05K3/4605—Manufacturing multilayer circuits characterized by a special circuit board as base or central core whereon additional circuit layers are built or additional circuit boards are laminated made from inorganic insulating material
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
- H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
- H10F39/10—Integrated devices
- H10F39/12—Image sensors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
- H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
- H10F39/80—Constructional details of image sensors
- H10F39/804—Containers or encapsulations
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
- H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
- H10F39/80—Constructional details of image sensors
- H10F39/806—Optical elements or arrangements associated with the image sensors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
- H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
- H10F39/80—Constructional details of image sensors
- H10F39/806—Optical elements or arrangements associated with the image sensors
- H10F39/8063—Microlenses
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10F—INORGANIC SEMICONDUCTOR DEVICES SENSITIVE TO INFRARED RADIATION, LIGHT, ELECTROMAGNETIC RADIATION OF SHORTER WAVELENGTH OR CORPUSCULAR RADIATION
- H10F39/00—Integrated devices, or assemblies of multiple devices, comprising at least one element covered by group H10F30/00, e.g. radiation detectors comprising photodiode arrays
- H10F39/80—Constructional details of image sensors
- H10F39/811—Interconnections
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/01—Manufacture or treatment
- H10W70/05—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/67—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their insulating layers or insulating parts
- H10W70/68—Shapes or dispositions thereof
- H10W70/685—Shapes or dispositions thereof comprising multiple insulating layers
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/01—Dielectrics
- H05K2201/0104—Properties and characteristics in general
- H05K2201/0108—Transparent
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/09—Shape and layout
- H05K2201/09009—Substrate related
- H05K2201/09072—Hole or recess under component or special relationship between hole and component
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2201/00—Indexing scheme relating to printed circuits covered by H05K1/00
- H05K2201/10—Details of components or other objects attached to or integrated in a printed circuit board
- H05K2201/10007—Types of components
- H05K2201/10121—Optical component, e.g. opto-electronic component
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W74/00—Encapsulations, e.g. protective coatings
- H10W74/10—Encapsulations, e.g. protective coatings characterised by their shape or disposition
- H10W74/15—Encapsulations, e.g. protective coatings characterised by their shape or disposition on active surfaces of flip-chip devices, e.g. underfills
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/721—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
- H10W90/724—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between a chip and a stacked insulating package substrate, interposer or RDL
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Chemical & Material Sciences (AREA)
- Inorganic Chemistry (AREA)
- Manufacturing & Machinery (AREA)
- Solid State Image Pick-Up Elements (AREA)
- Ceramic Engineering (AREA)
- Production Of Multi-Layered Print Wiring Board (AREA)
- Wire Bonding (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Abstract
【課題】平坦度の高い部品実装を低コストで実現できるようにする。
【解決手段】半導体装置は、コア基板と、複数の導電層および複数の絶縁層を有し、コア基板表面に形成された多層配線層と、多層配線層に形成され、複数の絶縁層のうちの少なくとも最もコア基板から遠い最外側の絶縁層を貫通する開口部と、開口部内における、複数の導電層のうちの最もコア基板から遠い最外側の導電層よりもコア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とを有する。本技術は撮像装置に適用することができる。
【選択図】図2
【解決手段】半導体装置は、コア基板と、複数の導電層および複数の絶縁層を有し、コア基板表面に形成された多層配線層と、多層配線層に形成され、複数の絶縁層のうちの少なくとも最もコア基板から遠い最外側の絶縁層を貫通する開口部と、開口部内における、複数の導電層のうちの最もコア基板から遠い最外側の導電層よりもコア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とを有する。本技術は撮像装置に適用することができる。
【選択図】図2
Description
本技術は半導体装置および製造方法、並びに電子機器に関し、特に、平坦度の高い部品実装を低コストで実現することができるようにした半導体装置および製造方法、並びに電子機器に関する。
例えば、半導体微細加工技術を応用したCCD(Charge Coupled Device)やCMOS(Complementary Metal Oxide Semiconductor)イメージセンサ等の撮像素子は、デジタルカメラや携帯電話等に広く採用されている。
これらの撮像素子はレンズ構造体を装着することでカメラモジュールとして電子機器に搭載されるが、このカメラモジュールを小型化および軽量化するため、センサチップ、つまり撮像素子をガラス配線基板にフリップチップ実装したイメージセンサ向けの実装パッケージ構造が提案されている。
このようなガラス配線基板を含め、一般的なフリップチップ実装のための配線基板は、コア基板の両面にビルドアップの配線層を積層し、コア基板に形成した貫通電極によって表裏の配線層を導通するように作製される。
例えば、そのような技術としてコア基板の両面にビルドアップの配線層を積層し、コア基板に形成した貫通電極によって表裏の配線層を導通するとともに、ビルドアップの配線層における素子の実装部分を除去する方法が提案されている(例えば、特許文献1参照)。
この技術では、基板上に素子を低背に実装するため、素子実装部分とするビルドアップの配線層の下層部に予め離型シートが形成され、その離型シート上にビルドアップの配線層が積層された後、離型シートを活用してビルドアップの配線層の一部が除去される。
これにより、基板厚み方向についてコア基板に近い位置に素子を低背実装することができる。また、コア基板の材料の物性を活かし、素子の平坦実装や素子の線膨張係数ミスマッチを低減させて信頼性を向上させることができる。
ところで、ガラス配線基板等の基板に撮像素子を実装する場合、良好な撮像特性を得ることができるように平坦度の高い素子実装が要求される。
例えば、撮像素子が基板に傾いた状態で実装されてしまったり、実装された撮像素子に反りが生じてしまったりすると、撮像素子に入射する光の焦点ずれが発生し、撮像により得られる画像の画質が低下してしまう。
しかしながら、上述した技術では、撮像素子等の部品を高い平坦度で、かつ低コストで実装することが困難であった。
例えば特許文献1に記載の技術のように、離型シートによりビルドアップの配線層の一部を除去してコア基板に近い絶縁層に実装する方法では、通常の製法に配線層を除去する工程を追加することになるため、その分だけ製造コストが上昇してしまう。また、ビルドアップの配線層の除去された部分は再利用できずに廃棄されてしまうので、材料コストも上昇してしまう。
本技術は、このような状況に鑑みてなされたものであり、平坦度の高い部品実装を低コストで実現することができるようにするものである。
本技術の第1の側面の製造方法は、コア基板と、複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とを備える半導体装置の製造方法であって、前記開口部を形成するために前記所定の導電層に隣接する隣接絶縁層に形成された開口部分にレジストが塗布されるように、前記隣接絶縁層に形成されたシードメタル上にレジストパターンを形成し、めっき処理が行われて前記レジストが除去された後、前記開口部分を含む前記隣接絶縁層上の前記シードメタルを除去することで前記所定の導電層に隣接する導電層を形成し、前記最外側の絶縁層が形成された後、前記開口部を形成するステップを含む。
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂を形成するステップをさらに設けることができる。
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部を形成することができる。
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成されるようにすることができる。
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止されるようにすることができる。
前記実装素子を、撮像素子とし、前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成されるようにすることができる。
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填されるようにすることができる。
前記実装素子と前記パッドとをバンプ接続により接続することができる。
前記多層配線層を構成する一部の絶縁層の厚みを、前記多層配線層を構成する他の絶縁層の厚みよりも厚くすることができる。
本技術の第1の側面の製造方法においては、コア基板と、複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とを備える半導体装置の製造時に、前記開口部を形成するために前記所定の導電層に隣接する隣接絶縁層に形成された開口部分にレジストが塗布されるように、前記隣接絶縁層に形成されたシードメタル上にレジストパターンが形成され、めっき処理が行われて前記レジストが除去された後、前記開口部分を含む前記隣接絶縁層上の前記シードメタルを除去することで前記所定の導電層に隣接する導電層が形成され、前記最外側の絶縁層が形成された後、前記開口部が形成される。
本技術の第1の側面の半導体装置は、コア基板と、複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とを備える。
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂が形成されているようにすることができる。
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部が形成されているようにすることができる。
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成されているようにすることができる。
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止されているようにすることができる。
前記実装素子を、撮像素子とすることができる。
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成されているようにすることができる。
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填されているようにすることができる。
前記実装素子と前記パッドとをバンプ接続により接続することができる。
前記多層配線層を構成する一部の絶縁層の厚みを、前記多層配線層を構成する他の絶縁層の厚みよりも厚くすることができる。
本技術の第1の側面の半導体装置においては、コア基板と、複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子とが設けられる。
本技術の第2の側面の電子機器は、本技術の第1の側面の半導体装置と同様の構成の電子機器とすることができる。
本技術の第1の側面および第2の側面によれば、平坦度の高い部品実装を低コストで実現することができる。
以下、図面を参照して、本技術を適用した実施の形態について説明する。
〈第1の実施の形態〉
〈本技術について〉
本技術は、任意の実装素子(部品)、特に撮像素子等の半導体素子を高い平坦度かつ低コストで基板に実装することができるようにするものである。
〈本技術について〉
本技術は、任意の実装素子(部品)、特に撮像素子等の半導体素子を高い平坦度かつ低コストで基板に実装することができるようにするものである。
まず、本技術について説明する。一般的に例えば図1に示すように撮像素子11が実装されたガラス配線基板12と、そのガラス配線基板12に装着されたレンズ構造体13とからなるカメラモジュール14が知られている。
また、ガラス配線基板12をガラス基板21と、そのガラス基板21の両面に積層により形成されたビルドアップの配線層22および配線層23とから構成し、配線層23に撮像素子11をフリップチップ実装した実装パッケージ構造が提案されている。
撮像素子11をガラス配線基板12に実装する場合、上述したように良好な撮像特性を得るためには、撮像素子11の平坦度を確保する必要がある。すなわち、例えば撮像素子11の反りやガラス配線基板12の反りの発生を抑制する必要がある。また、撮像素子11を実装するにあたっては、なるべくコストを抑えることが好ましい。
そこで本技術では、例えば図2に示すようにガラス配線基板51の最外側の導電層よりも内層側の導電層に、貫通する開口を介して直接、撮像素子52をバンプ接続することで、平坦度の高い部品実装を低コストで実現できるようにした。
この例では、ガラス配線基板51は、ガラスからなる透明なコア基板61と、そのコア基板61の両方の表面に形成されたビルドアップの多層配線層である配線層62および配線層63とから構成されている。配線層62および配線層63は、それぞれ複数の絶縁層と複数の導電層とを有している。
また、イメージセンサである撮像素子52の受光部にはマイクロレンズ64が形成されており、この受光部がガラス配線基板51側に向けられた状態で、撮像素子52がガラス配線基板51に実装されている。すなわち、撮像素子52の受光部がガラス配線基板51と対向するように、撮像素子52が実装されている。
配線層62は、最も内層側、つまりコア基板61側に位置する1層目の絶縁層71と、その絶縁層71の外側に形成された2層目の絶縁層72と、最外側、つまりコア基板61から最も遠い側に形成された3層目の絶縁層73とを有している。
さらに、配線層62の絶縁層71と絶縁層72の部分には1層目の導電層74が形成され、絶縁層72と絶縁層73の部分には2層目の導電層75が形成されている。
この例では、最もコア基板61側に設けられた1層目の導電層74は、金属配線76や金属配線77などから構成されており、最外側、つまり最もコア基板61から遠い側に設けられた2層目の導電層75は、金属配線78や金属配線79から構成されている。
同様に、配線層63は1層目の絶縁層81と、その絶縁層81の外側に形成された2層目の絶縁層82と、最外側に形成された3層目の絶縁層83とを有している。
また、配線層63の絶縁層81と絶縁層82の部分には1層目の導電層84が形成され、絶縁層82と絶縁層83の部分には2層目の導電層85が形成されている。
この例では、最もコア基板61側に設けられた1層目の導電層84は、金属配線86や金属配線87などから構成されており、最外側に設けられた2層目の導電層85は、金属配線88や金属配線89から構成されている。
さらに、配線層62には、最外層である絶縁層73全体と、絶縁層72の一部とを貫通する開口部90が形成されている。なお、開口部90は、少なくとも最外側の絶縁層73を貫通し、最外側の導電層よりもコア基板61側にある導電層に接続可能なものであればよい。
特に、この例では開口部90は撮像素子52の受光部を囲むように設けられており、配線層62における開口部90よりもコア基板61の中心側の部分である凸部91は、開口部90の部分よりも図中、上側の高さが高くなっている。
換言すれば、開口部90は、ガラス配線基板51における撮像素子52と対向する部分の領域を隙間なく囲む溝を配線層62に設けることにより形成されている。配線層62における開口部90の部分は、その開口部90に隣接する凸部91等の部分よりも高さが低くなっているダム構造とされている。つまり、配線層62に溝形状の開口部90を形成することにより、その開口部90に隣接する凸部91が形成される。
また、配線層62では、開口部90内部における金属配線76および金属配線77の部分にはパッド92およびパッド93が形成されて、それらのパッド92およびパッド93と、撮像素子52とがバンプ94およびバンプ95を介して電気的にも物理的にも接続されている。
本技術では、ガラス配線基板51に開口部90を設け、最外側の導電層75よりも内層側にある導電層74に、直接、撮像素子52をバンプ接続することにより、低コストで、かつ高い平坦度で撮像素子52等の部品をガラス配線基板51に実装することができる。また、撮像素子52とコア基板61との間の距離を短くすることができるので、撮像素子52の低背実装も実現することができる。
すなわち、開口部90や、パッド92およびパッド93を形成して撮像素子52をバンプ接続により実装する場合、通常のビルドアップ配線基板製造時における場合と同等の工程数で開口部90やパッド92なども形成することが可能である。
したがって、工程数が増加することもなく低コストで部品実装を実現することができる。しかも、ビルドアップの配線層を除去して、その部分に部品を実装する技術のように、配線層の除去部分が多くなり材料コストが上昇してしまうようなこともない。
また、開口部90を設けることで、ガラス等の剛性の高い材料からなる平坦なコア基板61により近い内層側の導電層74に撮像素子52を接続することが可能となるので、撮像素子52における反りの発生を抑制し、平坦度の高い実装を実現することができる。
しかもコア基板61を構成するガラスと、撮像素子52を構成するシリコンとは線膨張係数が近いので、撮像素子52とコア基板61は、熱が加えられたときなどにおける図中、横方向への伸縮の挙動が略等しく、バンプ94やバンプ95に応力がかかりにくい。つまり、実装バンプ部への温度サイクル応力を緩和することができる。その結果、撮像素子52の受光面が歪んで平坦度が低下したり、撮像素子52に負荷がかかって撮像特性が低下してしまったりすることを抑制することができる。
なお、例えばコア基板61の材料は、そのコア基板61を構成する材料の線膨張係数と、実装される半導体素子である撮像素子52を構成する材料の線膨張係数との差分が予め定めた閾値以下となるように選択することができる。
さらに、この例では、撮像素子52が接続される金属配線76等からなる導電層74が直接、ガラスからなるコア基板61上に形成されるのではなく、導電層74とコア基板61との間には伸縮性の高い樹脂や無機膜からなる絶縁層71が設けられている。
例えばCu(銅)などの金属からなる金属配線76等が、直接、コア基板61上に形成されると、金属配線76等とコア基板61との線膨張係数の差が大きいので、熱が加えられたときにコア基板61やバンプ94、バンプ95等に負荷がかかってしまう。そうすると、コア基板61やバンプ部分などが破損してしまう可能性がある。
そこで、本技術のように、導電層74とコア基板61との間に伸縮性の高い絶縁層71を設けることで、コア基板61と、導電層74やバンプ94等との間に発生する応力を緩和させ、高い平坦度および高い撮像特性を確保することができる。
また、ガラス配線基板51に実装される部品が、撮像素子52等の半導体素子である場合、実装部品表面へのダスト付着等からの保護のため、実装部品とガラス配線基板51との間の部分を封止することがある。例えば図2に示した例では、バンプ94やバンプ95の部分に、ディスペンサやインクジェットにより樹脂等のアンダーフィルが塗布されて、撮像素子52の受光部が封止される。
このように撮像素子52の受光部等の封止を行う場合、アンダーフィルが撮像素子52の受光部等に流入してしまうと、撮像特性の低下や不良発生の要因となる。
例えば、このようなアンダーフィルの流入を抑制するための技術として、撮像素子をガラス配線基板にフリップチップ実装するにあたり、バンプよりも内側にリング状の封止構造を設けて撮像素子の受光部を封止し、アンダーフィルの流入を防止する技術が提案されている(例えば、特許第5397037号公報参照)。
この技術では、撮像素子の受光部とガラス配線基板との間の空間が封止構造によって封止されるとともに、ガラス配線基板における封止された空間の外側部分における、内部の空気を逃がすことのできる位置にガラス貫通孔が形成される。このようにガラス貫通孔を設けることにより、撮像素子実装時の昇温によって封止部の内圧上昇による撮像素子の傾きや実装不良を防止することができる。
しかしながら、この技術では、ガラス貫通孔が開口されたままの状態で放置されると、ガラスクラックの起点になるなど、信頼性低下の要因となってしまう。
そこで、その対策として、組立後に樹脂などを用いてガラス貫通孔を埋め込むことが考えられるが、その分だけコストがかかってしまうことになる。さらに、そのような場合、撮像素子が実装された後でガラス貫通孔を埋め込む必要があり、また表裏ビルドアップ層の導通を取るための貫通孔と、内圧解放の空気通路としての貫通孔とを作り分ける必要があるため、工程が非常に複雑となる。
また、ガラス貫通孔の埋め込み時に樹脂の硬化収縮などに伴いガラス配線基板の厚み方向に面内で不均一な応力がかかるため、パッケージ全体の反りのコントロールが極めて困難になり、ガラス配線基板の反りから撮像素子の反りが誘発され、画像の画質の劣化等を招く可能性が高い。
さらに、アンダーフィルの流入を抑制するための技術として、撮像素子をガラス配線基板にフリップチップ実装する場合に、ガラス配線基板と撮像素子に土手部を設けることで、受光部への封止樹脂、つまりアンダーフィルの流入を防止する技術も提案されている(例えば、特開2003−78121号公報参照)。この技術では、撮像素子の実装時にアンダーフィルにより受光部が封止されるが、その際にアンダーフィルが受光部に流入しないように土手部が形成されている。
しかしながら、この技術では、土手部を樹脂の印刷により追加で形成する必要があるため工程数が増加し、製造コストが上昇してしまう。また、この土手部は、ガラス配線基板および撮像素子のそれぞれ片面側のみに形成される。そのため、土手部の部分における樹脂の温度収縮などに起因して、ガラス配線基板および撮像素子ともに厚み方向に面内で不均一な応力がかかり、それぞれの反りを誘発して画像の画質の劣化等を招く可能性が高い。
そこで、本技術では、配線層62に撮像素子52の受光部を囲むように溝を形成して開口部90とし、その開口部90内にパッド92等を設けてバンプ接続により撮像素子52を実装することで、アンダーフィルの受光部への流入を抑制するようにした。
図2に示した例でアンダーフィルによる封止を行う場合、バンプ94やバンプ95の部分にアンダーフィルが塗布されることになる。
ここで、上述したように開口部90を設けて撮像素子52とのバンプ接続部分をダム構造とすることで、封止樹脂となるアンダーフィルが開口部90よりも撮像素子52の受光部側に流入することを抑制することができる。すなわち、開口部90内のバンプ94等に塗布されたアンダーフィルが撮像素子52の受光部へと流入するのを、開口部90よりも受光部側に形成された絶縁層の部分である凸部91によってせき止めることができる。
このようなダム構造は、ビルドアップの配線層62を構成する絶縁層と導電層を形成する積層工程で一括して形成することができる。したがって、本技術によれば、封止樹脂であるアンダーフィルのせき止め構造を低コストで形成することができる。
しかも、本技術では、ガラス配線基板51や撮像素子52にアンダーフィルをせき止めるための土手部を専用に形成する必要がないため、ガラス配線基板51や撮像素子52に不均一な応力がかかってしまうこともない。したがって、ガラス配線基板51や撮像素子52に反りが発生してしまうこともなく、画像の画質の劣化も生じることはない。
なお、ここではコア基板61の撮像素子52側の配線層62にのみ開口部90や凸部91からなるダム構造が形成される例について説明したが、コア基板61の配線層63側にも同様のダム構造を形成するようにしてもよい。その際、配線層62側のダム構造の位置と、配線層63側のダム構造の位置とが図2中、横方向の同じ位置となるように、つまりコア基板61に対して表裏で対称な位置にダム構造が形成されるようにすることで、ガラス配線基板51面内の厚み方向の膜応力を均一にすることができる。これにより、ガラス配線基板51や撮像素子52での反りの発生をさらに抑制することができる。
〈撮像装置の構成例〉
次に、本技術を適用した具体的な実施の形態について説明する。
次に、本技術を適用した具体的な実施の形態について説明する。
図3は、本技術を適用した撮像装置の一実施の形態の構成例を示す図である。なお、図3において図2における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図3に示す撮像装置121は、ガラス配線基板51と、そのガラス配線基板51に実装された撮像素子52とを有している。図3では、撮像装置121の断面が示されている。
この例においても撮像素子52は、外部からの光を受光する受光部にはマイクロレンズ64が設けられており、撮像素子52は、マイクロレンズ64が設けられた面、つまり受光部がガラス配線基板51に向けられて、ガラス配線基板51にバンプ接続により固定されている。
また、ガラス配線基板51は、コア基板61と、そのコア基板61に積層された配線層62および配線層63を有している。さらに図2における場合と同様に、配線層62には絶縁層71乃至導電層75が形成されており、配線層63には絶縁層81乃至導電層85が形成されている。
コア基板61は例えばガラスから形成されており、コア基板61には、コア基板61を貫通し、一方の面に設けられた導電層74と、他方の面に設けられた導電層84とを電気的に接続する貫通電極131および貫通電極132が設けられている。
例えば貫通電極131の一方の端には、導電層74を構成する金属配線76が接続されており、貫通電極131の他方の端には、導電層84を構成する金属配線86が接続されている。このように貫通電極131や貫通電極132によって、コア基板61の表裏のそれぞれの面が電気的に接続されている。
また、ここではコア基板61はガラスからなる例について説明するが、ガラスに限らず、ある程度の剛性があり、光透過性を有する透明な材料から形成されるようにすればよい。
さらに、配線層62および配線層63における撮像素子52の受光部と対向する部分には、開口部133および開口部134が設けられており、コア基板61が露出するようになされている。これらの開口部133および開口部134により、撮像素子52は、外部(被写体)からの光を受光することができるようになっている。
すなわち、開口部134は、外部から入射した光をコア基板61へと導く光通過用開口部として機能する。また、開口部133は外部から入射し、開口部134を通過するとともに光透過性を有するコア基板61を透過した光を、撮像素子52の受光部へと導く光通過用開口部として機能する。
したがって、外部から開口部134に入射した光は、コア基板61を透過して開口部133を通り、撮像素子52の受光部に入射する。このときマイクロレンズ64は、入射した光を集光して撮像素子52の受光部に設けられた各画素に入射させる。そして、各画素は入射した光を光電変換し、これにより画像が撮像される。
また、配線層63では最も外側にある導電層である2層目の導電層85に、各種の部品が接続されている。例えば導電層85を構成する金属配線89には、パッドを介して所定の部品135が接続されている。
同様に、配線層62でも最も外側にある導電層である2層目の導電層75に、各種の部品が接続されている。例えば導電層75を構成する金属配線78には、パッド136およびパッド137を介して所定の部品138が接続されている。
また、配線層62にはダム構造の開口部90が形成されており、バンプ94やバンプ95によって、開口部90内部の導電層74に撮像素子52がバンプ接続されている。ここでは、パッド92やパッド93など、撮像素子52をバンプ接続により実装するためのパッドは、全て同一の導電層74上に形成されている。
このように最外側の導電層よりもコア基板61側にある1層目の導電層74に撮像素子52を実装することにより、低コストで、かつより高い平坦度で撮像素子52を実装することができる。
さらに、この例では、バンプ94やバンプ95の部分に、封止樹脂であるアンダーフィル139が塗布されており、このアンダーフィル139によって開口部133の部分が封止されている。この例では、封止された開口部133の部分は、空気が充填された状態となっている。
また、アンダーフィル139によってバンプ94やパッド92など、撮像素子52とガラス配線基板51側のパッド92等とのバンプ接続部分が覆われており、アンダーフィル139はバンプ接続部分を保護する保護樹脂としても機能している。
撮像装置121では、このようにして開口部133をアンダーフィル139により封止する場合でも、ダム構造とされた溝状の開口部90と、その開口部90に対して撮像素子52の受光部側に隣接して設けられた、図中、上側に突出する凸部91によって、アンダーフィル139の受光部への流入が防止されている。
これらのダム構造の開口部90と凸部91とは、ガラス配線基板51や撮像素子52と垂直な方向から見ると、例えば図4に示すようになっている。なお、図4において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図4に示す例では、撮像素子52の受光部と、コア基板61との間の空間の封止される部分を囲むように矩形の溝が開口部90として設けられている。この開口部90の底面は2層目の絶縁層72であり、その絶縁層72の部分に、絶縁層72内部に埋め込まれた導電層74表面に形成されたパッド92やパッド93が設けられている。
また、開口部90の外側および内側は、絶縁層72よりも図中、手前側、つまり撮像素子52側に高い絶縁層73となっている。特に、図4中、開口部90の内側に隣接する絶縁増73の部分が上述した凸部91となっており、この凸部91によりアンダーフィル139がせき止められて、撮像素子52の受光部への流入が防止される。
このようなダム構造の開口部90は製造工程を増加させることなく、簡単かつ安価に形成することができるので、開口部90を設けることにより低コストでアンダーフィルの流入を防止することができる。
〈製造処理の説明〉
続いて、図5のフローチャートと、図6乃至図9を参照して、本技術を適用した撮像装置を製造する処理である製造処理について説明する。なお、図6乃至図9において、互いに対応する部分や図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。また、図6乃至図9では、互いに対応する部分であっても、図を見やすくするため、符号を付していない部分もある。
続いて、図5のフローチャートと、図6乃至図9を参照して、本技術を適用した撮像装置を製造する処理である製造処理について説明する。なお、図6乃至図9において、互いに対応する部分や図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。また、図6乃至図9では、互いに対応する部分であっても、図を見やすくするため、符号を付していない部分もある。
図5を参照して説明する製造処理では、露光現像ビアを形成することにより、開口部90に対応する開口部が形成される例である。
ステップS11において、光透過性のコア基板に貫通電極が形成される。
すなわち、例えば図6の矢印Q11に示すように、ガラスからなるコア基板61に、そのコア基板61を貫通する貫通電極131および貫通電極132が形成される。ここで、貫通電極131および貫通電極132は、例えばCu(銅)や導電性ペーストなどの材料により形成される。
ステップS12において、コア基板の両面に1層目の絶縁層が形成される。
例えば、図6の矢印Q12に示すように、コア基板61の一方の面に絶縁層膜161が成膜されて、この絶縁層膜161の部分が絶縁層71とされるとともに、コア基板61の他方の面に絶縁層膜162が成膜されて、この絶縁層膜162の部分が絶縁層81とされる。
ここで、絶縁層膜161や絶縁層膜162は、例えばポリイミドやポリベンゾオキサゾール等の樹脂や、SiO2やSiN等の無機膜などとされる。特に、絶縁層71および絶縁層81は、上述したようにコア基板61と、金属の配線層やバンプ等との間に発生する応力を緩和する層として機能する。
また、ステップS12では、絶縁層が形成されると、絶縁層膜161および絶縁層膜162に対する露光現像などにより、貫通電極131や貫通電極132に接続するための開口部が形成される。
この例では、絶縁層膜161に、貫通電極131に接続するための開口部163と、貫通電極132に接続するための開口部164とが形成されている。また、絶縁層膜162には、貫通電極131に接続するための開口部165と、貫通電極132に接続するための開口部166とが形成されている。
なお、ここではコア基板61がガラスからなるため、1層目の絶縁層を形成する処理が行われているが、コア基板61が樹脂等から構成される場合にはコア基板61表面に1層目の絶縁層を形成する必要はない。したがって、コア基板61が樹脂等からなる場合には、ステップS12の処理は行われないようにしてもよい。
ステップS13において、1層目の絶縁層表面にセミアディティブ工法などにより金属膜の配線パターンを形成することで、1層目の導電層が形成される。
例えば図6の矢印Q13に示すように、絶縁層71の表面に金属配線171や金属配線172などがCuなどにより形成されて、それらの金属配線からなる層が1層目の導電層74とされる。この例では、金属配線171は直接、貫通電極131に接続されており、この金属配線171は図3に示した金属配線76に相当する。
同様に、絶縁層81の表面に金属配線173や金属配線174などがCuなどにより形成されて、それらの金属配線からなる層が1層目の導電層84とされる。この例では、金属配線173は直接、貫通電極131に接続されており、この金属配線173は図3に示した金属配線86に相当する。
ステップS14において、塗布やラミネートなどによって、1層目の導電層表面に2層目の絶縁層が形成される。
例えば図7の矢印Q21に示すように、コア基板61の一方の面に形成された絶縁層71や導電層74の表面に絶縁層膜181が成膜されて、この絶縁層膜181の部分が2層目の絶縁層72とされる。同様に、絶縁層81や導電層84の表面に絶縁層膜182が成膜されて、この絶縁層膜182の部分が2層目の絶縁層82とされる。
ステップS15において、2層目の絶縁層に対する露光現像などにより、1層目の導電層に接続するための開口部が形成される。また、このとき、ガラス配線基板51に半導体素子を実装するための、いくつかの絶縁層を貫通する開口部を形成するための開口部も形成される。
例えば図7の矢印Q22に示すように、絶縁層膜181に対する露光現像が行われ、1層目の導電層74に形成された金属配線に接続するための開口部191や、いくつかの絶縁層を貫通する開口部を形成するための開口部192などが形成される。同様に、絶縁層膜182に対する露光現像も行われ、1層目の導電層84に形成された金属配線に接続するための開口部193なども形成される。
ここで、開口部192は、例えば図3に示した開口部90に対応する開口部を形成するためのものである。したがって、この例では、半導体素子が1層目の導電層74に形成された金属配線171にバンプ接続等により接続されることになる。
ステップS16において、2層目の絶縁層表面にセミアディティブ工法などにより金属膜の配線パターンを形成することで、2層目の導電層が形成される。
例えば図7の矢印Q23に示すように、絶縁層72の表面に金属配線201や金属配線202などがCuなどにより形成されて、それらの金属配線からなる層が2層目の導電層75とされる。この例では、金属配線201は、開口部191を介して1層目の導電層74に設けられた金属配線に接続されている。
同様に、絶縁層82の表面に金属配線203などがCuなどにより形成されて、それらの金属配線からなる層が2層目の導電層85とされる。
ステップS17において、塗布やラミネートなどによって、2層目の導電層表面に3層目の絶縁層が形成される。
例えば図8の矢印Q31に示すように、コア基板61の一方の面に形成された絶縁層72や導電層75の表面に絶縁層膜211が成膜されて、この絶縁層膜211の部分が3層目の絶縁層73とされる。同様に、絶縁層82や導電層85の表面に絶縁層膜212が成膜されて、この絶縁層膜212の部分が3層目の絶縁層83とされる。
ステップS18において、3層目の絶縁層に対する露光現像などにより、1層目の導電層に接続するための開口部、および2層目の導電層に接続するための開口部が同時に形成される。
例えば図8の矢印Q32に示すように、絶縁層膜211に対する露光現像が行われ、1層目の導電層74に形成された金属配線に接続するための開口部221などが形成される。同様に、絶縁層膜212に対する露光現像も行われ、2層目の導電層85に形成された金属配線に接続するための開口部222なども形成される。
ここで、開口部221は、例えば図3に示した開口部90に対応する開口部であり、この開口部221は、図3に示した開口部133の部分、つまり光を透過させるためにコア基板61が露出されている部分を囲むように形成されるダム構造の開口部である。すなわち、開口部221は、図4に示した開口部90のように、撮像素子52が実装される部分を囲むように溝状に形成される。
また、絶縁層83には、2層目の導電層85に設けられた金属配線203に接続するための開口部222などが形成されている。
なお、この例では、絶縁層膜211に2層目の導電層75の金属配線に接続するための開口部は設けられていないが、そのような開口部が設けられるようにしてもよい。
ステップS19において、例えば電解めっきや無電解めっきなどにより、半導体素子等の部品を実装するためのパッドが形成される。
例えば図8の矢印Q33に示すように、開口部221内部における、1層目の導電層74の金属配線表面にパッド231およびパッド232等のパッドが形成される。また、2層目の導電層85の金属配線表面にもパッド233等のパッドが形成される。
この例では、例えば開口部221内部における金属配線171の表面にパッド231が形成されており、このパッド231は、図3に示したパッド92に対応する。
また、パッド233は、開口部222内部における2層目の導電層85の金属配線203の表面に形成されており、このパッド233には、例えば図3に示した部品135のような部品が実装されることになる。
これらのパッド231乃至パッド233等の各パッドは、例えばNi(ニッケル)やAu(金)などのめっき材料により形成される。具体的には、例えばNiによるめっきを行った後、その部分にさらにAuによるめっきを行うなどして、めっきの積層によりパッドが形成される。このようにしてパッド231等が形成されると、ガラス配線基板51が得られたことになる。
ステップS20において、ステップS11乃至ステップS19の処理により得られたガラス配線基板に撮像素子等の部品が実装されて撮像装置とされる。
例えば図9の矢印Q41に示されるように、実装される撮像素子52にバンプ241およびバンプ242が形成される。なお、図9では、図を見やすくするため、撮像素子52やガラス配線基板51が簡略化されて描かれている。
例えばバンプ241およびバンプ242は、金属のスタッドバンプやめっきバンプなどとされる。また、バンプ241およびバンプ242の部分を、NiとAuを順番に積層めっきなどすることで得られるランドグリッドアレイなどとしてもよい。
撮像素子52にバンプが形成されると、矢印Q42に示すように実装ヘッド243により、撮像素子52が熱圧着等によりガラス配線基板51にフリップチップ実装される。
この例では、バンプ241およびバンプ242と、ガラス配線基板51の開口部221内部に形成された図示せぬパッド231およびパッド232とが、物理的かつ電気的に接続(バンプ接続)されている。
そして、矢印Q43に示すように樹脂塗布ヘッド244によって、開口部221内部のバンプ241およびバンプ242の部分にバンプ保護樹脂であるアンダーフィル245が塗布され、その後、アンダーフィル245の熱硬化が行われる。このアンダーフィル245は、図3に示したアンダーフィル139に対応する。
このとき、アンダーフィル245がガラス配線基板51に形成されたダム構造の溝である開口部221部分に塗布されるようにすることで、絶縁層膜211や絶縁層膜181における開口部221と、撮像素子52の受光部との間の部分によりアンダーフィル245がせき止められる。これにより、撮像素子52の受光部にアンダーフィル245が流入してしまうことを防止することができる。
また、図8に示したパッド233等にもバンプ接続等により部品が実装されて最終的な撮像装置とされると、製造処理は終了する。このようにして得られた撮像装置は、上述した撮像装置121に対応するものとなる。
以上のようにして、撮像装置の製造時には、ガラス配線基板51にダム構造の開口部221が形成され、その開口部221内に設けられたパッドと、撮像素子52とがバンプ接続され、その接続部分にアンダーフィル245が塗布される。これにより、アンダーフィル245のせき止め構造を低コストで形成することができる。
また、ガラス配線基板51における最外側よりも内側にある導電層に撮像素子52を実装するようにしたので、より高い平坦度かつ低コストで撮像素子52を実装することができる。
以上のことから、本技術を適用した撮像装置によれば、平坦度の高い部品実装を低コストで実現することができる。
〈導電層形成処理の説明〉
ここで、図10のフローチャートと、図11および図12とを参照して、図5の製造処理におけるステップS16の処理についてより詳細に説明する。すなわち、図10のフローチャートを参照して、図5のステップS16の処理に対応する導電層形成処理について説明する。
ここで、図10のフローチャートと、図11および図12とを参照して、図5の製造処理におけるステップS16の処理についてより詳細に説明する。すなわち、図10のフローチャートを参照して、図5のステップS16の処理に対応する導電層形成処理について説明する。
なお、ここでは、2層目の導電層をセミアディティブ工法により形成する処理について説明するが、ステップS13の1層目の導電層をセミアディティブ工法により形成する場合にもより詳細には、図10を参照して説明する処理と同様の処理が行われる。また、図11および図12において図7における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図10に示す導電層形成処理では、ステップS51において、2層目の絶縁層にシードメタルが成膜される。
すなわち、例えば図11の矢印Q51に示すように、撮像素子52が接続される1層目の導電層74に隣接する2層目の絶縁層72上にシードメタル271が形成される。具体的には、例えば絶縁層72を形成する絶縁層膜181の表面にシードメタル271がスパッタリング等により成膜される。なお、図11は、図7におけるガラス配線基板51の金属配線171近傍の部分を拡大表示した図となっている。
例えばシードメタル271は、絶縁層膜181表面にTi(チタン)とCuを順番にスパッタリングにより積層することで成膜される。より具体的には、例えば絶縁層膜181表面にTiの膜が成膜された後、その上にさらにCuの膜が成膜されて、それらのTiとCuの膜がシードメタル271とされる。このようにして形成されたシードメタル271は、めっきの下地層となる。
ステップS52において、シードメタル表面に露光現像によりレジストパターンが形成される。
例えば図11の矢印Q52に示すように、開口部192の部分を含むシードメタル271上の所望の領域にレジスト272を塗布することでレジストパターンが形成される。レジストパターンでは、その後の処理でめっき処理される部分が開口された状態、つまりレジスト272がない状態となっている。
また、この例では、後に撮像素子52を実装するための開口部221を形成するために形成(開口)された、開口部192の部分にもシードメタル271とレジスト272が形成(塗布)されている。
ステップS53において、レジストパターンの開口部分に、めっき処理により2層目の導電層75を構成する金属配線が形成される。
例えば図12の矢印Q61に示すようにレジストパターンの開口部分に金属配線201および金属配線202がCuのめっきにより形成される。
ステップS54において、レジスト洗浄液により、レジストパターン、すなわちシードメタル上のレジストが除去される。例えば図12の矢印Q62に示すようにレジスト272が除去される。
ステップS55において、ウェットエッチングによりシードメタルが除去されて、2層目の導電層が形成され、導電層形成処理は終了する。
例えば図12の矢印Q63に示すようにシードメタル271が除去されて、図7の矢印Q23に示した状態となる。なお、図7の矢印Q23に示した例では、シードメタル271は図示されておらず、図12の矢印Q63に示す図が、図7の矢印Q23に示す図のより詳細な図となっている。
図12の矢印Q63に示す例では、シードメタル271における、金属配線201および金属配線202と絶縁層膜181との間にある部分のみが残されて、開口部192の部分など、絶縁層72上に形成された他のシードメタル271の部分は完全に除去されている。そのため、開口部192の部分では、1層目の導電層74を構成する金属配線171の一部が露出した状態となっている。
このようにしてシードメタル271を除去することで、1層目の導電層74に隣接する2層目の導電層75が形成される。
ここで、シードメタル271の除去にあたり、Cuに対するダメージの低いTi除去液を用いれば、開口部192内のシードメタル271も選択的に除去することが可能である。このようにCuに対して選択比のあるTi除去液を用いることで、1層目の導電層74、例えば露出するCuの金属配線171に殆どダメージを与えることなくシードメタル271を除去することが可能となる。つまり、必要な金属配線に対して低ダメージな加工を実現することができる。これにより、撮像素子52を実装するための開口部221が形成される部分に開口部192を形成することができる。
以上のようにして、2層目の導電層の形成時には、セミアディティブ工法により金属配線が形成される。
〈パッドの構成例〉
また、図3に示したパッド92やパッド93などの各パッド、すなわち実装部品とされる半導体素子である撮像素子52をガラス配線基板51に実装するためのパッド構造は、どのような構成とされてもよいが、例えば図13に示す構成とすることができる。なお、図13において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
また、図3に示したパッド92やパッド93などの各パッド、すなわち実装部品とされる半導体素子である撮像素子52をガラス配線基板51に実装するためのパッド構造は、どのような構成とされてもよいが、例えば図13に示す構成とすることができる。なお、図13において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
矢印Q71に示す例では、導電層74に形成された金属配線301のうちの開口部90により露出された部分が、撮像素子52を実装するためのパッド(パッド構造)を構成するランドとされている。
また、矢印Q72に示す例では、矢印Q71に示す例と同様に、金属配線301のうちの開口部90により露出された部分がランドとされているが、この例では金属配線301の端部分が開口部90内に位置するようになされている。
さらに矢印Q73に示す例では、矢印Q71に示した例と同様の金属配線301のランド部分の表面に、2層目の導電層75を構成する金属配線302が形成されており、この金属配線302もランドとして機能している。つまり、この例では、金属配線301のランド部分と、ランドとしての金属配線302とからなる2層のランドからパッドが構成されている。
なお、金属配線302は、導電層74上、より詳細には導電層74を構成する金属配線301上に設けられたものであれば、導電層75を構成する金属配線であってもよいし、開口部90を開口後、金属配線301表面に形成されたランド(パッド)であってもよい。
また、矢印Q73に示したパッド構造において、さらに矢印Q74に示すように金属配線302上にバンプ303が形成されて、このバンプ303により撮像素子52がバンプ接続されるようにしてもよい。例えばバンプ303は、Pb(鉛)フリーのSnAgCuやSnAgなどのはんだ等から形成すればよい。
なお、バンプ303の形成には、撮像素子52とガラス配線基板51との間のギャップ調整のため、Cuコアのはんだを用いるようにしてもよい。また、バンプ303としてAuやCuのスタッドバンプを用いるようにしてもよく、そのような場合には、ランドとして機能する金属配線302の表面がAuやはんだなどとなるようにすればよい。
さらに、矢印Q71乃至矢印Q74に示す例において、金属配線301や金属配線302は、例えばOSP(Organic Solderability Preservative)処理されたCuのみから形成されてもよい。その他、金属配線301や金属配線302はCuとNiとAuの積層、CuとNiとPd(パラジウム)とAuの積層、CuとAg(銀)の積層、CuとSn(錫)の積層など、いくつかの金属を順番に積層することにより形成されてもよい。
また、例えば矢印Q74に示したパッド構造とされる場合に、撮像素子52とガラス配線基板51とをバンプ接続すると、その接続部分は、例えば図14の矢印Q81に示すようになる。なお、図14において図13における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
矢印Q81に示す例では、バンプ303によって、ガラス配線基板51側の金属配線302と、撮像素子52に設けられたランド311とが接続され、これにより撮像素子52がガラス配線基板51に実装されている。
また、矢印Q82に示すように、撮像素子52側のランド311にさらにCuピラーバンプ312を形成し、そのCuピラーバンプ312と、バンプ303とを接続することで撮像素子52をガラス配線基板51に実装するようにしてもよい。
〈第1の実施の形態の変形例1〉
〈製造処理について〉
なお、撮像装置を製造する製造処理において、図5を参照して説明した例のように、撮像素子52を実装するための、絶縁層を貫通する開口部を露光現像などにより形成するのではなく、レーザ開口により貫通する開口部を形成するようにしてもよい。
〈製造処理について〉
なお、撮像装置を製造する製造処理において、図5を参照して説明した例のように、撮像素子52を実装するための、絶縁層を貫通する開口部を露光現像などにより形成するのではなく、レーザ開口により貫通する開口部を形成するようにしてもよい。
そのような場合、2層目の絶縁層72および絶縁層82を形成するまでの処理は、図5のステップS11乃至ステップS14の処理と同様の処理が行われ、その後は、例えば図15および図16に示す処理(工程)が行われて、撮像装置が製造される。なお、図15および図16において、図7または図8における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
レーザ開口により開口部が形成される場合、上述した図6の矢印Q11乃至矢印Q13に示した工程と、図7の矢印Q21に示した工程が行われた後、図15の矢印Q91に示すように、2層目の絶縁層に対する露光現像やレーザ加工などにより、1層目の導電層に接続するための開口部が形成される。
この例では、絶縁層膜181に対する露光現像やレーザ加工が行われ、1層目の導電層74に形成された金属配線に接続するための開口部191などが形成されている。同様に、絶縁層膜182に対する露光現像やレーザ加工も行われ、1層目の導電層84に形成された金属配線に接続するための開口部193なども形成される。
なお、このとき、撮像素子52を実装するための、いくつかの絶縁層を貫通する開口部を形成するための開口部、例えば図7に示した開口部192等は形成されない。
続いて、矢印Q92に示すように、セミアディティブ工法などにより絶縁層72の表面に金属配線201や金属配線202などがCuなどにより形成されて、それらの金属配線からなる層が2層目の導電層75とされる。同様に、絶縁層82の表面に金属配線203などがCuなどにより形成されて、それらの金属配線からなる層が2層目の導電層85とされる。
さらに、矢印Q93に示すように、塗布やラミネートなどによって絶縁層72や導電層75の表面に絶縁層膜211が成膜されて、この絶縁層膜211の部分が3層目の絶縁層73とされる。同様に、絶縁層82や導電層85の表面に絶縁層膜212が成膜されて、この絶縁層膜212の部分が3層目の絶縁層83とされる。
その後、図16の矢印Q94に示すように、絶縁層膜212に対する露光現像やレーザ加工が行われ、2層目の導電層85に形成された金属配線に接続するための開口部222などが形成される。
さらに、矢印Q95に示すように、絶縁層膜211および絶縁層膜181に対してレーザ加工が行われ、1層目の導電層74に形成された金属配線に接続するための開口部331が形成される。この開口部331は、例えば図3に示した開口部90に対応する開口部であり、開口部331は、図3に示した開口部133の部分、つまり光を透過させるためにコア基板61が露出されている部分を囲むように形成されるダム構造の開口部である。
このようにして開口部331が形成されると、矢印Q96に示すように電解めっきや無電解めっきなどにより、開口部331内部における、1層目の導電層74の金属配線表面にパッド231およびパッド232等のパッドが形成される。また、2層目の導電層85の金属配線表面にもパッド233等のパッドが形成される。
以上の処理によりガラス配線基板51が得られると、その後は、図5のステップS20の処理と同様の処理が行われ、製造処理は終了する。
以上のように、撮像素子52を実装するための開口部を形成する方法は、どのような方法であってもよい。
〈パッドの構成例〉
また、図16に示したパッド231やパッド232などの各パッド、すなわち撮像素子52をガラス配線基板51に実装するためのパッド構造は、どのような構成とされてもよいが、例えば図17に示す構成とすることができる。なお、図17において図16における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
また、図16に示したパッド231やパッド232などの各パッド、すなわち撮像素子52をガラス配線基板51に実装するためのパッド構造は、どのような構成とされてもよいが、例えば図17に示す構成とすることができる。なお、図17において図16における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
矢印Q101に示す例では、導電層74に形成された金属配線361のうちの開口部331により露出された部分が、撮像素子52を実装するためのパッド(パッド構造)を構成するランドとされている。
また、矢印Q102に示す例では、矢印Q101に示す例と同様に、金属配線361のうちの開口部331により露出された部分がランドとされているが、この例では金属配線361の端部分が開口部331内に位置するようになされている。
さらに矢印Q103に示す例では、矢印Q101に示した例と同様の金属配線361のランド部分の表面に、2層目の導電層75を構成する金属配線362が形成されており、この金属配線362もランドとして機能している。つまり、この例では、金属配線361のランド部分と、ランドとしての金属配線362とからなる2層のランドからパッドが構成されている。
なお、金属配線362は、金属配線361上に設けられたものであれば、導電層75を構成する金属配線であってもよいし、開口部331を開口後、金属配線361表面に形成されたランド(パッド)であってもよい。
また、矢印Q103に示したパッド構造において、さらに矢印Q104に示すように金属配線362上にバンプ363が形成されて、このバンプ363により撮像素子52がバンプ接続されるようにしてもよい。例えばバンプ363は、PbフリーのSnAgCuやSnAgなどのはんだ等から形成すればよい。
なお、バンプ363の形成には、撮像素子52とガラス配線基板51との間のギャップ調整のため、Cuコアのはんだを用いるようにしてもよい。また、バンプ363としてAuやCuのスタッドバンプを用いるようにしてもよく、そのような場合には、ランドとして機能する金属配線362の表面がAuやはんだなどとなるようにすればよい。
さらに、矢印Q101乃至矢印Q104に示す例において、金属配線361や金属配線362は、例えばOSP処理されたCuのみから形成されてもよい。その他、金属配線361や金属配線362はCuとNiとAuの積層、CuとNiとPdとAuの積層、CuとAgの積層、CuとSnの積層などにより形成されてもよい。
また、例えば矢印Q104に示したパッド構造とされる場合に、撮像素子52とガラス配線基板51とをバンプ接続すると、その接続部分は、例えば図18の矢印Q111に示すようになる。なお、図18において図17における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
矢印Q111に示す例では、バンプ363によって、ガラス配線基板51側の金属配線362と、撮像素子52に設けられたランド371とが接続され、これにより撮像素子52がガラス配線基板51に実装されている。
また、矢印Q112に示すように、撮像素子52側のランド371にさらにCuピラーバンプ372を形成し、そのCuピラーバンプ372と、バンプ363とを接続することで撮像素子52をガラス配線基板51に実装するようにしてもよい。
〈第2の実施の形態〉
〈撮像装置の構成例〉
また、撮像装置121において、撮像素子52等の部品の実装時の平坦度、つまり平行度をさらに向上させるために、最も部品側にある絶縁層の一部を部品に突き当てるようにしてもよい。
〈撮像装置の構成例〉
また、撮像装置121において、撮像素子52等の部品の実装時の平坦度、つまり平行度をさらに向上させるために、最も部品側にある絶縁層の一部を部品に突き当てるようにしてもよい。
そのような場合、撮像装置121は、例えば図19に示すように構成される。なお、図19において図3における場合と対応する部分には同一の符号を付してあり、その説明は省略する。
図19に示す例では、3層目の絶縁層73における、ダム構造とされた溝状の開口部90に対して撮像素子52の受光部側に隣接して設けられた部分が、アンダーフィル139の受光部への流入を防止するための凸部401となっている。
この凸部401は、撮像素子52側に突となっており、アンダーフィル139のせき止めのための構造となっている点など、基本的には図3に示した凸部91と同じであるが、撮像素子52が実装された状態で、凸部401の表面が撮像素子52に突き当てられた状態となっている点で凸部91とは異なる。
このように絶縁層73の少なくとも一部である凸部401が撮像素子52表面に突き当てられた状態、つまり当接された状態で、撮像素子52がガラス配線基板51に実装されるようにすることで、撮像素子52の平坦度をさらに向上させることができる。
〈第3の実施の形態〉
〈撮像装置の構成例〉
また、撮像装置121のガラス配線基板51を構成する材料、特に表面部分に設けられた絶縁層の一部または全部を反射防止材や遮光可能な材料などにより形成してもよい。これにより、意図せぬ迷光が反射して撮像素子52の受光部へと入射してしまうことを防止することができ、その結果、フレアの発生を抑制することができる。
〈撮像装置の構成例〉
また、撮像装置121のガラス配線基板51を構成する材料、特に表面部分に設けられた絶縁層の一部または全部を反射防止材や遮光可能な材料などにより形成してもよい。これにより、意図せぬ迷光が反射して撮像素子52の受光部へと入射してしまうことを防止することができ、その結果、フレアの発生を抑制することができる。
このように絶縁層の少なくとも一部を反射防止材や遮光可能な材料により形成する場合、撮像装置121は、例えば図20に示すように構成される。なお、図20において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図20に示す撮像装置121は、絶縁層73を構成する絶縁層膜431と、絶縁層83を構成する絶縁層膜432とが、反射防止材または遮光可能な材料により形成されている点で図3に示した撮像装置121と異なっており、その他の点では図3に示した撮像装置121と同じ構成となっている。
この例では、図3においては露出していた絶縁層71や絶縁層72の表面の部分も絶縁層膜431により覆われている。同様に、図3においては露出していた絶縁層81や絶縁層82の表面の部分も絶縁層膜432により覆われている。
図20に示す例では、外部から開口部134に入射した光は、コア基板61を透過して開口部133を通り、撮像素子52の受光部に入射する。このとき、外部からの光が絶縁層83や絶縁層73の表面に入射して迷光成分となってしまう可能性がある。
しかし、この例では絶縁層73を構成する絶縁層膜431と、絶縁層83を構成する絶縁層膜432とは、反射防止材または遮光可能な材料により形成されているため、これらの絶縁層に入射した光が反射して迷光成分となってしまうことを防止することができる。これにより、フレアの発生を抑制することができる。
なお、ここでは3層目の絶縁層73および絶縁層83全体が反射防止材または遮光可能な材料により形成されると説明したが、それらの絶縁層73および絶縁層83の表面部分のみが反射防止材または遮光可能な材料により形成されるようにしてもよい。
〈第4の実施の形態〉
〈撮像素子の実装について〉
また、撮像装置121では図3や図4に示したダム構造の溝部分である開口部90に、撮像素子52が実装されてからアンダーフィル139が塗布されて、アンダーフィル139の樹脂硬化が行われる。しかし、先にアンダーフィル139を形成してから撮像素子52を実装するようにしてもよい。
〈撮像素子の実装について〉
また、撮像装置121では図3や図4に示したダム構造の溝部分である開口部90に、撮像素子52が実装されてからアンダーフィル139が塗布されて、アンダーフィル139の樹脂硬化が行われる。しかし、先にアンダーフィル139を形成してから撮像素子52を実装するようにしてもよい。
そのような場合、製造処理では、例えば図21の矢印Q121に示すように、ガラス配線基板51の開口部221内部に、アンダーフィル245としてのNCP(Non Conductive Paste)またはNCF(Non Conductive Film)が形成(塗布)される。なお、図21において、図9における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
ここで、図21における開口部221は、図4に示した開口部90に対応する、ダム構造の溝である。図21に示す例では、撮像素子52の実装前にこの溝状の開口部221に予めアンダーフィル245が形成される。このような溝状の開口部221を利用することで、容易にアンダーフィル245を形成することが可能となる。なお、この場合、例えばバンプ241およびバンプ242は、撮像素子52側に形成される。
そして、矢印Q122に示すように、実装ヘッド243により、撮像素子52が圧着等によりガラス配線基板51にフリップチップ実装される。これにより、撮像素子52を実装してから液体のアンダーフィルを塗布する必要がなくなる。
また、アンダーフィル245だけでなく、撮像素子52の受光部の画素部分に、透明樹脂を予め形成しておくようにしてもよい。この場合、撮像素子52が実装されると、撮像素子52の受光部と、ガラス配線基板51との間が透明樹脂により封止されることになる。
〈第5の実施の形態〉
〈撮像装置の構成例〉
また、図4に示した例では、開口部90が開口部133の部分、つまり撮像素子52の受光部の部分を完全に隙間なく囲むように形成される例について説明した。図4に示した例では、撮像素子52が実装されると、開口部90により囲まれる部分が空気により完全に封止されることになる。
〈撮像装置の構成例〉
また、図4に示した例では、開口部90が開口部133の部分、つまり撮像素子52の受光部の部分を完全に隙間なく囲むように形成される例について説明した。図4に示した例では、撮像素子52が実装されると、開口部90により囲まれる部分が空気により完全に封止されることになる。
これに対して、例えば図22に示すように、撮像素子52の受光部の部分を隙間なく囲むのではなく、一部に空気の通路、つまり通気口が設けられるように撮像素子52の受光部の部分を囲む複数の開口部を形成するようにしてもよい。なお、図22において図4における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図22の矢印Q131に示す図は、ガラス配線基板51を、ガラス配線基板51の法線方向から見た図を示している。この例では、撮像素子52の受光部と、コア基板61との間の空間の封止される部分、すなわちガラス配線基板51における撮像素子52と対向する部分の領域を囲むように、L字形の4つの開口部461−1乃至開口部461−4が形成されている。
また、互いに隣接する開口部461−1と開口部461−2の間、開口部461−1と開口部461−3の間、開口部461−2と開口部461−4の間、および開口部461−3と開口部461−4の間には、それぞれ空気通路462−1乃至空気通路462−4が形成されている。なお、以下、開口部461−1乃至開口部461−4を特に区別する必要のない場合、単に開口部461とも称し、空気通路462−1乃至空気通路462−4を特に区別する必要のない場合、単に空気通路462とも称することとする。
このように矢印Q131に示す例では、ガラス配線基板51における撮像素子52と対向する部分の領域が、配線層62に形成された複数の溝状の開口部461により囲まれている。そして、互いに隣接する開口部461同士の間には、ガラス配線基板51における撮像素子52と対向する部分の領域と、外部の領域とを接続する通気口である空気通路462が形成されている。
ここで各開口部461の底面は2層目の絶縁層72であり、その絶縁層72の部分に、絶縁層72内部に埋め込まれた導電層74表面に形成されたパッド92やパッド93、パッド463、パッド464などのパッドが設けられている。
また、各空気通路462の底面は3層目の絶縁層73であり、空気通路462の部分は開口部461の部分よりも厚み方向、つまりガラス配線基板51の法線方向の撮像素子52側への高さが高くなるようになっている。
このようにダム構造の開口部461が形成される場合においても、開口部461の外側および内側は、絶縁層72よりも図中、手前側、つまり撮像素子52側に高い絶縁層73となっている。特に、図22中、開口部461の内側に隣接する絶縁増73の部分が凸部91となっており、この凸部91によりアンダーフィルがせき止められて、撮像素子52の受光部への流入が防止される。
また、撮像素子52のガラス配線基板51への実装時には、例えば図9を参照して説明したように撮像素子52が実装された後に、開口部461にアンダーフィルが塗布されて熱硬化が行われるか、または図21を参照して説明したように予め開口部461にアンダーフィルが形成されてから撮像素子52が実装される。
撮像素子52がガラス配線基板51に実装された状態で、矢印Q131に示したガラス配線基板51を図中、下から上方向に見ると、例えば矢印Q132に示すようになっている。この例では、開口部461−3にアンダーフィル465が形成されており、開口部461−4にアンダーフィル466が形成されている。
また、撮像素子52とガラス配線基板51との間の部分に空気通路462−4、つまり通気可能な隙間が形成されており、これにより撮像素子52とガラス配線基板51との間の空間(領域)が完全には封止されていない状態となっていることが分かる。
例えば撮像素子52の実装時には、開口部461に形成されたアンダーフィル465やアンダーフィル466が熱硬化により焼成されるが、この熱硬化時に空気通路462は、撮像素子52とガラス配線基板51との間の部分の空気を外部に逃す空気通路となる。
したがって、このような空気通路462により、撮像素子52とガラス配線基板51との間の部分、つまり封止部分の内圧の上昇を防ぐことが可能となる。
一般的に、アンダーフィルの熱硬化温度は130度程度であり、撮像素子52の受光部を完全に封止した状態で熱硬化を行うと封止部分の内圧上昇により、撮像素子52が傾いたり実装した撮像素子52が外れたりするなどの不良が起こる原因となる。
そこで、この実施の形態では、空気通路462を設けることで、アンダーフィルの熱硬化時の内圧上昇を防止して、撮像装置121の歩留まりや特性を向上させることができるようにした。
なお、この空気通路462は、アンダーフィルの熱硬化後もそのままにしておくと、外部からゴミ等が撮像素子52の受光部に侵入して付着するなど不良の原因となる。そのため、この例では、開口部461にアンダーフィルが形成された後、例えば空気通路462部分に内圧上昇を起こさない紫外線硬化樹脂や低温硬化樹脂などが塗布されて、最終的に撮像素子52とガラス配線基板51との間の部分が完全に封止される。
例えば開口部461部分に形成されるアンダーフィルは、ヤング率が大きいが熱硬化が必要な樹脂材料とされる。これに対して、空気通路462を封止するためのアンダーフィルは、開口部461部分に形成されるアンダーフィルとは異なる、高熱での焼成が不要な樹脂材料とされる。
このように空気通路462の部分も最終的には封止されることが望ましいが、必ずしも空気通路462の部分は封止されなくてもよい。また、ここではL字形の開口部461と、空気通路462とを設ける例について説明したが、これはあくまで一例であって、撮像素子52とガラス配線基板51との間の部分を囲む開口部や、その開口部に隣接して設けられる空気通路はどのようなものであってもよい。
〈第6の実施の形態〉
〈撮像装置の構成例〉
また、図22に示した例において、開口部461に形成(塗布)したアンダーフィルを焼成後、空気通路462を樹脂等で塞ぐのではなく、空気通路462を介して撮像素子52とガラス配線基板51との間の部分に透明樹脂を導入し、封止を行うようにしてもよい。
〈撮像装置の構成例〉
また、図22に示した例において、開口部461に形成(塗布)したアンダーフィルを焼成後、空気通路462を樹脂等で塞ぐのではなく、空気通路462を介して撮像素子52とガラス配線基板51との間の部分に透明樹脂を導入し、封止を行うようにしてもよい。
そのような場合、空気通路462から開口部461により囲まれる部分、つまり撮像素子52とガラス配線基板51の間の部分に透明樹脂が注入され(埋め込まれ)、その透明樹脂により封止が行われる。これにより、透明樹脂による封止後、撮像装置121(パッケージ)に熱を印加した場合でも撮像素子52とガラス配線基板51の間の部分の内圧が上昇してしまうようなこともない。
このように撮像素子52とガラス配線基板51の間の部分に透明樹脂を埋め込む場合、撮像装置121は、例えば図23に示すように構成される。なお、図23において、図3または図22における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図23に示す例では、ガラス配線基板51の撮像素子52側のビルドアップの多層の配線層62には、開口部461が形成されており、それらの開口部461内に設けられたバンプ491やバンプ492によって撮像素子52がガラス配線基板51に実装されている。
また、各開口部461にはアンダーフィル465やアンダーフィル466が形成されている。そして、撮像装置121の開口部133の部分、すなわち開口部461と、撮像素子52と、コア基板61とに囲まれる空間には、図示せぬ空気通路462から注入された透明樹脂493が充填されている。換言すれば、撮像素子52とガラス配線基板51との間の部分が透明樹脂493により完全封止されている。
ここで、透明樹脂493は、例えば撮像素子52の反りへの影響を考慮してヤング率ができるだけ小さい樹脂などとされる。また、光透過性のコア基板61と透明樹脂493との界面における入射光の反射による撮像特性の悪化を防ぐため、透明樹脂493の屈折率が、例えばコア基板61の屈折率と同等、すなわち略同じ屈折率となるように、透明樹脂493の材料が選択されている。
〈第7の実施の形態〉
〈撮像装置の構成例〉
さらに、アンダーフィルをせき止める凸部91について、ビルドアップの多層の配線層62や配線層63を構成する一部の絶縁層のみが、他の絶縁層よりも厚く形成されるようにすることでアンダーフィルのせき止め効果を向上させたり、撮像素子52の実装高さの調整を行い易くするようにすることができる。一方で、配線に関しては、絶縁層の厚みが薄い方が微細な加工が実施し易くなる。
〈撮像装置の構成例〉
さらに、アンダーフィルをせき止める凸部91について、ビルドアップの多層の配線層62や配線層63を構成する一部の絶縁層のみが、他の絶縁層よりも厚く形成されるようにすることでアンダーフィルのせき止め効果を向上させたり、撮像素子52の実装高さの調整を行い易くするようにすることができる。一方で、配線に関しては、絶縁層の厚みが薄い方が微細な加工が実施し易くなる。
そこで、例えば図24に示すようにガラス配線基板51の最も外側に位置する絶縁層73および絶縁層83を、他の絶縁層、すなわち絶縁層71や絶縁層72、絶縁層81、絶縁層82よりも厚くするようにしてもよい。なお、図24において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図24に示す例では、最外側に位置する絶縁層73および絶縁層83の図中、縦方向、つまりガラス配線基板51の法線方向の厚みが、他の内層側に位置する絶縁層71、絶縁層72、絶縁層81、および絶縁層82の厚みよりも厚くなっている。これにより、撮像素子52の実装高さを容易に調整することができるだけでなく、凸部91の高さを高くして、アンダーフィル139のせき止め効果を向上させることができる。
また、内層側に設けられた絶縁層71、絶縁層72、絶縁層81、および絶縁層82の厚みは十分に薄いので、微細な金属配線を形成するなど、導電層の微細な加工を容易に実現することができる。なお、撮像素子52等の実装部品の実装高さの調整は、例えば絶縁層71や絶縁層72など、各絶縁層の厚みを調整することにより行えばよい。
このように、各絶縁層の厚みを適切に調整することで、ガラス配線基板51全体を最適な構造に設計することができる。なお、図24に示した例は、あくまで一例であり、1層目の絶縁層71の厚みを厚くして撮像素子52の実装高さを高くすることなども考えられる。また、ガラス配線基板51に印加される厚み方向の膜応力を表裏で均一にするため、表裏に形成する絶縁層の厚みや構造、つまり配線層62と配線層63の各絶縁層の厚みや構造は、できるだけ対称にすることが望ましい。
〈第8の実施の形態〉
〈撮像装置の構成例〉
また、アンダーフィルのせき止め構造について、絶縁層73の一部または全部に対して親水処理や撥水処理を施すことにより、アンダーフィルのせき止め効果をさらに向上させるようにしてもよい。
〈撮像装置の構成例〉
また、アンダーフィルのせき止め構造について、絶縁層73の一部または全部に対して親水処理や撥水処理を施すことにより、アンダーフィルのせき止め効果をさらに向上させるようにしてもよい。
そのような場合、撮像装置121は、例えば図25に示すように構成される。なお、図25において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図25に示す例では、絶縁層73に設けられた凸部91の表面部分、すなわち矢印W11により示される、凸部91の撮像素子52と対向する部分に対して、親水処理または撥水処理が施されている。これにより、開口部90へのアンダーフィル139の塗布時に、アンダーフィル139が開口部90の外部に流出してしまうことを防止することができる。すなわち、アンダーフィル139のせき止め効果を向上させることができる。
なお、凸部91だけでなく、開口部90の凸部91側の斜面部分の一部や、絶縁層73表面における開口部90よりも外側、つまり開口部90に対して、ガラス配線基板51の中心側とは反対側の部分等にも親水処理や撥水処理が施されてもよい。
ここで、凸部91の表面部分等に対する親水処理や撥水処理は、例えば目的とする領域に対してプラズマ処理を施したり、目的とする領域に金属膜等の薄膜を成膜したりすることにより行われる。
〈第9の実施の形態〉
〈電子機器の構成例〉
なお、以上においては、撮像装置121に本技術を適用する例について説明した。しかし、本技術は、半導体素子等の部品、特に基板との間の空間を封止することが好ましい部品が実装された、撮像装置121とは異なる半導体装置や、撮像装置121を含む各種の半導体装置を備える電子機器全般に対して適用可能である。
〈電子機器の構成例〉
なお、以上においては、撮像装置121に本技術を適用する例について説明した。しかし、本技術は、半導体素子等の部品、特に基板との間の空間を封止することが好ましい部品が実装された、撮像装置121とは異なる半導体装置や、撮像装置121を含む各種の半導体装置を備える電子機器全般に対して適用可能である。
例えば本技術は、図26に示す半導体装置にも適用可能である。なお、図26において図3における場合と対応する部分には同一の符号を付してあり、その説明は適宜省略する。
図26に示す例では、半導体装置521は、ガラス配線基板51と、そのガラス配線基板51に実装された、機械構造を有するMEMS(Micro Electro Mechanical Systems)素子531とから構成されている。
この例では、ガラス配線基板51には、図3に示した開口部133および開口部134は設けられていない。また、実装素子の一例であるMEMS素子531は、開口部90内部に設けられたバンプ94やバンプ95によって、ガラス配線基板51にフリップチップ実装されている。
ここで、バンプ94やバンプ95は、図3における場合と同様に、最も外側に設けられた導電層75よりもコア基板61側にある導電層74に形成されたパッド92やパッド93に形成されている。また、開口部90の部分にはアンダーフィル139が形成されており、これによりMEMS素子531とガラス配線基板51との間の部分が封止されている。
特に、MEMS素子531におけるガラス配線基板51と対向する面の部分に機械構造が設けられている場合には、その機械構造の部分を封止することにより、機構構造の部分にダスト等が付着することを防止し、特性向上を図ることができる。
なお、以上において説明した各実施の形態や変形例を適宜、組み合わせるようにしてもよい。
〈撮像装置の構成例〉
さらに、本技術は、デジタルスチルカメラやビデオカメラ等の撮像装置や、撮像機能を有する携帯端末装置や、画像読取部に固体撮像装置を用いる複写機など、光電変換部に上述した撮像装置121に対応する固体撮像装置を用いる電子機器全般に対して適用可能である。
さらに、本技術は、デジタルスチルカメラやビデオカメラ等の撮像装置や、撮像機能を有する携帯端末装置や、画像読取部に固体撮像装置を用いる複写機など、光電変換部に上述した撮像装置121に対応する固体撮像装置を用いる電子機器全般に対して適用可能である。
図27は、本技術を適用した電子機器としての、撮像装置の構成例を示す図である。
図27に示す撮像装置601は、レンズ群等を含む光学系611、撮像部612、DSP(Digital Signal Processor)回路613、フレームメモリ614、表示部615、記録部616、操作部617、および電源部618を有する。また、DSP回路613乃至電源部618は、バスライン619を介して相互に接続されている。
光学系611は、被写体からの入射光(像光)を取り込んで撮像部612の撮像面上に結像する。撮像部612は、光学系611によって撮像面上に結像された入射光の光量を画素単位で電気信号に変換して画素信号として出力する。この撮像部612は、例えば図3に示した撮像装置121に対応する。
DSP回路613は、撮像部612からの信号を処理する。例えばDSP回路613は、撮像部612による撮像で得られた各画素からの信号を処理し、フレームメモリ614に展開する処理を行う。
表示部615は、液晶表示パネルや有機EL(Electro Luminescence)パネルからなり、撮像部612で撮像された動画像または静止画像を表示する。記録部616は、撮像部612で撮像された動画像や静止画像を、DVD(Digital Versatile Disk)等の記録媒体に記録する。
操作部617は、ユーザによる操作の下に、撮像装置601が持つ様々な機能について操作指令を発する。電源部618は、DSP回路613、フレームメモリ614、表示部615、記録部616、および操作部617の動作電源となる各種の電源を、これらの供給対象に対して適宜供給する。
<固体撮像装置の使用例>
図28は、上述の撮像装置121等の固体撮像装置(イメージセンサ)を使用する使用例を示す図である。
図28は、上述の撮像装置121等の固体撮像装置(イメージセンサ)を使用する使用例を示す図である。
上述した固体撮像装置は、例えば、以下のように、可視光や、赤外光、紫外光、X線等の光をセンシングする様々なケースに使用することができる。
・デジタルカメラや、カメラ機能付きの携帯機器等の、鑑賞の用に供される画像を撮影する装置
・自動停止等の安全運転や、運転者の状態の認識等のために、自動車の前方や後方、周囲、車内等を撮影する車載用センサ、走行車両や道路を監視する監視カメラ、車両間等の測距を行う測距センサ等の、交通の用に供される装置
・ユーザのジェスチャを撮影して、そのジェスチャに従った機器操作を行うために、TVや、冷蔵庫、エアーコンディショナ等の家電に供される装置
・内視鏡や、赤外光の受光による血管撮影を行う装置等の、医療やヘルスケアの用に供される装置
・防犯用途の監視カメラや、人物認証用途のカメラ等の、セキュリティの用に供される装置
・肌を撮影する肌測定器や、頭皮を撮影するマイクロスコープ等の、美容の用に供される装置
・スポーツ用途等向けのアクションカメラやウェアラブルカメラ等の、スポーツの用に供される装置
・畑や作物の状態を監視するためのカメラ等の、農業の用に供される装置
・自動停止等の安全運転や、運転者の状態の認識等のために、自動車の前方や後方、周囲、車内等を撮影する車載用センサ、走行車両や道路を監視する監視カメラ、車両間等の測距を行う測距センサ等の、交通の用に供される装置
・ユーザのジェスチャを撮影して、そのジェスチャに従った機器操作を行うために、TVや、冷蔵庫、エアーコンディショナ等の家電に供される装置
・内視鏡や、赤外光の受光による血管撮影を行う装置等の、医療やヘルスケアの用に供される装置
・防犯用途の監視カメラや、人物認証用途のカメラ等の、セキュリティの用に供される装置
・肌を撮影する肌測定器や、頭皮を撮影するマイクロスコープ等の、美容の用に供される装置
・スポーツ用途等向けのアクションカメラやウェアラブルカメラ等の、スポーツの用に供される装置
・畑や作物の状態を監視するためのカメラ等の、農業の用に供される装置
また、本技術の実施の形態は、上述した実施の形態に限定されるものではなく、本技術の要旨を逸脱しない範囲において種々の変更が可能である。
さらに、本技術は、以下の構成とすることも可能である。
(1)
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置の製造方法であって、
前記開口部を形成するために前記所定の導電層に隣接する隣接絶縁層に形成された開口部分にレジストが塗布されるように、前記隣接絶縁層に形成されたシードメタル上にレジストパターンを形成し、
めっき処理が行われて前記レジストが除去された後、前記開口部分を含む前記隣接絶縁層上の前記シードメタルを除去することで前記所定の導電層に隣接する導電層を形成し、
前記最外側の絶縁層が形成された後、前記開口部を形成する
ステップを含む製造方法。
(2)
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂を形成するステップをさらに含む
(1)に記載の製造方法。
(3)
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部を形成する
(2)に記載の製造方法。
(4)
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成される
(3)に記載の製造方法。
(5)
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止される
(4)に記載の製造方法。
(6)
前記実装素子は、撮像素子であり、
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成される
(4)に記載の製造方法。
(7)
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填される
(6)に記載の製造方法。
(8)
前記実装素子と前記パッドとはバンプ接続により接続される
(1)乃至(7)の何れか一項に記載の製造方法。
(9)
前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
(1)乃至(8)の何れか一項に記載の製造方法。
(10)
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置。
(11)
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂が形成されている
(10)に記載の半導体装置。
(12)
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部が形成されている
(11)に記載の半導体装置。
(13)
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成されている
(12)に記載の半導体装置。
(14)
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止されている
(13)に記載の半導体装置。
(15)
前記実装素子は、撮像素子である
(13)に記載の半導体装置。
(16)
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成されている
(15)に記載の半導体装置。
(17)
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填されている
(16)に記載の半導体装置。
(18)
前記実装素子と前記パッドとはバンプ接続により接続される
(10)乃至(17)の何れか一項に記載の半導体装置。
(19)
前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
(10)乃至(18)の何れか一項に記載の半導体装置。
(20)
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える電子機器。
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置の製造方法であって、
前記開口部を形成するために前記所定の導電層に隣接する隣接絶縁層に形成された開口部分にレジストが塗布されるように、前記隣接絶縁層に形成されたシードメタル上にレジストパターンを形成し、
めっき処理が行われて前記レジストが除去された後、前記開口部分を含む前記隣接絶縁層上の前記シードメタルを除去することで前記所定の導電層に隣接する導電層を形成し、
前記最外側の絶縁層が形成された後、前記開口部を形成する
ステップを含む製造方法。
(2)
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂を形成するステップをさらに含む
(1)に記載の製造方法。
(3)
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部を形成する
(2)に記載の製造方法。
(4)
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成される
(3)に記載の製造方法。
(5)
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止される
(4)に記載の製造方法。
(6)
前記実装素子は、撮像素子であり、
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成される
(4)に記載の製造方法。
(7)
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填される
(6)に記載の製造方法。
(8)
前記実装素子と前記パッドとはバンプ接続により接続される
(1)乃至(7)の何れか一項に記載の製造方法。
(9)
前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
(1)乃至(8)の何れか一項に記載の製造方法。
(10)
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置。
(11)
前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂が形成されている
(10)に記載の半導体装置。
(12)
前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部が形成されている
(11)に記載の半導体装置。
(13)
前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成されている
(12)に記載の半導体装置。
(14)
前記空気通路が前記保護樹脂とは異なる他の樹脂により封止されている
(13)に記載の半導体装置。
(15)
前記実装素子は、撮像素子である
(13)に記載の半導体装置。
(16)
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成されている
(15)に記載の半導体装置。
(17)
前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填されている
(16)に記載の半導体装置。
(18)
前記実装素子と前記パッドとはバンプ接続により接続される
(10)乃至(17)の何れか一項に記載の半導体装置。
(19)
前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
(10)乃至(18)の何れか一項に記載の半導体装置。
(20)
コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える電子機器。
51 ガラス配線基板, 52 撮像素子, 61 コア基板, 62 配線層, 64 マイクロレンズ, 71 絶縁層, 72 絶縁層, 73 絶縁層, 74 導電層, 75 導電層, 90 開口部, 91 凸部, 94 バンプ, 95 バンプ, 121 撮像装置, 133 開口部, 134 開口部, 139 アンダーフィル, 401 凸部, 431 絶縁層膜, 461−1乃至461−4,461 開口部, 462−1乃至462−4,462 空気通路, 493 透明樹脂
Claims (20)
- コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置の製造方法であって、
前記開口部を形成するために前記所定の導電層に隣接する隣接絶縁層に形成された開口部分にレジストが塗布されるように、前記隣接絶縁層に形成されたシードメタル上にレジストパターンを形成し、
めっき処理が行われて前記レジストが除去された後、前記開口部分を含む前記隣接絶縁層上の前記シードメタルを除去することで前記所定の導電層に隣接する導電層を形成し、
前記最外側の絶縁層が形成された後、前記開口部を形成する
ステップを含む製造方法。 - 前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂を形成するステップをさらに含む
請求項1に記載の製造方法。 - 前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部を形成する
請求項2に記載の製造方法。 - 前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成される
請求項3に記載の製造方法。 - 前記空気通路が前記保護樹脂とは異なる他の樹脂により封止される
請求項4に記載の製造方法。 - 前記実装素子は、撮像素子であり、
前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成される
請求項4に記載の製造方法。 - 前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填される
請求項6に記載の製造方法。 - 前記実装素子と前記パッドとはバンプ接続により接続される
請求項1に記載の製造方法。 - 前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
請求項1に記載の製造方法。 - コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える半導体装置。 - 前記開口部内における前記実装素子と前記パッドとの接続部分に、その接続部分を保護する保護樹脂が形成されている
請求項10に記載の半導体装置。 - 前記多層配線層に、前記実装素子と対向する領域を囲むように溝状の前記開口部が形成されている
請求項11に記載の半導体装置。 - 前記多層配線層には、前記実装素子と対向する前記領域を囲むように複数の前記開口部が形成され、互いに隣接する前記開口部の間に、前記開口部により囲まれる前記実装素子と対向する前記領域と、外部とを接続する空気通路が形成されている
請求項12に記載の半導体装置。 - 前記空気通路が前記保護樹脂とは異なる他の樹脂により封止されている
請求項13に記載の半導体装置。 - 前記実装素子は、撮像素子である
請求項13に記載の半導体装置。 - 前記コア基板は光透過性を有する材料から構成され、前記撮像素子の受光部が前記コア基板に対向するように前記撮像素子が前記パッド部分に接続され、
前記多層配線層における前記撮像素子と対向する部分には、外部から入射し、前記コア基板を透過した光を前記撮像素子の前記受光部へと導く光通過用開口部が形成されている
請求項15に記載の半導体装置。 - 前記開口部により囲まれる前記撮像素子と対向する前記領域には透明樹脂が充填されている
請求項16に記載の半導体装置。 - 前記実装素子と前記パッドとはバンプ接続により接続される
請求項10に記載の半導体装置。 - 前記多層配線層を構成する一部の絶縁層の厚みが、前記多層配線層を構成する他の絶縁層の厚みよりも厚くなっている
請求項10に記載の半導体装置。 - コア基板と、
複数の導電層と複数の絶縁層とを有し、前記コア基板表面に形成された多層配線層と、
前記多層配線層に形成され、前記複数の絶縁層のうちの少なくとも最も前記コア基板から遠い最外側の絶縁層を貫通する開口部と、
前記開口部内における、前記複数の導電層のうちの最も前記コア基板から遠い最外側の導電層よりも前記コア基板側にある所定の導電層に設けられたパッド部分に接続された実装素子と
を備える電子機器。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2016018881A JP2017139316A (ja) | 2016-02-03 | 2016-02-03 | 半導体装置および製造方法、並びに電子機器 |
| CN201780008573.0A CN108604574B (zh) | 2016-02-03 | 2017-01-20 | 半导体装置及制造方法、成像装置、以及电子设备 |
| PCT/JP2017/001852 WO2017135062A1 (ja) | 2016-02-03 | 2017-01-20 | 半導体装置および製造方法、撮像装置、並びに電子機器 |
| US16/070,383 US11043436B2 (en) | 2016-02-03 | 2017-01-20 | Semiconductor device, manufacturing method, imaging device, and electronic apparatus for enabling component mounting with high flatness |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2016018881A JP2017139316A (ja) | 2016-02-03 | 2016-02-03 | 半導体装置および製造方法、並びに電子機器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2017139316A true JP2017139316A (ja) | 2017-08-10 |
Family
ID=59500683
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2016018881A Pending JP2017139316A (ja) | 2016-02-03 | 2016-02-03 | 半導体装置および製造方法、並びに電子機器 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US11043436B2 (ja) |
| JP (1) | JP2017139316A (ja) |
| CN (1) | CN108604574B (ja) |
| WO (1) | WO2017135062A1 (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2019110705A (ja) * | 2017-12-19 | 2019-07-04 | 大日本印刷株式会社 | 圧電素子積層体およびそれを用いた振動発電デバイス |
| WO2020003732A1 (ja) * | 2018-06-29 | 2020-01-02 | ソニーセミコンダクタソリューションズ株式会社 | 撮像装置及び電子機器 |
| JP2020141064A (ja) * | 2019-02-28 | 2020-09-03 | 大日本印刷株式会社 | 配線基板および素子 |
| US20230005880A1 (en) * | 2021-06-30 | 2023-01-05 | Texas Instruments Incorporated | Flip chip packaged devices with thermal pad |
| JP2024002572A (ja) * | 2022-06-24 | 2024-01-11 | 沖電気工業株式会社 | 半導体装置及び半導体装置製造方法 |
| WO2024202527A1 (ja) * | 2023-03-29 | 2024-10-03 | ソニーセミコンダクタソリューションズ株式会社 | 半導体パッケージ、半導体装置、および、半導体パッケージの製造方法 |
| WO2025009257A1 (ja) * | 2023-07-05 | 2025-01-09 | 株式会社ジャパンディスプレイ | 電子装置 |
| WO2026009953A1 (ja) * | 2024-07-03 | 2026-01-08 | 大日本印刷株式会社 | 貫通電極基板、素子付き貫通電極基板、半導体装置および貫通電極用基板 |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US10128289B2 (en) | 2016-09-12 | 2018-11-13 | Semiconductor Components Industries, Llc | Embedded image sensor semiconductor packages and related methods |
| JP2019040893A (ja) | 2017-08-22 | 2019-03-14 | ソニーセミコンダクタソリューションズ株式会社 | 固体撮像装置およびその製造方法、並びに電子機器 |
| US10804305B2 (en) * | 2018-04-23 | 2020-10-13 | Sunny Opotech North America Inc. | Manufacture of semiconductor module with dual molding |
| CN109494241B (zh) * | 2018-10-08 | 2020-11-24 | 武汉华星光电半导体显示技术有限公司 | 柔性oled显示面板及其制备方法 |
| EP3886170A4 (en) * | 2018-11-20 | 2022-08-17 | LG Innotek Co., Ltd. | SUBSTRATE FOR AN IMAGE SENSOR |
| KR20230157536A (ko) * | 2019-03-08 | 2023-11-16 | 데쿠세리아루즈 가부시키가이샤 | 접속 구조체의 제조 방법, 및 접속 구조체, 그리고 필름 구조체, 및 필름 구조체의 제조 방법 |
| CN111757593B (zh) * | 2020-06-29 | 2023-12-22 | 深圳市百柔新材料技术有限公司 | 玻璃芯板电路板及其制备方法 |
| CN112701134B (zh) * | 2020-12-30 | 2023-04-25 | 长春长光辰芯微电子股份有限公司 | 一种图像传感器 |
| WO2022271598A1 (en) * | 2021-06-21 | 2022-12-29 | Meta Platforms Technologies, Llc | Camera module with component size based on image sensor |
| TWI774597B (zh) * | 2021-10-29 | 2022-08-11 | 矽品精密工業股份有限公司 | 電子封裝件及其製法 |
Family Cites Families (27)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1571706B1 (en) * | 2002-11-21 | 2018-09-12 | Hitachi, Ltd. | Electronic device |
| JP3768487B2 (ja) * | 2003-03-26 | 2006-04-19 | 三菱電機株式会社 | カメラモジュール |
| TWI296154B (en) * | 2004-01-27 | 2008-04-21 | Casio Computer Co Ltd | Optical sensor module |
| JP4170968B2 (ja) | 2004-02-02 | 2008-10-22 | 松下電器産業株式会社 | 光学デバイス |
| US20090053850A1 (en) * | 2005-03-25 | 2009-02-26 | Fujifilm Corporation | Method of manufacturing solid state imaging device |
| KR100735492B1 (ko) * | 2005-11-23 | 2007-07-04 | 삼성전기주식회사 | 단차부를 갖는 인쇄회로기판을 이용한 카메라 모듈 |
| TW200727501A (en) * | 2006-01-11 | 2007-07-16 | Advanced Semiconductor Eng | Image sensor module and method for manufacturing the same |
| JP4874005B2 (ja) * | 2006-06-09 | 2012-02-08 | 富士通セミコンダクター株式会社 | 半導体装置、その製造方法及びその実装方法 |
| KR100790996B1 (ko) * | 2006-08-30 | 2008-01-03 | 삼성전자주식회사 | 이미지 센서 패키지, 그 제조 방법 및 이를 포함하는이미지 센서 모듈 |
| US20080211075A1 (en) * | 2006-10-06 | 2008-09-04 | Advanced Chip Engineering Technology Inc. | Image sensor chip scale package having inter-adhesion with gap and method of the same |
| JP2008305972A (ja) | 2007-06-07 | 2008-12-18 | Panasonic Corp | 光学デバイス及びその製造方法、並びに、光学デバイスを用いたカメラモジュール及び該カメラモジュールを搭載した電子機器 |
| US7893527B2 (en) * | 2007-07-24 | 2011-02-22 | Samsung Electro-Mechanics Co., Ltd. | Semiconductor plastic package and fabricating method thereof |
| JPWO2009041159A1 (ja) * | 2007-09-28 | 2011-01-20 | 三洋電機株式会社 | 素子搭載用基板及びその製造方法、回路装置及びその製造方法、携帯機器 |
| US9460951B2 (en) * | 2007-12-03 | 2016-10-04 | STATS ChipPAC Pte. Ltd. | Semiconductor device and method of wafer level package integration |
| CN101494233A (zh) * | 2008-01-24 | 2009-07-29 | 索尼株式会社 | 固态摄像装置及其制造方法 |
| TW200952142A (en) * | 2008-06-13 | 2009-12-16 | Phoenix Prec Technology Corp | Package substrate having embedded semiconductor chip and fabrication method thereof |
| KR101608729B1 (ko) * | 2009-10-01 | 2016-04-20 | 삼성전자주식회사 | 이미지 센서 모듈, 이의 제조방법, 이미지 센서 모듈을 구비하는 촬상소자 및 이의 제조방법 |
| KR100976812B1 (ko) * | 2010-02-08 | 2010-08-20 | 옵토팩 주식회사 | 전자 소자 패키지 및 그 제조 방법 |
| US8581386B2 (en) * | 2010-02-26 | 2013-11-12 | Yu-Lin Yen | Chip package |
| US8698269B2 (en) * | 2011-02-28 | 2014-04-15 | Ibiden Co., Ltd. | Wiring board with built-in imaging device and method for manufacturing same |
| US8975183B2 (en) * | 2012-02-10 | 2015-03-10 | Taiwan Semiconductor Manufacturing Co., Ltd. | Process for forming semiconductor structure |
| KR101976602B1 (ko) * | 2012-12-26 | 2019-05-10 | 엘지이노텍 주식회사 | 인쇄회로 기판 및 그 제조 방법 |
| US8896094B2 (en) * | 2013-01-23 | 2014-11-25 | Taiwan Semiconductor Manufacturing Company, Ltd. | Methods and apparatus for inductors and transformers in packages |
| JP6316609B2 (ja) * | 2014-02-05 | 2018-04-25 | 新光電気工業株式会社 | 配線基板及び半導体装置と配線基板の製造方法及び半導体装置の製造方法 |
| US9379081B2 (en) * | 2014-03-24 | 2016-06-28 | King Dragon Nternational Inc. | Semiconductor device package and method of the same |
| TWI582916B (zh) * | 2015-04-27 | 2017-05-11 | 南茂科技股份有限公司 | 多晶片封裝結構、晶圓級晶片封裝結構及其製程 |
| US20170098628A1 (en) * | 2015-10-05 | 2017-04-06 | Mediatek Inc. | Semiconductor package structure and method for forming the same |
-
2016
- 2016-02-03 JP JP2016018881A patent/JP2017139316A/ja active Pending
-
2017
- 2017-01-20 WO PCT/JP2017/001852 patent/WO2017135062A1/ja not_active Ceased
- 2017-01-20 CN CN201780008573.0A patent/CN108604574B/zh active Active
- 2017-01-20 US US16/070,383 patent/US11043436B2/en active Active
Cited By (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2019110705A (ja) * | 2017-12-19 | 2019-07-04 | 大日本印刷株式会社 | 圧電素子積層体およびそれを用いた振動発電デバイス |
| WO2020003732A1 (ja) * | 2018-06-29 | 2020-01-02 | ソニーセミコンダクタソリューションズ株式会社 | 撮像装置及び電子機器 |
| US11894407B2 (en) | 2018-06-29 | 2024-02-06 | Sony Semiconductor Solutions Corporation | Imaging apparatus and electronic device |
| JP2020141064A (ja) * | 2019-02-28 | 2020-09-03 | 大日本印刷株式会社 | 配線基板および素子 |
| JP7305985B2 (ja) | 2019-02-28 | 2023-07-11 | 大日本印刷株式会社 | 配線基板および素子 |
| US20230005880A1 (en) * | 2021-06-30 | 2023-01-05 | Texas Instruments Incorporated | Flip chip packaged devices with thermal pad |
| US11955456B2 (en) * | 2021-06-30 | 2024-04-09 | Texas Instruments Incorporated | Flip chip packaged devices with thermal pad |
| JP2024002572A (ja) * | 2022-06-24 | 2024-01-11 | 沖電気工業株式会社 | 半導体装置及び半導体装置製造方法 |
| JP7790282B2 (ja) | 2022-06-24 | 2025-12-23 | 沖電気工業株式会社 | 半導体装置及び半導体装置製造方法 |
| WO2024202527A1 (ja) * | 2023-03-29 | 2024-10-03 | ソニーセミコンダクタソリューションズ株式会社 | 半導体パッケージ、半導体装置、および、半導体パッケージの製造方法 |
| WO2025009257A1 (ja) * | 2023-07-05 | 2025-01-09 | 株式会社ジャパンディスプレイ | 電子装置 |
| WO2026009953A1 (ja) * | 2024-07-03 | 2026-01-08 | 大日本印刷株式会社 | 貫通電極基板、素子付き貫通電極基板、半導体装置および貫通電極用基板 |
Also Published As
| Publication number | Publication date |
|---|---|
| CN108604574A (zh) | 2018-09-28 |
| US20190019737A1 (en) | 2019-01-17 |
| WO2017135062A1 (ja) | 2017-08-10 |
| CN108604574B (zh) | 2022-08-26 |
| US11043436B2 (en) | 2021-06-22 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP2017139316A (ja) | 半導体装置および製造方法、並びに電子機器 | |
| KR102366336B1 (ko) | 반도체 장치, 및, 반도체 장치의 제조 방법 | |
| JP6885331B2 (ja) | 半導体装置およびその製造方法、並びに電子機器 | |
| JP5794020B2 (ja) | 固体撮像装置 | |
| JP4567074B2 (ja) | カメラモジュールパッケージ及びその製造方法 | |
| US8823872B2 (en) | Image pickup module with improved flatness of image sensor and via electrodes | |
| CN108701696B (zh) | 玻璃中介层模块、成像装置和电子设备 | |
| US10446598B2 (en) | Semiconductor device, manufacturing method, and electronic apparatus | |
| CN104469106B (zh) | 摄像模块 | |
| WO2017126376A1 (ja) | イメージセンサ、製造方法、及び、電子機器 | |
| WO2004107738A1 (ja) | 撮像装置およびその製造方法 | |
| JP2010045082A (ja) | 表示素子・電子素子モジュールおよびその製造方法、電子情報機器 | |
| US8951858B2 (en) | Imager device with electric connections to electrical device | |
| CN103081105B (zh) | 图像拾取装置、图像拾取模块和照相机 | |
| JP2004079578A (ja) | 半導体装置 | |
| TWI886521B (zh) | 影像感測器封裝製造的方法 | |
| WO2022085326A1 (ja) | 撮像装置、電子機器および撮像装置の製造方法 | |
| JP2011066093A (ja) | 撮像ユニット | |
| KR102396489B1 (ko) | 카메라 패키징 장치 | |
| KR102396490B1 (ko) | 반도체 칩을 포함하는 카메라 패키징 장치 | |
| JP2016076616A (ja) | 半導体装置、製造装置、製造方法 | |
| JP6427864B2 (ja) | 固体撮像素子及び電子カメラ | |
| JP2014199949A (ja) | 撮像ユニット | |
| JP2015073017A (ja) | 半導体装置及び電子カメラ |