JP2017520906A - 貫通ガラスバイアの作製のための接合材料のエッチバックプロセス - Google Patents
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Abstract
Description
基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層によって接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有し、前記複数の孔の内の少なくともいくつかに延び込んで、前記ガラス基板の前記第1の面からの高さhを有する接着剤プラグを形成する、
前記基板の前記複数の孔を通して前記接合層を深さdまでエッチングする工程、前記深さdは前記厚さtと前記高さhの和以下である、及び
前記複数の孔を、前記複数のバイアを形成するため、材料で埋め込む工程、
を含む、方法。
パルスレーザビームを用いて孔開けすることで前記基板に前記複数の孔を形成する工程をさらに含む、実施形態1に記載の方法。
前記接合層をエッチングする工程がウエットエッチングプロセスを利用する工程を含む、実施形態1または2に記載の方法。
前記接合層をエッチングする工程がドライエッチングプロセスを利用する工程を含む、実施形態1または2に記載の方法。
前記材料が前記接合層に長さlで延び込む導電材料であり、前記lは前記深さdと前記高さhの間の差に等しい、及び
前記方法が前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程をさらに含み、前記複数のバイアを形成している前記導電材料の一部が前記基板の前記第1の面から突き出す、
実施形態1から4のいずれかに記載の方法。
前記深さdが前記接合層の厚さtと前記高さhの和に等しく、よって前記長さlが前記高さhに等しい、実施形態5に記載の方法。
基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層によって接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有する、
前記基板の前記複数の孔を通して前記接合層を、ウエットエッチングプロセスを用いて、深さdまでエッチングする工程、
前記複数の孔を、前記ガラスに前記複数のバイアを形成するため、導電材料で埋め込む工程、前記導電材料は前記接合層に長さlまで延び込み、前記長さlは前記厚さtより小さい、及び
前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程、前記導電材料は前記基板の前記第1の面から突き出す、
を含む、方法。
前記基板が100μm以下の厚さを有する、実施形態7に記載の方法。
前記基板の前記厚さが100μmより薄い、実施形態8に記載の方法。
前記ウエットエッチングプロセスが、HF及びアセトンから選ばれる溶剤に前記接合層をさらす工程を含む、実施形態7から9のいずれかに記載の方法。
前記基板が前記エッチングプロセスに対するハードマスクであるように、前記基板を通して前記接合層が前記溶剤にさらされる、実施形態10に記載の方法。
前記基板が100μm以下の厚さを有する、実施形態11に記載の方法。
前記導電材料が銅材料を含む、実施形態7から12のいずれかに記載の方法。
前記方法が前記複数のバイアを有する前記基板を三次元積層型集積回路に組み込む工程をさらに含む、実施形態7〜13に記載の方法。
基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層を用いて接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有する、
前記基板の前記複数の孔を通して前記接合層を、ドライエッチングプロセスを用いて、深さdまでエッチングする工程、前記深さdは前記基板の前記第1の面から前記接合層に前記エッチングが延び込んだ長さlと前記複数の孔の内の少なくともいくつかに前記接合層が延びこむことで形成された接着剤プラグの高さhの和に等しく、前記長さlは前記厚さtに等しく、前記キャリアの前記第1の面が前記ドライエッチングプロセスに対するストップ層である、
前記複数の孔を、前記基板に前記複数のバイアを形成するため、導電材料で埋め込む工程、前記導電材料は前記キャリアの前記第1の面まで前記接合層を貫通する、及び
前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程、前記導電材料は前記ガラス基板の前記第1の面から長さlで延びるピラーを形成する、
を含む、方法。
前記ドライエッチングプロセスがO2またはアルゴンを含有するガスの内の少なくとも1つから発生されるプラズマに前記接合層をさらす工程を含む、実施形態15に記載の方法。
前記導電材料が銅を含む、実施形態15または16に記載の方法。
前記ピラーのそれぞれが、前記基板の第1の面に実質的に垂直な方向に延びる、前記基板の前記第1の面から延びる円筒を含む、実施形態15から17のいずれかに記載の方法。
前記基板が100μm以下の厚さを有する、実施形態15から18のいずれかに記載の方法。
前記基板の前記厚さが100μmより薄い、実施形態19に記載の方法
102 ガラス基板
104 孔
106 ガラスキャリア
108 接合層
110,112 ガラス基板の面
114,116 ガラスキャリアの面
118 接着剤プラグ
120 接着剤プラグの遠位面
200 エッチャント
400 バイア/導電材料
Claims (10)
- 基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層によって接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有し、前記複数の孔の内の少なくともいくつかに延び込んで、前記ガラス基板の前記第1の面からの高さhを有する接着剤プラグを形成する、
前記基板の前記複数の孔を通して前記接合層を深さdまでエッチングする工程、前記深さdは前記厚さtと前記高さhの和以下である、及び
前記複数の孔を、前記複数のバイアを形成するため、材料で埋め込む工程、
を含むことを特徴とする方法。 - 前記接合層をエッチングする工程がウエットエッチングプロセスを利用する工程を含むことを特徴とする請求項1に記載の方法。
- 前記接合層をエッチングする工程がドライエッチングプロセスを利用する工程を含むことを特徴とする請求項1に記載の方法。
- 前記材料が前記接合層に長さlで延び込む導電材料であり、前記lは前記深さdと前記高さhの間の差に等しい、及び
前記方法が前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程をさらに含み、前記複数のバイアを形成している前記導電材料の一部が前記基板の前記第1の面から突き出す、
ことを特徴とする請求項1から3のいずれかに記載の方法。 - 基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層によって接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有する、
前記基板の前記複数の孔を通して前記接合層を、ウエットエッチングプロセスを用いて、深さdまでエッチングする工程、
前記複数の孔を、前記ガラスに前記複数のバイアを形成するため、導電材料で埋め込む工程、前記導電材料は前記接合層に長さlまで延び込み、前記長さlは前記厚さtより小さい、及び
前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程、前記導電材料は前記基板の前記第1の面から突き出す、
を含むことを特徴とする方法。 - 前記基板が100μm以下の厚さを有することを特徴とする請求項5に記載の方法。
- 前記ウエットエッチングプロセスがHF及びアセトンから選ばれる溶剤に前記接合層をさらす工程を含むことを特徴とする請求項5または6に記載の方法。
- 前記基板が前記エッチングプロセスに対するハードマスクであるように前記基板を通して前記接合層が前記溶剤にさらされることを特徴とする請求項7に記載の方法。
- 基板に複数のバイアを作製するための方法において、前記方法が、
複数の孔を有する前記基板の第1の面をキャリアの第1の面に接合層を用いて接合する工程、前記接合層は前記基板の前記第1の面と前記キャリアの前記第1の面の間の厚さtを有する、
前記基板の前記複数の孔を通して前記接合層を、ドライエッチングプロセスを用いて、深さdまでエッチングする工程、前記深さdは前記基板の前記第1の面から前記接合層に前記エッチングが延び込んだ長さlと前記複数の孔の内の少なくともいくつかに前記接合層が延びこむことで形成された接着剤プラグの高さhの和に等しく、前記長さlは前記厚さtに等しく、前記キャリアの前記第1の面が前記ドライエッチングプロセスに対するストップ層である、
前記複数の孔を、前記基板に前記複数のバイアを形成するため、導電材料で埋め込む工程、前記導電材料は前記キャリアの前記第1の面まで前記接合層を貫通する、及び
前記複数のバイアを有する前記基板を前記接合層及び前記キャリアから剥離させる工程、前記導電材料は前記ガラス基板の前記第1の面から長さlで延びるピラーを形成する、
を含むことを特徴とする方法。 - 前記ドライエッチングプロセスがO2またはアルゴンを含有するガスの内の少なくとも1つから発生されるプラズマに前記接合層をさらす工程を含むことを特徴とする請求項9に記載の方法。
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