JP2017532701A - インターフェース回路、状態切替え方法及び装置 - Google Patents
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Abstract
Description
PMICの第1身元ピンID1(Identity、身元)はICの第2身元ピンID2に接続され、ICの第1構成チャネルピンCC1(Configuration Channel、構成チャネル)はUSBインターフェースにおける第2構成チャネルピンCC2に接続され、
USBコントローラにおけるデータピンはICによってUSBインターフェースにおけるデータピンに接続され、
マスターからスレーブへの切替え状態において、ICは、第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をハイレベルにし、第1構成チャネルピンCC1をローレベルにするという状態であり、
スレーブからマスターへの切替え状態において、ICは、第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をローレベルにし、第1構成チャネルピンCC1をハイレベルにするという状態であり、
非切替え状態において、ICは、第2身元ピンID2と第1構成チャネルピンCC1を導通させるという状態である。
マスターからスレーブへの切替え状態又はスレーブからマスターへの切替え状態において、ICは、第2電圧バスピンVBus2と第3電圧バスピンVBus3をオフにするという状態であり、
非切替え状態において、ICは、第2電圧バスピンVBus2と第3電圧バスピンVBus3を導通させるという状態である。
USBコントローラの第1データマイナスピンD1−(Data−)はICの第2データマイナスピンD2−に接続され、ICの第3データマイナスピンD3−はUSBインターフェースの第4データマイナスピンD4−に接続され、
マスターからスレーブへの切替え状態又はスレーブからマスターへの切替え状態において、ICは、第2データプラスピンD2+と第3データプラスピンD3+をオフにし、第2データマイナスピンD2−と第3データマイナスピンD3−をオフにするという状態であり、
非切替え状態において、ICは、第2データプラスピンD2+と第3データプラスピンD3+を導通させ、且つ第2データマイナスピンD2−と第3データマイナスピンD3−を導通させるという状態である。
状態切替え信号を受信することと、
状態切替え信号によりインターフェース回路がマスターからスレーブへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をハイレベルにし、第1構成チャネルピンCC1をローレベルにすることと、
状態切替え信号によりインターフェース回路がスレーブからマスターへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をローレベルにし、第1構成チャネルピンCC1をハイレベルにすることと、
状態切替え信号に基づいて切替えを完成させた後に、ICによって第2身元ピンID2と第1構成チャネルピンCC1を導通させることと、を含む。
状態切替え信号を受信した後に、ICによって第2電圧バスピンVBus2と第3電圧バスピンVBus3をオフにすることを含む。
インターフェース回路が非切替え状態である場合、ICによって第2電圧バスピンVBus2と第3電圧バスピンVBus3を導通させることを含む。
状態切替え信号を受信した後に、ICによって第2データプラスピンD2+と第3データプラスピンD3+をオフにし、第2データマイナスピンD2−と第3データマイナスピンD3−をオフにすることを含む。
インターフェース回路が非切替え状態である場合、ICによって第2データプラスピンD2+と第3データプラスピンD3+を導通させ、第2データマイナスピンD2−と第3データマイナスピンD3−を導通させることを含む。
状態切替え信号によりインターフェース回路がマスターからスレーブへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をハイレベルにし、第1構成チャネルピンCC1をローレベルにするように配置され、
さらに、状態切替え信号によりインターフェース回路がスレーブからマスターへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をローレベルにし、第1構成チャネルピンCC1をハイレベルにするように配置され、
さらに、状態切替え信号に基づいて切替えを完成させた後に、ICによって第2身元ピンID2と第1構成チャネルピンCC1を導通させるように配置された、
第1態様に記載のインターフェース回路と、
状態切替えリクエストを受信し、状態切替えリクエストに基づいて、制御ピンによってインターフェース回路におけるICに状態切替え信号を送信するように配置された、インターフェース回路におけるICの制御ピンに接続されるプロセッサと、
プロセッサにより実行可能なコマンドを記憶するメモリと、を含む。
状態切替えリクエストを受信することと、状態切替えリクエストに基づいて、制御ピンによってインターフェース回路におけるICに状態切替え信号を送信することと、を実行することができ、
インターフェース回路は、状態切替え信号によりインターフェース回路がマスターからスレーブへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をハイレベルにし、第1構成チャネルピンCC1をローレベルにするように配置され、
インターフェース回路は、さらに、状態切替え信号によりインターフェース回路がスレーブからマスターへの切替え状態であることを示す場合、ICによって第2身元ピンID2と第1構成チャネルピンCC1をオフにし、第2身元ピンID2をローレベルにし、第1構成チャネルピンCC1をハイレベルにするように配置され、
インターフェース回路は、さらに、状態切替え信号に基づいて切替えを完成させた後、ICによって第2身元ピンID2と第1構成チャネルピンCC1を導通させるように配置される。
Claims (11)
- インターフェース回路であって、前記インターフェース回路は、集積電源管理回路PMICと、ユニバーサルシリアルバスコントローラであるUSBコントローラと、集積回路ICと、USBインターフェースと、を含み、
前記PMICの第1身元ピンID1は前記ICの第2身元ピンID2に接続され、
前記ICの第1構成チャネルピンCC1は前記USBインターフェースにおける第2構成チャネルピンCC2に接続され、
前記USBコントローラにおけるデータピンは前記ICによって前記USBインターフェースにおけるデータピンに接続され、
マスターからスレーブへの切替え状態において、前記ICは、前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をハイレベルにし、前記第1構成チャネルピンCC1をローレベルにするという状態であり、
スレーブからマスターへの切替え状態において、前記ICは、前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をローレベルにし、前記第1構成チャネルピンCC1をハイレベルにするという状態であり、
非切替え状態において、前記ICは、前記第2身元ピンID2と前記第1構成チャネルピンCC1を導通させるという状態である、ことを特徴とするインターフェース回路。 - 前記PMICの第1電圧バスピンVBus1は前記ICの第2電圧バスピンVBus2に接続され、前記ICの第3電圧バスピンVBus3は前記USBインターフェースの第4電圧バスピンVBus4に接続され、
前記マスターからスレーブへの切替え状態又は前記スレーブからマスターへの切替え状態において、前記ICは、前記第2電圧バスピンVBus2と前記第3電圧バスピンVBus3をオフにするという状態であり、
前記非切替え状態において、前記ICは、前記第2電圧バスピンVBus2と前記第3電圧バスピンVBus3を導通させるという状態である、ことを特徴とする請求項1に記載のインターフェース回路。 - 前記USBコントローラの第1データプラスピンD1+は前記ICの第2データプラスピンD2+に接続され、前記ICの第3データプラスピンD3+は前記USBインターフェースの第4データプラスピンD4+に接続され、
前記USBコントローラの第1データマイナスピンD1−は前記ICの第2データマイナスピンD2−に接続され、前記ICの第3データマイナスピンD3−は前記USBインターフェースの第4データマイナスピンD4−に接続され、
前記マスターからスレーブへの切替え状態又は前記スレーブからマスターへの切替え状態において、前記ICは、前記第2データプラスピンD2+と前記第3データプラスピンD3+をオフにし、前記第2データマイナスピンD2−と前記第3データマイナスピンD3−をオフにするという状態であり、
前記非切替え状態において、前記ICは、前記第2データプラスピンD2+と前記第3データプラスピンD3+を導通させ、前記第2データマイナスピンD2−と前記第3データマイナスピンD3−を導通させるという状態である、ことを特徴とする請求項1又は2に記載のインターフェース回路。 - 前記ICは、さらに、前記ICが前記マスターからスレーブへの切替え状態であるか又は前記スレーブからマスターへの切替え状態であるかを示すための状態切替え信号を受信する制御ピンを含むことを特徴とする請求項1〜3のいずれに記載のインターフェース回路。
- 端末であって、前記端末には請求項1〜4のいずれに記載のインターフェース回路が取り付けられることを特徴とする端末。
- 請求項1〜4のいずれに記載のインターフェース回路に用いられる状態切替え方法であって、前記方法は、
状態切替え信号を受信することと、
前記状態切替え信号により前記インターフェース回路が前記マスターからスレーブへの切替え状態であることを示す場合、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をハイレベルにし、前記第1構成チャネルピンCC1をローレベルにすることと、
前記状態切替え信号により前記インターフェース回路が前記スレーブからマスターへの切替え状態であることを示す場合、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をローレベルにし、前記第1構成チャネルピンCC1をハイレベルにすることと、
前記状態切替え信号に基づいて切替えを完成させた後に、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1を導通させることと、を含むことを特徴とする状態切替え方法。 - 前記インターフェース回路は請求項2に記載のインターフェース回路であり、前記方法は、さらに、
前記状態切替え信号を受信した後に、前記ICによって前記第2電圧バスピンVBus2と前記第3電圧バスピンVBus3をオフにすることを含むことを特徴とする請求項6に記載の方法。 - 前記方法は、さらに、
前記インターフェース回路が前記非切替え状態である場合、前記ICによって前記第2電圧バスピンVBus2と前記第3電圧バスピンVBus3を導通させることを含むことを特徴とする請求項7に記載の方法。 - 前記インターフェース回路は請求項3に記載のインターフェース回路であり、前記方法は、さらに、
前記状態切替え信号を受信した後に、前記ICによって前記第2データプラスピンD2+と前記第3データプラスピンD3+をオフにし、前記第2データマイナスピンD2−と前記第3データマイナスピンD3−をオフにすることを含むことを特徴とする請求項6に記載の方法。 - 前記方法は、さらに、
前記インターフェース回路が前記非切替え状態である場合、前記ICによって前記第2データプラスピンD2+と前記第3データプラスピンD3+を導通させ、且つ前記第2データマイナスピンD2−と前記第3データマイナスピンD3−を導通させることを含むことを特徴とする請求項9に記載の方法。 - 状態切替え装置であって、前記装置は、
前記状態切替え信号により前記インターフェース回路がマスターからスレーブへの切替え状態であることを示す場合、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をハイレベルにし、前記第1構成チャネルピンCC1をローレベルにするように配置され、
さらに、前記状態切替え信号により前記インターフェース回路が前記スレーブからマスターへの切替え状態であることを示す場合、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1をオフにし、前記第2身元ピンID2をローレベルにし、前記第1構成チャネルピンCC1をハイレベルにするように配置され、
さらに、前記状態切替え信号に基づいて切替えを完成させた後に、前記ICによって前記第2身元ピンID2と前記第1構成チャネルピンCC1を導通させるように配置された、
請求項4に記載のインターフェース回路と、
状態切替えリクエストを受信し、前記状態切替えリクエストに基づいて、前記制御ピンによって前記インターフェース回路における前記ICに状態切替え信号を送信するように配置された、前記インターフェース回路における前記ICの制御ピンに接続されるプロセッサと、
前記プロセッサの実行可能なコマンドを記憶するメモリと、を含むことを特徴とする状態切替え装置。
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