JP4260480B2 - 光学装置を製造する方法及び関係する改良 - Google Patents

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Description

本発明は光学装置を製造する方法に関し、特に、限定するものではないが、集積光学装置又は光電子装置、例えば、レーザダイオード、光変調器、光増幅器、光スイッチ及び似たもののような半導体光電子装置を製造する方法に関する。本発明は光電子集積回路(OEIC)及び装置を含む光子集積回路に更に関する。
量子井戸混合(QWI)は、一体構造の光電子集積への可能な経路を与えることとして報告されたプロセスである。QWIは、例えばガリウム-砒素(GaAs)又はインジウム-燐(InP)から成る2成分の基板上に成長する、例えばアリミニウム-ガリウム-砒素(AlGaAs)及びインジウム-ガリウム-砒素-燐(InGaAsP)などのIII―V族の半導体材料で実施される。QWIは、構成要素の合金を作るために、1つの量子井戸(QW)の複数成分の相互拡散を介しての成長したままの構造の禁制帯幅(バンド・ギャップ)及び関連する障壁を改める。その合金は、成長したままのQWの禁制帯幅よりも大きい禁制帯幅を有する。それ故、量子井戸混合(QWI)が起こらない量子井戸(QW)内で生成される如何なる光放射(光)も、1つのQWI又は光放射に対し効果的に透明である合金の“混合”領域を通過する。
さまざまなQWI技術が文献において報告されている。例えば、QWIは、1つの量子井戸(QW)を含む半導体材料内での亜鉛のような成分の高温拡散によって実施され得る。
また、QWIは、QW半導体材料内でのシリコンなどの成分の打ち込みによって実施され得る。そのような技術では、打ち込み成分は、高温アニール工程によってQW構造において混合を引き起こす半導体材料を介して動かされる点欠陥を、半導体材料の構造内にもたらす。
そのようなQWI技術は、以下の文献:“低損失光導波路及び集積導波路装置の製造における中性の不純物乱雑化の適用”(“Applications of Neutral Impurity Disordering in Fabricating Low−Loss Optical Waveguides and Integrated Waveguide Devices”)、マーシュなど、光及び量子エレクトロニクス23、1991年、941−957頁、に報告され、それの内容はここに参照によって組み入れられる。
そのような技術に以下の問題がある。つまり、QWIは半導体材料の成長後の禁制帯幅を改める(増加させる)けれども、残留拡散物又は打ち込みドープ剤は、ドープ剤成分の自由キャリア吸収効率により大きな損失をもたらし得る。
更に報告された混合を与えるQWI技術は、不純物無し空隙拡散(IFVD)である。IFVDを実施した場合、III―V族の半導体構造の上部キャップ層は、典型的にはガリウム-砒素(GaAs)又はインジウム−ガリウム−砒素(InGaAs)である。シリコン(SiO)膜が、その上部層上に堆積される。半導体材料の引き続く急速熱アニールは、キャップ層内に空隙を残すように、半導体合金及びシリカ(SiO)の影響を受けやすいガリウムのイオン又は原子内で結合を破壊し、シリカに分解することを引き起こす。その後、空隙は、例えばQW構造内で、層混合を引き起こす半導体材料を介して拡散する。
IFVDは、以下の文献:“GaAs-AlGaAs量子閉じ込めヘテロ構造での組成相互混合の動力学のための量に関するモデル”(“Quantitative Model for the Kinetics of Compositional Intermixing in GaAs-AlGaAs Quantum−Confined Heterostructures”)、ヘルミーなどによる、量子エレクトロニクスでの選択されたトピックのIEEEジャーナル、第4巻、第4、1998年の7,8月、653−660頁、に報告され、それの内容はここに参照によって組み入れられる。
報告されたQWI及び特にIFVDは、多くの不利益、例えばガリウムが半導体材料からシリカ(SiO2)膜へ拡散して出て行く温度に悩まされる。
前述の従来技術の不利益又は問題の少なくとも1つを除去するか又は少なくとも軽減することが、本発明の少なくとも1つの側面の目的である。
また、改良されたQWIプロセスを用いた光学装置を製造する改良された方法を与えることが本発明の少なくとも1つの側面の目的である。
本発明の第1の側面によれば、量子井戸(QW)構造を含んで装置本体部から作られるべきである光学装置を製造する方法において、装置本体部の表面の少なくとも一部に誘電体層を、該誘電体層に隣接する装置本体部の一部に少なくとも構造欠陥をもたらすように、堆積する工程を含む方法が与えられる。
更なる側面によれば、本発明は、量子井戸(QW)構造を含んで、III―V族の半導体材料系からなる装置本体部から作られるべきである光学装置を製造する方法において、装置本体部の表面層に隣接する装置本体部の少なくとも一部に構造欠陥をもたらすように、装置本体部の表面の少なくとも一部に、少なくとも300Wの電力で少なくとも0.5分間プラズマ・エッチングを実施する工程と、引き続き誘電体層を堆積してエッチングされた表面が誘電体層で蓋をかぶせられる工程と、前記プラズマ・エッチング及び前記蓋をかぶせる工程の後、前記装置をアニールする工程と、前記装置本体部の表面の少なくとも一部上に前記混合キャップとして働く誘電体層を与えるように、前記装置本体部の表面でフォトレジストでのパターンを定める工程と、前記誘電体層を堆積する前にコーティングされていない前記装置本体部をエッチングする工程と、前記フォトレジストを取り除く工程と、アニールすることに先立って、前記装置本体部の表面上及び予めエッチングされた表面上の前記混合キャップとして働く誘電体層の表面上に、更なる誘電体層を堆積する工程と、を含む方法を与える。
構造欠陥は、点欠陥を含んでもよい。
好ましくは、及び有益に、プラズマ・エッチング及び誘電体層堆積は、スパッタリングにより実施される。
好ましい実施形態では、誘電体層はダイオードスパッタ装置を用いたスパッタリングにより堆積される。
誘電体層は、有益に、かつ実質的に、シリカ(SiO2)からを含み、又はアルミニウム酸化物(Al23)などの他の誘電体材料から構成されてもよい。
好ましくは、スパッタ装置は、好ましくはおよそ2ミクロンの水銀柱の圧力で、アルゴンなどの不活性ガスで、又はアルゴン及び酸素の混合で、例えば90%対10%の比率で、実質的に満たされる室を含む。
誘電体層を堆積する工程は、装置の製造において使用される量子井戸混合(QWI)プロセスの一部であってもよい。
QWIプロセスは、不純物無し空隙乱雑化(IFVD)から成ってもよい。
好ましくは、製造方法は、高い温度で誘電体層を含む装置本体部をアニールする引き続く工程も含む。
驚くように分かったことであるが、IFVDのようなQWI技術で用いられるスパッタリングで誘電体層を堆積する前に、半導体表面をエッチングすることによって、損傷誘起構造欠陥が誘電体キャップに隣接する装置本体部の一部分にもたされることは明らかであり、その一部分は上部の又は“キャップする”層から成る。損傷は、例えば急速熱アニールによる熱エネルギーの適用などのアニールに先立ち、キャップ層での結合の破壊によって生じ、それによって、キャップ層から誘電体層内へのガリウム及び・又はインジウムの転移が促進されると、信じられている。
好ましくは、基板を与え、基板上に第1の光クラッド層、量子井戸(QW)井戸構造を含むコアガイド層及び第2の光クラッド層を成長させるという先立ち工程を含む。
第1の光クラッド層、コアガイド層及び第2の光クラッド層は、分子ビームエピタクシ(MBE)又は金属有機化学気相成長法(MOCVD)によって成長させられてもよい。
第1の実施形態では、装置本体部の表面の少なくとも一部上に誘電体層を与えるように、装置本体部の表面にフォトレジストでのパターンを定め、エッチング及び誘電体層堆積を実行し、フォトレジストを取り除く工程も含んでもよい。
第1の実施形態では、アニールすることに先立って、装置本体部の表面上及び誘電体層の表面上に、更なる誘電体層を、好ましくは、プラズマエッチング段階無しで、スパッタリング以外の技術、例えばプラズマ強化化学気相成長法(PECVD)によって、堆積する工程を含んでもよい。
第2の実施形態では、更なる誘電体層を堆積し、次いで基板エッチングを行い、誘電体層を堆積する工程を含んでもよい。
第1及び第2の実施形態では、以前にエッチングされた層に蓋をかぶせる誘電体層は、混合キャップを含んでいても良く、更なる誘電体層は混合抑制キャップを含んでいてもよい。
プラズマ・エッチングは、典型的には、0.5分間と20分間との間のある期間だけ実施されても良く、蓋をする誘電体層の厚みは、およそ10〜数100nmであってもよい。
アニール工程は、およそ650℃〜850℃の温度でおよそ0.5〜5分間、1つの実施形態では実質的に800℃でおよそ1分間生ずる。
本発明の第2の側面によれば、量子井戸(QW)構造を含んで装置本体部から作られるべきである光学装置を製造する方法において、装置本体部の表面の少なくとも一部上にスパッタリングで誘電体層を堆積する工程を含む方法が与えられる。
本発明の第3の側面によれば、本発明の第1又は第2の側面のいずれかに従った方法から作られる光学装置を与える。
光学装置は、一体的な光学装置又は光電子装置でよい。
装置本体部は、III―V族の半導体材料系で製造されてもよい。
1つの実施形態で、III―V族の半導体材料系は、ガリウム-砒素(GaAs)
に基づいた系であり、それで装置は600〜1300nmの範囲での1つ又はそれを超える数の波長で動作してもよい。その他に、好ましい実施形態では、III―V族の半導体材料系は、インジウム-燐に基づいた系であり、それで装置は1200〜1700nmの範囲での1つ又はそれを超える数の波長で動作してもよい。装置本体部は、少なくとも部分的に、アルミニウム-ガリウム-砒素(AlGaAs)、インジウム-ガリウム-砒素(InGaAs)、インジウム-ガリウム-砒素-燐(InGaAsP)、インジウム-ガリウム-アルミニウム-砒素(InGaAlAs)及び・又はインジウム-ガリウム-アルミニウム-燐(InGaAlP)から作られてもよい。
装置本体部は、上に第1の光クラッド層、コアガイド層及び第2の光クラッド層が与えられる基板を備えてもよい。
好ましくは、量子井戸(QW)構造はコアガイド層内に与えられる。
コアガイド層は、成長により、第1及び第2の光クラッド層よりも、小さな禁制帯幅及び大きな屈折率を有してもよい。
本発明の第4の側面によれば、本発明の第3の側面に従った少なくとも1つの光学装置を含む光学集積回路、光電子集積回路(OEIC)又は光子集積回路(PIC)が与えられる。
本発明の第5の側面によれば、本発明の第1又は第2の側面のいずれかに従った方法で用いられる場合に、装置本体部(例)が与えられる。
本発明の第6の側面によれば、本発明の第1又は第2の側面のいずれかに従った方法で用いられる場合に、少なくとも1つの装置本体部を含むウェハー材料が与えられる。
本発明の第7の側面によれば、本発明の第2の側面のいずれかに従った方法で用いられる場合に、スパッタリング装置が与えられる。
好ましくは、スパッタリング装置はダイオードスパッタ装置である。
本発明の第8の側面によれば、本発明の第1又は第2の側面のいずれかに従った方法でのスパッタリング装置の使用が与えられる。
本発明に係る実施形態が、例示としてのみによって、添付図を参照して今説明される。
図1を最初に参照して、全体的に5で示され、成長したとき、本発明の第1の実施形態に従って光学装置の製造の方法において使用するため、装置本体部が表示される。その光学装置は集積光学装置又は光電子装置である。
装置本体部5は、ガリウム-砒素(GaAs)のようなIII―V族の半導体材料系で適切に製造され、それ故に、600から1300nmの範囲での1つの波長又はそれ以上の波長で動作する。その他に有益に、装置本体部5は、インジウム-燐(InP)半導体系で製造され、それ故に、1200から1700nmの範囲での1つの波長又はそれ以上の波長で動作する。装置本体部5は、少なくとも部分的には、アルミニウム-ガリウム-砒素(AlGaAs)、インジウム-ガリウム-砒素(InGaAs)、インジウム-ガリウム-砒素-燐(InGaAsP)、インジウム-アルミニウム-ガリウム-砒素(InAlGaAs)及び・又はインジウム-ガリウム-アルミニウム-燐(InGaAlP)から作られてもよい。この説明された第1の実施形態では、装置本体部5はAlGaAsから作られる。
装置本体部5は、ウェハー処理後、ウェハーの劈開面に沿ってウェハーから切り出され得る複数の他の光学装置と共に、1つの半導体ウェハーの部分を形作る。装置本体部5は基板10を備え、基板10上に、第1の光クラッド層15、コアガイド層20及び第2の光クラッド層25が与えられる。少なくとも1つの量子井戸を含む量子井戸(QW)構造30が、成長したとき、コアガイド層20内に与えられる。第2の光クラッド層25上にはキャップ層35が与えられる。
認識されるであろうように、コアガイド層20は、成長したとき、第1及び第2の光クラッド層15、25よりも小さな禁制帯幅(バンド・ギャップ)及び大きな屈折率を有する。
図2を参照して、詳細に後述されるであろう方法によって、図1の装置本体部5から製造され、全体的に40で示される、光学装置が表示される。図2から分かるように、装置40は活性領域45と受動領域50とを備える。この実施形態では、活性領域45は1つの量子井戸(QW)増幅部を備える。しかしながら、活性領域45は、他の実施形態では、レーザ、変調器スイッチ、検出器又は能動(電気的に制御される)光学装置を備えてもよいことは理解されるであろう。さらに、受動領域50は、以降非常に詳細に説明されるように、量子井戸構造部30が量子井戸混合(QWI)技術によって少なくとも部分的に除去された低損失導波路を備える。
装置40は、コア層20の活性領域45および受動領域50の導波領域間で優れた整列性を有し、活性領域45と受動領域50との間で実質的に無視できる(約10-6の)反射率を有する。さらに、領域45と受動領域50との間でのモード釣り合いは装置40に本来備わっている。
典型的には、基板10はn型で第1の濃度にドープされ、第1のクラッド層15はn型で第2の濃度にドープされる。さらに、コア層20は典型的には実質的に真性であり、第2のクラッド層25はp型で第3の濃度にドープされる。さらに、キャップ層(又は接触層)35はp型で第4の濃度にドープされる。キャップ層35及び第2のクラッド層25は峰部(図示せず)を作るようにエッチングされることはこの技術に熟練した者たちによって認識されるであろう。峰部は、活性領域45及び受動領域50の両方内であるコア層20内で、光モードを閉じ込めるために、光導波路として働く。さらに、従来技術で知られるように、接触被覆金属(図示せず)が光学上活性領域45内で峰部の上部表面の少なくとも一部上に及び基板10の対抗面上に形成される。
装置40は、1つの又はそれ以上の光装置40から成る光集積回路、光電子集積回路(OEIC)又は光子集積回路(PIC)の一部を構成する。
図3を参照して、成長したときで、装置本体部5のコア層20内での量子井戸構造部30の1つの量子井戸31の禁制帯幅エネルギーの概略図を示す。図3から分かるように、AlGaAsコア層20は、取り囲むコア層20よりも低いアルミニウム含有量を有する量子井戸構造部30と共に少なくとも1つの量子井戸31を含み、量子井戸構造部30の禁制帯幅エネルギーは取り囲むAlGaAsコア層20のそれよりも小さい。量子井戸構造部30は典型的にはおよそ3〜20nm厚みであり、より典型的にはおよそ10nm厚みである。
また、図3の記述は、InGaAsPの、又は前に議論された他のIII―V族系のいずれかのコア層付きの系への適切な修正に適用されることは理解されるであろう。
図4を参照して、コア層20の対応する部分32が示され、コア層20の対応する部分32は、図3におけるように形成されるものの、量子井戸構造部30の量子井戸31に対応する部分32の禁制帯幅エネルギー(meV)を効果的に増加させるように、量子井戸混合(QWI)される。それ故、量子井戸混合(QWI)は、コア層20から量子井戸構造部30を本質的に“えぐり取る”(“ウオッシュ・アウト”)。図4に示される部分は装置40の受動領域50に関係する。理解されるように、装置40の光学上活性領域45から送信される又は内で生成される光放射は受動領域50のコア層20の量子井戸混合(QWI)領域32によって与えられる低損失導波路を通って送信される。
図5(a)〜図5(f)を参照して、本発明に従って量子井戸(QW)構造部30を含む装置本体部5から光学装置40を製造する方法の第1の実施形態が描かれている。この方法は、装置本体部5の表面52の少なくとも一部上に誘電体層51のプラズマ・エッチング及び引き続く堆積を、点欠陥をこの誘電体層51に隣接する装置本体部5の部分53内にもたらすように、実施する工程(図5(b)〜図5(d)参照)を含む。
製造方法は、基板10を与え、該基板10の上で、第1の光クラッド層15と、少なくとも量子井戸(QW)30を含むコアガイド層20と、第2の光クラッド層25と、キャップ層35とを成長させる工程で始まる。
第1の光クラッド層15、コアガイド層20、第2の光クラッド層25及びキャップ層35は、分子ビームエピタクシ(MBE)又は有機金属化学気相成長法(MOCVD)などの知られた半導体エピタキシアル成長技術によって成長させられる。一旦、装置本体5が、通常、複数の装置本体部5を含むウェハー(図示せず)の一部として、成長すると、装置本体部5の表面52上にフォトレジスト(PR)55でもってあるパターンが定められる。
プラズマ・エッチングが、表面52上への誘電体層51の堆積の前に、表面52上で実施され、装置本体部5の表面52の少なくとも一部上に誘電体層51を残すように、フォトレジスト55は取り外される。図5(c)及び図5(d)から分かるように、装置本体部5の表面52の少なくとも一部上での実施されるプラズマ・エッチング及び・又は堆積される誘電体層51はキャップ層35の領域53に局所的な損傷を引き起こし、点欠陥をキャップ層35にもたらす。
図6を簡潔に参照して、プラズマ・エッチング及び誘電体層51の堆積はスパッタリングによって成し遂げられ、本実施形態では、エッチング及び誘電体層51の堆積は、全体的に65で示されるダイオード・スパッタリング装置を用いたスパッタリングによって実施される。誘電体層51は実質的にシリカ(SiO2)から成るが、変更では、アルミニウム酸化物(Al23)のような他の誘電体材料から成ってもよい。
図6から分かるように、スパッタリング装置65は使用中にアルゴンのような不活性ガスで実質的に満たされる室(チャンバー)70を含み、好ましくは、アルゴンガスは水銀柱でおよそ2μmの圧力で、室70内に与えられる。また、スパッタリング装置65は、誘電体層の堆積のためのダイオード・スパッタリング装置65の(イ)標的電極(陰極(カソード))80又は装置本体部のプラズマ・エッチングのための(ロ)基板電極85に接続され得るRF源75を備える。
シリカ標的81が標的電極(陰極)80に与えられ、(ウェハー82上の)は装置本体部5はスパッタリング装置65の基板電極(陽極(アノード))85に与えられる。使用中、図6から分かるように、アルゴンプラズマ86が、第1及び第2の暗黒空間部(ダーク・スペース)90及び95がある陰極80と陽極85との間に生成され、第1及び第2の暗黒空間部90及び95はシリカ標的81とアルゴンプラズマ86との間及びアルゴンプラズマ86と装置本体部5との間に与えられる。
半導体表面でのプラズマ・エッチング及び誘電体層51の堆積は装置40の製造において使用される量子井戸混合(QWI)プロセスの一部を構成し、QWIプロセスは(好ましい実施形態では)不純物無し空隙乱雑化(IFVD)技術から成る。驚くように分かったことであるが、スパッタリング装置65を用いるエッチングによるIFVDのようなQWI技術で用いられる半導体表面でのプラズマ・エッチング及び引き続く誘電体層51の堆積によって、損傷誘起欠陥が誘電体キャップ51に隣接する装置本体部5の一部53にもたされることは明らかであり、この場合での部分53はキャップ層35の一部から成る。例えば、急速熱アニールによる熱エネルギーの適用などのような(以下に述べられる)アニールに先立ち、損傷によってキャップ層35内の結合が破壊され、それによって、キャップ層35から誘電体層51内へのガリウム及び・又はインジウムの転移が促進されると、信じられている。
誘電体層51は、典型的には、10と1000nmとの間の厚みであり、典型的には200又は300nmの厚みである。製造方法は、図5(e)に示されるように、アニールに先立ち、装置本体部5の表面52上及び誘電体層51の表面上に更なる誘電体層60を堆積する更なる工程を含む。更なる誘電体層60は、予備的プラズマ・エッチング無しで、好ましくはダイオード・スパッタリング以外の技術で、好ましくはプラズマ強化(エンハンスト)化学気相成長法(PECVD)のようなスパッタリング自体以外の技術で、堆積される。
それ故、プラズマ・エッチングを受けた層を内部封じ込める誘電体層51は混合キャップ層を有し、それに反して、更なる誘電体層60は混合抑制キャップ層を含む。混合抑制キャップ層は表面52を砒素及び・又は燐の脱離から守るために用いられる。方法は混合抑制キャップ層無しで具合良くいくものの、表面52の質はそれほど良くならない。
図5(f)に示されるように、更なる誘電体層60の堆積に引き続き、誘電体層51及び、更なる誘電体層60を含む装置本体部は高められた温度でアニールされる。アニール段階は急速熱アニール段階から成り、アニール温度はおよそ700℃〜1000℃であり、より好ましくは、およそ0.5〜5分間で650℃〜850℃であり、1つの実行では、ほぼ1分間で約800℃でアニールされる。
図5(f)のアニール工程の動きは、図7(a)及び図7(b)に図解で描かれている。図7(a)及び図7(b)から分かるように、アニール工程はガリウム及び・又はインジウムのキャップ層35から混合キャップ、例えば、誘電体層51への“拡散追い出し(アウト・ディフュージョン)”を引き起こす。しかしながら、例えば更なる誘電体層60である抑圧キャップ下方のキャップ層35の複数部分はガリウム及び・又はインジウムの“拡散追い出し”を被らない。混合キャップ、例えば、誘電体層51の領域内に横たわるキャップ層35の複数部分は、図7(b)に示すように、ガリウム及び・又はインジウムの“拡散追い出し”を被る。ガリウム及び・又はインジウムの“拡散追い出し”により、空隙が後に残り、空隙はキャップ層35から第2のクラッド層25を介してコア層20内に、それ故に、量子井戸構造30へ転移し、それによって、量子井戸構造30の実効禁制帯幅が変わり、混合キャップ層下方の量子井戸構造30の量子井戸は効果的にえぐり取られる。
例えばプラズマ・エッチングされた表面52を内部封じ込める誘電体層51である混合キャップは受動領域50の領域内に与えられて装置40内に形成され、一方、例えば更なる誘電体層60である抑制キャップは装置本体部5上であって光学上活性領域45のようなエリアに与えられて装置5上に形成され、エリアは量子井戸混合(QWI)になっていないことは理解されるであろう。
一旦、装置本体部5が図5(f)の段階へ処理されアニールされると、誘電体層51及び更なる誘電体層60は従来の方法、例えば湿式又は乾式エッチングによって取り除かれる。
インジウム-燐(InP)基板上に成長するインジウム-アルミニウム-ガリウム-砒素(InAlGaAs)又はインジウム-ガリウム-砒素-燐(InGaAsP)のような長波長アルミニウム合金において本発明に従って光電子装置を製造する方法においてIFVDを用いて得られる典型的な禁制帯幅の変化を例証する実施例が続く。
誘電体層51の堆積では、約50〜100mmの標的-基板電極(板)分離付きで形作られるスパッタリング室(チャンバー)70を必要とする。標的電極80及び基板電極85はそれぞれ実質的に8インチの円板のように形作られる。スパッタリングによるエッチング及び堆積ために、この実施例で用いられる気体は典型的にはアルゴンであるが、他の適切な不活性ガスを用いても良く、また、堆積された誘電体層51の化学量論を改善するために、少量の酸素を、例えば体積で約10%だけ、アルゴン・プラズマ86に加えてもよい。この方法で用いられる誘電体材料は典型的にはシリカ(SiO2)であるが、アルミニウム酸化物(Al23)のような他の誘電体材料が用いられてもよい。
この方法に対する室70での好ましい圧力範囲は水銀柱で1μmと5μmとの間であることは分かっている。以下の表1に示されるスパッタリングによるエッチングのRFパワー値に対し、一分間のスパッタリングによるエッチングが、少なくとも1つの装置本体部5を含む半導体ウェハーの表面52上で実行される。引き続いて堆積される誘電体膜45の厚みは10nmから数100nmまでである。表1での禁制帯幅の変化の数字は、1分間における800℃の温度でのアニールに対し、InGaAs-InAlGaAsのQW構造30における禁制帯幅の変化を説明する。
表1では、スパッタリングされたシリカでの内部封じ込めによって追いうちをかけられる半導体52の表面のエッチングは、スパッタリングされないシリカ(SiO2)と比較して、混合での増進を与えることが示され、また、予めエッチングされスパッタリングされたシリカ(SiO2)キャップの効果はスパッタリング・エッチングの間に使用されるRFパワーと共に増加することが示される。
さらに、スパッタリングされたSiO2層51の堆積によって追いうちをかけられるInGaAs-InGaAsPのQW構造の表面53へのプラズマ・エッチングからのデータが表2で提出される。2つのスパッタリング・エッチングのパワー値が、2つのスパッタリング圧力の設定値と共に、表2に示され、それぞれは、少なくとも1つの装置本体部5を含む半導体表面52の1分間のスパッタリング・エッチングに当てはまる。引き続いて堆積される誘電体膜51の厚みは10nmから数100nmまでである。表2での禁制帯幅の変化の数字は、1分間における700℃の温度でのアニールに対し、InGaAs-InGaAsPのQW構造30における禁制帯幅の変化を説明する。
再度、表2では、スパッタリングされたシリカ51での内部封じ込めによって追いうちをかけられる半導体の表面52のエッチングは、スパッタリングされないシリカ(SiO2)と比較して、混合での増進を与えることが示され、また、予めエッチングされスパッタリングされたシリカ(SiO2)キャップ51の効果は、低い圧力のエッチングに対しては圧力に強く依存しないが、高い圧力のエッチングに対しては圧力に依存し、効果はスパッタリング圧力の増加につれて減少する。また、表2では、InGaAs-InAlGaAsのQW材料と比較して、InGaAs-InGaAsPのQW材料の熱安定性は、与えられたスパッタリング・エッチング・パワーに対し、減少されたアニール温度でより大きな変化が得られるにつれて、低下することが示される。
本発明に従って光学装置40を製造する方法の第2の実施形態では、1つの禁制帯幅より多くを作るためにウェハーを処理するため、PECVDのSiO2の薄膜がウェハー上に堆積され、更なる誘電体層60が与えられる。次いで、写真製版(フォト・リソグラフィー)技術が、PECVDのSiO2の上部にパターンを描写するために、用いられる。次いで、湿式又は乾式エッチングがPECVD(SiO2)にパターンを移すために用いられる。
次いで、パターン化されたフォトレジスト(PR)がパターン化されたPECVD(SiO2)の上に残され、次いで、サンプル/ウェハーが、コーティングされていない表面52のプラズマ・エッチング及び誘電体層51の引き続く堆積のためのスパッタリング装置65内に置かれる。堆積後、サンプルはアセトンに浸けられ、フォトレジスト上のスパッタリングされたSiO2は“リフトオフ”プロセスにおいてはく離(リフトオフ)される。
急速熱アニールが要求される時間(0.5〜5分間)だけ適切な温度(650〜850℃)で実施される。これにより、点欠陥が表面52に生成されることが可能になり、点欠陥は装置本体部5を通って伝播し、複数成分の相互拡散を引き起こす。
前述された本発明の実施形態が例示のみによって与えられ、どのようであろうが本発明の範囲を制限することを意味しないことは、認識されるであろう。
スパッタリングされた誘電体層51に隣接する半導体装置本体部5に誘起される損傷が、2次電子及び軟X線の形態でのイオン及び・又は放射の衝突から生ずることは信じられることであると特に理解されるべきである。半導体装置本体部5又はウェハー82の表面50への損傷はスパッタリング装置65でのさまざまな手段によってもたらされ得る。効果的な方法は堆積室70内でダイオード構成を用いることである。
また、より一般的なマグネトロン機械では複数の磁石が高い局所場を作り出し、その局所場は誘電体標的81から半導体材料のウェハー82上に与えられる装置本体部5への粒子の運動を止めると信じられているが、そのマグネトロン機械配置におけるよりも、ダイオード構成の使用により、装置本体部5(又は“サンプル”)に更に放射損傷を生じさせることができると信じられる。
本発明に従った光学装置は、リッジ又は埋め込まれたヘテロ構造などの導波路又は他の適切な導波路を含んでもよいことは更に認識されるであろう。
また、量子井戸混合(QWI)領域は光学上能動装置から構成されてもよいことは認識されるであろう。
さらに、いくつかのRFパワー値を用いることを含む一連の処理がいくつかの異なったQWI禁制帯幅付きの装置を与えるために用いられてもよいことは認識できるであろう。
本発明の一実施例に係る光学装置の製造方法で使用のための、成長したときの装置本体部の側面図である。 図1の装置本体部から製造される本発明の一実施例に係る光学装置の側面図である。 図1の装置本体部の一部の禁制帯幅のエネルギーの概略図であり、その一部は量子井戸を含むコア層を備える。 量子井戸が混合されたときの、図2の光学装置の対応する一部分の禁制帯幅のエネルギーの図3に似た概略図である。 図5(a)〜図5(f)は、図2の光学装置の製造方法のさまざまな工程の間での装置本体部の一連の概略側面図である。 図5(c)に示される誘電体層堆積工程の間、図5(a)〜図5(f)の装置本体部分上への誘電体層の堆積で使用するためのダイオードスパッタリング装置の概略描写である。 図7(a)及び図7(b)は、図5(f)に示されるアニール工程の前後、図5(a)〜図5(f)の装置本体部分のより詳細な概略側面図である。

Claims (18)

  1. 量子井戸混合(QWI)構造を含んで、III―V族の半導体材料系からなる装置本体部から作られる光学装置を製造する方法であって
    前記装置本体部の表面の少なくとも一部上に混合キャップとして働く誘電体層を与えるように、前記装置本体部の表面でフォトレジストでのパターンを定める工程と、
    前記誘電体層を堆積する前に、コーティングされていない前記装置本体部の少なくとも一部に構造欠陥をもたらすように、前記装置本体部の表面の少なくとも一部に、少なくとも300Wの電力で少なくとも0.5分間プラズマ・エッチングを実施する工程と、
    引き続き誘電体層を堆積して、エッチングされた表面に前記混合キャップとして働く誘電体層で蓋をかぶせる工程と、
    前記フォトレジストを取り除く工程と、
    アニールすることに先立って、前記装置本体部の表面上及び予めエッチングされた表面上の前記混合キャップとして働く誘電体層の表面上に、更なる誘電体層であって、前記エッチングされ蓋をかぶせられた層以外の装置の領域内に堆積された前記更なる誘電体層が混合抑制キャップとして働く前記更なる誘電体層をスパッタリング以外の技術によって堆積する工程と、
    前記プラズマ・エッチング及び前記蓋をかぶせる工程の後、前記装置をアニールする工程と、を有する。
  2. 前記プラズマ・エッチングは、前記装置本体部の表面に局所的な損傷を引き起こし、前記構造欠陥を前記装置本体の表面にもたらすように実施されることを特徴とする請求項1に記載の方法。
  3. 前記プラズマ・エッチングは、前記アニール工程において、前記装置本体部内でバンドギャップ・シフトが促進されるように実施されることを特徴とする請求項1又は2に記載の方法。
  4. 前記構造欠陥は実質的に点欠陥を有することを特徴とする請求項1〜3のいずれか一項に記載の方法。
  5. 前記プラズマ・エッチングは、スパッタリングにより実施されることを特徴とする請求項1〜請求項4のいずれか一項に記載の方法。
  6. 前記誘電体層は、スパッタリングにより堆積されることを特徴とする請求項1〜請求項5のいずれか一項に記載の方法。
  7. 前記アニールする工程は、急速熱アニールすることを有することを特徴とする請求項1〜請求項6のいずれか一項に記載の方法。
  8. 前記アニールする工程は、0.5分と5分との間の期間650℃と850℃との間の温度を用いることを特徴とする請求項1〜請求項7のいずれか一項に記載の方法。
  9. 前記誘電体層は、シリカ(SiO)及びアルミニウム酸化物(Al)から選ばれることを特徴とする請求項1〜8のいずれか一項に記載の方法。
  10. 前記スパッタリングする工程は、不活性ガスで実質的に満たされる室で実行されることを特徴とする請求項5又は6に記載の方法。
  11. 前記スパッタリングする工程は、アルゴン及び酸素の混合で実質的に満たされる室で実行されることを特徴とする請求項5又は6に記載の方法。
  12. 前記プラズマ・エッチングする工程及び前記誘電体層を堆積する工程は、前記装置の製造において使用される量子井戸混合(QWI)プロセスの一部であることを特徴とする請求項1〜11のいずれか一項に記載の方法。
  13. 前記QWIプロセスは、不純物無し空隙乱雑化(IFVD)することを含むことを特徴とする請求項12に記載の方法。
  14. 基板を用意する工程と、
    前記基板上に
    第1の光クラッド層と、
    量子井戸混合(QWI)井戸構造を含むコアガイド層と、
    第2の光クラッド層と、を成長させる工程と、
    を含む前工程を有することを特徴とする請求項1〜13のいずれか一項に記載の方法。
  15. 前記第1の光クラッド層、前記コアガイド層及び前記第2の光クラッド層は、分子ビームエピタクシ(MBE)及び金属有機化学気相成長法(MOCVD)から選ばれる成長技術によって成長させられることを特徴とする請求項14に記載の方法。
  16. 前記スパッタリング以外の技術は、プラズマ強化化学気相成長法(PECVD)であることを特徴とする請求項1〜15のいずれか一項に記載の方法。
  17. 前記プラズマ・エッチング段階の期間は、0.5分間と20分間との間であることを特徴とする請求項1〜16のいずれか一項に記載の方法。
  18. 前記混合キャップとして働く誘電体層の厚みは、10〜1000nmであることを特徴とする請求項1〜17のいずれか一項に記載の方法。
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