JP5018024B2 - 電子部品の実装方法、電子基板、及び電子機器 - Google Patents
電子部品の実装方法、電子基板、及び電子機器 Download PDFInfo
- Publication number
- JP5018024B2 JP5018024B2 JP2006302483A JP2006302483A JP5018024B2 JP 5018024 B2 JP5018024 B2 JP 5018024B2 JP 2006302483 A JP2006302483 A JP 2006302483A JP 2006302483 A JP2006302483 A JP 2006302483A JP 5018024 B2 JP5018024 B2 JP 5018024B2
- Authority
- JP
- Japan
- Prior art keywords
- substrate
- forming
- terminal
- electronic component
- insulating material
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/01—Manufacture or treatment
- H10W70/05—Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
- H10W70/093—Connecting or disconnecting other interconnections thereto or therefrom, e.g. connecting bond wires or bumps
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/099—Connecting interconnections to insulating or insulated package substrates, interposers or redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/62—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
- H10W70/65—Shapes or dispositions of interconnections
- H10W70/652—Cross-sectional shapes
- H10W70/6523—Cross-sectional shapes for connecting to pads at different heights at the same side of the package substrate, interposer or RDL
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
- H10W70/62—Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
- H10W70/65—Shapes or dispositions of interconnections
- H10W70/654—Top-view layouts
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/071—Connecting or disconnecting
- H10W72/073—Connecting or disconnecting of die-attach connectors
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/851—Dispositions of multiple connectors or interconnections
- H10W72/874—On different surfaces
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
- H10W72/932—Plan-view shape, i.e. in top view
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/731—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
- H10W90/734—Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked insulating package substrate, interposer or RDL
Landscapes
- Electric Connection Of Electric Components To Printed Circuits (AREA)
- Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
- Manufacturing Of Printed Wiring (AREA)
Description
この実装方法によれば、電子部品の側方に絶縁層の積層膜を形成することで、電子部品の端子形成面と基板との段差を緩和することができ、前記積層膜の斜面上に液滴吐出法を用いて配線を形成することができる。絶縁層を電子部品の側方にのみ形成するので、液滴吐出法による絶縁膜形成を部分的に行えばよく、電子部品と基板面との間に大きな段差がある場合にも極めて効率よく電子部品の実装を行うことができる。
またこの方法では、ワイヤボンディングのように配線を引き回す空間が必要ないことから、薄型の電子基板を簡便な工程で得ることができる。
この実装方法によれば、溝部により配線形成領域が規定されるので、配線を正確かつ安定に形成できるようになる。またかかる方法によれば、絶縁層の形状を利用して溝部を形成するので、レーザ光照射等の溝部形成のための工程が不要になり、電子基板の製造コストや製造効率の点で有利な実装方法となる。
この電子基板によれば、電子部品と基板との段差を緩和する積層膜の斜面上に配線を形成しているので、ワイヤボンディングのように配線を引き回す空間を設ける必要が無く、薄型の電子基板を実現できる。
図1(a)は、本発明に係る電子部品の実装方法を用いて製造できる電子部品実装体である電子基板の平面構成図であり、図1(b)は、(a)に示すA−A’線に沿う断面構成図である。
次に、本発明に係る電子デバイスの実装方法について説明する。
図2(a)〜(e)は、上記実施形態の電子基板100におけるICチップ(電子部品)10の実装工程を説明する図であって、図1(b)に相当する断面構成図である。
以下、図面を参照して実装方法の各工程について詳細に説明する。
まず、図2(a)に示すように、所定の基板側端子22等が形成された回路基板20上に、接着層29を介してICチップ10を載置する。ICチップ10の基板上への載置は、真空チャック等によりICチップ10を吸着支持して搬送し、回路基板20上の実装位置に配置する方法が採用できる。ICチップ10の裏面又は回路基板20上に、図2(a)に示す接着層29を形成するための接着剤を塗布した状態でICチップ10が回路基板20上に載置される。接着層29には、先に記載のように、DAFや樹脂製接着剤を用いることができる。接着層29を介して回路基板20にICチップ10を接着させた後でも、樹脂製接着剤を未硬化状態としておけば、ICチップ10の位置調整を容易に行うことができる。またこの場合において、ICチップ10の載置後にも真空チャックでICチップ10を保持しておき、真空チャックの水平移動によりICチップ10の位置調整を行ってもよい。
上記絶縁材料としては、ポリイミド樹脂、シリコーン変性ポリイミド樹脂、エポキシ樹脂、シリコーン変性エポキシ樹脂、ベンゾシクロブテン(BCB;benzocyclobutene)、ポリベンゾオキサゾール(PBO;polybenzoxazole)等の樹脂材料を用いてもよい。
次に、図2(c)に示すように、絶縁層30a上に、絶縁層30aよりも幅の狭い枠状に絶縁材料を配置し、これに紫外線等の光を照射することで、半硬化状態の絶縁材料からなる絶縁層30bを形成する。
そして、図2(d)に示すように、積層された絶縁層30a〜30dがICチップ10の高さに達するまで絶縁材料の塗布と光照射とを繰り返し、ICチップ10を取り囲む概略階段状のスロープ材30を形成する。スロープ材30の一部はICチップ10のパッシべーション膜16に乗り上げていてもよい。
ただし、接続配線34を絶縁層中に封止した構成の電子基板を製造する場合には、かかる乾燥処理において加熱を行わず、接続配線34上にさらに被覆絶縁層を形成した後に加熱を行うこととするのが好ましい。接続配線34上の被覆絶縁層とともに硬化させることで、接続配線34を取り囲む絶縁層内に応力が残留するのを防止でき、また封止状態をより良好なものとすることができるからである。
この焼成工程により、分散媒の除去がより確実に成される。また前記乾燥体に金属有機塩が含まれている場合、熱分解により金属に変成することができる。さらに、導電性微粒子がコーティング材に覆われている場合、その除去も行うことができる。
加熱処理や光照射処理は通常大気中で行われるが、必要に応じて、窒素、アルゴン、ヘリウムなどの不活性ガス雰囲気中で行うこともできる。この加熱工程についても、接続配線34上にさらに絶縁層を積層する場合には、かかる絶縁層の硬化工程と一括して行うことが好ましい。
なお、実装したICチップ10上に、さらに絶縁材料を塗布して被覆絶縁層を形成し、ICチップ10や接続配線34を封止してもよく、封止後の被覆絶縁層上にさらに配線等を形成することもできる。
特に、この接続配線34上に積層される被覆絶縁層を、絶縁層30a〜30dの形成に用いられる絶縁材料と同一の絶縁材料により形成すれば、極めて良好に配線を封止でき、優れた信頼性を得ることができる。
被覆絶縁層についてより詳細に説明すると、上述したようにスロープ材30を構成する絶縁層30a〜30dは、光照射により半硬化状態とされた絶縁材料からなる状態で接続配線34の形成工程に供される。その後、かかるスロープ材30を加熱すれば、半硬化状態の絶縁材料を完全に硬化させることができるが、このとき、接続配線34上にスロープ材30と同一の絶縁材料からなり、光照射により半硬化状態とされた被覆絶縁層が配されていると、加熱によって接続配線34下の絶縁層30a〜30dと被覆絶縁層とが、それらの間に界面を形成することなく一体となって硬化するために接続配線34への水分の進入経路や、接続配線34の構成材料のマイグレーション経路が形成されにくくなり、また絶縁層中に応力が残留するのも防止できるので、極めて優れた信頼性を得ることができる。
図3(a)は、本発明に係る電子部品の実装方法の第2の実施形態を説明するための電子基板の部分断面構成図であり、図3(b)は図3(a)に対応する平面構成図、図3(c)は図3(a)に対応する斜視構成図である。
先の第1の実施形態では、ICチップ10の側方に概略階段状のスロープ材30を形成し、スロープ材30の斜面上に接続配線34を形成することとしていた。これに対して本実施形態では、図3に示すように、スロープ材30の斜面上に複数の溝部30sを形成し、かかる溝部30s内に接続配線34を形成するようになっている。
図4(a)は、本発明に係る電子部品の実装方法の第3の実施形態を説明するための電子基板の部分断面構成図であり、図4(b)は図4(a)に対応する平面構成図である。本実施形態では、上記第2実施形態の溝部30sに代えて、スロープ材30の斜面上に絶縁下地膜40を形成する。
図5(a)は、本発明に係る電子部品の実装方法の第5の実施形態を説明するための電子基板の部分断面構成図であり、図5(b)は図5(a)に対応する平面構成図、図5(c)は図5(a)に対応する斜視構成図である。本実施形態は、第2実施形態と同様の機能を奏する溝部30sを、絶縁層の形状を利用して形成する実装方法である。
本実施形態の電子部品の実装方法によれば、図6に示すような構成の電子基板200を得ることができる。図6に示す電子基板200は、多層配線構造を備えた回路基板20上に、ICチップ10等を実装したものである。
配線パターン115上を含む第1層間絶縁膜113上に第2層間絶縁膜160が形成されており、第2層間絶縁膜160上に形成された配線パターン125は、第2層間絶縁膜160を貫通して形成されたコンタクトホールH1,H2を介して下層側の配線パターン115と電気的に接続されている。
配線パターン125上を含む第2層間絶縁膜160上に、第3層間絶縁膜162が形成されており、第3層間絶縁膜162を貫通してコンタクトホールH3〜H5が形成されている。コンタクトホールH3を介して第3層間絶縁膜162上に形成された配線パターン135と下層側の配線パターン115とが接続されている。コンタクトホールH4,H5を介して第3層間絶縁膜163上に形成された基板側端子22と下層側の配線パターン125とが接続されている。
そして、第3層間絶縁膜162上に実装されたICチップ10は、スロープ材30上に形成された接続配線34を介して基板側端子22と電気的に接続され、さらにコンタクトホールH4、H5を介して配線パターン125と接続されている。配線パターン125と接続された配線パターン115を介して回路チップ120,121と電気的に接続されている。
さらに、ICチップ10と配線パターン135とを覆って被覆絶縁膜163が形成されている。被覆絶縁膜163を貫通するコンタクトホールH6が形成されており、コンタクトホールH6を介して被覆絶縁膜163上に配置された回路チップ124と配線パターン135とが電気的に接続されている。
なお、本実施形態では、ICチップ10の実装にのみ本発明に係る実装方法を適用しているが、同様に接続端子(バンプ電極40)を基板20Aと反対側に向けて配置されている回路チップ120,121の実装について、本発明に係る実装方法を採用してもよいのは勿論である。
図7は、本発明に係る電子機器の一例を示す斜視図である。この図に示す携帯電話1300は、筐体の内部あるいは表示部1301に、前述の方法を用いて得られる電子基板を備えている。図中、符号1302は操作ボタン1302、符号1303は受話口、符号1304は送話口を示している。上記電子基板には、本発明の実装方法を用いて電子部品を実装された電子基板が用いられており、小型で高性能でありかつ信頼性に優れた電子基板により、携帯電話1300の信頼性を確保しつつその薄型化や小型化、高機能化を実現することができる。
Claims (12)
- 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品を実装する方法であって、
前記端子形成面を基板と反対側を向けた状態で前記電子部品を前記基板上に載置する工程と、
前記電子部品の接続端子と、該接続端子に対応する前記基板側端子との間の前記基板上の領域に、前記基板側端子から前記端子形成面につながる斜面を形成する工程と、
前記斜面上に、液滴吐出法を用いて、前記基板側端子と前記接続端子とを接続する配線を形成する工程と、を有し、
前記斜面を形成する工程が、
前記電子部品の接続端子と前記基板側端子との間の前記基板上の領域に、液滴吐出法を用いて絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第1の絶縁層を形成する工程と、前記第1の絶縁層上であって該第1の絶縁層より狭い平面領域に前記絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第2の絶縁層を形成する工程と、を繰り返すことで、前記電子部品の側方に前記絶縁層の積層膜を形成する工程であり、
前記積層膜の前記斜面上に、前記基板側端子から前記接続端子につながる溝部を形成する工程を有し、
前記配線を形成する工程では前記溝部内に前記配線を形成することを特徴とする電子部品の実装方法。 - 前記溝部を形成する工程が、前記積層膜の前記斜面上でレーザ光を走査する工程であることを特徴とする請求項1に記載の電子部品の実装方法。
- 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品を実装する方法であって、
前記端子形成面を基板と反対側を向けた状態で前記電子部品を前記基板上に載置する工程と、
前記電子部品の接続端子と、該接続端子に対応する前記基板側端子との間の前記基板上の領域に、前記基板側端子から前記端子形成面につながる斜面を形成する工程と、
前記斜面上に、液滴吐出法を用いて、前記基板側端子と前記接続端子とを接続する配線を形成する工程と、を有し、
前記斜面を形成する工程が、
前記電子部品の接続端子と前記基板側端子との間の前記基板上の領域に、液滴吐出法を用いて絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第1の絶縁層を形成する工程と、前記第1の絶縁層上であって該第1の絶縁層より狭い平面領域に前記絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第2の絶縁層を形成する工程と、を繰り返すことで、前記電子部品の側方に前記絶縁層の積層膜を形成する工程であり、
前記積層膜の前記斜面上に、絶縁材料を液滴吐出法を用いて配置し、当該絶縁材料の少なくとも一部を硬化することで、前記基板側端子から前記接続端子につながる絶縁下地膜を形成する工程を有し、
前記配線を形成する工程では前記絶縁下地膜上に前記配線を形成することを特徴とする電子部品の実装方法。 - 前記絶縁下地膜を形成する前記絶縁材料と、前記積層膜を形成する前記絶縁材料とが同一の絶縁材料であることを特徴とする請求項3に記載の電子部品の実装方法。
- 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品を実装する方法であって、
前記端子形成面を基板と反対側を向けた状態で前記電子部品を前記基板上に載置する工程と、
前記電子部品の接続端子と、該接続端子に対応する前記基板側端子との間の前記基板上の領域に、前記基板側端子から前記端子形成面につながる斜面を形成する工程と、
前記斜面上に、液滴吐出法を用いて、前記基板側端子と前記接続端子とを接続する配線を形成する工程と、を有し、
前記斜面を形成する工程が、
前記電子部品の接続端子と前記基板側端子との間の前記基板上の領域に、液滴吐出法を用いて絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第1の絶縁層を形成する工程と、前記第1の絶縁層上であって該第1の絶縁層より狭い平面領域に前記絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第2の絶縁層を形成する工程と、を繰り返すことで、前記電子部品の側方に前記絶縁層の積層膜を形成する工程であり、
前記斜面を形成する工程において、前記積層膜を構成する前記各絶縁層を、外側に向かって突出する複数の突出部を有する形状に形成するとともに、前記各絶縁層の突出部が前記基板側端子から前記接続端子に向かって平面的に配列されるように前記各絶縁層を積層することで、前記各絶縁層内で隣接する前記突出部を側壁として前記基板側端子から前記接続端子につながる溝部を前記斜面上に形成し、
前記配線を形成する工程では前記溝部内に前記配線を形成することを特徴とする電子部品の実装方法。 - 前記各絶縁層に3カ所上の前記突出部を形成し、前記積層膜の前記斜面上に、前記基板側端子から前記接続端子につながる複数の前記溝部を形成することを特徴とする請求項5に記載の電子部品の実装方法。
- 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品を実装する方法であって、
前記端子形成面を基板と反対側を向けた状態で前記電子部品を前記基板上に載置する工程と、
前記電子部品の接続端子と、該接続端子に対応する前記基板側端子との間の前記基板上の領域に、前記基板側端子から前記端子形成面につながる斜面を形成する工程と、
前記斜面上に、液滴吐出法を用いて、前記基板側端子と前記接続端子とを接続する配線を形成する工程と、を有し、
前記斜面を形成する工程が、
前記電子部品の接続端子と前記基板側端子との間の前記基板上の領域に、液滴吐出法を用いて絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第1の絶縁層を形成する工程と、前記第1の絶縁層上であって該第1の絶縁層より狭い平面領域に前記絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第2の絶縁層を形成する工程と、を繰り返すことで、前記電子部品の側方に前記絶縁層の積層膜を形成する工程であり、
前記電子部品を取り囲むように前記積層膜を形成することを特徴とすることを特徴とする電子部品の実装方法。 - 前記絶縁材料を基板上に配置した後、当該絶縁材料に光を照射することで、前記絶縁材料を部分的に硬化させることを特徴とする請求項1から7のいずれか1項に記載の電子部品の実装方法。
- 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品を実装する方法であって、
前記端子形成面を基板と反対側を向けた状態で前記電子部品を前記基板上に載置する工程と、
前記電子部品の接続端子と、該接続端子に対応する前記基板側端子との間の前記基板上の領域に、前記基板側端子から前記端子形成面につながる斜面を形成する工程と、
前記斜面上に、液滴吐出法を用いて、前記基板側端子と前記接続端子とを接続する配線を形成する工程と、を有し、
前記斜面を形成する工程が、
前記電子部品の接続端子と前記基板側端子との間の前記基板上の領域に、液滴吐出法を用いて絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第1の絶縁層を形成する工程と、前記第1の絶縁層上であって該第1の絶縁層より狭い平面領域に前記絶縁材料を配置し、該絶縁材料の少なくとも一部を硬化させて第2の絶縁層を形成する工程と、を繰り返すことで、前記電子部品の側方に前記絶縁層の積層膜を形成する工程であり、
前記配線を形成した後、
前記電子部品、前記配線、及び前記絶縁層の積層膜を覆うように前記絶縁材料を塗布する工程と、
前記絶縁材料に光を照射して部分的に硬化させて被覆絶縁層を形成する工程と、
前記基板上に形成された前記絶縁層を加熱して硬化させる工程と、
を有することを特徴とする電子部品の実装方法。 - 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品が実装された電子基板であって、
前記電子部品の側方に、複数の絶縁層を積層してなり、前記基板側端子から該基板側端子に対応する前記接続端子につながる斜面を有する積層膜が形成されており、
前記積層膜の前記斜面上に、前記基板側端子から前記接続端子につながる溝部が形成されており、当該溝部内に、前記基板側端子と前記接続端子とを接続する配線が形成されていることを特徴とする電子基板。 - 基板側端子が配列された基板上に、接続端子が配列形成された端子形成面を有する電子部品が実装された電子基板であって、
前記電子部品の側方に、複数の絶縁層を積層してなり、前記基板側端子から該基板側端子に対応する前記接続端子につながる斜面を有する積層膜が形成されており、
前記積層膜を構成する前記各絶縁層に、当該絶縁層の一部を外側に突出させてなる複数の突出部が形成され、
前記積層膜の前記斜面上で前記各絶縁層の突出部が平面的に配列されて、当該配列された前記突出部を側壁として前記基板側端子から前記接続端子につながる溝部が前記斜面上に形成されており、
前記溝部内に、前記基板側端子と前記接続端子とを接続する配線が形成されていることを特徴とする電子基板。 - 請求項10または11に記載の電子基板を備えたことを特徴とする電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2006302483A JP5018024B2 (ja) | 2006-11-08 | 2006-11-08 | 電子部品の実装方法、電子基板、及び電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2006302483A JP5018024B2 (ja) | 2006-11-08 | 2006-11-08 | 電子部品の実装方法、電子基板、及び電子機器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2008118075A JP2008118075A (ja) | 2008-05-22 |
| JP5018024B2 true JP5018024B2 (ja) | 2012-09-05 |
Family
ID=39503760
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2006302483A Expired - Fee Related JP5018024B2 (ja) | 2006-11-08 | 2006-11-08 | 電子部品の実装方法、電子基板、及び電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP5018024B2 (ja) |
Families Citing this family (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4940063B2 (ja) * | 2007-08-28 | 2012-05-30 | 株式会社東芝 | 半導体装置およびその製造方法 |
| US9082438B2 (en) | 2008-12-02 | 2015-07-14 | Panasonic Corporation | Three-dimensional structure for wiring formation |
| CN102246298A (zh) * | 2008-12-09 | 2011-11-16 | 垂直电路公司 | 通过电传导材料的喷雾施加形成的半导体裸片互连 |
| KR101284376B1 (ko) | 2009-01-27 | 2013-07-09 | 파나소닉 주식회사 | 반도체 칩의 실장 방법, 그 방법을 이용하여 얻어진 반도체 장치 및 반도체 칩의 접속 방법, 및, 표면에 배선이 설치된 입체 구조물 및 그 제법 |
| US9070393B2 (en) | 2009-01-27 | 2015-06-30 | Panasonic Corporation | Three-dimensional structure in which wiring is provided on its surface |
| JP4908620B2 (ja) * | 2010-09-07 | 2012-04-04 | 株式会社東芝 | テレビジョン受像機及び電子機器 |
| WO2012060091A1 (ja) * | 2010-11-05 | 2012-05-10 | パナソニック株式会社 | 立体構造物の表面への配線方法、表面に配線が設けられた立体構造物を得るための中間構造物、及び、表面に配線が設けられた立体構造物 |
| JP2012142525A (ja) * | 2011-01-06 | 2012-07-26 | Fuji Mach Mfg Co Ltd | 成膜パターン形成方法及び成膜パターン形成装置 |
| US20150207050A1 (en) * | 2012-05-08 | 2015-07-23 | Fuji Machine Mfg Co., Ltd. | Semiconductor package and manufacturing method thereof |
| CN109817574A (zh) * | 2019-03-15 | 2019-05-28 | 浙江荷清柔性电子技术有限公司 | 半导体器件封装方法、互连装置及柔性电路板 |
| US12230594B2 (en) * | 2020-12-31 | 2025-02-18 | Texas Instruments Incorporated | Printed package and method of making the same |
| WO2024039228A1 (ko) * | 2022-08-18 | 2024-02-22 | 엘지이노텍 주식회사 | 회로 기판 및 이를 포함하는 반도체 패키지 |
Family Cites Families (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| NO20001360D0 (no) * | 2000-03-15 | 2000-03-15 | Thin Film Electronics Asa | Vertikale elektriske forbindelser i stabel |
| JP2005223067A (ja) * | 2004-02-04 | 2005-08-18 | Seiko Epson Corp | 電子デバイス及びその製造方法 |
| JP2005251910A (ja) * | 2004-03-03 | 2005-09-15 | Seiko Epson Corp | 回路基板とその製造方法、電気光学装置、電子機器 |
| JP2006303408A (ja) * | 2004-09-09 | 2006-11-02 | Seiko Epson Corp | 電子装置及びその製造方法 |
| JP4613590B2 (ja) * | 2004-11-16 | 2011-01-19 | セイコーエプソン株式会社 | 実装基板及び電子機器 |
| JP3992038B2 (ja) * | 2004-11-16 | 2007-10-17 | セイコーエプソン株式会社 | 電子素子の実装方法、電子装置の製造方法、回路基板、電子機器 |
| JP2008071902A (ja) * | 2006-09-13 | 2008-03-27 | Fujifilm Corp | 配線方法 |
-
2006
- 2006-11-08 JP JP2006302483A patent/JP5018024B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2008118075A (ja) | 2008-05-22 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP3994262B2 (ja) | 半導体装置及びその製造方法、回路基板並びに電子機器 | |
| CN100542375C (zh) | 布线电路基板、布线电路基板的制造方法和电路模块 | |
| JP3633559B2 (ja) | 半導体装置及びその製造方法、回路基板並びに電子機器 | |
| JP4592751B2 (ja) | プリント配線基板の製造方法 | |
| US8941016B2 (en) | Laminated wiring board and manufacturing method for same | |
| US7640655B2 (en) | Electronic component embedded board and its manufacturing method | |
| JP5406389B2 (ja) | 部品内蔵基板及びその製造方法 | |
| CN101595563B (zh) | 在其上表面和下表面具有半导体结构体的半导体装置及其制造方法 | |
| US20090194322A1 (en) | Device mounting board and manufacturing method therefor, and semiconductor module | |
| JP5167516B1 (ja) | 部品内蔵基板及びその製造方法並びに部品内蔵基板実装体 | |
| US20090310323A1 (en) | Printed circuit board including electronic component embedded therein and method of manufacturing the same | |
| KR100749983B1 (ko) | 실장 기판 및 전자 기기 | |
| US8274148B2 (en) | Semiconductor module | |
| CN101083235A (zh) | 半导体装置及半导体装置的制造方法 | |
| JP5018024B2 (ja) | 電子部品の実装方法、電子基板、及び電子機器 | |
| JP2010141293A (ja) | 半導体装置及び半導体装置の製造方法 | |
| CN114038760A (zh) | 一种基于模制成型制程的封装基板及其制造方法 | |
| JP3847693B2 (ja) | 半導体装置の製造方法 | |
| CN101510538A (zh) | 元件搭载用基板及其制造方法、半导体组件及便携式设备 | |
| US8129846B2 (en) | Board adapted to mount an electronic device, semiconductor module and manufacturing method therefor, and portable device | |
| JP2009135391A (ja) | 電子装置およびその製造方法 | |
| CN101408688B (zh) | 布线电路基板、布线电路基板的制造方法和电路模块 | |
| JP2010114221A (ja) | 電子装置、及び電子装置の製造方法 | |
| JP5295211B2 (ja) | 半導体モジュールの製造方法 | |
| JP6028256B2 (ja) | 部品内蔵基板及びその製造方法 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20091026 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20100402 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20120214 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20120412 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20120515 |
|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20120528 |
|
| R150 | Certificate of patent or registration of utility model |
Ref document number: 5018024 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20150622 Year of fee payment: 3 |
|
| S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
| R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
| LAPS | Cancellation because of no payment of annual fees |