JP7403630B2 - 電力変換装置の制御システム - Google Patents

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本発明は、電力変換装置の制御システムに関し、同期発電機を模擬した仮想同期発電機制御を行う電圧制御型の電力変換器において、出力電流に応じて仮想同期インピーダンスモデルによって発生する電圧降下の模擬と、出力電圧振幅を制御する方法に関する。
図１の上段に、例えば蓄電池等の直流電源の直流電力を交流電力に変換する電力変換器を有し、電力変換器の出力がＬＣフィルタを介して電力系統と連系されるＰＣＳ（Ｐｏｗｅｒ Ｃｏｎｖｅｒｓｉｏｎ Ｓｙｓｔｅｍ；電力変換装置）の構成を示し、図１の下段に仮想同期インピーダンスモデルの構成を示す。
尚、従来、蓄電池による仮想同期発電システムは、例えば特許文献１に記載のものが提案されていた。
特開２０１９－８０４７６号公報
図１において、同期発電機を模擬した仮想同期発電機制御を行う電圧制御型の電力変換器では、電力変換装置（ＰＣＳ）の内部誘起電圧Ｅｆから仮想同期インピーダンスＺｓによる出力電圧降下Ｖｚを減じた値を電圧指令値Ｖａｃ*として、フィルタコンデンサＣの電圧Ｖａｃを電圧制御することで、仮想同期インピーダンスによる同期化力を再現する。
一方、電圧振幅｜Ｖａｃ｜は、電圧振幅指令値｜Ｖａｃ｜*に一致させる必要がある。仮想同期インピーダンスによる電圧降下量は負荷電流によって一意に決定されるので、電圧降下量に応じて電圧振幅｜Ｖａｃ｜を電圧振幅指令値｜Ｖａｃ｜*に一致させる制御が必要であり、負荷変動時にも高速に応答できる制御系が望ましい。
本発明は、上記課題を解決するものであり、その目的は、仮想同期インピーダンスによる同期化力を再現しつつ、負荷変動時にも出力電圧振幅制御の高速応答を可能とした電力変換装置の制御システムを提供することにある。
上記課題を解決するための請求項１に記載の電力変換装置の制御システムは、
同期発電機を模擬した仮想同期発電機制御が行われ、直流電源の直流電力を交流電力に変換する電力変換器を有し、前記電力変換器の出力がＬＣフィルタを介して電力系統と連系される電力変換装置において、
前記電力変換器の出力電流を検出した出力電流検出値と設定した電圧振幅指令値を入力とし、電力変換器の出力電流で生じる仮想同期インピーダンスによる電圧降下を模擬し、その模擬した電圧降下に応じて、出力電圧指令値と仮想同期発電機の内部誘起電圧を算出する仮想同期インピーダンス補償ブロックと、
同期発電機を模擬した角周波数を決定する仮想同期発電機モデルと、
前記電力変換装置の出力電圧が、前記仮想同期インピーダンス補償ブロックで算出された出力電圧指令値と一致するように、前記仮想同期発電機モデルにより決定された角周波数に基いて制御する出力電圧制御部と、
を備えたことを特徴とする。
請求項２に記載の電力変換装置の制御システムは、請求項１において、
前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴としている。
請求項３に記載の電力変換装置の制御システムは、請求項１において、
前記仮想同期インピーダンス補償ブロックは、出力電圧指令値Ｖａｃ*を基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴としている。
請求項４に記載の電力変換装置の制御システムは、請求項１において、
前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、前回制御周期時に算出された内部誘起電圧から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、
該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出することを特徴としている。
請求項５に記載の電力変換装置の制御システムは、請求項１において、
前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、
該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出することを特徴としている。
請求項６に記載の電力変換装置の制御システムは、請求項２において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000001
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
前記Ｖｚ算出部で算出されたＶｚ＿ｑと、前記電圧振幅指令値｜Ｖａｃ｜*に基いて、下記（２）式を演算して出力電圧位相δを求めるｓｉｎ-1算出部と、
Figure 0007403630000002
前記出力電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖａｃ｜*を乗算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の出力電圧指令値Ｖａｃ＿ｄ*を求める乗算器と、
前記乗算器で求められた出力電圧指令値Ｖａｃ＿ｄ*と前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の内部誘起電圧Ｅｆを求める加算器と、
を備えたことを特徴とする。
請求項７に記載の電力変換装置の制御システムは、請求項３において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000003
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
前記Ｖｚ算出部で算出されたＶｚ＿ｄと前記電圧振幅指令値｜Ｖａｃ｜*を加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の内部誘起電圧Ｅｆを求める加算器と、
を備えたことを特徴とする。
請求項８に記載の電力変換装置の制御システムは、請求項４において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000004
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
制御周期毎に算出された内部誘起電圧Ｅｆを一時記憶するバッファと、
前記バッファに記憶されている、前回制御周期時に算出された内部誘起電圧Ｅｆ＿ｄ（Ｚ-1）と、前記Ｖｚ算出部で算出されたＶｚ＿ｄ、Ｖｚ＿ｑとに基いて、下記（７）式を演算して位相差δを求めるｔａｎ-1算出部と、
Figure 0007403630000005
前記電圧振幅指令値｜Ｖａｃ｜*を、前記ｔａｎ-1算出部で求められた位相差δによって回転座標変換して、下記（８）式に沿って出力電圧指令値Ｖａｃ*を演算する回転行列演算部と、
Figure 0007403630000006
前記回転行列演算部で演算された出力電圧指令値Ｖａｃ*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆを算出する加算器と、
を備えたことを特徴とする。
請求項９に記載の電力変換装置の制御システムは、請求項５において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000007
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
前記電圧振幅指令値｜Ｖａｃ｜*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄ、Ｖｚ＿ｑとに基いて、下記（１０）式を演算して位相差δを求めるｔａｎ-1算出部と、
Figure 0007403630000008
前記電圧振幅指令値｜Ｖａｃ｜*を、前記ｔａｎ-1算出部で求められた位相差δによって回転座標変換して出力電圧指令値Ｖａｃ*を演算する回転行列演算部と、
前記回転行列演算部で演算された出力電圧指令値Ｖａｃ*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆを算出する加算器と、
を備えたことを特徴とする。
請求項１０に記載の電力変換装置の制御システムは、
同期発電機を模擬した仮想同期発電機制御が行われ、直流電源の直流電力を交流電力に変換する電力変換器を有し、前記電力変換器の出力がＬＣフィルタおよび連系用のトランスを介して電力系統と連系される電力変換装置において、
前記電力変換器の出力電流を検出した出力電流検出値と設定した電圧振幅指令値｜Ｖ｜*を入力とし、電力変換器の出力電流で生じる仮想同期インピーダンスおよびトランスによる電圧降下を模擬し、その模擬した電圧降下に応じて、出力電圧指令値Ｖａｃ*と仮想同期発電機の内部誘起電圧Ｅｆを算出する仮想同期インピーダンス補償ブロックと、
同期発電機を模擬した角周波数を決定する仮想同期発電機モデルと、
前記電力変換装置の出力電圧Ｖａｃが、前記仮想同期インピーダンス補償ブロックで算出された出力電圧指令値Ｖａｃ*と一致するように制御する出力電圧制御部と、
を備え、
前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、トランスのインピーダンスＺｔｒと、設定した電圧振幅指令値｜Ｖ｜*から、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴とする。
請求項１１に記載の電力変換装置の制御システムは、請求項１０において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃを前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000009
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑと、前記トランスのインピーダンスＺｔｒに基いて、下記（１１）式を演算してトランスによる電圧降下Ｖｔｒを算出するＶｔｒ算出部と、
Figure 0007403630000010
（ただし、ＲｔｒはＺｔｒの抵抗成分、ＸｔｒはＺｔｒのリアクタンス成分）
前記Ｖｚ算出部で算出されたＶｚ＿ｑと、前記電圧振幅指令値｜Ｖ｜*に基いて、下記（１２）式を演算して系統電圧位相δを求めるｓｉｎ-1算出部と、
Figure 0007403630000011
前記系統電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器と、
前記乗算器の乗算出力と前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下Ｖｔｒを打ち消すように補償する動作点の、内部誘起電圧Ｅｆ＿ｄを算出する加算器と、
前記Ｖｚ算出部で算出されたＶｚ＿ｄから前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｄを減算する第１の減算器と、
前記加算器で算出された内部誘起電圧Ｅｆ＿ｄから、前記第１の減算器の減算出力を減算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下Ｖｔｒを打ち消すように補償する動作点の出力電圧指令値Ｖａｃ＿ｄ*を算出する第２の減算器と、
前記Ｖｚ算出部で算出されたＶｚ＿ｑから前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｑを減算する第３の減算器と、
前記第３の減算器の偏差出力を極性反転させて出力電圧指令値Ｖａｃ＿ｑ*を出力する極性反転器と、を備え、
前記出力電圧制御部の制御は、前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ、ｑ座標上で実施することを特徴とする。
請求項１２に記載の電力変換装置の制御システムは、請求項１０において、
前記仮想同期インピーダンス補償ブロックは、
前記出力電流検出値Ｉａｃを前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
Figure 0007403630000012
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑと、前記トランスのインピーダンスＺｔｒに基いて、下記（１１）式を演算してトランスによる電圧降下Ｖｔｒを算出するＶｔｒ算出部と、
Figure 0007403630000013
（ただし、ＲｔｒはＺｔｒの抵抗成分、ＸｔｒはＺｔｒのリアクタンス成分）
前記Ｖｚ算出部で算出されたＶｚ＿ｄと前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｄを加算する第１の加算器と、
前記Ｖｚ算出部で算出されたＶｚ＿ｑと前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｑを加算する第２の加算器と、
前記第２の加算器の加算出力と前記電圧振幅指令値｜Ｖ｜*に基づいて、下記（１６）式を演算して系統電圧位相δを求めるｓｉｎ-1算出部と、
Figure 0007403630000014
前記系統電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器と、
前記乗算器の乗算出力と第１の加算器の加算出力を加算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下のうち振幅の減少を補償する動作点の、内部誘起電圧Ｅｆ＿ｄを算出する第３の加算器と、
前記第３の加算器で算出された内部誘起電圧Ｅｆ＿ｄから、前記Ｖｚ算出部で算出されたＶｚ＿ｄを減算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下のうち振幅の減少を補償する動作点の、出力電圧指令値Ｖａｃ＿ｄ*を算出する減算器と、
前記Ｖｚ算出部で算出されたＶｚ＿ｑを極性反転させて出力電圧指令値Ｖａｃ＿ｑ*を出力する極性反転器と、を備え、
前記出力電圧制御部の制御は、前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ、ｑ座標上で実施することを特徴とする。
（１）請求項１～９に記載の発明によれば、負荷変動時でも出力電圧指令の振幅を一定に保ちつつ、仮想同期インピーダンスによる電圧降下を模擬し、同期化力を再現することができる。
（２）請求項３、７に記載の発明によれば、出力電圧指令値Ｖａｃ*を基準位相としているため、仮想同期インピーダンス補償ブロックにおける演算量は少なくて済む。
（３）請求項５、９に記載の発明によれば、仮想同期インピーダンスを、位相差δの誤差が問題にならない程度に小さい値に設定する場合、請求項４のように制御周期毎に算出した内部誘起電圧Ｅｆを一時記憶するために必要な記憶手段（例えばバッファ）が不要となり、構成が簡略化できる。
（４）請求項１０～１２に記載の発明によれば、負荷変動時でも系統電圧（電力系統との連系点電圧）Ｖｓｙｓの振幅を電圧振幅指令値｜Ｖ｜*に保ち、仮想同期インピーダンスＺｓおよび連系用のトランスのインピーダンスＺｔｒによる電圧降下を模擬し、同期化力を再現することができる。
（５）請求項１１に記載の発明によれば、連系用のトランスによる電圧降下を打ち消すように補償する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することができる。
（６）請求項１２に記載の発明によれば、連系用のトランスによる電圧降下のうち振幅の減少を補償する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することができる。
電力変換装置における仮想インピーダンスモデルの説明図。 本発明の実施形態例における電力変換装置の制御システムの一例を示す全体構成図。 本発明の実施例１における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例１による仮想同期インピーダンス補償ブロックの構成図。 本発明の実施例２における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例２による仮想同期インピーダンス補償ブロックの構成図。 本発明の実施例３における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例３による仮想同期インピーダンス補償ブロックの構成図。 本発明の実施例４における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例４による仮想同期インピーダンス補償ブロックの構成図。 トランスを介して電力系統に連系される電力変換装置の、本発明の実施例５における仮想インピーダンスモデルの説明図。 本発明の実施形態例における電力変換装置の制御システムの他の例を示す全体構成図。 本発明の実施例５における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例５による仮想同期インピーダンス補償ブロックの構成図。 本発明の実施例６における仮想インピーダンスモデルの説明図。 本発明の実施例６における仮想同期インピーダンスモデルのベクトル図。 本発明の実施例６による仮想同期インピーダンス補償ブロックの構成図。
以下、図面を参照しながら本発明の実施の形態を説明するが、本発明は下記の実施形態例に限定されるものではない。
本実施形態例では、蓄電池等の直流電源をＤＣ／ＡＣ変換装置（電力変換器ＩＮＶ）とＬＣフィルタとトランスを介して系統連系を行い、特に制御系に、同期発電機を模擬した角周波数ωｒを決定する仮想同期発電機モデルと、内部誘起電圧Ｅｆと同期発電機の仮想同期インピーダンス（Ｚｓ）による電圧降下（Ｖｚ）を模擬する仮想同期インピーダンス補償ブロックとを備えたＰＣＳ（電力変換装置）において、ＰＣＳの出力電圧を指令値に制御する電圧制御によって制御されるときに、仮想同期インピーダンス補償ブロックにて、仮想同期インピーダンス（Ｚｓ）により発生する電圧降下（Ｖｚ）に応じて、電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆの動作点を数学的に求めることによって、仮想同期インピーダンスによる同期化力を再現しつつ、負荷変動時にも高速に応答できるように構成した。
図２は、本実施形態例における電力変換装置の制御システムの全体構成の一例を示している。図２において、１は例えば蓄電池を有した直流電源であり、２は直流電源１の直流電力を交流電力に変換する電力変換器（ＩＮＶ）である。
電力変換器２は、例えばＩＧＢＴをブリッジ接続して構成され、後述のＰＷＭ部（１６）で生成されたゲート信号Ｇａｔｅによってオン、オフ制御がなされる。
電力変換器２の交流出力側は、リアクトルＬｆおよびコンデンサＣｆからなるＬＣフィルタ３とトランス４（Ｔｒ）を介して電力系統５に接続（連系）されている。
１１は、電力変換器２の出力電流を変流器１２で検出した出力電流検出値Ｉａｃと、設定した電圧振幅指令値｜Ｖａｃ｜*を入力とし、電力変換器２の出力電流で生じる仮想同期インピーダンスＺｓによる電圧降下Ｖｚを模擬し、その模擬した電圧降下Ｖｚに応じて、出力電圧指令値Ｖａｃ*と仮想同期発電機の内部誘起電圧Ｅｆを算出する仮想同期インピーダンス補償（Ｚｓ補償）ブロックである。
１３は、仮想同期インピーダンス補償ブロック１１で算出された内部誘起電圧Ｅｆと前記出力電流検出値ＩａｃからＶＳＧ（Ｖｉｒｔｕａｌ Ｓｙｎｃｈｒｏｎｏｕｓ Ｇｅｎｅｒａｔｏｒ）モデルの電気出力（Ｐｅ）を演算し、その演算した電気出力（Ｐｅ）と設定した基準電力Ｐｒｅｆとの偏差に基いて、同期発電機を模擬した角周波数ωｒを決定する仮想同期発電機モデルである。
１４は、ＰＣＳの出力電圧（電力変換器２の出力電圧）を計器用変圧器１５により検出した出力電圧Ｖａｃが、仮想同期インピーダンス補償ブロック１１で算出された出力電圧指令値Ｖａｃ*と一致するように制御するための出力電圧制御指令Ｖｃｍｄを生成するＰＣＳ出力電圧制御部（ＡＶＲ）である。
１６は、ＰＣＳ出力電圧制御部１４で生成された出力電圧制御指令ＶｃｍｄとＰＷＭキャリアによりＰＷＭ変調したゲート信号Ｇａｔｅを生成し、電力変換器２をＰＷＭ制御するＰＷＭ部である。同期ＰＷＭの場合は、仮想同期発電機モデル１３で決定された角周波数ωｒを逓倍した周波数のＰＷＭキャリアを用いる。非同期ＰＷＭの場合は固定周波数のＰＷＭキャリアを用いる。
尚、図２において、出力電流検出値Ｉａｃ、出力電圧Ｖａｃは、角周波数ωｒを積分した位相により３相のｕ、ｖ、ｗをｄ軸、ｑ軸に変換した信号を各々用いており、出力電圧制御指令Ｖｃｍｄは、角周波数ωｒを積分した位相によりｄ軸、ｑ軸を３相のｕ，ｖ，ｗに逆ｄｑ変換した信号を用いているものとする。
前記仮想同期インピーダンス補償ブロック１１の詳細は、以下の各実施例のように構成されている。
（実施例１）
実施例１における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖａｃ｜*、電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑの、ｄ軸、ｑ軸上の関係は図３に示すとおりであり、内部誘起電圧Ｅｆを基準位相（ｄ軸上）としている。
実施例１における仮想同期インピーダンス補償ブロック１１は、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出するものであり、図４のように構成されている。
図４において、２０は、前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部である。
Figure 0007403630000015
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
２１は、前記Ｖｚ算出部２０で算出されたＶｚ＿ｑと、前記電圧振幅指令値｜Ｖａｃ｜*に基いて、下記（２）式を演算して出力電圧位相δを求めるｓｉｎ-1算出部である。
Figure 0007403630000016
２２は、前記出力電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部である。
２３は、ｃｏｓ算出部２２の出力と電圧振幅指令値｜Ｖａｃ｜*を乗算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の出力電圧指令値Ｖａｃ＿ｄ*を求める乗算器である。
２４は、Ｖｚ算出部２０で算出された電圧降下Ｖｚ＿ｑの極性を反転させる極性反転器であり、その出力は、出力電圧指令値Ｖａｃ＿ｑ*として出力される。
２５は、乗算器２３で求められた出力電圧指令値Ｖａｃ＿ｄ*とＶｚ算出部２０で算出されたＶｚ＿ｄを加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の内部誘起電圧Ｅｆ＿ｄを求める加算器である。尚、内部誘起電圧Ｅｆ＿ｑは０である。
上記のように構成された装置において、ＰＣＳ出力電圧制御部１４は、出力電圧Ｖａｃ（ＬＣフィルタ後の端子電圧を検出した電圧Ｖａｃ）が、内部誘起電圧Ｅｆから出力電流Ｉａｃが流れることによって生じる仮想同期インピーダンスＺｓによる電圧降下Ｖｚを減算した出力電圧指令値Ｖａｃ*と一致するように電圧制御を行う。
仮想同期インピーダンスＺｓ（ｒおよびｘ）と出力電流Ｉａｃより、電圧降下Ｖｚをｄ、ｑ座標上で表すと下記（１）式（Ｖｚ算出部２０で算出される式）のようになる。
Figure 0007403630000017
電圧降下Ｖｚより、出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸上に位置する動作点は一意に求めることができ、下記（２）～（４）式のようになる。
Figure 0007403630000018
Figure 0007403630000019
Figure 0007403630000020
上記（２）式は図４のｓｉｎ-1算出部２１により求められ、上記（３）式は乗算器２３および極性反転器２４により求められ、上記（４）式は加算器２５により求められる。
このように、負荷電流（出力電流検出値Ｉａｃ）に応じて出力すべき電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを図４の仮想同期インピーダンス補償ブロック（１１）にて逐次演算することで、負荷変動時も出力電圧指令値Ｖａｃ*の振幅を電圧振幅指令値｜Ｖａｃ｜*に保ち、且つ仮想同期インピーダンスＺｓによる電圧降下Ｖｚを模擬し、同期化力を再現することが可能になる。
以上のように本実施例１によれば、内部誘起電圧Ｅｆ基準の座標上において、負荷電流に応じて、出力電圧指令値Ｖａｃ*の振幅が電圧振幅指令値｜Ｖａｃ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸上に位置する動作点の出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを逐次演算することで、負荷変動時でも電圧振幅を一定に保ちつつ、仮想同期インピーダンスによる電圧降下を模擬し、同期化力を再現できる。
（実施例２）
実施例２における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖａｃ｜*、電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑの、ｄ軸、ｑ軸上の関係は図５に示すとおりであり、出力電圧指令値Ｖａｃ*を基準位相（ｄ軸上）としている。
実施例２における仮想同期インピーダンス補償ブロック１１は、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出するものであり、図６のように構成されている。
図６において、図４と同一部分は同一符号をもって示している。２６は、前記Ｖｚ算出部２０で算出されたＶｚ＿ｄと電圧振幅指令値｜Ｖａｃ｜*を加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の内部誘起電圧Ｅｆ＿ｄを求める加算器である。
Ｖｚ算出部２０で算出されたＶｚ＿ｑは内部誘起電圧Ｅｆ＿ｑとして出力される。
出力電圧指令値Ｖａｃ*をｄ軸上に配置しているため、｜Ｖａｃ｜*がＶａｃ＿ｄ*として出力され、ｑ軸成分Ｖａｃ＿ｑ*は０である。
前記実施例１では基準位相を内部誘起電圧Ｅｆとしていたのに対して、本実施例２では図５に示すように基準位相を出力電圧指令値Ｖａｃ*で考える。仮想同期インピーダンスＺｓによる電圧降下Ｖｚは実施例１と同様に（１）式から求める。
電圧降下Ｖｚより、出力電圧指令値の振幅が｜Ｖａｃ｜*であり、且つ出力電圧指令値Ｖａｃ*がｄ軸上に位置する動作点は一意に求めることができ下記（５）式、（６）式のようになる。
Figure 0007403630000021
Figure 0007403630000022
上記（５）式のＶａｃ＿ｄ*、Ｖａｃ＿ｑ*は図２、図６の仮想同期インピーダンス補償ブロック１１から出力され、上記（６）式は図６の加算器２６により求められる。
以上のように本実施例２によれば、実施例１と同様に、負荷変動時も出力電圧指令値Ｖａｃ*の振幅を電圧振幅指令値｜Ｖａｃ｜*に保ち、且つ仮想同期インピーダンスＺｓによる電圧降下Ｖｚを模擬し、同期化力を再現することが可能になる。
但し、本実施例２では三角関数の演算が不要であるため、実施例１と比較して少ない演算量で済む。
（実施例３）
実施例３における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖａｃ｜*、電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑの、ｄ軸、ｑ軸上の関係は図７に示すとおりであり、内部誘起電圧Ｅｆを基準位相（ｄ軸上）としている。
尚、出力電圧指令値Ｖａｃ*の演算時は、図７（ａ）のように前回制御周期で求めた内部誘起電圧Ｅｆ（Ｚ-1）をｄ軸上に配置し、Ｅｆの演算時は図７（ｂ）のように今回制御周期での内部誘起電圧Ｅｆをｄ軸上に配置している。
実施例３における仮想同期インピーダンス補償ブロック１１は、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、前回制御周期時に算出された内部誘起電圧から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出するものであり、図８のように構成されている。
図８において、図４と同一部分は同一符号をもって示している。図８において、３１は、制御周期毎に、後述の加算器３６により算出された内部誘起電圧Ｅｆ＿ｄを一時記憶するバッファ（Ｚ-1は単位遅延演算子）である。
３２は、前記バッファ３１に記憶されている、前回制御周期時に演算された内部誘起電圧Ｅｆ＿ｄ（Ｚ-1）と、Ｖｚ算出部２０で算出されたＶｚ＿ｄとの偏差をとる減算器である。
３３は、設定した０とＶｚ算出部２０で算出されたＶｚ＿ｑとの偏差をとる減算器である。
３４は、減算器３２の偏差出力（Ｅｆ＿ｄ（Ｚ-1）－Ｖｚ＿ｄ）と減算器３３の偏差出力（－Ｖｚ＿ｑ）に基いて、下記（７）式を演算して位相差δを求めるｔａｎ-1算出部である。
Figure 0007403630000023
３５は、電圧振幅指令値｜Ｖａｃ｜*を、ｔａｎ-1算出部３４で求められた位相差δによって回転座標変換して、下記（８）式に沿って出力電圧指令値Ｖａｃ＿ｄ*、Ｖａｃ＿ｑ*を演算する回転行列演算部である。
Figure 0007403630000024
３６は、回転行列演算部３５で演算された出力電圧指令値Ｖａｃ＿ｄ*と、Ｖｚ算出部２０で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆ＿ｄを算出する加算器である。
加算器３６の加算出力であるＥｆ＿ｄは出力されるとともに、次回制御周期の演算のためにバッファ３１に入力される。尚、内部誘起電圧Ｅｆ＿ｑは０と近似する。
前記実施例１では内部誘起電圧Ｅｆと出力電圧指令値Ｖａｃ*を同時に求めていたのに対して、本実施例３では、図８の回路のように、前回制御周期で求めた内部誘起電圧前回値Ｅｆ（Ｚ-1）と電圧降下Ｖｚの差分より、ｔａｎ-1算出部３４にて下記（７）式のように位相差δを求め、回転行列演算部３５にて下記（８）式のように電圧振幅指令値｜Ｖａｃ｜*を位相差δで回転座標変換することで、出力電圧指令値Ｖａｃ*を求める。
Figure 0007403630000025
Figure 0007403630000026
内部誘起電圧Ｅｆは、出力電圧指令値Ｖａｃ*と電圧降下Ｖｚより、下記（９）式のようになる。
Figure 0007403630000027
上記（９）式は加算器３６で演算される。
本実施例３では、内部誘起電圧前回値Ｅｆ（Ｚ-1）を基準に動作点を決定するため、内部誘起電圧Ｅｆにｑ軸成分が出てくる場合があるが、内部誘起電圧Ｅｆをｄ軸上に配置するため、ｑ軸成分は０と近似する。また、次回制御周期の演算のためにＥｆ＿ｄをバッファ３１に保存する。尚、バッファ３１の初期値は電圧振幅指令値｜Ｖａｃ｜*とする。
以上のように実施例３によれば、前回制御周期のＥｆ（Ｚ-1）を利用して出力電圧指令値Ｖａｃ*を演算することで、電圧振幅を一定に保ちつつ、仮想同期インピーダンスＺｓによる電圧降下Ｖｚを模擬し、同期化力を再現できる。前回制御周期のＥｆ（Ｚ-1）を使用するため、実施例１、２と比較して応答は遅い。また、内部誘起電圧Ｅｆは近似値となる。
（実施例４）
実施例４における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖａｃ｜*、電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑの、ｄ軸、ｑ軸上の関係は図９に示すとおりであり、内部誘起電圧Ｅｆを基準位相（ｄ軸上）としている。尚、出力電圧指令値Ｖａｃ*の演算時は図９（ａ）のベクトルとなり、Ｅｆの演算時は図９（ｂ）のベクトルとなる。
実施例４における仮想同期インピーダンス補償ブロック１１は、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出するものであり、図１０のように構成されている。
図１０において図８と同一部分は同一符号をもって示している。図１０において４１は、電圧振幅指令値｜Ｖａｃ｜*とＶｚ算出部２０で算出されたＶｚ＿ｄの偏差をとる減算器である。
４２は、設定した０とＶｚ算出部２０で算出されたＶｚ＿ｑの偏差をとる減算器である。
４３は、減算器４１の偏差出力（｜Ｖａｃ｜*－Ｖｚ＿ｄ）と減算器４２の偏差出力（－Ｖｚ＿ｑ）に基いて下記（１０）式を演算して位相差δを求めるｔａｎ-1算出部である。
Figure 0007403630000028
４４は、電圧振幅指令値｜Ｖａｃ｜*を、ｔａｎ-1算出部４３で求められた位相差δによって回転座標変換して、下記（８）式に沿って出力電圧指令値Ｖａｃ＿ｄ*、Ｖａｃ＿ｑ*を演算する回転行列演算部である。
Figure 0007403630000029
４５は、回転行列演算部４４で演算された出力電圧指令値Ｖａｃ＿ｄ*と、Ｖｚ算出部２０で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆ＿ｄを算出する加算器である。尚、内部誘起電圧Ｅｆ＿ｑは０と近似する。
前記実施例３では位相差δ演算のために、内部誘起電圧Ｅｆ前回値を使用していたのに対して、本実施例４では電圧振幅指令値｜Ｖａｃ｜*を使用することで簡略化した。
すなわち、減算器４１，４２およびｔａｎ-1算出部４３によって下記（１０）式を演算して位相差δを演算している。
Figure 0007403630000030
出力電圧指令値Ｖａｃ＿ｄ*，Ｖａｃ＿ｑ*は、実施例３と同様に回転行列演算部４４にて（８）式を演算することで求められる。
内部誘起電圧Ｅｆ＿ｄは、実施例３と同様に加算器４５にて（９）式を演算することで求められる。
位相差δは、実施例３のように内部誘起電圧Ｅｆからの電圧降下によって決定した場合と比較して誤差が生じるが、電圧振幅を一定に保ちつつ、同期化力を再現できる。
本実施例４は、実施例３と比較して内部誘起電圧Ｅｆのバッファ（３１）を不要とすることができ、構成を簡略化できる。
尚、模擬する同期発電機の仮想同期インピーダンスは、電力変換器内のパラメータであるため、同期機の物理的な制限に囚われず自由に設定することができる。仮想同期インピーダンスが小さいほど、前記位相差δの誤差は小さくなると考えられるため、仮想同期インピーダンスを位相差δの誤差が問題にならない程度に小さい値に設定する場合は、本実施例４の方式を適用できる。
（実施例５）
図１１の上段に、例えば蓄電池等の直流電源の直流電力を交流電力に変換する電力変換器の出力が、ＬＣフィルタおよび連系用のトランス（Ｔｒ）を介して電力系統と連系されるＰＣＳの構成を示し、図１１の下段に仮想同期インピーダンスモデルの構成を示す。
図１１のように、電力変換器の出力が、ＬＣフィルタおよび連系用のトランスＴｒを介して電力系統と連系される場合、トランスＴｒによる電圧降下Ｖｔｒによって系統電圧（電力系統との連系点電圧）Ｖｓｙｓは減少する。
系統電圧振幅｜Ｖｓｙｓ｜を電圧振幅指令値｜Ｖ｜*に一致させたい場合、電圧降下量に応じて系統電圧振幅｜Ｖｓｙｓ｜を電圧振幅指令値｜Ｖ｜*に一致させる制御が必要であり、負荷変動時にも高速に応答できる制御系が望ましい。
そこで本実施例５では、蓄電池等の直流電源をＤＣ／ＡＣ変換装置（電力変換器ＩＮＶ）とＬＣフィルタとトランスを介して系統連系を行い、特に制御系に、同期発電機を模擬した角周波数ωｒを決定する仮想同期発電機モデルと、内部誘起電圧Ｅｆと同期発電機の仮想同期インピーダンス（Ｚｓ）による電圧降下（Ｖｚ）を模擬する仮想同期インピーダンス補償ブロックとを備えたＰＣＳ（電力変換装置）において、ＰＣＳの出力電圧を指令値に制御する電圧制御によって制御されるときに、仮想同期インピーダンス補償ブロックにて、仮想同期インピーダンスとトランスにより発生する電圧降下量に応じて、電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆの動作点を数学的に求めることによって、仮想同期インピーダンスによる同期化力を再現しつつ、連系用のトランスによる電圧降下を補償し、負荷変動時にも高速に応答できるように構成した。
図１２は、本実施例５における電力変換装置の制御システムの全体構成を示しており、図２と同一部分は同一符号をもって示している。図１２において、１は例えば蓄電池を有した直流電源であり、２は直流電源１の直流電力を交流電力に変換する電力変換器（ＩＮＶ）である。
電力変換器２は、例えばＩＧＢＴをブリッジ接続して構成され、後述のＰＷＭ部（１６）で生成されたゲート信号Ｇａｔｅによってオン、オフ制御がなされる。
電力変換器２の交流出力側は、リアクトルＬｆおよびコンデンサＣｆからなるＬＣフィルタ３とトランス４（Ｔｒ）を介して電力系統５に接続（連系）されている。
１１は、電力変換器２の出力電流を変流器１２で検出した検出電流を、後述する座標変換部５２によりｄ、ｑ軸に変換した出力電流検出値Ｉａｃと、設定した電圧振幅指令値｜Ｖ｜*を入力とし、電力変換器２の出力電流で生じる仮想同期インピーダンスＺｓによる電圧降下Ｖｚを模擬し、その模擬した電圧降下Ｖｚに応じて、出力電圧指令値Ｖａｃ*と仮想同期発電機の内部誘起電圧Ｅｆを算出する仮想同期インピーダンス補償（Ｚｓ補償）ブロックである。
１３は、仮想同期インピーダンス補償ブロック１１で算出された内部誘起電圧Ｅｆと前記出力電流検出値ＩａｃからＶＳＧ（Ｖｉｒｔｕａｌ Ｓｙｎｃｈｒｏｎｏｕｓ Ｇｅｎｅｒａｔｏｒ）モデルの電気出力（Ｐｅ）を演算し、その演算した電気出力（Ｐｅ）と設定した基準電力Ｐｒｅｆとの偏差に基いて、同期発電機を模擬した角周波数ωｒを決定する仮想同期発電機モデルである。
１４は、ＰＣＳの出力電圧（電力変換器２の出力電圧）を計器用変圧器１５により検出した検出電圧を、後述する座標変換部５３によりｄ、ｑ軸に変換した出力電圧検出値Ｖａｃが、仮想同期インピーダンス補償ブロック１１で算出された出力電圧指令値Ｖａｃ*と一致するように制御するための指令信号を生成するＰＣＳ出力電圧制御部（ＡＶＲ）であり、その指令信号は後述する座標変換部５４により３相のｕ，ｖ，ｗに変換され、３相の出力電圧制御指令Ｖｃｍｄが出力される。
１６は、ＰＣＳ出力電圧制御部１４で生成された出力電圧制御指令ＶｃｍｄとＰＷＭキャリアによりＰＷＭ変調したゲート信号Ｇａｔｅを生成し、電力変換器２をＰＷＭ制御するＰＷＭ部である。同期ＰＷＭの場合は、仮想同期発電機モデル１３で決定された角周波数ωｒを逓倍した周波数のＰＷＭキャリアを用いる。非同期ＰＷＭの場合は固定周波数のＰＷＭキャリアを用いる。
５１は、仮想同期発電機モデル１３から出力される角周波数ωｒを積分して内部位相θｒを出力する積分器である。
前記座標変換部５２，５３，５４は、積分器５１から出力される内部位相θｒで各々回転座標変換を行う。
実施例５における仮想インピーダンスモデルは図１１のとおりである。実施例５における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖ｜*、仮想同期インピーダンスでの電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑ、系統電圧（連系点電圧）Ｖｓｙｓ、連系用のトランスによる電圧降下Ｖｔｒ＿ｄ，Ｖｔｒ＿ｑの、ｄ軸、ｑ軸上の関係は図１３に示すとおりであり、内部誘起電圧Ｅｆを基準位相（ｄ軸上）としている。
実施例５における仮想同期インピーダンス補償ブロック１１は、図１４のように構成されている。
図１４において、６１は、前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部である。
Figure 0007403630000031
（ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
６２は、ｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１１）式を演算して連系用のトランス４のインピーダンスＺｔｒによる電圧降下Ｖｔｒ＿ｄ、Ｖｔｒ＿ｑを算出するＶｔｒ算出部である。
Figure 0007403630000032
（ただし、ＲｔｒはＺｔｒの抵抗成分、ＸｔｒはＺｔｒのリアクタンス成分）
６３は、Ｖｚ算出部６１で算出された電圧降下Ｖｚ＿ｄから、Ｖｔｒ算出部６２で算出された電圧降下Ｖｔｒ＿ｄを減算する減算器（第１の減算器）である。
６４は、Ｖｚ算出部６１で算出された電圧降下Ｖｚ＿ｑから、Ｖｔｒ算出部６２で算出された電圧降下Ｖｔｒ＿ｑを減算する減算器（第３の減算器）である。
６５は、前記Ｖｚ算出部６１で算出されたＶｚ＿ｑと、設定された電圧振幅指令値｜Ｖ｜*に基いて、下記（１２）式を演算して出力電圧位相δを求めるｓｉｎ-1算出部である。
Figure 0007403630000033
６６は、前記出力電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部である。
６７は、ｃｏｓ算出部６６の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器である。
６８は、Ｖｚ算出部６１で算出されたＶｚ＿ｄと乗算器６７の出力とを加算して、系統電圧（電力系統の連系点電圧）Ｖｓｙｓの振幅が｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸に存在しトランス４による電圧降下Ｖｔｒを打ち消すように補償する動作点の内部誘起電圧Ｅｆ＿ｄを出力する加算器である。
６９は、加算器６８から出力される内部誘起電圧Ｅｆ＿ｄから、減算器６３の偏差出力を減算して、系統電圧（電力系統の連系点電圧）Ｖｓｙｓの振幅が｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸に存在しトランス４による電圧降下Ｖｔｒを打ち消すように補償する動作点の出力電圧指令値Ｖａｃ＿ｄ*を出力する減算器（第２の減算器）である。
７０は、減算器６４の偏差出力の極性を反転させる極性反転器であり、その出力は、出力電圧指令値Ｖａｃ＿ｑ*として出力される。尚、内部誘起電圧Ｅｆ＿ｑは０である。
尚、図１３のベクトル「Ｖｚ－Ｖｔｒ」は図１４の減算器６３（第１の減算器）の減算動作を表し、図１３のベクトルＥｆ，Ｖｚ－Ｖｔｒ，Ｖａｃ*は図１４の減算器６９（第２の減算器）の減算動作を表している。
上記のように構成された装置において、ＰＣＳ出力電圧制御部１４は、出力電圧Ｖａｃ（ＬＣフィルタ後の端子電圧を検出した電圧Ｖａｃ）が、内部誘起電圧Ｅｆから出力電流Ｉａｃが流れることによって生じる仮想同期インピーダンスＺｓによる電圧降下Ｖｚを減算した値に、連系用のトランス４に生じる電圧降下を加算した出力電圧指令値Ｖａｃ*と一致するように電圧制御を行う。
仮想同期インピーダンスＺｓ（ｒおよびｘ）と出力電流Ｉａｃより、電圧降下Ｖｚをｄ、ｑ座標上で表すと下記（１）式（Ｖｚ算出部６１で算出される式）のようになる。
Figure 0007403630000034
連系用のトランス４のインピーダンスＺｔｒ（ＲｔｒおよびＸｔｒ）と出力電流Ｉａｃより、推定される電圧降下Ｖｔｒをｄ、ｑ軸上で表すと下記（１１）式のようになる。
Figure 0007403630000035
電圧降下Ｖｚより、電力系統の連系点電圧Ｖｓｙｓの振幅が｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸上に位置する動作点は一意に求めることができ、下記（１２）～（１４）式のようになる。
Figure 0007403630000036
Figure 0007403630000037
Figure 0007403630000038
上記（１２）式は図１４のｓｉｎ-1算出部６５により求められ、上記（１３）式は乗算器６７および加算器６８により求められる。また（１４）式は図１３のベクトル図に示されるＥｆ，Ｖｚ＿ｄ，Ｖｓｙｓの関係から明らかである。
算出した系統電圧Ｖｓｙｓに連系用のトランス４の電圧降下Ｖｔｒを下記（１５）式のように加算し、出力電圧指令値Ｖａｃ*とする。
Figure 0007403630000039
加算したトランス４の電圧降下Ｖｔｒは、実際に発生する電圧降下と打ち消し合うことで（１４）式で算出した系統電圧Ｖｓｙｓを連系用のトランス４の上位に再現する。
以上のように本実施例５によれば、負荷電流に応じて、系統電圧Ｖｓｙｓの振幅が電圧振幅指令値｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸上に位置する、連系用のトランスによる電圧降下を打ち消す動作点の出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを逐次演算することで、負荷変動時でも系統電圧振幅を一定に保ちつつ、仮想同期インピーダンスによる電圧降下を模擬し、同期化力を再現できる。
（実施例６）
実施例６における仮想インピーダンスモデルは図１５に示すとおりである。実施例６における、出力電流検出値Ｉａｃ、出力電圧指令値Ｖａｃ*、内部誘起電圧Ｅｆ、出力電圧位相δ、電圧振幅指令値｜Ｖ｜*、仮想同期インピーダンスＺｓでの電圧降下Ｖｚ＿ｄ，Ｖｚ＿ｑ、系統電圧（連系点電圧）Ｖｓｙｓ、連系用のトランス４による電圧降下Ｖｔｒ＿ｄ，Ｖｔｒ＿ｑの、ｄ軸、ｑ軸上の関係は図１６に示すとおりであり、内部誘起電圧Ｅｆを基準位相（ｄ軸上）としている。
前記実施例５では連系用のトランス４による電圧降下を全て補償していたのに対して、本実施例６は、系統電圧（Ｖｓｙｓ）振幅の電圧振幅指令値｜Ｖ｜*からの降下分のみを補償する方式である。系統（Ｖｓｙｓ側）から見たときに、実施例５では図１１のように内部誘起電圧Ｅｆと位相同期インピーダンスＺｓのみが存在するように見える（トランス４による電圧降下分は打ち消されるため）のに対し、実施例６では図１５のように連系用のトランス４のインピーダンスも見える点が異なる。
実施例６における仮想同期インピーダンス補償ブロック１１は、図１７のように構成されている。図１７において、図１４と同一部分は同一符号をもって示している。
８１は、Ｖｚ算出部６１で算出された電圧降下Ｖｚ＿ｄと、Ｖｔｒ算出部６２で算出された電圧降下Ｖｔｒ＿ｄを加算する加算器（第１の加算器）である。
８２は、Ｖｚ算出部６１で算出された電圧降下Ｖｚ＿ｑと、Ｖｔｒ算出部６２で算出された電圧降下Ｖｔｒ＿ｑを加算する加算器（第２の加算器）である。
８３は、加算器８２の出力と、設定された電圧振幅指令値｜Ｖ｜*に基いて、下記（１６）式を演算して出力電圧位相δを求めるｓｉｎ-1算出部である。
Figure 0007403630000040
８４は、前記出力電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部である。
８５は、ｃｏｓ算出部８４の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器である。
８６は、加算器８１の加算出力と乗算器８５の出力とを加算して、系統電圧（電力系統の連系点電圧）Ｖｓｙｓの振幅が｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸に存在しトランス４による電圧降下Ｖｔｒのうち振幅の減少を補償する動作点の内部誘起電圧Ｅｆ＿ｄを出力する加算器（第３の加算器）である。
８７は、加算器８６から出力される内部誘起電圧Ｅｆ＿ｄから、Ｖｚ算出部６１で算出されたＶｚ＿ｄを減算して、系統電圧（電力系統の連系点電圧）Ｖｓｙｓの振幅が｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸に存在しトランス４による電圧降下Ｖｔｒのうち振幅の減少を補償する動作点の出力電圧指令値Ｖａｃ＿ｄ*を出力する減算器である。
８８は、Ｖｚ算出部６１から出力されるＶｚ＿ｑの極性を反転させる極性反転器であり、その出力は、出力電圧指令値Ｖａｃ＿ｑ*として出力される。尚、内部誘起電圧Ｅｆ＿ｑは０である。
上記のように構成された装置において、仮想同期インピーダンスによる電圧降下Ｖｚは実施例５と同様に（１）式から求め、連系用のトランス４による電圧降下Ｖｔｒは実施例５と同様に（１１）式から求める。
Figure 0007403630000041
Figure 0007403630000042
前記電圧降下Ｖｚ，Ｖｔｒより、系統電圧（Ｖｓｙｓ）振幅が｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸上に位置する動作点は一意に求めることができ、下記（１６）～（１９）式のようになる。
Figure 0007403630000043
Figure 0007403630000044
Figure 0007403630000045
Figure 0007403630000046
上記（１６）式は図１７のｓｉｎ-1算出部８３により求められ、（１７）式は図１７の加算器８６により求められる。（１８）式は図１６のベクトルＶｓｙｓ、Ｅｆ、Ｖｚ、Ｖｔｒの関係から明らかであり、（１９）式は図１６のベクトルＥｆ、Ｖｚ、Ｖａｃ*の関係から明らかである。
以上のように本実施例６によれば、負荷電流に応じて、系統電圧Ｖｓｙｓの振幅が電圧振幅指令値｜Ｖ｜*であり、且つ内部誘起電圧Ｅｆがｄ軸上に位置する、連系用のトランスによる電圧降下のうち振幅の減少を補償する動作点の出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを逐次演算することで、負荷変動時でも系統電圧振幅を一定に保ちつつ、仮想同期インピーダンスによる電圧降下を模擬し、同期化力を再現できる。

Claims (12)

  1. 同期発電機を模擬した仮想同期発電機制御が行われ、直流電源の直流電力を交流電力に変換する電力変換器を有し、前記電力変換器の出力がＬＣフィルタを介して電力系統と連系される電力変換装置において、
    前記電力変換器の出力電流を検出した出力電流検出値と設定した電圧振幅指令値を入力とし、電力変換器の出力電流で生じる仮想同期インピーダンスによる電圧降下を模擬し、その模擬した電圧降下に応じて、出力電圧指令値と仮想同期発電機の内部誘起電圧を算出する仮想同期インピーダンス補償ブロックと、
    同期発電機を模擬した角周波数を決定する仮想同期発電機モデルと、
    前記電力変換装置の出力電圧が、前記仮想同期インピーダンス補償ブロックで算出された出力電圧指令値と一致するように、前記仮想同期発電機モデルにより決定された角周波数に基いて制御する出力電圧制御部と、
    を備えたことを特徴とする電力変換装置の制御システム。
  2. 前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴とする請求項１に記載の電力変換装置の制御システム。
  3. 前記仮想同期インピーダンス補償ブロックは、出力電圧指令値Ｖａｃ*を基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、前記出力電圧指令値Ｖａｃ*の振幅が、｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の、出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴とする請求項１に記載の電力変換装置の制御システム。
  4. 前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、前回制御周期時に算出された内部誘起電圧から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、
    該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出することを特徴とする請求項１に記載の電力変換装置の制御システム。
  5. 前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、設定した電圧振幅指令値｜Ｖａｃ｜*から、位相差δを算出し、設定した電圧振幅指令値｜Ｖａｃ｜*を前記位相差δで回転座標変換することによって出力電圧指令値Ｖａｃ*を算出し、
    該算出した出力電圧指令値Ｖａｃ*と、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓから内部誘起電圧Ｅｆを算出することを特徴とする請求項１に記載の電力変換装置の制御システム。
  6. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000047
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    前記Ｖｚ算出部で算出されたＶｚ＿ｑと、前記電圧振幅指令値｜Ｖａｃ｜*に基いて、下記（２）式を演算して出力電圧位相δを求めるｓｉｎ-1算出部と、
    Figure 0007403630000048
     前記出力電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
    前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖａｃ｜*を乗算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の出力電圧指令値Ｖａｃ＿ｄ*を求める乗算器と、
    前記乗算器で求められた出力電圧指令値Ｖａｃ＿ｄ*と前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の内部誘起電圧Ｅｆを求める加算器と、
    を備えたことを特徴とする請求項２に記載の電力変換装置の制御システム。
  7. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000049
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    前記Ｖｚ算出部で算出されたＶｚ＿ｄと前記電圧振幅指令値｜Ｖａｃ｜*を加算して、前記出力電圧指令値Ｖａｃ*の振幅が｜Ｖａｃ｜*であり且つ出力電圧指令値Ｖａｃ*がｄ軸に存在する動作点の内部誘起電圧Ｅｆを求める加算器と、
    を備えたことを特徴とする請求項３に記載の電力変換装置の制御システム。
  8. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000050
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    制御周期毎に算出された内部誘起電圧Ｅｆを一時記憶するバッファと、
    前記バッファに記憶されている、前回制御周期時に算出された内部誘起電圧Ｅｆ＿ｄ（Ｚ-1）と、前記Ｖｚ算出部で算出されたＶｚ＿ｄ、Ｖｚ＿ｑとに基いて、下記（７）式を演算して位相差δを求めるｔａｎ-1算出部と、
    Figure 0007403630000051
     前記電圧振幅指令値｜Ｖａｃ｜*を、前記ｔａｎ-1算出部で求められた位相差δによって回転座標変換して、下記（８）式に沿って出力電圧指令値Ｖａｃ*を演算する回転行列演算部と、
    Figure 0007403630000052
     前記回転行列演算部で演算された出力電圧指令値Ｖａｃ*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆを算出する加算器と、
    を備えたことを特徴とする請求項４に記載の電力変換装置の制御システム。
  9. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000053
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    前記電圧振幅指令値｜Ｖａｃ｜*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄ、Ｖｚ＿ｑとに基いて、下記（１０）式を演算して位相差δを求めるｔａｎ-1算出部と、
    Figure 0007403630000054
     前記電圧振幅指令値｜Ｖａｃ｜*を、前記ｔａｎ-1算出部で求められた位相差δによって回転座標変換して出力電圧指令値Ｖａｃ*を演算する回転行列演算部と、
    前記回転行列演算部で演算された出力電圧指令値Ｖａｃ*と、前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して内部誘起電圧Ｅｆを算出する加算器と、
    を備えたことを特徴とする請求項５に記載の電力変換装置の制御システム。
  10. 同期発電機を模擬した仮想同期発電機制御が行われ、直流電源の直流電力を交流電力に変換する電力変換器を有し、前記電力変換器の出力がＬＣフィルタおよび連系用のトランスを介して電力系統と連系される電力変換装置において、
    前記電力変換器の出力電流を検出した出力電流検出値と設定した電圧振幅指令値｜Ｖ｜*を入力とし、電力変換器の出力電流で生じる仮想同期インピーダンスおよびトランスによる電圧降下を模擬し、その模擬した電圧降下に応じて、出力電圧指令値Ｖａｃ*と仮想同期発電機の内部誘起電圧Ｅｆを算出する仮想同期インピーダンス補償ブロックと、
    同期発電機を模擬した角周波数を決定する仮想同期発電機モデルと、
    前記電力変換装置の出力電圧Ｖａｃが、前記仮想同期インピーダンス補償ブロックで算出された出力電圧指令値Ｖａｃ*と一致するように制御する出力電圧制御部と、
    を備え、
    前記仮想同期インピーダンス補償ブロックは、内部誘起電圧Ｅｆを基準位相とし、出力電流検出値Ｉａｃと、前記仮想同期インピーダンスＺｓと、トランスのインピーダンスＺｔｒと、設定した電圧振幅指令値｜Ｖ｜*から、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在する動作点の出力電圧指令値Ｖａｃ*と内部誘起電圧Ｅｆを算出することを特徴とする電力変換装置の制御システム。
  11. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃを前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000055
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑと、前記トランスのインピーダンスＺｔｒに基いて、下記（１１）式を演算してトランスによる電圧降下Ｖｔｒを算出するＶｔｒ算出部と、
    Figure 0007403630000056
     （ただし、ＲｔｒはＺｔｒの抵抗成分、ＸｔｒはＺｔｒのリアクタンス成分）
    前記Ｖｚ算出部で算出されたＶｚ＿ｑと、前記電圧振幅指令値｜Ｖ｜*に基いて、下記（１２）式を演算して系統電圧位相δを求めるｓｉｎ-1算出部と、
    Figure 0007403630000057
     前記系統電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
    前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器と、
    前記乗算器の乗算出力と前記Ｖｚ算出部で算出されたＶｚ＿ｄを加算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下Ｖｔｒを打ち消すように補償する動作点の、内部誘起電圧Ｅｆ＿ｄを算出する加算器と、
    前記Ｖｚ算出部で算出されたＶｚ＿ｄから前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｄを減算する第１の減算器と、
    前記加算器で算出された内部誘起電圧Ｅｆ＿ｄから、前記第１の減算器の減算出力を減算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下Ｖｔｒを打ち消すように補償する動作点の出力電圧指令値Ｖａｃ＿ｄ*を算出する第２の減算器と、
    前記Ｖｚ算出部で算出されたＶｚ＿ｑから前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｑを減算する第３の減算器と、
    前記第３の減算器の偏差出力を極性反転させて出力電圧指令値Ｖａｃ＿ｑ*を出力する極性反転器と、を備え、
    前記出力電圧制御部の制御は、前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ、ｑ座標上で実施することを特徴とする請求項１０に記載の電力変換装置の制御システム。
  12. 前記仮想同期インピーダンス補償ブロックは、
    前記出力電流検出値Ｉａｃを前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑに基いて、下記（１）式を演算して仮想同期インピーダンスＺｓによる電圧降下Ｖｚ＿ｄ、Ｖｚ＿ｑを算出するＶｚ算出部と、
    Figure 0007403630000058
     （ただし、ｒはＺｓの抵抗成分、ｘはＺｓのリアクタンス成分）
    前記出力電流検出値Ｉａｃをｄ軸、ｑ軸に変換したｄ軸電流検出値Ｉａｃ＿ｄ、ｑ軸電流検出値Ｉａｃ＿ｑと、前記トランスのインピーダンスＺｔｒに基いて、下記（１１）式を演算してトランスによる電圧降下Ｖｔｒを算出するＶｔｒ算出部と、
    Figure 0007403630000059
     （ただし、ＲｔｒはＺｔｒの抵抗成分、ＸｔｒはＺｔｒのリアクタンス成分）
    前記Ｖｚ算出部で算出されたＶｚ＿ｄと前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｄを加算する第１の加算器と、
    前記Ｖｚ算出部で算出されたＶｚ＿ｑと前記Ｖｔｒ算出部で算出されたＶｔｒ＿ｑを加算する第２の加算器と、
    前記第２の加算器の加算出力と前記電圧振幅指令値｜Ｖ｜*に基づいて、下記（１６）式を演算して系統電圧位相δを求めるｓｉｎ-1算出部と、
    Figure 0007403630000060
     前記系統電圧位相δのｃｏｓ成分であるｃｏｓδを算出するｃｏｓ算出部と、
    前記ｃｏｓ算出部の出力と電圧振幅指令値｜Ｖ｜*を乗算する乗算器と、
    前記乗算器の乗算出力と第１の加算器の加算出力を加算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下のうち振幅の減少を補償する動作点の、内部誘起電圧Ｅｆ＿ｄを算出する第３の加算器と、
    前記第３の加算器で算出された内部誘起電圧Ｅｆ＿ｄから、前記Ｖｚ算出部で算出されたＶｚ＿ｄを減算して、前記電力系統の連系点電圧Ｖｓｙｓの振幅が、｜Ｖ｜*であり且つ内部誘起電圧Ｅｆがｄ軸に存在し前記トランスによる電圧降下のうち振幅の減少を補償する動作点の、出力電圧指令値Ｖａｃ＿ｄ*を算出する減算器と、
    前記Ｖｚ算出部で算出されたＶｚ＿ｑを極性反転させて出力電圧指令値Ｖａｃ＿ｑ*を出力する極性反転器と、を備え、
    前記出力電圧制御部の制御は、前記仮想同期発電機モデルで決定された角周波数から決まる内部位相により回転座標変換したｄ、ｑ座標上で実施することを特徴とする請求項１０に記載の電力変換装置の制御システム。
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