JPH01114208A - 増幅回路 - Google Patents
増幅回路Info
- Publication number
- JPH01114208A JPH01114208A JP27025387A JP27025387A JPH01114208A JP H01114208 A JPH01114208 A JP H01114208A JP 27025387 A JP27025387 A JP 27025387A JP 27025387 A JP27025387 A JP 27025387A JP H01114208 A JPH01114208 A JP H01114208A
- Authority
- JP
- Japan
- Prior art keywords
- input signal
- level
- variable gain
- amplifier circuit
- circuit
- Prior art date
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- Granted
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕 ・
増幅回路、特に入力信号レベルが過大であると利得を制
限される可変利得増幅回路を備えた増幅回路に関し、 入力信号レベルが過大であっても出力信号レベルを一定
に制限することなく最大許容入力信号レベル近傍でも良
好に入力信号を増幅可能とすることを目的とし、 入力信号を増幅する可変利得増幅回路と、該可変利得増
幅器回路の出力信号レベルに応じて該可変利得増幅回路
の利得を可変制御するレベル検出回路を備えた増幅回路
において、該レベル検出回路は、該可変利得増幅回路の
出力信号レベルが一又は複数の所定レベルを越える点で
該可変利得増幅回路の利得が１以上の範囲で低下するよ
うに可変制御を行なうように構成する。
限される可変利得増幅回路を備えた増幅回路に関し、 入力信号レベルが過大であっても出力信号レベルを一定
に制限することなく最大許容入力信号レベル近傍でも良
好に入力信号を増幅可能とすることを目的とし、 入力信号を増幅する可変利得増幅回路と、該可変利得増
幅器回路の出力信号レベルに応じて該可変利得増幅回路
の利得を可変制御するレベル検出回路を備えた増幅回路
において、該レベル検出回路は、該可変利得増幅回路の
出力信号レベルが一又は複数の所定レベルを越える点で
該可変利得増幅回路の利得が１以上の範囲で低下するよ
うに可変制御を行なうように構成する。
本発明は増幅回路、特に入力信号レベルが過大であると
利得を制限される可変利得増幅回路を備えた増幅回路に
関する。
利得を制限される可変利得増幅回路を備えた増幅回路に
関する。
音声信号用の増幅回路は、通常線形増幅回路を用いてお
り、出ツノ信号Ｖ。Ｕ、と入力信号■１ｎとの振幅は第
６図（ａ）に示す如く一定の比例関係にある。この一定
の比例関係は増幅回路の出力段トランジスタが飽和する
までは保たれるが、出力段トランジスタの飽和領域であ
る入力信号ｖｉｏの振幅がＶ 以上では入力信号Ｖｉｏ
の波形と出力信号Ｖｏｕｔの波形とは一致ぜす、第６図
（ａ）の実線に示す如く、■３以上で比例関係が異なっ
てしまう。飽和領域では、第６図（ｂ）に示す如く高調
波成分による歪率の悪化が著しい。
り、出ツノ信号Ｖ。Ｕ、と入力信号■１ｎとの振幅は第
６図（ａ）に示す如く一定の比例関係にある。この一定
の比例関係は増幅回路の出力段トランジスタが飽和する
までは保たれるが、出力段トランジスタの飽和領域であ
る入力信号ｖｉｏの振幅がＶ 以上では入力信号Ｖｉｏ
の波形と出力信号Ｖｏｕｔの波形とは一致ぜす、第６図
（ａ）の実線に示す如く、■３以上で比例関係が異なっ
てしまう。飽和領域では、第６図（ｂ）に示す如く高調
波成分による歪率の悪化が著しい。
従来の増幅回路は、大略入力信号を増幅する可変利得増
幅回路とレベル検出回路とよりなる。レベル検出回路は
、可変利得増幅回路の出力信号Ｖｏｕｔが所定レベル以
上、即ち、入力信号ｖｉ、のレベルが■Ｌｉ以上で過大
であると、第６図（ａ）に破線で示ず如く出力信号Ｖ
のレベルをＶｌ−８ｕｔ に制限するように可変利得増幅回路を可変制御する。こ
の様な従来回路は、ＡＧＣ（自動利得制御）回路、△１
−Ｃ（自動レベル制御）回路として公知である。
幅回路とレベル検出回路とよりなる。レベル検出回路は
、可変利得増幅回路の出力信号Ｖｏｕｔが所定レベル以
上、即ち、入力信号ｖｉ、のレベルが■Ｌｉ以上で過大
であると、第６図（ａ）に破線で示ず如く出力信号Ｖ
のレベルをＶｌ−８ｕｔ に制限するように可変利得増幅回路を可変制御する。こ
の様な従来回路は、ＡＧＣ（自動利得制御）回路、△１
−Ｃ（自動レベル制御）回路として公知である。
従来回路では、レベルがＶｌ−１以上の入力信号Ｖ１ｏ
に対して出力信号Ｖ。ｕｔのレベルがＶｌ−ｏなる一定
のレベルに制限されてしまうので、増幅回路の最大許容
入力信号レベル近傍での信号増幅が行なえないという問
題が生じていた。
に対して出力信号Ｖ。ｕｔのレベルがＶｌ−ｏなる一定
のレベルに制限されてしまうので、増幅回路の最大許容
入力信号レベル近傍での信号増幅が行なえないという問
題が生じていた。
本発明は、入力信号レベが過大であっても出力信号レベ
ルを一定に制限することなく最大許容入力信号レベル近
傍でも良好に入力信号を増幅可能とすることのできる増
幅回路を提供することを目的とする。
ルを一定に制限することなく最大許容入力信号レベル近
傍でも良好に入力信号を増幅可能とすることのできる増
幅回路を提供することを目的とする。
第１図は本発明の原理説明図、第２図は本発明の原理説
明用入出力特性図である。
明用入出力特性図である。
第１図中、１は入力信号を増幅する可変利得増幅回路、
２は可変利１ｑ増幅回路１の出力信号レベヘルに応じて
可変利得増幅回路１の利得を可変制御するレベル検出回
路である。
２は可変利１ｑ増幅回路１の出力信号レベヘルに応じて
可変利得増幅回路１の利得を可変制御するレベル検出回
路である。
レベル検出回路２は、第２図に実線で示す如く可変利得
増幅回路１の出力信号レベルが一又は複数の所定レベル
Ｖ、１．■、２．■、３を越える点で可変利得増幅回路
１の利得が１以上の範囲で低下するように可変制御を行
なう。なお、第２図中、破線は増幅回路自体の特性を示
す。
増幅回路１の出力信号レベルが一又は複数の所定レベル
Ｖ、１．■、２．■、３を越える点で可変利得増幅回路
１の利得が１以上の範囲で低下するように可変制御を行
なう。なお、第２図中、破線は増幅回路自体の特性を示
す。
従って、入力信号レベルが過大であっても出力信号レベ
ルを一定に制限することなく最大許容入力信号レベル近
傍でも良好に入力信号を増幅できる。
ルを一定に制限することなく最大許容入力信号レベル近
傍でも良好に入力信号を増幅できる。
第３図は本発明回路の一実施例を示す。
同図中、可変利得増幅回路１は、増幅器１１゜１２と、
抵抗Ｒ１〜Ｒ３と、トランジスタＱとよりなる。レベル
検出回路２は、整流回路１３と、コンパレータ１４と、
基準電圧供給源ＶＲＥ Ｆと、抵抗Ｒ４と、コンデンサ
Ｃとよりなる。
抵抗Ｒ１〜Ｒ３と、トランジスタＱとよりなる。レベル
検出回路２は、整流回路１３と、コンパレータ１４と、
基準電圧供給源ＶＲＥ Ｆと、抵抗Ｒ４と、コンデンサ
Ｃとよりなる。
整流回路１３は、可変利得増幅回路１の出力信号Ｖ。ｕ
ｔを整流してコンパレータ１４に供給する。
ｔを整流してコンパレータ１４に供給する。
このコンパレータ１４には、基準電圧供給源Ｖ ＲＥＦ
からの基準電圧ＶＲＥＦも供給されて３３す、整流回路
１３からの電圧が基準電圧ＶＲ１，より大である期間ハ
イレベル信号を出力する。これにより、トランジスタＱ
はこの期間オンとされ、抵抗Ｒ１〜Ｒ３よりなる減衰回
路の減衰量が大となる。
からの基準電圧ＶＲＥＦも供給されて３３す、整流回路
１３からの電圧が基準電圧ＶＲ１，より大である期間ハ
イレベル信号を出力する。これにより、トランジスタＱ
はこの期間オンとされ、抵抗Ｒ１〜Ｒ３よりなる減衰回
路の減衰量が大となる。
トランジスタＱがオンの時の減衰ｆｆ１ＡＴＴ （ＯＮ
）は（Ｒ２／ （Ｒ１＋Ｒ２））であり、トランジスタ
Ｑがオフの時の減衰量ＡＴＴ （ＯＦＦ）は（（Ｒ２＋
Ｒ３）／ （Ｒ１＋Ｒ２＋Ｒ３））である。
）は（Ｒ２／ （Ｒ１＋Ｒ２））であり、トランジスタ
Ｑがオフの時の減衰量ＡＴＴ （ＯＦＦ）は（（Ｒ２＋
Ｒ３）／ （Ｒ１＋Ｒ２＋Ｒ３））である。
第４図は、本実施例の入力対出力特性を示す。
同図中、実線で示す如く、入力信号ｖｉｏのレベルがＶ
ｌを越えると可変利得増幅回路１の利得が低下されるの
で、最大許容入力信号レベル近傍でも良好に入力信号Ｖ
ｉｏを増幅し得、大レベルの出力信号Ｖ。Ｉｊｔを得る
ことができる。なお、−点鎖線は利得一定とされた場合
の増幅回路自体の特性を示し、本実施例では入力信号Ｖ
・のレベルがｖ２団 を越えるとこの増幅回路自体の特性に沿ったものとなる
。又、比較のため、第６図（ａ）に示した従来回路の特
性を破線で示す。
ｌを越えると可変利得増幅回路１の利得が低下されるの
で、最大許容入力信号レベル近傍でも良好に入力信号Ｖ
ｉｏを増幅し得、大レベルの出力信号Ｖ。Ｉｊｔを得る
ことができる。なお、−点鎖線は利得一定とされた場合
の増幅回路自体の特性を示し、本実施例では入力信号Ｖ
・のレベルがｖ２団 を越えるとこの増幅回路自体の特性に沿ったものとなる
。又、比較のため、第６図（ａ）に示した従来回路の特
性を破線で示す。
第５図は全高調波歪率を示す。線■−■は従来回路で利
得一定とされた場合の全高調波歪率、線■−■は増幅回
路自体の全高調波歪率、線■−■は本実施例の全高調波
歪率を示す。増幅回路自体の全高調波歪率は入力信号Ｖ
１ｏがＶ８以上となると出力段トランジスタの飽和のた
め著しく悪化する。しかし、本実施例では、入力信号Ｖ
ｉ、がｖ２となるまで全高調波歪率が小であり、従来回
路と異なり大レベルの入力信号Ｖｉｏに対しても全高調
波歪率が小なる出力信号Ｖ。ｕｔが得られる。
得一定とされた場合の全高調波歪率、線■−■は増幅回
路自体の全高調波歪率、線■−■は本実施例の全高調波
歪率を示す。増幅回路自体の全高調波歪率は入力信号Ｖ
１ｏがＶ８以上となると出力段トランジスタの飽和のた
め著しく悪化する。しかし、本実施例では、入力信号Ｖ
ｉ、がｖ２となるまで全高調波歪率が小であり、従来回
路と異なり大レベルの入力信号Ｖｉｏに対しても全高調
波歪率が小なる出力信号Ｖ。ｕｔが得られる。
なお、レベル検出回路２は、出力信号Ｖ。を複数の基準
レベルと比較して出力信号レベルが各基準レベルを越え
る毎に可変利得増幅回路１の利得を互いに異なる１以上
の範囲で低下させる構成としても良い。
レベルと比較して出力信号レベルが各基準レベルを越え
る毎に可変利得増幅回路１の利得を互いに異なる１以上
の範囲で低下させる構成としても良い。
以上本発明を実施例により説明したが、本発明は本発明
の趣旨に従い種々の変形が可能であり、本発明からこれ
らを排除するものではない。
の趣旨に従い種々の変形が可能であり、本発明からこれ
らを排除するものではない。
本発明によれば、レベル検出回路は可変利得増幅回路の
出力信号レベルが一又は複数の所定レベルを越える点で
可変利得増幅回路の利得が１以上の範囲で低下するよう
に可変制御を行なうので、入力信号レベルが過大であっ
ても出力信号レベルを一定に制限することなく最大許容
入力信号レベル近傍でも良好に入力信号を増幅すること
ができ、特に音声信号用の増幅回路のとしての効果が大
であり、実用的に極めて有用である。
出力信号レベルが一又は複数の所定レベルを越える点で
可変利得増幅回路の利得が１以上の範囲で低下するよう
に可変制御を行なうので、入力信号レベルが過大であっ
ても出力信号レベルを一定に制限することなく最大許容
入力信号レベル近傍でも良好に入力信号を増幅すること
ができ、特に音声信号用の増幅回路のとしての効果が大
であり、実用的に極めて有用である。
第１図は本発明の原理説明図、
第２図は本発明の原理説明用人出力特性図、第３図は本
発明回路の一実施例を示す回路図、第４図は実施例の入
力対出力特性を示す図、第５図は全高調波歪率を示す図
、 第６図（ａ）、（ｂ）は増幅回路の説明用特性図である
。 第１図〜第５図において、 １は可変利得増幅回路、 ２はレベル検出回路、 １１．１２は増幅器、 １３は整流回路、 １４はコンパレータ、 Ｒ１−Ｒ４は抵抗、 Ｃはコンデンサ、 ■ＲＥＦは基準電圧供給源、 Ｑはトランジスタ を示す。 特許出願人 富 士 通 株式会社 同 富士通ヴイエルエスアイ株式会社）ｎｏ７ｙ僚
泣丑
発明回路の一実施例を示す回路図、第４図は実施例の入
力対出力特性を示す図、第５図は全高調波歪率を示す図
、 第６図（ａ）、（ｂ）は増幅回路の説明用特性図である
。 第１図〜第５図において、 １は可変利得増幅回路、 ２はレベル検出回路、 １１．１２は増幅器、 １３は整流回路、 １４はコンパレータ、 Ｒ１−Ｒ４は抵抗、 Ｃはコンデンサ、 ■ＲＥＦは基準電圧供給源、 Ｑはトランジスタ を示す。 特許出願人 富 士 通 株式会社 同 富士通ヴイエルエスアイ株式会社）ｎｏ７ｙ僚
泣丑
Claims (1)
- 入力信号を増幅する可変利得増幅回路（１）と、該可変
利得増幅器回路の出力信号レベルに応じて該可変利得増
幅回路の利得を可変制御するレベル検出回路（２）を備
えた増幅回路において、該レベル検出回路は、該可変利
得増幅回路の出力信号レベルが一又は複数の所定レベル
を越える点で該可変利得増幅回路の利得が１以上の範囲
で低下するように可変制御を行なうことを特徴とする増
幅回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62270253A JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62270253A JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01114208A true JPH01114208A (ja) | 1989-05-02 |
| JP2644775B2 JP2644775B2 (ja) | 1997-08-25 |
Family
ID=17483670
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62270253A Expired - Lifetime JP2644775B2 (ja) | 1987-10-28 | 1987-10-28 | 増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2644775B2 (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5780917U (ja) * | 1980-10-31 | 1982-05-19 | ||
| JPS6198007A (ja) * | 1984-10-18 | 1986-05-16 | Matsushita Electric Ind Co Ltd | 自動利得制御装置 |
| JPS6228094U (ja) * | 1985-08-05 | 1987-02-20 |
-
1987
- 1987-10-28 JP JP62270253A patent/JP2644775B2/ja not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5780917U (ja) * | 1980-10-31 | 1982-05-19 | ||
| JPS6198007A (ja) * | 1984-10-18 | 1986-05-16 | Matsushita Electric Ind Co Ltd | 自動利得制御装置 |
| JPS6228094U (ja) * | 1985-08-05 | 1987-02-20 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2644775B2 (ja) | 1997-08-25 |
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