JPH01120254U - - Google Patents

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JPH01120254U
JPH01120254U JP1462188U JP1462188U JPH01120254U JP H01120254 U JPH01120254 U JP H01120254U JP 1462188 U JP1462188 U JP 1462188U JP 1462188 U JP1462188 U JP 1462188U JP H01120254 U JPH01120254 U JP H01120254U
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JP1462188U
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【図面の簡単な説明】
第１図はこの考案に係るコンピユータプログラ
ムトレース装置の一実施例を示すブロツク図、第
２図ａ〜ｃは同実施例において実行されるトレー
ス処理データ編集の手順例を示すフローチヤート
、第３図は同実施例におけるトレース処理データ
編集の原理を説明する図、である。 １０…マイクロプロセツシングユニツト（ＭＰ
Ｕ）、１１…端末部、２０…被測定コンピユータ
装置、ＲＡＭ１〜ＲＡＭ３…データメモリ、ＦＤ
Ａ，ＦＤＢ…フロツピーデイスク駆動装置、４０
…コンピユータプログラムトレース装置。

Claims (1)

  1. 【実用新案登録請求の範囲】 異なるトレース条件で実行されたコンピユータ
    プログラムの同一アドレス領域に関する複数組の
    通過アドレス情報を複数の外部記録媒体に別々に
    記録するコンピユータプログラムトレース装置に
    おいて、 前記複数の外部記録媒体の１つから或る１組の
    前記通過アドレス情報を読取り記憶する第１の記
    憶手段と、 前記第１の記憶手段に記憶した通過アドレス情
    報とは別のトレース条件で実行された同一アドレ
    ス領域に関する別の１組の前記通過アドレス情報
    を前記複数の外部記録媒体の１つから読取り記憶
    する第２の記憶手段と、 前記第１の記憶手段と前記第２の記憶手段とに
    記憶された夫々の通過アドレス情報を読み出して
    同一アドレス毎に演算し１組のトレースデータと
    して出力する演算手段と を具えたことを特徴とするコンピユータプログ
    ラムトレース装置。
JP1462188U 1988-02-08 1988-02-08 Pending JPH01120254U (ja)

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JP1462188U JPH01120254U (ja) 1988-02-08 1988-02-08

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JP1462188U JPH01120254U (ja) 1988-02-08 1988-02-08

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JPH01120254U true JPH01120254U (ja) 1989-08-15

Family

ID=31225985

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JP1462188U Pending JPH01120254U (ja) 1988-02-08 1988-02-08

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JP (1) JPH01120254U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08314765A (ja) * 1995-05-15 1996-11-29 Nec Corp デバッグ情報収集方式

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08314765A (ja) * 1995-05-15 1996-11-29 Nec Corp デバッグ情報収集方式

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