JPH01164134A - Apdのバイアス回路 - Google Patents
Apdのバイアス回路Info
- Publication number
- JPH01164134A JPH01164134A JP62321568A JP32156887A JPH01164134A JP H01164134 A JPH01164134 A JP H01164134A JP 62321568 A JP62321568 A JP 62321568A JP 32156887 A JP32156887 A JP 32156887A JP H01164134 A JPH01164134 A JP H01164134A
- Authority
- JP
- Japan
- Prior art keywords
- apd
- circuit
- current
- flow
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- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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Landscapes
- Amplifiers (AREA)
- Optical Communication System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は光通信システムに使用する受信回路に関し、特
に光受信回路におけるAPD(アバランンエフォトダイ
オード)のバイアス回路(=関する。
に光受信回路におけるAPD(アバランンエフォトダイ
オード)のバイアス回路(=関する。
光デイジタル通信においては、受信した光信号をAPD
などで電気信号(−変換し、これを増幅回路で増幅した
後、識別回路で識別して信号を再生している。識別回路
への入力信号の振幅を一定にするために、受信した光信
号の大きさに重じて増幅回路の利得やAPDの増倍率を
制御する必要がある。この必要性に対して従来は。
などで電気信号(−変換し、これを増幅回路で増幅した
後、識別回路で識別して信号を再生している。識別回路
への入力信号の振幅を一定にするために、受信した光信
号の大きさに重じて増幅回路の利得やAPDの増倍率を
制御する必要がある。この必要性に対して従来は。
可変利得増幅回路を用い、この出力で帰還をかけ、増幅
回路の利得を制御(Fj−AGC)L。
回路の利得を制御(Fj−AGC)L。
かつAPDのバイアス電圧を制御してAPDの増倍率を
制御CF−AG(1)している。
制御CF−AG(1)している。
上述した従来の方法は、APDの増倍率と増幅回路の利
得の両方を制御することにより、光入力信号の変動の広
い範囲にわたって識別回路の入力振幅を一定にすること
ができる。しかし。
得の両方を制御することにより、光入力信号の変動の広
い範囲にわたって識別回路の入力振幅を一定にすること
ができる。しかし。
帰還ループが2カ所存在するので2発振を防ぐため片方
のループの時定数をあまり小さくすることができない。
のループの時定数をあまり小さくすることができない。
すなわち、電源のオン、オフや光入力の急激な変動に対
する応答が遅いという欠点がある。
する応答が遅いという欠点がある。
本発明は従来のもののこのような欠点を解消しようとす
るもので、APDにバイアス電圧を与える高電圧発生回
路として出力電圧を制御できる制御端子性の直流変圧回
路と、該直流変圧回路の出力に対し逆バイアスとなるよ
うに第1の端子を接続したAPDと、該APDの第2の
端子に接続された電流検出回路と、該電流検出回路の出
力に接続され、出力側が前記直流変圧回路の制御端子に
接続されている増幅回路および前記APDの第1の端子
に接続された結合コンデンサから構成される。
るもので、APDにバイアス電圧を与える高電圧発生回
路として出力電圧を制御できる制御端子性の直流変圧回
路と、該直流変圧回路の出力に対し逆バイアスとなるよ
うに第1の端子を接続したAPDと、該APDの第2の
端子に接続された電流検出回路と、該電流検出回路の出
力に接続され、出力側が前記直流変圧回路の制御端子に
接続されている増幅回路および前記APDの第1の端子
に接続された結合コンデンサから構成される。
本発明によるバイアス回路においては、 APDに流
れる電流は、その平均値が電流検出回路によりAPD+
=流れる平均電流に比例した電圧に変換され、増幅回路
によりAPDに流れる電流が一定になるように直流変圧
回路に制御がかかっている。すなわち、APDに流れる
電流は光入力信号の大小に関係なく一定の電流が流れる
こと(=なる。従ってF−AGCが不要となり。
れる電流は、その平均値が電流検出回路によりAPD+
=流れる平均電流に比例した電圧に変換され、増幅回路
によりAPDに流れる電流が一定になるように直流変圧
回路に制御がかかっている。すなわち、APDに流れる
電流は光入力信号の大小に関係なく一定の電流が流れる
こと(=なる。従ってF−AGCが不要となり。
また受信回路の後段(=おいて可変利得制御増幅回路の
代わりに振幅制限回路を使用することが−tJるのでE
−AGOも省略することができる。
代わりに振幅制限回路を使用することが−tJるのでE
−AGOも省略することができる。
APDに流れる信号成分は結合コンデンサを通して増幅
器に伝達される。
器に伝達される。
本発明について図面を参照して説明する。第1図は本発
明の実施例を表わす回路図である。
明の実施例を表わす回路図である。
本実施例は、直流変圧回路1と、APD2と。
抵抗器R1からなる電流検出回路と、抵抗器R2,R3
および演算増幅回路OP1からなる増幅回路4および結
合コンデンサ5とから構成されている。
および演算増幅回路OP1からなる増幅回路4および結
合コンデンサ5とから構成されている。
電流検出回路3の抵抗器R1によりA、PD2に流れる
電流が電圧に変換される。増幅回路44は、抵抗器R2
,R3および演算増幅回路opiにより反転増幅回路を
構成しており、電流検出回路3の出力が常に基準電圧に
一致するように制御がかかっている。すなわち、APD
2に流れる電流は、APD2への光入力の大きさC二か
かわらず一定に保たれる。APD 2の信号成分は、結
合コンデンサ5を通して次段の演算増幅器op2を含む
増幅回路に伝達される。この増幅回路には更に2通常、
可変利得制御増幅回路(図示省略)が接続されるが2本
発明ではこれを簡単な振幅制限回路で代用することがで
きる。
電流が電圧に変換される。増幅回路44は、抵抗器R2
,R3および演算増幅回路opiにより反転増幅回路を
構成しており、電流検出回路3の出力が常に基準電圧に
一致するように制御がかかっている。すなわち、APD
2に流れる電流は、APD2への光入力の大きさC二か
かわらず一定に保たれる。APD 2の信号成分は、結
合コンデンサ5を通して次段の演算増幅器op2を含む
増幅回路に伝達される。この増幅回路には更に2通常、
可変利得制御増幅回路(図示省略)が接続されるが2本
発明ではこれを簡単な振幅制限回路で代用することがで
きる。
以上説明したように本発明は、F−AGC!を用いずに
APDに流れる電流を一定にすることができるので、応
答時間を早くできる利点がある。また、可変利得増幅回
路のかわりに振幅制限回路を使用することができ回路が
簡単化される利点がある。
APDに流れる電流を一定にすることができるので、応
答時間を早くできる利点がある。また、可変利得増幅回
路のかわりに振幅制限回路を使用することができ回路が
簡単化される利点がある。
第1図は本発明の実施例の回路図である。
OPl 、OF2 :演算増幅器、5:結合コンデンサ
。
。
Claims (1)
- 1、APDを受光素子とする光受信回路において、AP
Dにバイアス電圧を与える高電圧発生回路として出力電
圧を制御できる制御端子付の直流変圧回路と、該直流変
圧回路の出力に対し逆バイアスとなるように第1の端子
を接続したAPDと、該APDの第2の端子に接続され
た電流検出回路と、該電流検出回路の出力に接続され、
出力側が前記直流変圧回路の制御端子に接続されている
増幅回路および前記APDの第1の端子に接続された結
合コンデンサから構成されることを特徴とするAPDの
バイアス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62321568A JPH01164134A (ja) | 1987-12-21 | 1987-12-21 | Apdのバイアス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62321568A JPH01164134A (ja) | 1987-12-21 | 1987-12-21 | Apdのバイアス回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01164134A true JPH01164134A (ja) | 1989-06-28 |
Family
ID=18134017
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62321568A Pending JPH01164134A (ja) | 1987-12-21 | 1987-12-21 | Apdのバイアス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01164134A (ja) |
-
1987
- 1987-12-21 JP JP62321568A patent/JPH01164134A/ja active Pending
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