JPH01211974A - ヒ化ガリウムを用いたmis型半導体装置の製造方法 - Google Patents

ヒ化ガリウムを用いたmis型半導体装置の製造方法

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JPH01211974A
JPH01211974A JP3696988A JP3696988A JPH01211974A JP H01211974 A JPH01211974 A JP H01211974A JP 3696988 A JP3696988 A JP 3696988A JP 3696988 A JP3696988 A JP 3696988A JP H01211974 A JPH01211974 A JP H01211974A
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JP
Japan
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gaas
gallium arsenide
semiconductor device
film
type semiconductor
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JP3696988A
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Shinji Fujieda
信次 藤枝
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NEC Corp
Original Assignee
NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は半導体装置の製造方法、更に詳しくはヒ化ガリ
ウムを用いたMIS型半導体装置の製造方法に関する。
(従来の技術) ヒ化ガリウム(以降GaAsと記す)を用いたMIS型
半導体装置の特性は絶縁体膜とGaAs kの界面特性
に大きく依存する。従来、良好な界面特性を得る方法と
しては、絶縁体膜形成前に、■GaAs表面をH2,N
2. NH3等のプラズマで処理する方法(ジャーナル
・オブ・アプライド・フィツクス(Journal o
f theApplied Physics)52(1
981)3515−3519)、■GaAs表面を高純
度流水で処理する方法(アプライド・フィツクス・レタ
ーズ(Applied Physics Letter
s)50(1987)256−258)等が検討されて
きた。これらは、n型GaAsを用いたMIS型半導体
装置においてGaAs表面の過剰Asが表面ポテンシャ
ルをピンニングしてしまい界面特性を劣化させてしまう
という問題の解決を目的としたものである。
(発明が解決しようとする問題点) しかし、■の場合プラズマ条件によってはGaAs表面
が損傷を受ける危険性がある。すなわち、プラズマ処理
時間やプラズマ出力条件等の最適化が必要になる。また
■の場合には流水処理後絶縁体膜を形成するまでの間に
GaAs表面を大気に晒してはならず特別の工夫が必要
とされ再現性に問題がある。本発明の目的は、以上の点
を解決した半導体装置の製造方法を提供することにある
(問題を解決するための手段) 本発明はヒ化ガリウム上に非酸化物系絶縁体膜を形成さ
せMIS型半導体装置を製造する方法において、該絶縁
体膜形成前にヒ化ガリウム表面をヒ素安定化面とした後
これにIII族元素として、アルミニウム、あるいはガ
リウムのうちいづれかの元素を結合させるかまたは該元
素を含むラジカルあるいは分子を吸着させた上に非酸化
物系絶縁体膜を450℃以下で形成することを含むヒ化
ガリウムを用いたMIS型半導体装置の製造方法を提供
するものである。
(作用) 上記の問題を解決するための手段を検討した結果、特許
願61−191307、同61−191379において
記載した方法などが有用であることを見いだした。すな
わち、(1)GaAs基板上に成長させたGaAsエピ
タキシャル成長層の上に絶縁体膜としてIII族窒化物
を被着させる工程において該III族窒化物堆積直前に
(1−1)As原料、III族窒化物のIII族原料、
N原料を順に供給するかあるいは(1−2)Ga原料、
N原料を順に供給する方法、または(2)GaAsエピ
タキシャル成長層あるいはGaAs基板のAs雰囲気中
熱処理の後50〇−550℃において(2−1)高純度
H2中あるいは高真空中または(2−2)燐雰囲気中で
熱処理を行った後450’C以下で非酸化物系絶縁体膜
を被着させる方法を採ることにより比較的簡便に特性の
再現性を改善することが可能であった。しかしながら、
依然として、再現性に問題があった。その原因を検討し
たところ、上記方法の場合には製造工程の繰り返しに伴
い製造装置内の内壁などにGaAsやAsが付着する結
果、装置内に制御されないAs分圧が生じ、GaAs表
面における過剰Asの生成の防止を意図した上記工程の
制御性が悪化することが分った。
さらにこのAs分圧の変動が過剰As生成の防止に与え
る影響は、絶縁体膜を堆積させるGaAs表面の状態に
よって異ることが分かった。
GaAs表面の初期状態をAs安定化面としIII族元
素を結合させることにより過剰Asの生成が抑制される
。ここでAs安定化面に結合させる元素を上記のIII
族元素に限定するのは、Asとの結合力が下地Gaと同
等以上であり過剰As生成が抑制されると期待されるこ
と、およびAsとの結合が下地Gaと同じく共有結合性
であるため界面に生ずる分極が小さいと考えられるため
である。界面に生ずる分極が大きすぎると形成した膜の
剥離が起きやすいことは半導体へテロ接合界面に関して
よく知られている。
本発明では、まず、GaAs表面には自然酸化膜が含ま
れぬようGaAsエピタキシャル成長あるいはGaAs
基板のAs雰囲気中熱処理などによる自然酸化膜除去の
工程は行っておく。この後As安定化面を形成し、さら
にIII族元素などを結合させておく。
そして絶縁体膜として窒化物、フッ化物等非酸化物系絶
縁体を450℃以下で堆積するものとする。酸化物系の
絶縁体膜はその堆積がGaAs表面酸化膜・過剰As生
成の原因となるために除外する。
(実施例) 以下、本発明を実施例により説明する。
第1の実施例では非酸化物系絶縁体として窒化アルミニ
ウム(AIN)をトリメチルアルミニウム(TMA)−
ヒドラジン(N2H4)系原料により°堆積してMIS
型電界効果トランジスタ(MISFET)を作製した。
ここではAs安定化面にアルミニウム(A1)を結合さ
せることとした。本実施例ではガスソース分子線エピタ
キシャル(MOMBE)装置により工程を行った。まず
化学的エツチングを行った半絶縁性(100)GaAs
基板(ソース、ドレインn+コンタクト領域を形成した
もの)を装置内に導入し、 As分子線(As4強度:
IXIO15am−2sec−’)を照射しながら昇温
し650℃で2分間熱処理することにより基板表面の自
然酸化膜を除去した。次に550℃まではAs分子線照
射を供給しながら400℃まで降温した。このとき反射
高速電子線回折(RHEED)バタンは2×4構造(A
s安定化面)を示した。400℃においてトリイソブチ
ルアルミニウム(TiBA)0.05cc/minを供
給しながら1分間熱処理した後TiBA供給を停止しA
s安定化面にAIを結合させた。
引き続き400’CでN2H4、TMAの供給を順に開
始し厚さ1100nのALN膜を堆積した。得られたA
IN/GaAs試料にアルミニウム(AI)を蒸着後パ
ターニングしゲートを形成した。最後にソース、ドレイ
ンn+コンタクト上に金・ゲルマニウム・ニッケル(A
uGeNi)電極を形成しMISFETとした。本方法
で作製したMISFETは蓄積型の動作を示した。ゲー
ト長1pmのとき相互コンダクタンス(gm)は平均5
0m5/mmであり、この平均gmは10回の製造回数
で±25%の分布範囲内にあり、本実施例が良好な再現
性を持つことがわかった。
第2の実施例では第1の実施例におけるAIに代えガリ
ウム(Ga)をAs安定化面に結合させた。但しGa原
料としてはジエチルガリウムクロライド((C2H5)
2GaC1: 0.05cc/m1n)を500℃で1
分間供給した。本方法で作製したMISFETは蓄積型
の動作を示した。ゲート長1pmのとき相互コンダクタ
ンス(gm)は平均45m5/mmであり、この平均g
mは10回の製造回数で±25%の分布範囲内にあり、
本実施例が良好な再現性を持つことがわかった。
以上の結果は従来法のうちでも最良の場合の40%より
も改善されたものである。
実施例においてはGaAs基板上に直接絶縁体膜を被着
したが、基板上にGaAsのエピタキシャル成長層を形
成させ、その成長層の表面をGa安定化面とした後、絶
縁体膜を形成させても良い。また絶縁体膜としてはGa
F2やALNに限られたものではなく、SiNxやBN
なと他の酸素を含まない絶縁体膜でも良い。絶縁体膜の
成長方法も分子線エピタキシー以外の気相成長方法を用
いることができる。
(発明の効果) 以上に述べたように、本発明によればヒ化ガリウムを用
いたMIS型半導体装置の製造工程の再現性を向上させ
ることができる。

Claims (1)

    【特許請求の範囲】
  1.  ヒ化ガリウム上に非酸化物系絶縁体膜を形成させMI
    S型半導体装置を製造する方法において、該絶縁体膜形
    成前にヒ化ガリウム表面をヒ素安定化面とした後これに
    III族元素としてアルミニウムとガリウムのうちいづれ
    かの元素を結合させるかまたは該元素を含むラジカルあ
    るいは分子を吸着させた上に非酸化物系絶縁体膜を45
    0℃以下で形成することを含むヒ化ガリウムを用いたM
    IS型半導体装置の製造方法。
JP3696988A 1988-02-18 1988-02-18 ヒ化ガリウムを用いたmis型半導体装置の製造方法 Pending JPH01211974A (ja)

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