JPH01240984A - Digital image processor - Google Patents
Digital image processorInfo
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- JPH01240984A JPH01240984A JP63059438A JP5943888A JPH01240984A JP H01240984 A JPH01240984 A JP H01240984A JP 63059438 A JP63059438 A JP 63059438A JP 5943888 A JP5943888 A JP 5943888A JP H01240984 A JPH01240984 A JP H01240984A
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Abstract
Description
【発明の詳細な説明】 [産業上の利用分野] 本発明はデジタル画像信号を処理する装置に関する。[Detailed description of the invention] [Industrial application field] The present invention relates to an apparatus for processing digital image signals.
[従来の技術]
従来の画像処理技術の原理を第3図に示す、従来の方式
は記+!回路41から必要な領域の画像信号と画像処理
回路42に取り込んで処理を施し、処理した信号を直接
出力するものであった。従来技術における画像処理回路
の基本は、2次元フィルタに代表されるように、処理対
象となる画素信号とこれに隣接する画素信号との相関を
求めることであり、そのためにはたたみ込み積分をはじ
めとする高位の演算を繰り返す必要がある。[Prior Art] The principle of conventional image processing technology is shown in Figure 3, and the conventional method is described below. The image signal of the required area is taken in from the circuit 41 and is processed by the image processing circuit 42, and the processed signal is directly output. The basics of image processing circuits in conventional technology, as typified by two-dimensional filters, is to find the correlation between a pixel signal to be processed and its adjacent pixel signals. It is necessary to repeat the high-level calculations.
画像処理の主たる対象は、ノイズの除去とボケの修復で
ある。一般的にフィルタ作用はノイズを除去するうえで
は効果的であるが、その副作用として画像の解像度が低
下し、輪郭がぼけてしまう。The main targets of image processing are noise removal and blur correction. Generally, filtering is effective in removing noise, but as a side effect, the resolution of the image decreases and the outline becomes blurred.
しかし、このぼけを修復して輪郭を強調しようとすると
、ノイズも同時に強調されてしまう。However, if you try to correct this blur and emphasize the outline, noise will also be emphasized at the same time.
[発明が解決しようとする問題点]
このように従来の画像処理袋!は、画像信号に高位の演
算を施して出力するため、計算量が膨大になり、処理の
高速化、実時間化が難しいという欠点があった。また、
ノイズの除去とボケの修復という基本的な処理を同時に
実行できないという欠点があった。[Problems to be solved by the invention] Like this conventional image processing bag! Since the method performs high-level calculations on the image signal and outputs it, the amount of calculation becomes enormous, and it is difficult to speed up the processing and implement it in real time. Also,
The drawback was that the basic processing of removing noise and restoring blur could not be performed at the same time.
[問題点を解決するための手段]
本発明は、従来の画像処理装置の高速性と機能性におけ
る上記の問題点を解決するために、画像信号を格納する
記憶回路と、画像に対する補正の要、不要を判定する判
定回路、およびその判定結果に従って出力する画素信号
のアドレスを指定するアドレス回路によって画像処理装
置を構成したところに特色がある。特に、画像信号を直
接処理して出力するための手段を必要としないところに
本発明の際だった特徴がある。[Means for Solving the Problems] In order to solve the above-mentioned problems in the high speed and functionality of conventional image processing devices, the present invention provides a storage circuit for storing image signals and correction requirements for images. A distinctive feature of the image processing apparatus is that the image processing apparatus is composed of a determination circuit that determines whether the pixel signal is unnecessary, and an address circuit that specifies the address of the pixel signal to be output according to the determination result. In particular, a distinctive feature of the present invention is that it does not require means for directly processing and outputting image signals.
[作用コ
本発明に係る画像処理装置は、第1図に示すように記憶
口n1がアドレス回路3から与えられたアドレス信号に
よって指定された画素信号を判定回路2に送り出す9判
定回路2は与えられた画素信号を補正する必要の有無を
判定する9画像信号に混入したインパルス状のノイズや
ボケな部分は画像信号強度が不連続に変化する微小領域
として認識される6判定回路2は判定結果を2値化して
アドレス回路3へ与える。アドレス回路は補正の有無に
応じて前記アドレス信号を変更する。補正の必要がない
場合には、アドレスを変更せずに記憶回路1に与える。[Function] As shown in FIG. 1, the image processing device according to the present invention has a memory port n1 which sends out a pixel signal designated by an address signal given from the address circuit 3 to the decision circuit 2. 9. Impulse-like noise mixed in the image signal and blurred parts are recognized as minute areas where the image signal intensity changes discontinuously. 6. The judgment circuit 2 determines whether or not it is necessary to correct the pixel signal. is binarized and given to the address circuit 3. The address circuit changes the address signal depending on the presence or absence of correction. If there is no need for correction, the address is provided to the memory circuit 1 without being changed.
一方、補正を要する場合には、補正を必要としない画素
の中で補正しようとする画素に最も近接する画素のアド
レスを求めて、これを記憶回路1に与える。記憶回路1
はアドレス回路3から与えられたアドレス信号によって
指定された画素信号を出力する。On the other hand, when correction is required, the address of the pixel closest to the pixel to be corrected among the pixels that do not require correction is determined and provided to the storage circuit 1. Memory circuit 1
outputs the pixel signal specified by the address signal given from the address circuit 3.
以上のように1判定回路2においてノイズやボケな部分
を認識し、この部分の画素信号はそのまま出力せずに、
最近接の補正不要画素信号と入れ換えて出力することに
よって、ノイズを取り除くと同時に図形の輪郭を際だた
せることができる。As described above, the 1 judgment circuit 2 recognizes noise and blurred parts, and does not output the pixel signals of these parts as they are.
By replacing the pixel signal with the nearest pixel signal that does not require correction and outputting it, it is possible to remove noise and at the same time make the outline of the figure stand out.
[実施例]
第2図は本発明に係るデジタル画像処理装置の実施例で
ある。第1図の判定回路2が第2図の実施例においては
3画素×3画素のシフトレジスタ21と比較回路22、
しきい値回路23によって構成されており、アドレス回
路3は記憶回路31と7画素×7画素のシフトレジスタ
32.優先回路33およびポインタ回路34で構成され
ている。[Embodiment] FIG. 2 shows an embodiment of a digital image processing apparatus according to the present invention. In the embodiment shown in FIG. 2, the determination circuit 2 shown in FIG.
The address circuit 3 includes a storage circuit 31 and a shift register 32 . of 7 pixels x 7 pixels. It is composed of a priority circuit 33 and a pointer circuit 34.
シフトレジスタ21は、記憶回路11に格納された2次
元的な画像信号に対する、3画素×3画素のウィンドウ
として作用し、判定回路はこのウィンドウ中央に位置す
る画像信号A(x@、3/II)に対する補正の要、不
要を判定する。The shift register 21 acts as a 3 pixel x 3 pixel window for the two-dimensional image signal stored in the storage circuit 11, and the determination circuit selects the image signal A (x@, 3/II ) to determine whether correction is necessary or not.
比較回路22は8つの2重しきい値回路から成っており
、画像信号A(xe、 y@)とそれに隣接する画像
信号A(x@÷i、ya+j)を比較し、信号強度の変
化が連続的か否かの判断を行う、以降、表記を簡単にす
るために(xe−y@)をr@で表し、(x@+i、y
@+J)をrとする。各々のしきい値回路の出力C(r
)は
で与えられる。ここでαは連続、不連続を区分んするし
きい値であり、外部から与えうるパラメータである。ま
た、 1およびjは0、±1のうちのいずれかひとつの
値をとる。C−1は信号強度の変化が連続的であること
を意味し、C−0は不連続であることを表す。The comparison circuit 22 consists of eight double threshold circuits, and compares the image signal A (xe, y@) and the adjacent image signal A (x@÷i, ya+j) to detect changes in signal strength. To judge whether it is continuous or not, hereafter, to simplify the notation, (xe-y@) will be expressed as r@, and (x@+i, y
@+J) is set to r. The output C(r
) is given by. Here, α is a threshold value that distinguishes between continuity and discontinuity, and is a parameter that can be given from the outside. Furthermore, 1 and j take either one of 0 and ±1. C-1 means that the change in signal strength is continuous, and C-0 means that it is discontinuous.
8つの2重しきい値回路の出力信号は次段のしきい値回
路23に与えられる。しきい値回路23の出力R(r+
りは
となる。ここでβは、補正の要、不要を判断するしきい
値であり、これも外部から与えうるパラメータである。The output signals of the eight double threshold circuits are applied to the next stage threshold circuit 23. The output R(r+
Riha becomes. Here, β is a threshold value for determining whether correction is necessary or not, and is also a parameter that can be given from the outside.
R(r@)の値が1ならば画像信号A(rs)に対する
補正は不要でり、0であれば補正の必要が有る。If the value of R (r@) is 1, there is no need to correct the image signal A (rs), and if it is 0, correction is necessary.
以上のような手順で2 前記判定回路で与えられた判定
結果R(r@)はアドレス回路を構成する記憶回路31
に格納される。記憶回路31の中からR(r@)を中心
に7ビツト×7ビツトのデータがシフトレジスタ32に
取り出される。即ちシフトレジスタ32に格納されるデ
ータは、R(xs+p、y@+q)であり、ここでpお
よびqは0、±1、±2、±3のいずれかひとつの値を
とる。With the above procedure, 2. The judgment result R(r@) given by the judgment circuit is sent to the memory circuit 31 that constitutes the address circuit.
is stored in 7 bits×7 bits of data are taken out from the memory circuit 31 into the shift register 32, centering on R(r@). That is, the data stored in the shift register 32 is R(xs+p, y@+q), where p and q take any one of 0, ±1, ±2, and ±3.
シフトレジスタ32の内容は全て優先回路33に与えら
れる。優先回路においてはデータが1であるビット、即
ち補正不要画素を探す、この作業をンフトレジスタ32
の中心(p、q>=(0,0)から始めて、中心に近い
ビットから遠いビットに向けて順次進めていく、優先回
路33は、最初に1が見いだされたビットの相対座標値
〈p、q)をポインタ回路34に与える。 ポインタ回
路34は、あらかじめ与えられていた座標値(XS、y
ll)に優先回路33から与えられた相対座標値(p、
q)を加えて得られた座標値をアドレス信号に変換して
記憶回路11に与える。All contents of shift register 32 are given to priority circuit 33. The priority circuit searches for bits whose data is 1, that is, pixels that do not require correction.
Starting from the center (p, q>= (0, 0) of , q) are given to the pointer circuit 34. The pointer circuit 34 uses previously given coordinate values (XS, y
Relative coordinate values (p, ll) given from the priority circuit 33 to
The coordinate value obtained by adding q) is converted into an address signal and provided to the storage circuit 11.
記憶回路11は、ポインタ回路34が指定したアドレス
に格納されている画像信号A(x@+p”、ye+q)
を出力する。出力しようとする画像信号A(x@、ys
)が補正不要であれば(p、q)=(0,0)において
R=1となるため、A(xs、ys)がそのまま出力さ
れる。一方、補正が必要な場合にはR=1となる最近接
のビット(x s+P+ys+q)に対応する画像信号
が出力される。The memory circuit 11 stores the image signal A (x@+p", ye+q) stored at the address specified by the pointer circuit 34.
Output. Image signal A (x@, ys
) does not require correction, R=1 when (p, q)=(0,0), so A(xs, ys) is output as is. On the other hand, if correction is required, an image signal corresponding to the nearest bit (xs+P+ys+q) with R=1 is output.
第2図の実施例に示した構成は何ら本発明を限定するも
のではなく、他の改変は容易に成すことができるもので
ある。The configuration shown in the embodiment of FIG. 2 does not limit the present invention in any way, and other modifications can be easily made.
[発明の効果]
本発明に係るデジタル画像処理装置は、出力する画像信
号を必要に応じて入れ換えることによって、インパルス
ノイズの除去とぼけの修復を同時に実現できるという潰
れた効果を発揮する6本発明に係る方式は、画像信号を
直接処理して出力する従来方式と比較すると計算量が大
幅に減少するため、画像処理に要する時間を飛躍的に短
縮できる。従って、従来の技術では困難とされていたデ
ジタル画像の実時間処理を実現するうえでも著しい効果
を発揮する。[Effects of the Invention] The digital image processing device according to the present invention exhibits the outstanding effect of being able to simultaneously remove impulse noise and restore blur by replacing output image signals as necessary. This method significantly reduces the amount of calculation compared to the conventional method of directly processing and outputting image signals, and therefore can dramatically reduce the time required for image processing. Therefore, it is extremely effective in realizing real-time processing of digital images, which has been difficult with conventional techniques.
図面はいずれも本発明に係るデジタル画像処理装置の実
施例を説明するためのものであって、第1図は本発明に
係るデジタル画像処理装置のブロック図、第2図は同デ
ジタル画像処理装置のブロック図、第3図は従来の画像
処理装置のブロック図である。
第 1 図
1 記憶回路
〈
1、記憶回路
2 判定回路
3 アドレス回路
第 2 図
11記憶回路
23シきい値回路
第 3(2i
41記憶回路 42画像処理回路The drawings are all for explaining embodiments of the digital image processing apparatus according to the present invention, and FIG. 1 is a block diagram of the digital image processing apparatus according to the present invention, and FIG. 2 is a block diagram of the digital image processing apparatus according to the present invention. FIG. 3 is a block diagram of a conventional image processing device. 1st Figure 1 Memory circuit 1. Memory circuit 2 Judgment circuit 3 Address circuit 2nd Figure 11 Memory circuit 23 Threshold circuit 3rd (2i 41 Memory circuit 42 Image processing circuit
Claims (1)
が出力しようとする画素信号に対する補正の要、不要を
判定する判定回路と、この判定回路の出力を受けて前記
記憶回路が実際に出力すべき画素信号が格納されている
アドレスを発生し、このアドレス信号を前記記憶回路へ
与えるアドレス回路を備えることを特徴とするデジタル
画像処理装置。A storage circuit that stores a digital image signal, a determination circuit that determines whether or not correction is necessary for the pixel signal that this storage circuit is going to output, and a determination circuit that the storage circuit should actually output based on the output of this determination circuit. A digital image processing device comprising an address circuit that generates an address in which a pixel signal is stored and supplies this address signal to the storage circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63059438A JPH01240984A (en) | 1988-03-15 | 1988-03-15 | Digital image processor |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63059438A JPH01240984A (en) | 1988-03-15 | 1988-03-15 | Digital image processor |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01240984A true JPH01240984A (en) | 1989-09-26 |
Family
ID=13113282
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63059438A Pending JPH01240984A (en) | 1988-03-15 | 1988-03-15 | Digital image processor |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01240984A (en) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59110286A (en) * | 1982-12-16 | 1984-06-26 | Fujitsu Ltd | Improving method of video due to defective channel |
| JPS61187467A (en) * | 1985-02-14 | 1986-08-21 | Matsushita Electric Ind Co Ltd | Image sensor |
-
1988
- 1988-03-15 JP JP63059438A patent/JPH01240984A/en active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59110286A (en) * | 1982-12-16 | 1984-06-26 | Fujitsu Ltd | Improving method of video due to defective channel |
| JPS61187467A (en) * | 1985-02-14 | 1986-08-21 | Matsushita Electric Ind Co Ltd | Image sensor |
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