JPH01302928A - アナログ・デイジタル通信方法およびその装置 - Google Patents
アナログ・デイジタル通信方法およびその装置Info
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- JPH01302928A JPH01302928A JP9009689A JP9009689A JPH01302928A JP H01302928 A JPH01302928 A JP H01302928A JP 9009689 A JP9009689 A JP 9009689A JP 9009689 A JP9009689 A JP 9009689A JP H01302928 A JPH01302928 A JP H01302928A
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- signal
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、工業計測等において、アナログ信号とディジ
タル信号とを同一の伝送路にょυ伝送する場合に適用さ
れるアナログ・ディジタル通信方法およびその装置に関
するものである。
タル信号とを同一の伝送路にょυ伝送する場合に適用さ
れるアナログ・ディジタル通信方法およびその装置に関
するものである。
従来、工業計測においては、差圧発信器、電磁流量計等
の測定出力を遠隔地点へ伝送する場合、一般に４〜２０
ｍＡ等の統一信号が用いられておシ、このアナログ信号
の電流値により測定値を示すものと々っている。
の測定出力を遠隔地点へ伝送する場合、一般に４〜２０
ｍＡ等の統一信号が用いられておシ、このアナログ信号
の電流値により測定値を示すものと々っている。
しかし、差圧発信器、電磁流量計等は、広域に分散のう
え設置されるのが一般的であシ、これらの調整および動
作状況チェックを行なうには、係員が巡回のうえ保守９
点検作業を行々わねば々らず、既存の設備を利用して遠
隔操作にょ９、調整および動作状況チェック等をも行な
うことのできる手段の出現が要望されるに至っている。
え設置されるのが一般的であシ、これらの調整および動
作状況チェックを行なうには、係員が巡回のうえ保守９
点検作業を行々わねば々らず、既存の設備を利用して遠
隔操作にょ９、調整および動作状況チェック等をも行な
うことのできる手段の出現が要望されるに至っている。
例えば、今までは発信器が正確に０％出力のとき４ｍＡ
。
。
１００％出力のとき２０ｍＡというように計測値に対応
したアナログ出力を発信しているか否かがすぐにはわか
らがかった。
したアナログ出力を発信しているか否かがすぐにはわか
らがかった。
本発明は、電源部から供給される電流値を発信器により
変化させてアナログ信号とする通信方法において、前記
アナログ信号の通ずる伝送路中へ電圧降下素子を挿入し
、該電圧降下素子に通ずる前記アナログ信号と重畳のう
え前記電流値を通信器によりパルス状に正負方向へ変化
させてディジタル信号とし、該ディジタル信号を前記発
信器により受信すふと共に、前記アナログ信号と重畳の
うえ前記電流価を前記発信器によυパルス状に正負方向
へ変化させてディジタル信号とし、該ディジタル信号を
前記通信器により受信する通信方法であって、前記通信
器からのディジタル信号の１つとして前記発信器に対し
て任意の値のアナログ値を出力させる信号を発信し、こ
のアナログ値に対応し次出力があるか否かをチェックす
ることを特徴として構成したものである。
変化させてアナログ信号とする通信方法において、前記
アナログ信号の通ずる伝送路中へ電圧降下素子を挿入し
、該電圧降下素子に通ずる前記アナログ信号と重畳のう
え前記電流値を通信器によりパルス状に正負方向へ変化
させてディジタル信号とし、該ディジタル信号を前記発
信器により受信すふと共に、前記アナログ信号と重畳の
うえ前記電流価を前記発信器によυパルス状に正負方向
へ変化させてディジタル信号とし、該ディジタル信号を
前記通信器により受信する通信方法であって、前記通信
器からのディジタル信号の１つとして前記発信器に対し
て任意の値のアナログ値を出力させる信号を発信し、こ
のアナログ値に対応し次出力があるか否かをチェックす
ることを特徴として構成したものである。
また、伝送路へ電流を供給する電源部と、前記伝送路へ
接続されかつ該伝送路の電流値を変化させてアナログ信
号とする発信器とからなる通信装置において、前記伝送
路へ挿入された電圧降下素子と、該電圧降下素子よシも
前記発信器側の伝送路へ橋絡接続された前記アナログ信
号と重畳のうえ前記電圧降下素子の電流値をパルス状に
正負方向へ変化させディジタル信号として送信しかつ同
様のディジタル信号を受信する通信器と、該通信器から
送信された前記ディジタル信号を受信しかつ前記アナロ
グ信号と重畳のうえ前記伝送路の電流値をパルス状に正
負方向へ変化させディジタル信号として前記通信器へ送
信する前記発信器とを備え、前記通信器は、ディジタル
信号の１つとして前記発信器に対して任意の値のアナロ
グ値を出力させる信号を発信可能としたことを特徴とし
て構成したものである。
接続されかつ該伝送路の電流値を変化させてアナログ信
号とする発信器とからなる通信装置において、前記伝送
路へ挿入された電圧降下素子と、該電圧降下素子よシも
前記発信器側の伝送路へ橋絡接続された前記アナログ信
号と重畳のうえ前記電圧降下素子の電流値をパルス状に
正負方向へ変化させディジタル信号として送信しかつ同
様のディジタル信号を受信する通信器と、該通信器から
送信された前記ディジタル信号を受信しかつ前記アナロ
グ信号と重畳のうえ前記伝送路の電流値をパルス状に正
負方向へ変化させディジタル信号として前記通信器へ送
信する前記発信器とを備え、前記通信器は、ディジタル
信号の１つとして前記発信器に対して任意の値のアナロ
グ値を出力させる信号を発信可能としたことを特徴とし
て構成したものである。
以下、実施例を示す図によって本発明の詳細な説明する
。
。
第１図は、全構成のブロック図であシ、線路ＬＩ＋Ｌ２
からなる２線式伝送路（以下、伝送路）に対し電流を
供給する電源部ｐｓが設けられていると共に、伝送路の
他端には、差圧発信器、電磁流量計等の発信器Ｔｘが接
続されておシ、発信器Ｔｘが電流値Ｉを制御し、アナロ
グ信号として伝送路へ通ずるものと々つている。
からなる２線式伝送路（以下、伝送路）に対し電流を
供給する電源部ｐｓが設けられていると共に、伝送路の
他端には、差圧発信器、電磁流量計等の発信器Ｔｘが接
続されておシ、発信器Ｔｘが電流値Ｉを制御し、アナロ
グ信号として伝送路へ通ずるものと々つている。
また、伝送路中には、電圧降下素子として抵抗器ＲＬが
直列に挿入されておシ、これの端子電圧をアナログ・デ
ィジタル変換器（以下、ＡＤＣ）へ与え、ディジタル信
号としてから数字表示器等の表示器ＤＰを駆動し、電流
値工によって示されるアナログ信号の値を受信のうえ表
示するものとなっている。
直列に挿入されておシ、これの端子電圧をアナログ・デ
ィジタル変換器（以下、ＡＤＣ）へ与え、ディジタル信
号としてから数字表示器等の表示器ＤＰを駆動し、電流
値工によって示されるアナログ信号の値を受信のうえ表
示するものとなっている。
一方、抵抗器ＲＬ よシも発信器Ｔｘ側の伝送路には、
通信器ＣＥが橋絡接続されておシ、これがアナログ信号
と重畳のうえ抵抗器Ｒｔ、に通ずる電流値工をパルス状
に正負方向へ変化させ、ディジタル信号として発信器Ｔ
ｘへ送信すると、これが発信器Ｔｘ において受信され
、受信に応じて発信器ＴＸが電流値工を同様に変化させ
、ディジタル信号として通信器ＣＥへ送信するため、こ
れが通信器ＣＥにおいて受信されるものとなっている。
通信器ＣＥが橋絡接続されておシ、これがアナログ信号
と重畳のうえ抵抗器Ｒｔ、に通ずる電流値工をパルス状
に正負方向へ変化させ、ディジタル信号として発信器Ｔ
ｘへ送信すると、これが発信器Ｔｘ において受信され
、受信に応じて発信器ＴＸが電流値工を同様に変化させ
、ディジタル信号として通信器ＣＥへ送信するため、こ
れが通信器ＣＥにおいて受信されるものとなっている。
第２図は、抵抗器ＲＬに通ずる電流値Ｉの時間ｔに応す
る変化状況を示す波形図であυ、発信器Ｔｘの測定値に
応じて定まるアナログ信号８ａは、この場合４〜２０ｍ
Ａの範囲において変化するものとなっているが、通信器
ＣＥからの送信が行なわれると、ディジタル信号８ｃの
期間、アナログ信号Ｓａと重畳のうえ、パルス状に正負
方向へ電流値工が変化し、これによって７ラグビツ）Ｂ
Ｆ、スタートビットＢｓ、第１ビツトＢ＋ 〜第８ピッ
）Ｂａが送信される。
る変化状況を示す波形図であυ、発信器Ｔｘの測定値に
応じて定まるアナログ信号８ａは、この場合４〜２０ｍ
Ａの範囲において変化するものとなっているが、通信器
ＣＥからの送信が行なわれると、ディジタル信号８ｃの
期間、アナログ信号Ｓａと重畳のうえ、パルス状に正負
方向へ電流値工が変化し、これによって７ラグビツ）Ｂ
Ｆ、スタートビットＢｓ、第１ビツトＢ＋ 〜第８ピッ
）Ｂａが送信される。
なお、各ビットは、正負方向の変化により示され、フラ
グピッ）Ｂｐは特にパルス幅が広く設定され、かつ必ず
正負方向へ変化するものとなっているが、データを示す
第１ピツ）Ｂ＋ 〜第８ビットＢｓは、論理値も１″の
とき正負方向へ変化し、論理値啄Ｏ１１のときには無変
化を維持するものとがっている。
グピッ）Ｂｐは特にパルス幅が広く設定され、かつ必ず
正負方向へ変化するものとなっているが、データを示す
第１ピツ）Ｂ＋ 〜第８ビットＢｓは、論理値も１″の
とき正負方向へ変化し、論理値啄Ｏ１１のときには無変
化を維持するものとがっている。
この電流値変化は、抵抗器Ｒｔの電圧降下変化を生じ、
発信器Ｔｘ側の線路”１＋”２間電圧変化として発信器
Ｔｘへ与えられ、これによってディジタル信号Ｓｃが発
信器ＴＸによｐ受信される。
発信器Ｔｘ側の線路”１＋”２間電圧変化として発信器
Ｔｘへ与えられ、これによってディジタル信号Ｓｃが発
信器ＴＸによｐ受信される。
すると、発信器ＴＸは、ディジタル信号Ｓｃの終了後、
一定期間ｔ８を経てからディジタル信号Ｓｔの期間、同
様に電流値■を変化させ、フラグビットＢＰ、スタート
ビットＢａおよび、データを示す第１ピツ）Ｂｌ −第
８ビツトＢ８を送信する。
一定期間ｔ８を経てからディジタル信号Ｓｔの期間、同
様に電流値■を変化させ、フラグビットＢＰ、スタート
ビットＢａおよび、データを示す第１ピツ）Ｂｌ −第
８ビツトＢ８を送信する。
このため、前述と同様に線路Ｌｌ＋”２間の電圧変化が
生じ、これが通信器ＣＥにより受信される。
生じ、これが通信器ＣＥにより受信される。
ただし、この例では、８ビツトから力る１バイトの送受
信のみを示したが、状況に応じ、所定数のビットからな
る所望数のバイトがディジタル信号Ｓｃ、Ｓｔの各々に
おいて送受信される。
信のみを示したが、状況に応じ、所定数のビットからな
る所望数のバイトがディジタル信号Ｓｃ、Ｓｔの各々に
おいて送受信される。
なお、各ビットの正負方向変化は同一電流値となってお
り、これらの平均値が零となるため、第１図のＡＤＣ−
Ａ／Ｄにおいて、入力側へ積分回路等を挿入すれば、ア
ナログ信号Ｓｍの受信には全く無関係となる。
り、これらの平均値が零となるため、第１図のＡＤＣ−
Ａ／Ｄにおいて、入力側へ積分回路等を挿入すれば、ア
ナログ信号Ｓｍの受信には全く無関係となる。
第３図は、通信器ＣＥのブロック図であシ、マイクロプ
ロセッサ等のプロセッサＣＰＵｃを中心とし、固定メモ
リＲＯＭｃ、可変メモリＲＡＭｃ、キーボードＫＢｃ、
数字表示器等の表示器ＤＰｃ、ユニバーサル非同期送受
信部（以下、送受信部） ＵＡＲＴｃおよびインターフ
ェイスＩ／Ｆｃ等が周辺に配され、母線ＢＵｃ により
相互間が接続されておシ、固定メモリＲＯＭｃへ格納さ
れたプログラムをプロセッサＣＰＵｃ が実行し、所定
のデータを可変メモＩＪ ＲＡＭｃへアクセスしながら
制御動作を行なうものとガっている。
ロセッサ等のプロセッサＣＰＵｃを中心とし、固定メモ
リＲＯＭｃ、可変メモリＲＡＭｃ、キーボードＫＢｃ、
数字表示器等の表示器ＤＰｃ、ユニバーサル非同期送受
信部（以下、送受信部） ＵＡＲＴｃおよびインターフ
ェイスＩ／Ｆｃ等が周辺に配され、母線ＢＵｃ により
相互間が接続されておシ、固定メモリＲＯＭｃへ格納さ
れたプログラムをプロセッサＣＰＵｃ が実行し、所定
のデータを可変メモＩＪ ＲＡＭｃへアクセスしながら
制御動作を行なうものとガっている。
ここにおいて、キーボードＫＢｃ から所望のデータを
与えれば、これに応じてプロセッサＣＰＵｃが送受信部
ＵＡＲＴｃを制御すると共に、インターフェイスＩ ／
Ｆ ｃ を介してゲートパルスＰｃｇｌ ’ｋｓＨ＝（
高レベル）として送出するため、 ＡＮＤゲー） Ｇａ
４ 、 Ｇａ２がオンとなシ、送受信部ＵＡＲＴｃ か
ら送出される各々！Ｈ″の増加パルスＰｕおよび減少パ
ルスＰｄが電流制御部ＣＣｃへ与えられ、増加パルスＰ
ｕ に応じて電流制御部ＣＣｃが線路端子Ｔ１からＴ鵞
への電流ＩＣを通ずる一方、減少パルスＰｄ に応じて
同制御部ＣＣｃが線路端子Ｔ１を正極、線路端子Ｔ２を
負極とする制御電圧を送出する。
与えれば、これに応じてプロセッサＣＰＵｃが送受信部
ＵＡＲＴｃを制御すると共に、インターフェイスＩ ／
Ｆ ｃ を介してゲートパルスＰｃｇｌ ’ｋｓＨ＝（
高レベル）として送出するため、 ＡＮＤゲー） Ｇａ
４ 、 Ｇａ２がオンとなシ、送受信部ＵＡＲＴｃ か
ら送出される各々！Ｈ″の増加パルスＰｕおよび減少パ
ルスＰｄが電流制御部ＣＣｃへ与えられ、増加パルスＰ
ｕ に応じて電流制御部ＣＣｃが線路端子Ｔ１からＴ鵞
への電流ＩＣを通ずる一方、減少パルスＰｄ に応じて
同制御部ＣＣｃが線路端子Ｔ１を正極、線路端子Ｔ２を
負極とする制御電圧を送出する。
したがって、電流Ｉｃが通じたときには、抵抗器ＲＬを
通ずる電流値工が、アナログ信号Ｓａを示す電流Ｉｔと
電流ＩＣとの和と々つて増加する反面、制御電圧が送出
されたときには、線路Ｌ１ ＋Ｌ２間の電圧が上昇し、
電流値工が減少する。
通ずる電流値工が、アナログ信号Ｓａを示す電流Ｉｔと
電流ＩＣとの和と々つて増加する反面、制御電圧が送出
されたときには、線路Ｌ１ ＋Ｌ２間の電圧が上昇し、
電流値工が減少する。
また、線路り、 、 Ｌ２間の線間電圧は、ディジタル
信号Ｓｔの周波数成分のみを通過させる帯域ｆ波器等の
ｆ波器ＦＬｃを介し、比較器ＣＰｃの一方の入力へ与え
られてお夛、他方の入力へ与えられている基準電圧ＥＣ
８との比較がなされ、基準電圧Ｅ’Ｃ８以上のレベルが
受信出力として抽出されるものとなっている。
信号Ｓｔの周波数成分のみを通過させる帯域ｆ波器等の
ｆ波器ＦＬｃを介し、比較器ＣＰｃの一方の入力へ与え
られてお夛、他方の入力へ与えられている基準電圧ＥＣ
８との比較がなされ、基準電圧Ｅ’Ｃ８以上のレベルが
受信出力として抽出されるものとなっている。
このため、ディジタル信号Ｓｃの送信終了後、ディジタ
ル信号Ｓｊ の７ラグビツ）Ｂｙ と対応する受信出
力がインターフェイスＩ／Ｆｃ を介して与えられるの
に応じ、インターフェイスＩ ／Ｆ ｃがらゲートパル
スＰ。ｇ２を ％Ｈ″として送出し、ＡＮＤゲートＧｃ
３ をオンとすれば、スタートビットＢｓ以降と対応
する受信出力が送受信部ＵＡＲＴｃへ与えられ、これの
出力に応じて表示器ＤＰｃ による受信データの表示が
行彦われる。
ル信号Ｓｊ の７ラグビツ）Ｂｙ と対応する受信出
力がインターフェイスＩ／Ｆｃ を介して与えられるの
に応じ、インターフェイスＩ ／Ｆ ｃがらゲートパル
スＰ。ｇ２を ％Ｈ″として送出し、ＡＮＤゲートＧｃ
３ をオンとすれば、スタートビットＢｓ以降と対応
する受信出力が送受信部ＵＡＲＴｃへ与えられ、これの
出力に応じて表示器ＤＰｃ による受信データの表示が
行彦われる。
第４図は、電流制御部ＣＣｃの回路図でちり、抵抗器Ｒ
１およびコンデンサＣ１による雑音除去用の低域ｆ波器
を介するＡＮＤゲートＧｃ１からの増加パルスＰｕは、
差動増幅器Ａ１により増幅されたうえ、電界効果形等の
トランジスタＱ１をオンとするため、抵抗器Ｒ２、Ｒ３
を経て電流Ｉｃが通ずる。
１およびコンデンサＣ１による雑音除去用の低域ｆ波器
を介するＡＮＤゲートＧｃ１からの増加パルスＰｕは、
差動増幅器Ａ１により増幅されたうえ、電界効果形等の
トランジスタＱ１をオンとするため、抵抗器Ｒ２、Ｒ３
を経て電流Ｉｃが通ずる。
々お、抵抗器Ｒ３の端子電圧は、抵抗器Ｒ４を介して差
動増幅器Ａ、へ負帰還されておシ、これによって電流Ｉ
Ｃが所定の値に保たれる。
動増幅器Ａ、へ負帰還されておシ、これによって電流Ｉ
Ｃが所定の値に保たれる。
一方、抵抗器Ｒ６およびコンデンサＣ２による前述と同
様の低域Ｆ波器を介するＡＮＤゲートＧｃ２からの減少
パルスＰｄは、差動増幅器Ａ２により反転増幅されたう
え、前述と同様のトランジスタＱ！をオンとするため、
抵抗器Ｒ，、Ｒ？を介し、直列に挿入された局部電源Ｅ
ＣＬの電圧が制御電圧として送出される。
様の低域Ｆ波器を介するＡＮＤゲートＧｃ２からの減少
パルスＰｄは、差動増幅器Ａ２により反転増幅されたう
え、前述と同様のトランジスタＱ！をオンとするため、
抵抗器Ｒ，、Ｒ？を介し、直列に挿入された局部電源Ｅ
ＣＬの電圧が制御電圧として送出される。
々お、抵抗器Ｒ７の端子電圧は、抵抗器Ｒ５を介して差
動増幅器Ａ２へ負帰還されておシ、局部電源ＥＣＬから
の電流を所定の値に僅っている。
動増幅器Ａ２へ負帰還されておシ、局部電源ＥＣＬから
の電流を所定の値に僅っている。
第５図は、通信器ｃｇの外形斜視図であり、手持形のケ
ース１に表示器ＤＰｃおよびキーボードＫＢｃが配され
ていると共に、コード２が導出されておし、コード２の
先端にはクリップ３が接続され、線路Ｌｌ ＋ ”１に
対する着脱が自在となっている。
ース１に表示器ＤＰｃおよびキーボードＫＢｃが配され
ていると共に、コード２が導出されておし、コード２の
先端にはクリップ３が接続され、線路Ｌｌ ＋ ”１に
対する着脱が自在となっている。
第６図は、発信器Ｔｘのブロック図であシ、第３図と同
様のプロセッサＣＰＵｔ、固定メモＩＪＲＯＭｔ。
様のプロセッサＣＰＵｔ、固定メモＩＪＲＯＭｔ。
可変メモリＲＡＭｔ、送受信部ＵＡＲＴｔ、インターフ
ェイスＩ／Ｆｔ等を母線ＢＵｔにより接続し、第３図と
同様にプロセッサｃｐｕｔ が制御製作を行なうもの
と麿っているが、差圧、流量等を検出するセンサＳＳの
出力をディジタル信号へ変換するＡＤＣ−Ａ／Ｄｔ 、
および、これの出力をプロセッサＣＰＵｔ が処理のう
え送出するディジタル信号をアナログ信号へ変換するデ
ィジタル・アナログ変換器（以下、ＤＡＣ）Ｄ／Ａｔが
設けである。
ェイスＩ／Ｆｔ等を母線ＢＵｔにより接続し、第３図と
同様にプロセッサｃｐｕｔ が制御製作を行なうもの
と麿っているが、差圧、流量等を検出するセンサＳＳの
出力をディジタル信号へ変換するＡＤＣ−Ａ／Ｄｔ 、
および、これの出力をプロセッサＣＰＵｔ が処理のう
え送出するディジタル信号をアナログ信号へ変換するデ
ィジタル・アナログ変換器（以下、ＤＡＣ）Ｄ／Ａｔが
設けである。
また、線路端子Ｔ、には、電源回路ｐｓｔが接続され、
この場合は、線路り、から４ｍＡの電流を取シ入れ、安
定化のうえ局部電源ｇｔとして各部へ供給していると共
に、線路Ｌ’ｌ ＋ ５２間の線間電圧は、ディジタル
信号Ｓｃの周波数成分のみを通過させる帯域ｆ波器等の
Ｆ波器ＦＬｔ を介し、第３図と同様に比較器ｃｒｔへ
与えられており、ここにおいて、第３図と同様に基準電
圧ｇｔｓ と比較され、比較器ｃｒｔが受信出力を生
じ、インターフェイスＩ／Ｆｔへ与えると共に、ＡＮＤ
ゲー）Ｇｔｌ を介して送受信部ＵＡＲＴｔへ与える
ものとなっている。
この場合は、線路り、から４ｍＡの電流を取シ入れ、安
定化のうえ局部電源ｇｔとして各部へ供給していると共
に、線路Ｌ’ｌ ＋ ５２間の線間電圧は、ディジタル
信号Ｓｃの周波数成分のみを通過させる帯域ｆ波器等の
Ｆ波器ＦＬｔ を介し、第３図と同様に比較器ｃｒｔへ
与えられており、ここにおいて、第３図と同様に基準電
圧ｇｔｓ と比較され、比較器ｃｒｔが受信出力を生
じ、インターフェイスＩ／Ｆｔへ与えると共に、ＡＮＤ
ゲー）Ｇｔｌ を介して送受信部ＵＡＲＴｔへ与える
ものとなっている。
との喪め、フラグビットＢＦの検出に応じて気Ｈ″のゲ
ートパルスＰ ｔｇ＋が送出され、ＡＮＤゲ−）Ｇｔｌ
がオンと力ってディジタル信号８ｃの受信がたされ、デ
ィジタル信号８ｃの受信終了後、期間ｔ、の経過に応じ
、プロセッサＣＰＵｔがインターフェイスＩ／Ｆｔ を
介し隼Ｈ”のゲートパルスＰｔｇ＊を送出すると共に、
送受信部ＵＡＲＴｔを制御すれば、オンと力ったＡＮＤ
ゲートＧｔ２を介し、パルス状に正負方向へ変化する送
信データが送出され、加算器ＡＩ）Ｄｔの一方の入力へ
与えられる。
ートパルスＰ ｔｇ＋が送出され、ＡＮＤゲ−）Ｇｔｌ
がオンと力ってディジタル信号８ｃの受信がたされ、デ
ィジタル信号８ｃの受信終了後、期間ｔ、の経過に応じ
、プロセッサＣＰＵｔがインターフェイスＩ／Ｆｔ を
介し隼Ｈ”のゲートパルスＰｔｇ＊を送出すると共に、
送受信部ＵＡＲＴｔを制御すれば、オンと力ったＡＮＤ
ゲートＧｔ２を介し、パルス状に正負方向へ変化する送
信データが送出され、加算器ＡＩ）Ｄｔの一方の入力へ
与えられる。
なお、加算容入ＤＤｔの他方の入力には、センサＳＳに
よる測定値に応じたアナログ信号が定常的に与えられて
おり、ゲートパルス”ｔｇｚが生じないときは、ＤＡＣ
−Ｄ／Ａｔ の出力のみが電流制御部ＣＣｔへ与えられ
、これには、測定値に応じた値の電流がアナログ信号Ｓ
ａ として通ずるのに対し、ゲートパルスＰｔｇｚが生
じかつ送信データが送受信部ＵＡＲＴｔから送出されれ
ば、加算器ＡＤＤｔ において両入力の加算が力される
ため、アナログ信号Ｓａ と重畳のうえ、電流制御部Ｃ
Ｃｔに通ずる電流がパルス状に正負方向へ変化し、ディ
ジタル信号Ｓｔ として送信される。
よる測定値に応じたアナログ信号が定常的に与えられて
おり、ゲートパルス”ｔｇｚが生じないときは、ＤＡＣ
−Ｄ／Ａｔ の出力のみが電流制御部ＣＣｔへ与えられ
、これには、測定値に応じた値の電流がアナログ信号Ｓ
ａ として通ずるのに対し、ゲートパルスＰｔｇｚが生
じかつ送信データが送受信部ＵＡＲＴｔから送出されれ
ば、加算器ＡＤＤｔ において両入力の加算が力される
ため、アナログ信号Ｓａ と重畳のうえ、電流制御部Ｃ
Ｃｔに通ずる電流がパルス状に正負方向へ変化し、ディ
ジタル信号Ｓｔ として送信される。
ただし、アナログ信号Ｓａの値とディジタル信号Ｓｔに
応するデータとをプロセッサＣＰＵｔにおいて加算のう
え、ＤＡＣ−Ｄ／Ａｔかも送出し、加算器ＡＤＤ ｔ
を省略するものとしても同様である。
応するデータとをプロセッサＣＰＵｔにおいて加算のう
え、ＤＡＣ−Ｄ／Ａｔかも送出し、加算器ＡＤＤ ｔ
を省略するものとしても同様である。
彦お、発信器Ｔｘは、ＥへＲＯＭ等の不揮発性メモリを
有し、通信器ＣＥからのデータ中必要彦ものは、このメ
モリに書き込むものとしている。このため、電源断の場
合にもデータが保持されるものとなっている。さらに、
通信器ＣＥからのデータとして、任意のアナログ値を発
（ｉする命令を受けた場合は、プロセッサＣＰＵはこの
任意の値に対応した値の信号をセンサＳＳからの信号の
代わりにＤＡＣ−Ｄ／Ａに与え、電流制御器ＣＣｃによ
って電流を制御する。この電流値は受信器ＤＳＲによっ
て受信され、通信器ｃｇｏ設定した値との比較を行なう
ことによって発信のチェックを行なうことができる。
有し、通信器ＣＥからのデータ中必要彦ものは、このメ
モリに書き込むものとしている。このため、電源断の場
合にもデータが保持されるものとなっている。さらに、
通信器ＣＥからのデータとして、任意のアナログ値を発
（ｉする命令を受けた場合は、プロセッサＣＰＵはこの
任意の値に対応した値の信号をセンサＳＳからの信号の
代わりにＤＡＣ−Ｄ／Ａに与え、電流制御器ＣＣｃによ
って電流を制御する。この電流値は受信器ＤＳＲによっ
て受信され、通信器ｃｇｏ設定した値との比較を行なう
ことによって発信のチェックを行なうことができる。
第７図は、電流制御部ＣＣｔの回路図であり、第４図の
トランジスタＱｌ側と同様、抵抗器Ｒ＋１、コンデンサ
Ｃｏの低域ｒ波器を介し、加算器ＡＤＤｔの出力を差動
増幅器Ａｌｌにより増幅のうえ、トランジスタＱ１１の
内部インピーダンスを制御しておシ、これによって定ま
る電流を抵抗器Ｒ１ｍ ＋ Ｒｌ ３を経て通ずるもの
としている。
トランジスタＱｌ側と同様、抵抗器Ｒ＋１、コンデンサ
Ｃｏの低域ｒ波器を介し、加算器ＡＤＤｔの出力を差動
増幅器Ａｌｌにより増幅のうえ、トランジスタＱ１１の
内部インピーダンスを制御しておシ、これによって定ま
る電流を抵抗器Ｒ１ｍ ＋ Ｒｌ ３を経て通ずるもの
としている。
ただし、第４図と同様に抵抗器ＲＩ３の端子電圧が抵抗
器ＲＩ４を介し、差動増幅器Ａｌｌへ負帰還されてお９
、加算器ＡＤＤｔ の出力値に応する電流値を保つも
のとなっている。
器ＲＩ４を介し、差動増幅器Ａｌｌへ負帰還されてお９
、加算器ＡＤＤｔ の出力値に応する電流値を保つも
のとなっている。
第８図は、他の実施例を示す全構成のブロック図であり
、第１図におけるＡＤＣ−Ａ／Ｄおよび表示器ＤＰの代
υに、低インピーダンスの電流針入が挿入され、これに
よってアナログ信号Ｓａの指示を行なうものになってい
ると共に、伝送回路中へ挿入された抵抗器ＲＬの端子電
圧を通信器ＣＥへ取り入れ、八ＤＣ−Ａ／Ｄｃによりデ
ィジタル信号としたうえ、表示器ＤＰｃａを駆動し、こ
こにおいても、アナログ信号Ｓａの受信を行なうものと
している。
、第１図におけるＡＤＣ−Ａ／Ｄおよび表示器ＤＰの代
υに、低インピーダンスの電流針入が挿入され、これに
よってアナログ信号Ｓａの指示を行なうものになってい
ると共に、伝送回路中へ挿入された抵抗器ＲＬの端子電
圧を通信器ＣＥへ取り入れ、八ＤＣ−Ａ／Ｄｃによりデ
ィジタル信号としたうえ、表示器ＤＰｃａを駆動し、こ
こにおいても、アナログ信号Ｓａの受信を行なうものと
している。
なお、データ送受信部ＤＳＲは、第３図に示すものと同
様である。
様である。
したがって、伝送路を収容する端子板等へ通信器ｃｇを
接続し、所望のデータ送受信を発信器’ｒｘと行なうこ
とが自在となシ、発信器Ｔｘの可変メモｌＪＲＡＭｔ中
へ格納されている各種調整値、設定値等の更新が遠隔操
作により可能に々ると共に、発信器Ｔｘの動作状況を遠
隔チェックすることが可能と々るうえ、従来からの設備
に若干の追加を行なうのみにより目的を達することがで
きる。
接続し、所望のデータ送受信を発信器’ｒｘと行なうこ
とが自在となシ、発信器Ｔｘの可変メモｌＪＲＡＭｔ中
へ格納されている各種調整値、設定値等の更新が遠隔操
作により可能に々ると共に、発信器Ｔｘの動作状況を遠
隔チェックすることが可能と々るうえ、従来からの設備
に若干の追加を行なうのみにより目的を達することがで
きる。
ただし、第１図および第８図において、発信器Ｔｘ用の
電源を別途の線路により供給するものとし、あるいは、
抵抗器ＲＬＯ代りに他のインビーダンス素子を用いても
よく、第２図においては、各バイト毎にパリティチェッ
ク用のビットを付加し、あるいは、ディジタル信号Ｓｔ
に発イｄ器Ｔｘの個別コードを付加するものとして同様
であシ、第３図、第４図、第６図、第７図の構成は、状
況に応じて選定が任意であると共に、第５図の形状は、
手持形に限らず、パネル実装形等とし、スイッチにより
伝送路の選択および接続を打力うものとしてもよく、通
信器ＣＢから送信のみを行ない、発信器Ｔｘが受信のみ
を行なうものとしても場合によっては十分である等、種
々の変形が自在である。
電源を別途の線路により供給するものとし、あるいは、
抵抗器ＲＬＯ代りに他のインビーダンス素子を用いても
よく、第２図においては、各バイト毎にパリティチェッ
ク用のビットを付加し、あるいは、ディジタル信号Ｓｔ
に発イｄ器Ｔｘの個別コードを付加するものとして同様
であシ、第３図、第４図、第６図、第７図の構成は、状
況に応じて選定が任意であると共に、第５図の形状は、
手持形に限らず、パネル実装形等とし、スイッチにより
伝送路の選択および接続を打力うものとしてもよく、通
信器ＣＢから送信のみを行ない、発信器Ｔｘが受信のみ
を行なうものとしても場合によっては十分である等、種
々の変形が自在である。
以上の説明により明らか々とおシ本発明にょれば、既存
の設備を大幅に変更するととガく、差圧発信器、電磁流
量計等の発信器とデータの送受信が自在とカシ、かつ、
アナログ信号の受信に対して影響を与えないため、各種
発信器の遠隔調整およびチェックのような動作状況監視
を打力う上で、顕著々効果が得られる。
の設備を大幅に変更するととガく、差圧発信器、電磁流
量計等の発信器とデータの送受信が自在とカシ、かつ、
アナログ信号の受信に対して影響を与えないため、各種
発信器の遠隔調整およびチェックのような動作状況監視
を打力う上で、顕著々効果が得られる。
図は本発明の実施例を示し、第１図は全構成のブロック
図、第２図は電流値の波形図、第３図は通信器のブロッ
ク図、第４図は第３図における電流制御部の回路図、第
５図は通信器の外形斜視図、第６図は発信器のブロック
図、第７図は第６図における電流制御部の回路図、第８
図は他の実施例を示す全構成のブロック図である。 Ｔｘ ・・・・発信器、ｐｓ ・・・・電源部、ＬＩ
ｒ Ｌ２ ・・・・線路、ＣＥ・・・・通信器、Ｉ・
・・・電流値、Ｐｔ ・・・・抵抗器（電圧降下紫子）
、Ｓａ ・・・・アナログ信号、Ｓｃ、Ｓｔ・命・・デ
ィジタル信号、ＣＰＵｃ 、ＣＰＵｔ・・０台プロセッ
サ、ＲＯＭｃ 、ＲＯＭｔ・・ｅ・固定メモリ、ＲＡＭ
ｃ 、ＲＡＭｔ ａ ｍ ・＠可変メモリ、ＵＡＲＴ
ｃ、ＵＡＲＴｔ・・・・送受信部、ＫＢｃ ＠・・・
キーボード、ＤＰｃ 、 ＤＰ（Ｂ ・・・・表示器、
Ｉ／Ｆｃ、Ｉ／Ｆｔ φ・・・ インターフェイス、Ｆ
ＬＣ，Ｆｔ、ｔ Ｉ ６ ａ−Ｆ波器、ＣＰｃ 、Ｃ
Ｐｔ ” ”・・比較器、Ｅｃｓ ＋ Ｅｔｓ ・・
・・基準電圧、ＣＣｃ、ＣＣｔ ＃・−・電流制御部、
ＥＣＬ １１１１６・局部電源、Ｄ／Ａｔ・・・・ＤＡ
Ｃ（ディジタル・アナログ変換器）、ＳＷｔ・・・−ス
イッチ回路、Ｃｔ・・・・コンデンサ、八／Ｄｃ ・
・・・ＡＤＣ（アナログ・ディジタル変換器）、３ ・
・・・クリップ。
図、第２図は電流値の波形図、第３図は通信器のブロッ
ク図、第４図は第３図における電流制御部の回路図、第
５図は通信器の外形斜視図、第６図は発信器のブロック
図、第７図は第６図における電流制御部の回路図、第８
図は他の実施例を示す全構成のブロック図である。 Ｔｘ ・・・・発信器、ｐｓ ・・・・電源部、ＬＩ
ｒ Ｌ２ ・・・・線路、ＣＥ・・・・通信器、Ｉ・
・・・電流値、Ｐｔ ・・・・抵抗器（電圧降下紫子）
、Ｓａ ・・・・アナログ信号、Ｓｃ、Ｓｔ・命・・デ
ィジタル信号、ＣＰＵｃ 、ＣＰＵｔ・・０台プロセッ
サ、ＲＯＭｃ 、ＲＯＭｔ・・ｅ・固定メモリ、ＲＡＭ
ｃ 、ＲＡＭｔ ａ ｍ ・＠可変メモリ、ＵＡＲＴ
ｃ、ＵＡＲＴｔ・・・・送受信部、ＫＢｃ ＠・・・
キーボード、ＤＰｃ 、 ＤＰ（Ｂ ・・・・表示器、
Ｉ／Ｆｃ、Ｉ／Ｆｔ φ・・・ インターフェイス、Ｆ
ＬＣ，Ｆｔ、ｔ Ｉ ６ ａ−Ｆ波器、ＣＰｃ 、Ｃ
Ｐｔ ” ”・・比較器、Ｅｃｓ ＋ Ｅｔｓ ・・
・・基準電圧、ＣＣｃ、ＣＣｔ ＃・−・電流制御部、
ＥＣＬ １１１１６・局部電源、Ｄ／Ａｔ・・・・ＤＡ
Ｃ（ディジタル・アナログ変換器）、ＳＷｔ・・・−ス
イッチ回路、Ｃｔ・・・・コンデンサ、八／Ｄｃ ・
・・・ＡＤＣ（アナログ・ディジタル変換器）、３ ・
・・・クリップ。
Claims (2)
- （１）電源部から供給される電流値を発信器により変化
させてアナログ信号とする通信方法において、前記アナ
ログ信号の通ずる伝送路中へ電圧降下素子を挿入し、該
電圧降下素子に通ずる前記アナログ信号と重畳のうえ前
記電流値を通信器によりパルス状に正負方向へ変化させ
てディジタル信号とし、該ディジタル信号を前記発信器
により受信すると共に、前記アナログ信号と重畳のうえ
前記電流値を前記発信器によりパルス状に正負方向へ変
化させてディジタル信号とし、該ディジタル信号を前記
通信器により受信する通信方法であつて、前記通信器か
らのディジタル信号の１つとして前記発信器に対して任
意の値のアナログ値を出力させる信号を発信し、このア
ナログ値に対応した出力があるか否かをチェックするこ
とを特徴としたアナログ・ディジタル通信方法。 - （２）伝送路へ電流を供給する電源部と、前記伝送路へ
接続されかつ該伝送路の電流値を変化させてアナログ信
号とする発信器とからなる通信装置において、前記伝送
路へ挿入された電圧降下素子と、該電圧降下素子よりも
前記発信器側の伝送路へ橋絡接続された前記アナログ信
号と重畳のうえ前記電圧降下素子の電流値をパルス状に
正負方向へ変化させディジタル信号として送信しかつ同
様のディジタル信号を受信する通信器と、該通信器から
送信された前記ディジタル信号を受信しかつ前記アナロ
グ信号と重畳のうえ前記電圧降下素子の電流値をパルス
状に正負方向へ変化させディジタル信号として前記通信
器へ送信する前記発信器とを備え、前記通信器は、ディ
ジタル信号の１つとして前記発信器に対して任意の値の
アナログ値を出力させる信号を発振可能としたことを特
徴とするアナログ・ディジタル通信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9009689A JPH01302928A (ja) | 1989-04-10 | 1989-04-10 | アナログ・デイジタル通信方法およびその装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9009689A JPH01302928A (ja) | 1989-04-10 | 1989-04-10 | アナログ・デイジタル通信方法およびその装置 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7647983A Division JPS59201535A (ja) | 1983-04-30 | 1983-04-30 | アナログ・デイジタル通信方法およびその装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01302928A true JPH01302928A (ja) | 1989-12-06 |
Family
ID=13988991
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9009689A Pending JPH01302928A (ja) | 1989-04-10 | 1989-04-10 | アナログ・デイジタル通信方法およびその装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01302928A (ja) |
-
1989
- 1989-04-10 JP JP9009689A patent/JPH01302928A/ja active Pending
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