JPH01310460A - Scsiバスモニタ装置 - Google Patents

Scsiバスモニタ装置

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Publication number
JPH01310460A
JPH01310460A JP63141103A JP14110388A JPH01310460A JP H01310460 A JPH01310460 A JP H01310460A JP 63141103 A JP63141103 A JP 63141103A JP 14110388 A JP14110388 A JP 14110388A JP H01310460 A JPH01310460 A JP H01310460A
Authority
JP
Japan
Prior art keywords
timer
signal
scsi
reset
control unit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63141103A
Other languages
English (en)
Inventor
Hideji Shoji
庄司 秀治
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP63141103A priority Critical patent/JPH01310460A/ja
Publication of JPH01310460A publication Critical patent/JPH01310460A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、コンピュータ、外部記憶装置等を結ぶパスイ
ンターフェースを制御するSCSI (smal Ic
omputer  systems  1nterfa
ce ) ハ、Cモニタ装置に関する。
従来の技術 第2図は従来のSCSIバスの周辺構成を示すブロック
図である。SCSIパス500には、SCSIデバイス
100 、200及び300が接続されている。
SCSIデバイス100及び200はイニシエータとな
り、SCSIデバイス300はターゲットとなる。さら
に、SCSIデバイス300には磁気ディスク装置40
0が接続されている。
次に以上の構成における動作を第3図を参照して説明す
る。
SCSIデバイス300がビジー(BUSY )信号を
”H”レベルにし、SCSIバス500を占有し続けた
場合、SCSIデバイス100又は200側によってビ
ジー信号が監視される。一定時間が経過した時点にあっ
て、SCSIデバイス300によるビジー信号が”H’
レベルである場合、SCSIデバイス100からリセッ
トコンデイション(R8T)4i号(信号600)が出
され、SCSIデバイス300をSCSIバス500か
ら解放する。
このように、SCSIバスを占有し続けるデバイスに対
しては、リセットコンデイション信号により、パスのデ
ッドロック状態を解除する。
発明が解決しようとする課題 しかし、以上のような従来のデッドロック解除方法では
、ターゲットがビジー信号をハイレベルにしてからダク
ンした場合、リセットコンデイション信号を受けてもバ
スフリーフェーズに移行することができないだめ、バス
のデッドロック状態が解除されないという問題がある。
本発明は、上記のような従来の課題を解決するもので、
SCSIパスのデッドロックを解除できるようにしたS
CSIバスモニタ装置を提供することを目的とするもの
である。
課題を解決するための手段 本発明は上記目的を達成するため、SCSIデバイスよ
り出力されるビジー信号の状態変化を監視する入力ポー
ト監視制御部と、この入力ポート監視制御部に接続され
て上記ビジー信号をリセットするためのり七ノド起動タ
イミングを判定するタイマコントロール部ト、コのタイ
マコントロール部のタイマのカウントアツプに連動して
リセット信号を生成し、このリセット信号と上記ビジー
信号との論理積をとった信号をSCSIバスに送出する
制御手段とを具備したものである。
作用 本発明は上記構成により次のような作用を有する。すな
わち、SCSIデバイスのビジー信号がハイレベルにな
り、かつこれが一定時間継続したことをもってSCSI
デバイスの異常を検出し、この検出をもってSCSIデ
バイスのビジー信号を抑制することにより、他のSCS
Iデバイスに対しSC8丁バスを解放することができる
実施例 以下、本発明の実施例について図面を参照しながら説明
する。第1図は本発明の一実施例におけるSCSIバス
モニタ装置のブロック図である。
1は入力ポート部であり、8ビツトのレジスタによって
構成される。2は入力ポート部1に接続されてその状態
を監視する入力ポート監視制御部、3は入力ポート監視
制御部2からのセット通知信号によってタイマを起動さ
せると共に、リセット通知信号によってタイマ値をゼロ
クリアするタイマコントロール部である。
4は入力ポート監視制御部2よりのリセット通知信号に
よって2系統のリセット信号を発生するBUSY信号リ
セット制御部、10及び20はSCSIデバイス、12
及び22はSCSIデバイス1.0.20の各々より出
力されるBUSY信号とBUSY信号リセット制御部4
より出力されるリセット信号との論理積をとるAND(
アンド)ゲートである。また、30はSCSIバスであ
り、 13及び23はSC:S Iデバイス10 、2
0のBUSY信号線11 、21と入力ポート部1との
間に挿入されるインバータである。
次に、以上の構成の動作について説明する。
入力ポート部1のポートに変化が生じると(少くとも1
ビツトがOFF状態からON状態に、或いは逆の状態に
変化した場合)、この変化を入力ポート監視制御部2が
検知する。ここで、ON状態とはBUSY信号がアクテ
ィブな状態をさし、この逆をOFF状態としている。
入力ポート監視制御部2は、監視内容に応じてタイマコ
ントロール部3のタイマをセットあるいはリセットする
。具体的には、入力ポート部1がON状態に変化したと
きにタイマをセットするためのタイマセット通知信号S
1をタイマコントロール部3へ発信し、OFF状態に変
化したときにタイマリセット通知信号をタイマコントロ
ール部3から入力ポート監視制御部2へ発信する。
タイマコントロール部3は、入力ポート監視制御部2か
らのタイマセット通知信号Slによってタイマを起動し
、リセットでタイマ起動中であればタイマリセット通知
信号S2によってタイマを停止させ、タイマ値をゼロク
リアする。タイマが起動されてから成る一定時間までタ
イマをカウントアツプする。このタイマ時間内にタイマ
リセット通知信号S2が入力ポート監視制御部2より発
せられなかった場合、タイマコントロール部3はタイム
アウトとみなし、タイムアウト通知信号S3 を入力ポ
ート監視制御部2へ発信する。タイムアウト通知信号を
受けた入力ボート監視制御部2はSCSIバス30がデ
ッドロック状態になったことを認識する。これに基づい
て入力ポート監視制御部2は、リセット通知信号S4を
BUSY信号リセット制御部4へ送る。リセット通知信
号S4を受けたBUSY信号リセット制御部4は、リセ
ット信号Ss 、 Ssを、υ■ゲート12及び22の
一方の入力端子に供給する。
、静■ゲート12及び22は、リセット信号Ss。
S6 とSCSIデバイス10 、20のBUSY信号
】1゜21  との論理積をとり、SCSIデバイス1
0 、20のBUSY信号を抑制する指示信号をSCS
Iバス30へ送出する。リセット信号S5.S6はロー
レベル(0″)であり、SCSIデバイス10 、20
の各々より出力されるハイレベル(”1”)のBUSY
信号11 、21との論理積がかのゲート12 、22
でとられ、ローレベルの出力信号がSCSIバス30 
に出力されるときに、SCSIバス30のデッドロック
状態が解除される。
発明の効果 以上述べたように本発明によれば、5C3Iデ、(イス
より出力されるビジー信号の状態変化を監視する入力ポ
ート監視制御部と、この入力ポート監視制御部に接続さ
れて上記ビジー信号をリセットするためのリセット起動
タイミングを判定するタイマコントロール部ト、このタ
イマコントロール部のタイマのカウントアツプに連動し
てリセット信号を生成し、このリセット信号と上記ビジ
ー信号との論理積をとった信号をSCSIバスに送出す
る制御手段とを設けるようにしているので、5C3Iデ
バイスのデッドロック状態を解除することができ、すべ
ての5C3Iデバイスに対して5C3Iバスの使用権を
保証し、5C3Iバスの高信頼化を図ることができる。
【図面の簡単な説明】
第1図は本発明の一実施例におけるSCSIバスモニタ
装置のブロック図、第2図は従来のSCSIバスの周辺
構成を示すブロック図、第3図は従来の5C3Iバスに
接がる装置の動作を説明するための動作波形図である。 1・・・入力ポート部、2・・・入力ポート監視制御部
、3・・タイマコントロール部、4・・・BUSY信号
リセット制御部、10.20・・・SCSIデバイス、
12.22・・・AND ゲー ト、13.23 ・・
・インバータ。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1

Claims (1)

    【特許請求の範囲】
  1. SCSIデバイスより出力されるビジー信号の状態変化
    を監視する入力ポート監視制御部と、この入力ポート監
    視制御部に接続されて上記ビジー信号をリセットするた
    めのリセット起動タイミングを判定するタイマコントロ
    ール部と、このタイマコントロール部のタイマのカウン
    トアップに連動してリセット信号を生成し、このリセッ
    ト信号と上記ビジー信号との論理積をとった信号をSC
    SIバスに送出する制御手段とを具備することを特徴と
    するSCSIバスモニタ装置。
JP63141103A 1988-06-08 1988-06-08 Scsiバスモニタ装置 Pending JPH01310460A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP63141103A JPH01310460A (ja) 1988-06-08 1988-06-08 Scsiバスモニタ装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP63141103A JPH01310460A (ja) 1988-06-08 1988-06-08 Scsiバスモニタ装置

Publications (1)

Publication Number Publication Date
JPH01310460A true JPH01310460A (ja) 1989-12-14

Family

ID=15284254

Family Applications (1)

Application Number Title Priority Date Filing Date
JP63141103A Pending JPH01310460A (ja) 1988-06-08 1988-06-08 Scsiバスモニタ装置

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JP (1) JPH01310460A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002207646A (ja) * 2001-01-05 2002-07-26 Matsushita Electric Ind Co Ltd 記録再生装置

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59218530A (ja) * 1983-05-27 1984-12-08 Hitachi Ltd 入出力制御装置

Patent Citations (1)

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