JPH01314005A - buffer amplifier - Google Patents
buffer amplifierInfo
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- JPH01314005A JPH01314005A JP63144939A JP14493988A JPH01314005A JP H01314005 A JPH01314005 A JP H01314005A JP 63144939 A JP63144939 A JP 63144939A JP 14493988 A JP14493988 A JP 14493988A JP H01314005 A JPH01314005 A JP H01314005A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
〔産業上の利用分野〕
本発明は、出力電圧が温度補償された緩衝増幅器に関す
る。
〔発明の概要〕
本発明は、ベースに定電圧が供給された補償用トランジ
スタのコレクタを、第１の抵抗器を介して、エミッタフ
ォロワのエミッタに接続すると共に、補償用トランジス
タのエミッタと基準電位点との間に第２の抵抗器を接続
することにより、温度により変動するエミッタフォロワ
のＶＢ＋＋の影響を除去ないしは相殺して、出力電圧の
温度補償を行なうものである。
〔従来の技術〕
従来、バイポーラトランジスタによるアナログ増幅器は
、例えば第２図に示すように構成されていた。
即ち、第２図において、（１０）は差動増幅器であって
、入力端子（１）が１対のｎｐｎ）ランジスタ（１１）
及び（１２）の一方のベースに接続され、他方のベース
には定電圧源（２）が接続される。この定電圧源（２）
は、電源ＶＣＣとアースとの間に接続された分圧器であ
ってもよい。両トランジスタ（１１）及び（１２）のエ
ミッタが、それぞれ定電流源としてのｎｐｎ）ランジス
タ（１３）及び（１４）を介して接地され、トランジス
タ（１１）及び（１２）のエミッタ間に抵抗器（１５）
が接続される。トランジスタ（１１）のコレクタに直接
に電源ＶＣＣが供給され、トランジスタ（１２）のコレ
クタには負荷抵抗器（１６）を介して電源ＶＣＣが供給
される。
定電流源（１７）とダイオード接続のｎｐｎ）ランジス
タ（１８）とが、電源Ｖ。０とアースとの間に直列に接
続され、このトランジスタ（１８）がトランジスタ（１
３）及び〈１４〉とそれぞれカレントミラー接続される
。
ｎｐｎ）ランジスタ（２１）は、そのコレクタが直接に
電源Ｖ。Ｃに接続されると共に、そのエミッタが定電流
源としてのｎｐｎトランジスタ（２２）を介して接地さ
れて、エミッタフォロワとされる。トランジスタ（２２
）はダイオード接続のトランジスタ（１８）とカレント
ミラー接続される。増幅器（１０）の出力が、端子（３
）を介して、トランジスタ（２１）のベースに供給され
、そのエミッタからの出力が端子（４）に導出される。
周知のように、端子（３）及び（４）間の電圧利得は略
〔１〕であり、端子（４）の出力インピーダンスは極め
て小さく、エミッタフォロワ（２１）は緩衝増幅器（バ
ッファ）として機能する。
〔発明が解決しようとする課題〕
ところで、第２図の端子（３）の直流電位、即ち増幅器
（１０）の出力電圧の直流成分ＶＩＯは、通常、温度変
化による変動が比較的小さい。そして、この直流電位変
動がないことが好ましい場合が多く、この場合には、温
度補償によって直流電位変動が除去される。
ところが、一般に、トランジスタのベース・エミッタ間
電圧ＶＢＥは約−２ｍｖ／℃と比較的大きな温度係数を
有するため、増幅器（１０）の出力の直流電位変動が小
さい場合、エミッタフォロワ（２１）を介して、端子（
４）に導出された出力電圧は、はぼＶＢＥ １個分相当
の直流電位変動が付加されてしまうという問題があった
。
かかる点に鑑み、本発明の目的は、エミッタフォロワの
Ｖ、の影響を除去して、出力電圧を温度補償した緩衝増
幅器を提供するところにある。
〔課題を解決するための手段〕
本発明は、エミッタフォロワ接続の第１のトランジスタ
（２１）のエミッタに第１の抵抗器（２３）を介して第
２のトランジスタ（２４）のコレクタを接続し、この第
２のトランジスタのエミッタを第２の抵抗器（２５）を
介して基準電圧点に接続すると共に、第２のトランジス
タのベースに定電圧Ｖ２６を供給して、出力電圧の温度
補償を行なうようにした緩衝増幅器である。
〔作用〕
かかる構成によれば、エミッタフォロワ接続されたトラ
ンジスタのＶＢＩ！の影響が除去されて、出力電圧が温
度補償される。
〔実施例〕
以下、第１図を参照しながら、本発明による緩衝増幅器
の一実施例について説明する。
本発明の一実施例の構成を第１図に示す。この第１図に
おいて、前出第２図に対応する部分には同一符号を付け
て重複説明を省略する。
第１図において、（２０）は緩衝増幅器を全体として示
し、エミッタフォロワ接続のトランジスタ（２１）のエ
ミッタに、抵抗器（２３）を介して、ｎｐｎトランジス
タ（２４）のコレクタが接続され、トランジスタ〈２４
）のエミッタは抵抗器（２５）を介して接地される。ト
ランジスタ（２４）のベースには定電圧源（２６）が接
続される。この定電圧源（２６）は、第２図の定電圧源
（２）と同様に、分圧器であってもよい。
トランジスタ（２４）のコレクタに端子（４）が接続さ
れ、この端子（４）の出力信号は、それぞれエミッタフ
ォロワ接続された、ｐｎｐ）ランジスタ（２７）及びｎ
ｐｎ）ランジスタ（２８）を介して端子（５）に導出さ
れる。
本実施例の動作は次のとおりである。
第２図の増幅器（１０）の直流出力電圧ＶＩＯが端子（
３）に供給され、トランジスタ（２４）のコレクタ電流
が■。であるとする。トランジスタ（２１）のコレク夕
電流はこのＩｃ よりも大きくなるが、これによる両ト
ランジスタ（２１）及び〈２４）のベース・エミッタ電
圧間の差を無視すれば、抵抗器（２３）及び（２５）の
抵抗値をそれぞれＲ２３及びＲ２Ｓとし、端子（４）の
直流出力電圧をＶ、として、次の（１）式及び（２）式
が成立する。
ｖ４−ｖｌｏ−Ｖ［ＩＥ−ＩＣ−Ｒ２３・・・（１）Ｖ
２１１−ＶＢＥ＝ＩＣ−Ｒ２ｓ・・・（２）両式から■
。を消去すれば次の（３）式が得られる。
Ｒ２３”Ｒ２Ｓの場合、（３）式は次の（３ａ）式のよ
うになる。
■、−Ｖ１ｏ−■２６ ・・・（３ａ）
前述のように、温度によるＶ Ｉ Ｇの変動は比較的小
さく、または[Industrial Application Field] The present invention relates to a buffer amplifier whose output voltage is temperature compensated. [Summary of the Invention] The present invention connects the collector of a compensation transistor whose base is supplied with a constant voltage to the emitter of an emitter follower via a first resistor, and connects the emitter of the compensation transistor to a reference potential. By connecting a second resistor between the two points, the effect of VB++ of the emitter follower, which varies with temperature, is removed or offset, and the output voltage is temperature-compensated. [Prior Art] Conventionally, an analog amplifier using bipolar transistors has been configured as shown in FIG. 2, for example. That is, in FIG. 2, (10) is a differential amplifier, and the input terminal (1) is connected to a pair of npn transistors (11).
and (12), and a constant voltage source (2) is connected to the other base. This constant voltage source (2)
may be a voltage divider connected between the power supply VCC and ground. The emitters of both transistors (11) and (12) are grounded via NPN transistors (13) and (14) as constant current sources, respectively, and a resistor (12) is connected between the emitters of transistors (11) and (12). 15)
is connected. Power supply VCC is supplied directly to the collector of the transistor (11), and power supply VCC is supplied to the collector of the transistor (12) via a load resistor (16). A constant current source (17) and a diode-connected NPN transistor (18) are connected to a power source V. 0 and ground, and this transistor (18) is connected in series between the transistor (1
3) and <14>, respectively, in a current mirror connection. npn) transistor (21) has its collector directly connected to the power supply V. C, and its emitter is grounded via an npn transistor (22) serving as a constant current source, making it an emitter follower. Transistor (22
) is connected in a current mirror with a diode-connected transistor (18). The output of the amplifier (10) is connected to the terminal (3
) to the base of the transistor (21), and the output from its emitter is led out to the terminal (4). As is well known, the voltage gain between terminals (3) and (4) is approximately [1], the output impedance of terminal (4) is extremely small, and the emitter follower (21) functions as a buffer amplifier (buffer). . [Problems to be Solved by the Invention] Incidentally, the DC potential of the terminal (3) in FIG. 2, that is, the DC component VIO of the output voltage of the amplifier (10), usually has relatively small fluctuations due to temperature changes. In many cases, it is preferable not to have this DC potential fluctuation, and in this case, the DC potential fluctuation is eliminated by temperature compensation. However, in general, the base-emitter voltage VBE of a transistor has a relatively large temperature coefficient of about -2 mv/°C, so when the DC potential fluctuation of the output of the amplifier (10) is small, the , terminal (
There is a problem in that the output voltage derived in 4) is subject to a DC potential fluctuation equivalent to one VBE. In view of this, an object of the present invention is to provide a buffer amplifier whose output voltage is temperature-compensated by eliminating the influence of V of the emitter follower. [Means for Solving the Problems] The present invention connects the collector of a second transistor (24) to the emitter of a first transistor (21) connected as an emitter follower via a first resistor (23). , the emitter of this second transistor is connected to the reference voltage point via the second resistor (25), and a constant voltage V26 is supplied to the base of the second transistor to perform temperature compensation of the output voltage. This is a buffer amplifier. [Operation] According to this configuration, VBI! of the emitter follower-connected transistor! effects are removed and the output voltage is temperature compensated. [Embodiment] An embodiment of the buffer amplifier according to the present invention will be described below with reference to FIG. FIG. 1 shows the configuration of an embodiment of the present invention. In FIG. 1, parts corresponding to those in FIG. 2 are given the same reference numerals and redundant explanation will be omitted. In FIG. 1, (20) shows the buffer amplifier as a whole, and the collector of an npn transistor (24) is connected to the emitter of an emitter follower-connected transistor (21) via a resistor (23). 24
) is grounded via a resistor (25). A constant voltage source (26) is connected to the base of the transistor (24). This constant voltage source (26) may be a voltage divider like the constant voltage source (2) in FIG. A terminal (4) is connected to the collector of the transistor (24), and the output signal of this terminal (4) is transmitted to the transistor (27) and np (pnp) transistor (27) and
pn) is led out to the terminal (5) via the transistor (28). The operation of this embodiment is as follows. The DC output voltage VIO of the amplifier (10) in FIG.
3), and the collector current of the transistor (24) is ■. Suppose that The collector current of the transistor (21) is larger than this Ic, but if the difference between the base and emitter voltages of both transistors (21) and (24) due to this is ignored, the resistors (23) and (25) The following equations (1) and (2) hold true, assuming that the resistance values of are R23 and R2S, respectively, and the DC output voltage of terminal (4) is V. v4-vlo-V[IE-IC-R23...(1)V
211-VBE=IC-R2s...(2) From both equations■
. By eliminating , the following equation (3) is obtained. In the case of R23''R2S, equation (3) becomes the following equation (3a). ■, -V1o-■26 ... (3a)
As mentioned above, the variation in V I G due to temperature is relatively small or
〔０〕であり、Ｖ２Ｇは定電圧であるから
、本実施例においては、抵抗器（２３）及び（２５）の
抵抗値が等しい場合、トランジスタ（２１）のＶＢＥの
影響が除去されて、端子（４）からは温度補償された出
力電圧が得られる。
Ｒ２３は例えば８にΩ程度に選定されて、そのままでは
、端子（４）の出力インピーダンスが増大する。
このため、本実施例では、ｐｎｐ ）ランジスタ（２７
）及びｎｐｎ）ランジスタ（２８）によるエミッタフォ
ロワを縦続接続して、端子（５）において、通常の低出
力インピーダンスを得ている。この場合、両トランジス
タ（２７）及び（２８）のＶＩＩＥの変動は互いに逆方
向となって相殺される。
第１図の実施例において、端子（３）に供給される直流
電圧Ｖ、。が温度によって変動する場合は、Ｒ２３及び
Ｒ２Ｓの比率を適宜選定して出力電圧の温度補償を行な
うことができる。
この場合、ｋを正の任意常数として、Ｖｌ。がトランジ
スタのＶｌｌ［！のに倍の温度係数を有するものとすれ
ば、前出（１）式に対応して、次の−（４）式が成立す
る。
Ｖｌ ＝ Ｖ ＋ｏ ｋ ＶＢＩＩ Ｖａｉ Ｒ
２３・Ｉ ｃ＝ Ｖ＋ｏ （１＋ ｋ） ＶＢＥＲ２
３・ＩＣ・・・（４）
この（４）式と前出（２）式から■。を消去すれば次の
（５）式が得られる。
・・・（５）[0] and V2G is a constant voltage, so in this example, if the resistance values of resistors (23) and (25) are equal, the influence of VBE of transistor (21) is removed, and the terminal (4) gives a temperature compensated output voltage. R23 is selected to be approximately 8Ω, for example, and if left as is, the output impedance of the terminal (4) will increase. Therefore, in this embodiment, the pnp) transistor (27
) and npn) transistors (28) are cascaded to obtain a conventional low output impedance at the terminal (5). In this case, the fluctuations in VIIE of both transistors (27) and (28) are in opposite directions and cancel each other out. In the embodiment of FIG. 1, the DC voltage V, supplied to terminal (3). If the voltage varies with temperature, the output voltage can be temperature compensated by appropriately selecting the ratio of R23 and R2S. In this case, Vl, where k is a positive arbitrary constant. is the transistor's Vll [! If it has a temperature coefficient twice that of , then the following equation (4) holds true corresponding to the above equation (1). Vl = V +ok VBII Vai R
23・I c= V+o (1+ k) VBER2
3.IC...(4) From this equation (4) and the above equation (2), ■. By eliminating , the following equation (5) is obtained. ...(5)
〔０〕となって、端子（４）の出力電圧Ｖ４ が温度補
償される。
〔発明の効果〕
以上詳述のように、本発明によれば、ベースに定電圧が
供給された補償用トランジスタのコレクタを、第１の抵
抗器を介して、エミッタフォロワのエミッタに接続する
と共に、補償用トランジスタのエミッタと基準電位点と
の間に第２の抵抗器を接続するようにしたので、温度に
より変動するエミッタフォロワのＶＢＨの影響が除去な
いしは相殺されて、出力電圧の温度補償が行なわれた緩
衝増幅器が得られる。[0], and the output voltage V4 of the terminal (4) is temperature compensated. [Effects of the Invention] As detailed above, according to the present invention, the collector of the compensation transistor whose base is supplied with a constant voltage is connected to the emitter of the emitter follower via the first resistor, and Since the second resistor is connected between the emitter of the compensation transistor and the reference potential point, the influence of the VBH of the emitter follower, which varies with temperature, is removed or canceled out, and the temperature compensation of the output voltage is achieved. A buffer amplifier is obtained.
第１図は本発明による緩衝増幅器の一実施例の構成を示
す結線図、第２図は従来の緩衝増幅器の構成例を示す結
線図である。
（２１）、 （２４） はトランジスタ、（２３）、
（２５＞ は抵抗器、（２６）は定電圧源である。
代 理 人 伊 藤 頁間
松 隈 秀 盛電光例
１し１ 粟 イ列FIG. 1 is a wiring diagram showing the configuration of an embodiment of a buffer amplifier according to the present invention, and FIG. 2 is a wiring diagram showing an example of the configuration of a conventional buffer amplifier. (21), (24) are transistors, (23),
(25> is a resistor, and (26) is a constant voltage source. Agent: Ito Between pages
Hide Matsukuma Mori Denko Example 1 and 1 Millet I series
Claims (1)
に第１の抵抗器を介して第２のトランジスタのコレクタ
を接続し、 この第２のトランジスタのエミッタを第２の抵抗器を介
して基準電位点に接続すると共に、上記第２のトランジ
スタのベースに定電圧を供給して、 出力電圧の温度補償を行なうようにしたことを特徴とす
る緩衝増幅器。[Claims] A collector of a second transistor is connected to the emitter of a first transistor in an emitter follower connection via a first resistor, and the emitter of the second transistor is connected to the emitter of the second transistor via a second resistor. 1. A buffer amplifier, characterized in that the second transistor is connected to a reference potential point, and a constant voltage is supplied to the base of the second transistor to perform temperature compensation of the output voltage.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63144939A JP2720458B2 (en) | 1988-06-13 | 1988-06-13 | Buffer amplifier |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63144939A JP2720458B2 (en) | 1988-06-13 | 1988-06-13 | Buffer amplifier |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01314005A true JPH01314005A (en) | 1989-12-19 |
| JP2720458B2 JP2720458B2 (en) | 1998-03-04 |
Family
ID=15373703
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63144939A Expired - Fee Related JP2720458B2 (en) | 1988-06-13 | 1988-06-13 | Buffer amplifier |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2720458B2 (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012099929A (en) * | 2010-10-29 | 2012-05-24 | Renesas Electronics Corp | Output buffer circuit |
| JP2012114870A (en) * | 2010-11-29 | 2012-06-14 | Mitsumi Electric Co Ltd | Video signal output circuit |
-
1988
- 1988-06-13 JP JP63144939A patent/JP2720458B2/en not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012099929A (en) * | 2010-10-29 | 2012-05-24 | Renesas Electronics Corp | Output buffer circuit |
| JP2012114870A (en) * | 2010-11-29 | 2012-06-14 | Mitsumi Electric Co Ltd | Video signal output circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2720458B2 (en) | 1998-03-04 |
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