JPH0182523U - - Google Patents

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JPH0182523U
JPH0182523U JP1987178479U JP17847987U JPH0182523U JP H0182523 U JPH0182523 U JP H0182523U JP 1987178479 U JP1987178479 U JP 1987178479U JP 17847987 U JP17847987 U JP 17847987U JP H0182523 U JPH0182523 U JP H0182523U
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digital
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analog
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  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図はその動作説明図、第3図は従来例を示す
回路図である。 2,7…モードスイツチ、3…DAコンバータ
、4…加算器、9…制御装置。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力デイジタル信号をアナログ信号に変換する
    デイジタルアナログ変換器において、前記デイジ
    タルアナログ変換器を調整モードに設定する手段
    と、該調整モードにおいて前記入力デイジタル信
    号に換えて、最上位ビツトのみオンとなる第1の
    デイジタル信号と、最上位ビツトのみオフとなる
    第2のデイジタル信号とを交互に前記デイジタル
    アナログ変換器に印加する手段と、上記第1及び
    第2のデイジタル信号のうちの一方に対応するデ
    イジタルアナログ変換器の出力に最下位ビツトに
    対応するアナログ変換出力を加算もしくは減算す
    る手段と、第1及び第2のデイジタル信号印加期
    間にそれぞれ得られる上記アナログ変換出力のレ
    ベル差を最少にする様に上記デイジタルアナログ
    変換器の最上位ビツトに対応するアナログ変換出
    力を調整する手段とを有することを特徴とするデ
    イジタルアナログ変換器。
JP1987178479U 1987-11-24 1987-11-24 Pending JPH0182523U (ja)

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JPH0182523U true JPH0182523U (ja) 1989-06-01

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ID=31470093

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Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57104320A (en) * 1980-12-22 1982-06-29 Nec Corp Digital-analogue converter
JPS5876241A (ja) * 1981-11-02 1983-05-09 Seiyuu Bussan Kk 中芯封入射出成形方法

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS57104320A (en) * 1980-12-22 1982-06-29 Nec Corp Digital-analogue converter
JPS5876241A (ja) * 1981-11-02 1983-05-09 Seiyuu Bussan Kk 中芯封入射出成形方法

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