JPH0191549A - Polling control system - Google Patents
Polling control systemInfo
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- JPH0191549A JPH0191549A JP62249251A JP24925187A JPH0191549A JP H0191549 A JPH0191549 A JP H0191549A JP 62249251 A JP62249251 A JP 62249251A JP 24925187 A JP24925187 A JP 24925187A JP H0191549 A JPH0191549 A JP H0191549A
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- Japan
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- communication control
- data
- register
- control unit
- transmission
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- Pending
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Abstract
Description
【発明の詳細な説明】
〔概要〕
通信制御部に対してポーリング制御を行うポーリング制
御方式に関し、
複数の通信制御部から送出されたリクエスト信号を一括
して保持するデータリクエストレジスタを設け、このデ
ータリクエストレジスタの内容を読み込んで対応する通
信制御部に対して送受処理を行ってデータ転送速度を向
上させることを目的とし、
各通信制御部から送出されたリクエスト信号によって夫
々セットされるデータリクエストレジスタと、このデー
タリクエストレジスタにセットされている情報を読んで
対応する通信制御部に対して送受処理を実行するデータ
転送制御部とを備え、このデータ転送制御部が、通信制
御部から送出されたリクエスト信号によってセットされ
たデータリクエストレジスタの内容を読み込み、セット
されている通信制御部に対して送受処理を行うように構
成する。[Detailed Description of the Invention] [Summary] Regarding a polling control method that performs polling control on communication control units, a data request register is provided that collectively holds request signals sent from a plurality of communication control units, and this data The purpose is to read the contents of the request register and perform transmission/reception processing to the corresponding communication control unit to improve the data transfer speed. , and a data transfer control unit that reads the information set in this data request register and executes sending/receiving processing to the corresponding communication control unit, and this data transfer control unit handles requests sent from the communication control unit. It is configured to read the contents of the data request register set by the signal and perform transmission/reception processing to the set communication control unit.
本発明は、通信制御部に対してポーリング制御を行うポ
ーリング制御方式に関するものである。The present invention relates to a polling control method that performs polling control on a communication control unit.
従来、第３図に示すように、回線を介して端末などとデ
ータの送受を行う複数の通信制御部１１−１ないし１１
−ｎを設け、これらを−括管理するＭＰｔＪ１４が当該
通信制御部１１−１ないし１１−ｎ中のステータスレジ
スタ１２−１ないし１２−ｎの内容を順次ポーリングし
て、内部に設けたバッファに受信したデータがあるか否
かなどの情報を読み込んで対応する所定の送受処理を行
うようにしていた。以下第４図を用いて第３図構成の動
作を簡単に説明する。Conventionally, as shown in FIG. 3, a plurality of communication control units 11-1 to 11 transmit and receive data to and from terminals via lines.
MPtJ14, which collectively manages these, sequentially polls the contents of the status registers 12-1 to 12-n in the communication control units 11-1 to 11-n, and receives them in an internal buffer. The system reads information such as whether or not there is any data, and performs the corresponding predetermined transmission/reception processing. The operation of the configuration shown in FIG. 3 will be briefly explained below using FIG. 4.
第４図において、図中０は、通信制御部＃１の５ＴＳＲ
ＥＡＤ （ステータスレジスタ１２−１の内容をリード
）を行う状態を示す。これは、ＭＰＵ１４が通信制御部
（＃１）１２−１中のステータスレジスタ１２−１の内
容を読み込むことを意味している。In Fig. 4, 0 in the figure is 5TSR of communication control unit #1.
Indicates a state in which EAD (reading the contents of status register 12-1) is performed. This means that the MPU 14 reads the contents of the status register 12-1 in the communication control unit (#1) 12-1.
図中＠は、ＤＡＴＡありか否かを判別する状態を示す。In the figure, @ indicates a state in which it is determined whether or not DATA exists.
ＹＥＳの場合には、図中０で対応する送受処理を行い、
図中［相］を実行する。Ｎｏの場合には、図中■を実行
する。If YES, perform the corresponding sending/receiving process at 0 in the diagram,
Execute [phase] in the diagram. In the case of No, perform ■ in the figure.
図中■は、図中０と同様に、通信制御部＃２の５ＴＳＲ
ＥＡＤを行い、更に図中＠と同様にＤＡＴＡがある場合
には、所定の送受処理を行う状態を示す。■ in the figure is the 5TSR of communication control unit #2, similar to 0 in the figure.
EAD is performed, and if there is DATA like @ in the figure, it indicates a state in which predetermined transmission/reception processing is performed.
図中■は、通信制御部＃ｎの５ＴＳＲＥＡＤを行う状態
を示す。In the figure, ■ indicates a state in which communication control unit #n performs 5TSREAD.
図中［相］は、ＤＡＴＡありか否かを判別する状態を示
す、ＹＥＳの場合には、図中０で対応する送受処理を行
い、図中０以下を繰り返し実行する。[Phase] in the figure indicates a state in which it is determined whether or not there is DATA. If YES, the corresponding transmission/reception process is performed at 0 in the figure, and the steps starting from 0 in the figure are repeatedly executed.
ＮＯの場合には、図中０以下を繰り返し実行する。If NO, steps 0 and below in the diagram are repeatedly executed.
以上のように、従来は、通信制御部１１−１ないし１１
−ｎ中のステータスレジスタ１２−１ないし１２−ｎの
内容を順次読み込んで、対応する送受処理を行うように
していた。As described above, conventionally, communication control units 11-1 to 11
-n, the contents of the status registers 12-1 to 12-n are read in sequence, and the corresponding transmission/reception processing is performed.
従来は、第３図および第４図を用いて説明したように、
ＭＰＵ１４が通信制御部１１−１ないし１１−ｎ中のス
テータスレジスタ１２−１ないし１２−ｎの内容をポー
リングし、対応する送受処理を行うようにしていたため
、通信制御部の数が増えるに従ってポーリングしなけれ
ばならない数が増大してこのポーリングのために多くの
時間が取られてしまい、通信制御部１１−１ないし１１
−ｎに対するデータ転送が遅くなってしまうという問題
点があった。Conventionally, as explained using FIGS. 3 and 4,
Since the MPU 14 polls the contents of the status registers 12-1 to 12-n in the communication control units 11-1 to 11-n and performs the corresponding transmission/reception processing, polling increases as the number of communication control units increases. As the number of polling data increases and a lot of time is taken for this polling, the communication control units 11-1 to 11
There is a problem in that data transfer for -n becomes slow.
本発明は、複数の通信制御部から送出されたリクエスト
信号を一括して保持するデータリクエストレジスタを設
け、このデータリクエストレジスタの内容を読み込んで
対応する通信制御部に対して送受処理を行ってデータ転
送速度を向上させることを目的としている。The present invention provides a data request register that collectively holds request signals sent from a plurality of communication control units, reads the contents of this data request register, and performs processing to transmit and receive data to the corresponding communication control unit. The purpose is to improve transfer speed.
第１図を参照して問題点を解決するための手段を説明す
る。Means for solving the problem will be explained with reference to FIG.
第１図において、通信制御部１−１ないし１−ｎは、回
線を介して端末などとデータの送受を行うものである。In FIG. 1, communication control units 1-1 to 1-n send and receive data to and from terminals via lines.
ＤＲＥＱ （データリクエスト）レジスタ２は、通信制
御部１−１ないしｌ−ｎから送出されたリクエスト信号
の状態を一括して保持するものである。The DREQ (data request) register 2 collectively holds the states of request signals sent from the communication control units 1-1 to l-n.
データ転送制御部３−１は、ＤＲＥＱレジスタ２に保持
されている内容を読み込んで、該当する通信制御部１−
１ないしｌ−ｎ中のバッファと、内部メモリ例えばＲＡ
Ｍ５との間のデータ転送を制御などするものである。The data transfer control unit 3-1 reads the contents held in the DREQ register 2, and the corresponding communication control unit 1-1 reads the contents held in the DREQ register 2.
1 to l-n and internal memory e.g. RA
It controls data transfer between M5 and M5.
（作用〕
本発明は、第１図に示すように、データ転送制御部３−
１が、各通信制御部１−１ないしｌ−ｎから送出された
リクエスト信号の状態を一括して保持するＤＲＥＱレジ
スタ２の内容を読み込んで、該当する通信制御部１−１
ないしｌ −ｎ中のバッファと、内部メモリ （例えば
ＲＡＭ５）との間でデータ転送などの送受処理を行うよ
うにしている。(Operation) As shown in FIG.
1 reads the contents of the DREQ register 2 that collectively holds the states of request signals sent from each communication control unit 1-1 to l-n, and transmits the corresponding communication control unit 1-1.
Transmission/reception processing such as data transfer is performed between the buffers in 1 to 1-n and the internal memory (for example, RAM 5).
このため、データ転送制御部３−１は、通信制御部１−
１ないしｌ−ｎを１つづつ順次ポーリングする必要がな
く、単にＤＲＥＱレジスタ２の内容を読み込んで送受処
理を行うことが可能となり、ポーリングに要する時間を
削減して高速に送受処理を行うことができる。For this reason, the data transfer control unit 3-1 controls the communication control unit 1-
There is no need to sequentially poll 1 to l-n one by one, and it is now possible to simply read the contents of DREQ register 2 and perform transmission/reception processing, reducing the time required for polling and performing transmission/reception processing at high speed. can.
次に、第１図および第２図を用いて本発明の構成および
動作を詳細に説明する。Next, the configuration and operation of the present invention will be explained in detail using FIGS. 1 and 2.
第１図において、通信制御部１−１ないし１−ｎは、回
線を介して端末などとデータの送受を行うものである。In FIG. 1, communication control units 1-1 to 1-n send and receive data to and from terminals via lines.
この通信制御部１−１ないし１−ｎは、バッファを持ち
、これに送信用のデータを蓄えた後、回線を介して相手
先の端末などに送信したり、あるいは相手先の端末から
回線を介して送イδされてきたデータを受信してバッフ
ァに格納するようにしている。そして、データをバッフ
ァに受信した場合には、内部のステータスレジスタにこ
の旨が表示されると共に、リクエスト信号としてＤＭＡ
リクエスト信号をＤＲＥＱレジスタ２に送出してバッフ
ァに受信データがある旨を表示させる。これにより、受
信したデータがＲＡＭ５中などにデータ転送され、所定
の受信処理が実行される。The communication control units 1-1 to 1-n have buffers, and after storing data for transmission in the buffers, transmit the data to the other party's terminal via the line, or disconnect the line from the other party's terminal. The data sent via the LAN terminal is received and stored in a buffer. When data is received in the buffer, this fact is displayed on the internal status register and the DMA is sent as a request signal.
A request signal is sent to the DREQ register 2 to indicate that there is received data in the buffer. As a result, the received data is transferred to the RAM 5 or the like, and a predetermined reception process is executed.
ＤＲＥＱ （データリクエスト）レジスタ２は、通信制
御部１−１ないしＬ−ｎから送出されたリクエスト信号
であるＤＭＡリクエスト信号の状態を一括して保持する
ものである。このＤＭＡリクエスト信号は、通信制御部
１−１ないしｌ−ｎがＤＭＡ転送を制御するＤＭＡＣ（
ＤＭＡコントローラ）に対してＤＭＡ転送を要求するた
めのものである。The DREQ (data request) register 2 collectively holds the states of DMA request signals, which are request signals sent from the communication control units 1-1 to L-n. This DMA request signal is sent to the DMAC (
This is for requesting DMA transfer from the DMA controller.
ＲＯＭ３は、プログラムなどを格納するものである。The ROM 3 stores programs and the like.
データ転送制御部３−１は、プログラムによって構成さ
れたものであって、ＤＲＥＱレジスタ２の内容を読み込
んで、該当する通信制御部１−１ないし１−ｎに対して
送受処理を実行するものである。The data transfer control unit 3-1 is configured by a program, and reads the contents of the DREQ register 2 and executes transmission/reception processing to the corresponding communication control unit 1-1 to 1-n. be.
尚、ＭＰＵ （、マイクロプロセッサ）４は各種制御を
行うもの、ＲＡＭ５はデータなどを格納するものである
。Incidentally, an MPU (microprocessor) 4 performs various controls, and a RAM 5 stores data and the like.
次に第２図を用いて第１図構成の動作を詳細に説明する
。Next, the operation of the configuration shown in FIG. 1 will be explained in detail using FIG.
第２図において、図中■は、ＤＲＥＱレジスタ２の内容
をＲＥＡＤする状態を示す、これは、通信制御部１−１
ないしｌ−ｎから送出されたＤＭＡリクエスト信号の状
態を一括して保持しているＤＲＥＱレジスタ２の内容を
読み込むことを意味している。In FIG. 2, ■ in the figure indicates a state in which the contents of the DREQ register 2 are read.
This means reading the contents of the DREQ register 2, which collectively holds the states of the DMA request signals sent from 1 to ln.
図中■は、フラグがありか否かを判別する状態を示す。In the figure, ■ indicates a state in which it is determined whether or not there is a flag.
ＹＥＳの場合には、図中■で送受処理を行い、図中Φ以
下を繰り返し実行する。Ｎｏの場合には、図中■以下を
操り返し実行する。In the case of YES, the transmission/reception process is performed at ■ in the figure, and the steps from Φ in the figure are repeatedly executed. In the case of No, repeat the steps below (■) in the figure.
以上のように、各通信制御部１−１ないし１−ｎから送
出されたＤＭＡリクエスト信号の状態を一括して保持す
るＤＲＥＱレジスタ２を設け、データ転送制御部３−１
がこのＤＲＥＱレジスタ２の内容を読み込んで、該当す
る通信制御部１−１ないしｌ−ｎに対して送受処理を行
うことにより、１回のポーリングによって多数の通信制
御部１−１なしいｌ−ｎの状態を検出して高速に送受処
理を行うことが可能となる。As described above, the DREQ register 2 that collectively holds the states of the DMA request signals sent from each communication control unit 1-1 to 1-n is provided, and the data transfer control unit 3-1
reads the contents of this DREQ register 2 and performs transmission/reception processing to the corresponding communication control unit 1-1 to l-n, thereby transmitting data to a large number of communication control units 1-1 to l-n by one polling. It becomes possible to detect the state of n and perform transmission/reception processing at high speed.
以上説明したように、本発明によれば、複数の通信制御
部から送出されたリクエスト信号の状態を一括して保持
するデータリクエストレジスタ２を設け、データ転送制
御部３−１がこれをポーリングして該当する通信制御部
に対して送受処理を行う構成を採用しているため、１つ
１つの通信制御部に対するポーリングに要する時間を削
減して高速に送受処理を行うことができる。As described above, according to the present invention, the data request register 2 is provided that collectively holds the states of request signals sent from a plurality of communication control units, and the data transfer control unit 3-1 polls this register. Since the configuration is adopted in which the transmission and reception processing is performed with respect to the corresponding communication control unit, the time required for polling each communication control unit can be reduced and the transmission and reception processing can be performed at high speed.
第１図は本発明の１実施例構成図、第２図は本発明の動
作説明フローチャート、第３図は従来技術の説明図、第
４図は従来技術の動作説明フローチャートを示す。
図中、１−１ないしｌ−ｎは通信制御部、２はＤＲＥＱ
（データリクエスト）レジスタ、３はＲＯＭ、３−１
はデータ転送制御部、４はＭＰＵ。
５はＲＡＭを表す。
オ（号し日月の１突潤隻４デＩｉ万！図光 １ 閃
本づし８月の重υイ乍藩し置局）Ｄ−チャート兜 ２
艷
従来技術の翫明図
χ ３ 図FIG. 1 is a block diagram of one embodiment of the present invention, FIG. 2 is a flowchart explaining the operation of the present invention, FIG. 3 is a diagram explaining the prior art, and FIG. 4 is a flowchart explaining the operation of the prior art. In the figure, 1-1 to l-n are communication control units, 2 is DREQ
(Data request) register, 3 is ROM, 3-1
4 is a data transfer control unit, and 4 is an MPU. 5 represents RAM. O (No. 1 Sun Moon 1 Tujunsen 4 De Iiman! Zuko 1 Senhon Zushi August's Juuyui Hanshi Station) D-Chart Kabuto 2
Diagram of conventional technology χ 3
Claims (1)
御方式において、 各通信制御部（１−ｉ）から送出されたリクエスト信号
によって夫々セットされるデータリクエストレジスタ（
２）と、 このデータリクエストレジスタ（２）にセットされてい
る情報を読んで対応する通信制御部（１−ｉ）に対して
送受処理を実行するデータ転送制御部（３−１）とを備
え、 このデータ転送制御部（３−１）が、通信制御部（１−
ｉ）から送出されたリクエスト信号によってセットされ
たデータリクエストレジスタ（２）の内容を読み込み、
セットされている通信制御部（１−ｉ）に対して送受処
理を行うように構成したことを特徴とするポーリング制
御方式。[Claims] In a polling control method that performs polling control on a communication control unit, a data request register (1-i) is set by a request signal sent from each communication control unit (1-i).
2), and a data transfer control unit (3-1) that reads the information set in the data request register (2) and executes transmission/reception processing to the corresponding communication control unit (1-i). , This data transfer control unit (3-1) is connected to the communication control unit (1-
i) reads the contents of the data request register (2) set by the request signal sent from
A polling control method characterized in that it is configured to perform transmission and reception processing for a set communication control unit (1-i).
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62249251A JPH0191549A (en) | 1987-10-02 | 1987-10-02 | Polling control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62249251A JPH0191549A (en) | 1987-10-02 | 1987-10-02 | Polling control system |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0191549A true JPH0191549A (en) | 1989-04-11 |
Family
ID=17190179
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62249251A Pending JPH0191549A (en) | 1987-10-02 | 1987-10-02 | Polling control system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0191549A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018167701A (en) * | 2017-03-30 | 2018-11-01 | 大同信号株式会社 | Railroad signal facility monitoring support program |
-
1987
- 1987-10-02 JP JP62249251A patent/JPH0191549A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2018167701A (en) * | 2017-03-30 | 2018-11-01 | 大同信号株式会社 | Railroad signal facility monitoring support program |
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