JPH02100400U - - Google Patents
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- Publication number
- JPH02100400U JPH02100400U JP867989U JP867989U JPH02100400U JP H02100400 U JPH02100400 U JP H02100400U JP 867989 U JP867989 U JP 867989U JP 867989 U JP867989 U JP 867989U JP H02100400 U JPH02100400 U JP H02100400U
- Authority
- JP
- Japan
- Prior art keywords
- operational amplifiers
- components
- sum signal
- pass filter
- signal components
- Prior art date
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- Pending
Links
- 230000003111 delayed effect Effects 0.000 claims 2
- 230000000903 blocking effect Effects 0.000 claims 1
- 239000011159 matrix material Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Description
第１図は本考案の一実施例の構成図、第２図は
従来例の構成図である。 １……サラウンド回路、２，３……演算増幅器
、８……遅延回路、１２，１３……第１、第２ロ
ーパスフイルタ。
従来例の構成図である。 １……サラウンド回路、２，３……演算増幅器
、８……遅延回路、１２，１３……第１、第２ロ
ーパスフイルタ。
Claims (1)
- 【実用新案登録請求の範囲】 左右の各チヤンネルに個別的に対応する２つの
演算増幅器および該演算増幅器の出力側に接続さ
れたスピーカを備え、左右の各チヤンネル信号が
前記各演算増幅器の非反転入力にそれぞれ与えら
れるとともに、各チヤンネル信号の和信号成分が
遅延されて前記各演算増幅器の反転入力にそれぞ
れ与えられるスピーカマトリツクス方式のサラウ
ンド回路において、 前記遅延された和信号成分の内の高域成分を阻
止するローパスフイルタを設け、 前記ローパスフイルタの出力を前記各演算増幅
器の非反転入力にそれぞれ与えることを特徴とす
るサラウンド回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP867989U JPH02100400U (ja) | 1989-01-27 | 1989-01-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP867989U JPH02100400U (ja) | 1989-01-27 | 1989-01-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02100400U true JPH02100400U (ja) | 1990-08-09 |
Family
ID=31214772
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP867989U Pending JPH02100400U (ja) | 1989-01-27 | 1989-01-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02100400U (ja) |
-
1989
- 1989-01-27 JP JP867989U patent/JPH02100400U/ja active Pending