JPH02121068A - ２値画像１／２縮小装置 - Google Patents
２値画像１／２縮小装置Info
- Publication number
- JPH02121068A JPH02121068A JP27561288A JP27561288A JPH02121068A JP H02121068 A JPH02121068 A JP H02121068A JP 27561288 A JP27561288 A JP 27561288A JP 27561288 A JP27561288 A JP 27561288A JP H02121068 A JPH02121068 A JP H02121068A
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- Japan
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- image
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T3/00—Geometric image transformations in the plane of the image
- G06T3/40—Scaling of whole images or parts thereof, e.g. expanding or contracting
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- Physics & Mathematics (AREA)
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- Engineering & Computer Science (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の目的］
（産業上の利用分野）
この発明は、２次元２値画像をライン方向並びにライン
方向と直交する方向にいずれも１／２縮小する２値画像
１／２縮小装置に関する。
方向と直交する方向にいずれも１／２縮小する２値画像
１／２縮小装置に関する。
（従来の技術）
従来、第３図に示すような２値画像３１をｙ軸方向（ラ
イン方向）並びにＸ軸方向（ライン方向に直交する方向
）に縮小、例えば１／２縮小する場合、２値画像（被縮
小２値画像） ３１は、符号ａ。
イン方向）並びにＸ軸方向（ライン方向に直交する方向
）に縮小、例えば１／２縮小する場合、２値画像（被縮
小２値画像） ３１は、符号ａ。
ｂ，ｃ・・・で示されるように２／２画素（ドツト、ビ
ット）のマトリクス（部分２値画像）に分割されて管理
され、各２×２マトリクスを単位に１画素ずつの読出し
が行われる。そして、４回の画像メモリアクセスにより
２Ｘ２マトリクスの４画素分の２値画像データ読出しが
行われると、その４画素分の２値画像データ（４ビツト
）に対して例えば論理和処理が施される。この処理によ
り、２×２マトリクスの部分２値画像ａ、ｂ、ｃ・・・
が、符号ａ′、ｂ′、Ｃ′・・・で示されるようにＸ軸
およびｙ軸方向に１／２縮小された１画素分の２値画像
に縮小される。以上の処理が、被縮小２値画像３１を構
成する全ての２×２マトリクスについて、繰返し実行さ
れることにより、縮小２値画像３２を得ることができる
。この縮小２値画像３２を得るのに要する時間は、縮小
２値画像３１が例えば４０９６Ｘ４０９６画索（２メガ
バイト）の場合であれば２４秒程度である。
ット）のマトリクス（部分２値画像）に分割されて管理
され、各２×２マトリクスを単位に１画素ずつの読出し
が行われる。そして、４回の画像メモリアクセスにより
２Ｘ２マトリクスの４画素分の２値画像データ読出しが
行われると、その４画素分の２値画像データ（４ビツト
）に対して例えば論理和処理が施される。この処理によ
り、２×２マトリクスの部分２値画像ａ、ｂ、ｃ・・・
が、符号ａ′、ｂ′、Ｃ′・・・で示されるようにＸ軸
およびｙ軸方向に１／２縮小された１画素分の２値画像
に縮小される。以上の処理が、被縮小２値画像３１を構
成する全ての２×２マトリクスについて、繰返し実行さ
れることにより、縮小２値画像３２を得ることができる
。この縮小２値画像３２を得るのに要する時間は、縮小
２値画像３１が例えば４０９６Ｘ４０９６画索（２メガ
バイト）の場合であれば２４秒程度である。
（発明が解決しようとする課題）
前記したように従来は、２値画像を縮小するには、画素
単位で画像メモリのアドレスを決定して全画素を読出す
必要があるため、多大な処理時間を要するという問題が
あった。
単位で画像メモリのアドレスを決定して全画素を読出す
必要があるため、多大な処理時間を要するという問題が
あった。
したがってこの発明の解決すべき課題は、２次元２値画
像をライン方向並びにライン方向と直交する方向にいず
れも１／２縮小するのに必要な処理時間が大幅に減小で
きるようにすることである。
像をライン方向並びにライン方向と直交する方向にいず
れも１／２縮小するのに必要な処理時間が大幅に減小で
きるようにすることである。
［発明の構成］
（課題を解決するための手段）
この発明は、２値画像をライン方向並びにライン方向と
直交する方向にいずれも１／２縮小する場合に、従来の
ように両方向に同時に１／２縮小せずに、一方向ずつ１
／２縮小することにより、１次元データを対象とする縮
小処理が可能となり、したがって同時に複数画素性のデ
ータ取出しが可能となることに着目してなされたもので
、画像メモリに格納されている縮小対象２値画像のうち
の奇数または偶数ラインのデータだけをライン毎にｍ画
素単位（ｍは２以上の整数）で順次取出し、このｍ画素
単位で取出されたデータを２Ｂ画素単位でその１／２の
画素数のデータに変換して１／２縮小を行うようにした
ことを特徴とするものである。また、縮小画像の画質の
低下を防ぐために、上記２Ｂ画素のデータに対するデー
タ変換結果が、同データを２画素単位で分割して各２画
素毎に論理和をとることによる得られる０画素分のデー
タに一致する構成としている。
直交する方向にいずれも１／２縮小する場合に、従来の
ように両方向に同時に１／２縮小せずに、一方向ずつ１
／２縮小することにより、１次元データを対象とする縮
小処理が可能となり、したがって同時に複数画素性のデ
ータ取出しが可能となることに着目してなされたもので
、画像メモリに格納されている縮小対象２値画像のうち
の奇数または偶数ラインのデータだけをライン毎にｍ画
素単位（ｍは２以上の整数）で順次取出し、このｍ画素
単位で取出されたデータを２Ｂ画素単位でその１／２の
画素数のデータに変換して１／２縮小を行うようにした
ことを特徴とするものである。また、縮小画像の画質の
低下を防ぐために、上記２Ｂ画素のデータに対するデー
タ変換結果が、同データを２画素単位で分割して各２画
素毎に論理和をとることによる得られる０画素分のデー
タに一致する構成としている。
（作用）
上記の構成によれば、画像メモリをｍ画素単位でアクセ
スすることが可能となるため、１画素ずつアドレスを決
定して画像メモリアクセスを行う必要があった従来装置
に比べ、高速処理が可能となる。また、２画素毎の論理
和結果が縮小画像の１画素として用いられる構成とする
ことで、被縮小２値画像の奇数または偶数ラインデータ
を間引いていても、被縮小２値画像の白黒の分布に対し
て、確率的に従来の４画素毎の論理和とほぼ同じ情報量
を保った状態となるため、縮小画像の画質を従来装置と
ほぼ同等とすることができる。
スすることが可能となるため、１画素ずつアドレスを決
定して画像メモリアクセスを行う必要があった従来装置
に比べ、高速処理が可能となる。また、２画素毎の論理
和結果が縮小画像の１画素として用いられる構成とする
ことで、被縮小２値画像の奇数または偶数ラインデータ
を間引いていても、被縮小２値画像の白黒の分布に対し
て、確率的に従来の４画素毎の論理和とほぼ同じ情報量
を保った状態となるため、縮小画像の画質を従来装置と
ほぼ同等とすることができる。
（実施例）
第１図はこの発明の一実施例に係る２値画像１／２縮小
装置のブロック構成図、第２図は第１図の装置の画像縮
小動作を説明するための図である。
装置のブロック構成図、第２図は第１図の装置の画像縮
小動作を説明するための図である。
第１図において、１１は１／２縮小対象となる２次元２
値画像（被縮小２値画像）を格納するための例えば４０
９６Ｘ４０９６画素（２メガバイト）のサイズの画像メ
モリ（ソース画像メモリ）である。画像メモリーｌは、
Ｘ軸方向（ラスクスキャン方向、ライン方向と直交する
方向）にバイト（８ビツト）単位でアクセス可能に構成
されている。
値画像（被縮小２値画像）を格納するための例えば４０
９６Ｘ４０９６画素（２メガバイト）のサイズの画像メ
モリ（ソース画像メモリ）である。画像メモリーｌは、
Ｘ軸方向（ラスクスキャン方向、ライン方向と直交する
方向）にバイト（８ビツト）単位でアクセス可能に構成
されている。
１２は画像メモリー１から被縮小２値画像の例えば奇数
ラインのデータを第１ラインから順にバイト単位で取出
すためのデータ取出し部である。データ取出し部１２は
、画像メモリー１をＸ軸方向にバイト単位でアクセスす
るためのラスクアドレスを生成するアドレスコントロー
ラ１３と、アドレスコントローラー３からのラスクアド
レスに応じて画像メモリ１１からバイト単位で読出され
るデータの取捨選択を１ライン毎に切替えて行ない、奇
数ラインのデータだけをバイト単位で取出すインクレー
ス制御回路１４とを有している。
ラインのデータを第１ラインから順にバイト単位で取出
すためのデータ取出し部である。データ取出し部１２は
、画像メモリー１をＸ軸方向にバイト単位でアクセスす
るためのラスクアドレスを生成するアドレスコントロー
ラ１３と、アドレスコントローラー３からのラスクアド
レスに応じて画像メモリ１１からバイト単位で読出され
るデータの取捨選択を１ライン毎に切替えて行ない、奇
数ラインのデータだけをバイト単位で取出すインクレー
ス制御回路１４とを有している。
１５はデータ取出し部１２（のインタレース制御回路１
４）によって取出されたバイトデータ（８ビツト）を縮
小して４ビツト（４画素分）のデータに変換するデータ
変換回路、１Ｂはデータ変換回路１５のデータ変換に供
される変換テーブルである。変換テーブル１６は変換対
象となるバイト（８ビツト）データ（被変換データ）を
アドレス（エントリアドレス）として索引される２８個
のエントリを有している。変換テーブル１６の各エント
リには、対応する８ビツトのエントリアドレスを１／２
に縮小した４とットデータ（４ビツト変換データ）が登
録されている。１７は画像メモリ１１に格納されている
２値画像をｙ軸およびＸ軸方向にいずれも１／２縮小し
た縮小画像を格納するための２０４８Ｘ２０４８画素（
５１２キロバイト）のサイズの画像メモリ（デスティネ
ーション画像メモリ）である。
４）によって取出されたバイトデータ（８ビツト）を縮
小して４ビツト（４画素分）のデータに変換するデータ
変換回路、１Ｂはデータ変換回路１５のデータ変換に供
される変換テーブルである。変換テーブル１６は変換対
象となるバイト（８ビツト）データ（被変換データ）を
アドレス（エントリアドレス）として索引される２８個
のエントリを有している。変換テーブル１６の各エント
リには、対応する８ビツトのエントリアドレスを１／２
に縮小した４とットデータ（４ビツト変換データ）が登
録されている。１７は画像メモリ１１に格納されている
２値画像をｙ軸およびＸ軸方向にいずれも１／２縮小し
た縮小画像を格納するための２０４８Ｘ２０４８画素（
５１２キロバイト）のサイズの画像メモリ（デスティネ
ーション画像メモリ）である。
次に、第１図の構成の動作を、第２図を参照して説明す
る。
る。
画像メモリ１１はスキャナ装置（図示せず）等で読取ら
れた２次元２値画像を格納するためのもので、例えば左
上部からＸ軸方向（図面上で右方向）に連続的にバイト
単位でメモリ領域が配されている。したがって、画像メ
モリ１１をアドレスを連続的にインクリメントしながら
リードアクセスすると、図面上で左上から順にラスクス
キャンすることになる。このラスクスキャンのためのラ
スクアドレスはデータ取出し部１２のアドレスコントロ
ーラ１３によって順に生成され、これにより画像メモリ
１１に格納されている例えば第２図において符号２１で
示されるような被縮小２値画像が、第１ライン（のデー
タ）から順にバイト（８画素、８ビツト）単位で読出さ
れる。
れた２次元２値画像を格納するためのもので、例えば左
上部からＸ軸方向（図面上で右方向）に連続的にバイト
単位でメモリ領域が配されている。したがって、画像メ
モリ１１をアドレスを連続的にインクリメントしながら
リードアクセスすると、図面上で左上から順にラスクス
キャンすることになる。このラスクスキャンのためのラ
スクアドレスはデータ取出し部１２のアドレスコントロ
ーラ１３によって順に生成され、これにより画像メモリ
１１に格納されている例えば第２図において符号２１で
示されるような被縮小２値画像が、第１ライン（のデー
タ）から順にバイト（８画素、８ビツト）単位で読出さ
れる。
画像メモリ１１から（ラスクスキャンにより）順に読出
されたバイトデータはデータ取出し部１２のインタレー
ス制御回路１４に導かれる。インタレース制御回路１４
は、画像メモリ１１から読出されているバイトデータが
奇数ラインのデータである期間は、同データを取込んで
そのままデータ変換回路１５に出力し、偶数ラインのデ
ータである期間は同データを廃棄してデータ変換回路１
５への出力を控える。この結果、データ変換回路１５に
は、第２図に示すように被縮小２値画像２１のうちの奇
数ラインのデータだけから成る画像（即ち被縮小２値画
像２１の偶数ラインのデータを間引いてｙ軸方向に１／
２縮小された画像）２２がバイト単位で導かれることに
なる。
されたバイトデータはデータ取出し部１２のインタレー
ス制御回路１４に導かれる。インタレース制御回路１４
は、画像メモリ１１から読出されているバイトデータが
奇数ラインのデータである期間は、同データを取込んで
そのままデータ変換回路１５に出力し、偶数ラインのデ
ータである期間は同データを廃棄してデータ変換回路１
５への出力を控える。この結果、データ変換回路１５に
は、第２図に示すように被縮小２値画像２１のうちの奇
数ラインのデータだけから成る画像（即ち被縮小２値画
像２１の偶数ラインのデータを間引いてｙ軸方向に１／
２縮小された画像）２２がバイト単位で導かれることに
なる。
データ変換回路１５はインタレース制御回路１４からの
バイトデータをエントリアドレスとして変換テーブル１
６を参照し、このバイトデータに対応する４ビツト変換
データを読出す。この４ビツト変換データは、バイトデ
ータ（８ビツトデータ）をＸ軸方向に１／２縮小したも
のである。この縮小の論理は、バイトデータ（８ビツト
データ）をＡＯＡ、Ａ２Ａ、Ａ４Ａ、Ａ６ Ａ７ とし、４ビツト変換データを Ｂ、ＢＩＢ２８３ とし、記号子を論理和を示すものとすると、次式１式％
（４） で示される通りである。即ち４ビット変換データＢｏ−
８３は、バイトデータＡ。−Ａ７の２ビットずつの論理
和結果となっている。このような変換データを用いるこ
とで、被縮小２値画像（２１）の偶数ラインのデータを
データ取出し部１２（内のインタレース制御回路１４）
で廃棄しても、被縮小２値画像（２１）の白黒の分布に
対して、従来の４ビツトずつの論理和をとることによる
縮小方式と同様に、確率的にほぼ同等の情報量を保つこ
とが可能となる。
バイトデータをエントリアドレスとして変換テーブル１
６を参照し、このバイトデータに対応する４ビツト変換
データを読出す。この４ビツト変換データは、バイトデ
ータ（８ビツトデータ）をＸ軸方向に１／２縮小したも
のである。この縮小の論理は、バイトデータ（８ビツト
データ）をＡＯＡ、Ａ２Ａ、Ａ４Ａ、Ａ６ Ａ７ とし、４ビツト変換データを Ｂ、ＢＩＢ２８３ とし、記号子を論理和を示すものとすると、次式１式％
（４） で示される通りである。即ち４ビット変換データＢｏ−
８３は、バイトデータＡ。−Ａ７の２ビットずつの論理
和結果となっている。このような変換データを用いるこ
とで、被縮小２値画像（２１）の偶数ラインのデータを
データ取出し部１２（内のインタレース制御回路１４）
で廃棄しても、被縮小２値画像（２１）の白黒の分布に
対して、従来の４ビツトずつの論理和をとることによる
縮小方式と同様に、確率的にほぼ同等の情報量を保つこ
とが可能となる。
以上の方式は、例えば８画素／ｍｍ程度の解像度のスキ
ャナで読取られた一般書類、図面等（別の表現をするな
らば、１本の水平線が２ビツト以上の幅を持った線とし
て読取られるようにもの）に対して、有効である。なぜ
ならば、例えばＣＣＩＴＴ（国際電信電話諮問委員会）
規格において黒画素２が最も短いコードになっており、
このことは２ビツトずつの論理和をとることが確率的に
正しいことを意味しているからである。
ャナで読取られた一般書類、図面等（別の表現をするな
らば、１本の水平線が２ビツト以上の幅を持った線とし
て読取られるようにもの）に対して、有効である。なぜ
ならば、例えばＣＣＩＴＴ（国際電信電話諮問委員会）
規格において黒画素２が最も短いコードになっており、
このことは２ビツトずつの論理和をとることが確率的に
正しいことを意味しているからである。
データ変換回路１５は、同回路１５に入力されたバイト
データをもとに４ビツトの変換データを求める毎に、同
変換データをバイトデータに対する１／２縮小結果とし
て画像メモリ１７に供給する動作を繰返す。この繰返し
により、データ変換回路１５から画像メモリ１７に順に
供給される４ビツト変換データは、（アドレスコントロ
ーラ１３と同様の）図示せぬアドレスコントローラから
順に生成されるラスクアドレスの指定する画像メモリ１
７の領域に書込まれ、同メモリ１７内に第２図に示すよ
うにｙ軸およびＸ軸の両方向に１／２縮小された縮小２
値画像２３を得ることができる。
データをもとに４ビツトの変換データを求める毎に、同
変換データをバイトデータに対する１／２縮小結果とし
て画像メモリ１７に供給する動作を繰返す。この繰返し
により、データ変換回路１５から画像メモリ１７に順に
供給される４ビツト変換データは、（アドレスコントロ
ーラ１３と同様の）図示せぬアドレスコントローラから
順に生成されるラスクアドレスの指定する画像メモリ１
７の領域に書込まれ、同メモリ１７内に第２図に示すよ
うにｙ軸およびＸ軸の両方向に１／２縮小された縮小２
値画像２３を得ることができる。
第１図の構成では、画像メモリ１１に対するアクセス回
数が従来の１画素単位でアクセスする方式に比べて１／
８となり、且つインタレース制御回路１４の操作でデー
タ変換回路１５のデータ処理量を１／２としているため
、従来装置に比べて処理速度をほぼ１桁（約１０倍）高
めることができる。
数が従来の１画素単位でアクセスする方式に比べて１／
８となり、且つインタレース制御回路１４の操作でデー
タ変換回路１５のデータ処理量を１／２としているため
、従来装置に比べて処理速度をほぼ１桁（約１０倍）高
めることができる。
なお、前記実施例では、偶数ラインのデータを廃棄する
ものとして説明したが、奇数ラインのデータを廃棄する
ようにしてもよい。また、アドレスコントローラ１３に
代えて、奇数または偶数ラインのいずれか一方だけを飛
越し走査するための７ドレスを生成するコントローラを
用いることも可能であり、この場合にはインタレース制
御回路１４は不要となる。また、画像メモリ１１からの
データ読出しサイズとデータ変換回路１５における被変
換データのサイズは、１バイト（８ビツト）である必要
はなく、また両サイズが一致している必要もない。
ものとして説明したが、奇数ラインのデータを廃棄する
ようにしてもよい。また、アドレスコントローラ１３に
代えて、奇数または偶数ラインのいずれか一方だけを飛
越し走査するための７ドレスを生成するコントローラを
用いることも可能であり、この場合にはインタレース制
御回路１４は不要となる。また、画像メモリ１１からの
データ読出しサイズとデータ変換回路１５における被変
換データのサイズは、１バイト（８ビツト）である必要
はなく、また両サイズが一致している必要もない。
［発明の効果］
以上詳述したようにこの発明によれば、２次元２値画像
をライン方向並びにライン方向と直交する方向にいずれ
も１／２に縮小する処理が、画質の低下を招くことなく
高速で行うことができる。
をライン方向並びにライン方向と直交する方向にいずれ
も１／２に縮小する処理が、画質の低下を招くことなく
高速で行うことができる。
第１図はこの発明の一実施例に係る２値画像１／２縮小
装置のブロック構成図、第２図は同実施例における画像
縮小動作を説明するための図、第３図は従来の画像縮小
動作を説明するための図である。 １１・・・画像メモリ（ソース画像メモリ）、１２・・
・データ取出し部、１３・・・アドレスコントローラ、
１４・・・インクレース制御回路、１５・・・データ変
換回路、１６・・・変換テーブル、１７・・・画像メモ
リ（デスティネーション画像メモリ）。 出願人代理人 弁理士 鈴江武彦
装置のブロック構成図、第２図は同実施例における画像
縮小動作を説明するための図、第３図は従来の画像縮小
動作を説明するための図である。 １１・・・画像メモリ（ソース画像メモリ）、１２・・
・データ取出し部、１３・・・アドレスコントローラ、
１４・・・インクレース制御回路、１５・・・データ変
換回路、１６・・・変換テーブル、１７・・・画像メモ
リ（デスティネーション画像メモリ）。 出願人代理人 弁理士 鈴江武彦
Claims (2)
- （１）２次元２値画像を格納するための画像メモリと、
この画像メモリに格納されている２値画像のうちの奇数
または偶数ラインのデータだけをライン毎にｍ画素単位
（ｍは２以上の整数）で順次取出すデータ取出し手段と
、このデータ取出し手段によって上記ｍ画素単位で取出
されたデータを２ｎ画素単位でその１／２の画素数のデ
ータに変換して１／２縮小を行うデータ変換手段とを具
備し、上記２値画像をライン方向並びにライン方向と直
交する方向にいずれも１／２縮小するようにしたことを
特徴とする２値画像１／２縮小装置。 - （２）上記データ変換手段による上記２ｎ画素のデータ
に対するデータ変換結果が、同データを２画素単位で分
割して各２画素毎に論理和をとることによる得られるｎ
画素分のデータに一致することを特徴とする第１請求項
記載の２値画像１／２縮小装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27561288A JPH02121068A (ja) | 1988-10-31 | 1988-10-31 | ２値画像１／２縮小装置 |
| EP19890120095 EP0367175A3 (en) | 1988-10-31 | 1989-10-30 | Method and system for halfreducing binary image |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27561288A JPH02121068A (ja) | 1988-10-31 | 1988-10-31 | ２値画像１／２縮小装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02121068A true JPH02121068A (ja) | 1990-05-08 |
Family
ID=17557877
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27561288A Pending JPH02121068A (ja) | 1988-10-31 | 1988-10-31 | ２値画像１／２縮小装置 |
Country Status (2)
| Country | Link |
|---|---|
| EP (1) | EP0367175A3 (ja) |
| JP (1) | JPH02121068A (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3036711C2 (de) * | 1980-09-29 | 1985-08-01 | Siemens AG, 1000 Berlin und 8000 München | Verfahren zum Verkleinern von grafischen Mustern |
| US4656664A (en) * | 1984-10-24 | 1987-04-07 | International Business Machines Corporation | Method for reducing a binary image |
-
1988
- 1988-10-31 JP JP27561288A patent/JPH02121068A/ja active Pending
-
1989
- 1989-10-30 EP EP19890120095 patent/EP0367175A3/en not_active Withdrawn
Also Published As
| Publication number | Publication date |
|---|---|
| EP0367175A3 (en) | 1992-08-05 |
| EP0367175A2 (en) | 1990-05-09 |
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