JPH02123147U - - Google Patents

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JPH02123147U
JPH02123147U JP3086989U JP3086989U JPH02123147U JP H02123147 U JPH02123147 U JP H02123147U JP 3086989 U JP3086989 U JP 3086989U JP 3086989 U JP3086989 U JP 3086989U JP H02123147 U JPH02123147 U JP H02123147U
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  • Control Of Amplification And Gain Control (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例を示す接続図、第
２図は従来の回路を示す接続図。 １……第１の定電流回路、２……第２の定電流
回路、３……第３の定電流回路、４……増幅用ト
ランジスタ、５……接続点、６……負荷抵抗、７
……増幅器、８，９……ダーリントン回路、１０
……出力点、１２……スピーカ、１３……第１の
スイツチングトランジスタ、１４……抵抗、１５
……キヤパシタ、１６……抵抗、１７……第２の
スイツチングトランジスタ、１９……電圧点。な
お、図中同一符号は同一または相当部分を示す。

Claims (1)

  1. 【実用新案登録請求の範囲】 エミツタが第１の定電流回路１を介して電源に
    接続されコレクタが第２の定電流回路２を介して
    接地される増幅用トランジスタ４のベースに信号
    を入力し、出力点１０が第３の定電流回路３を介
    して上記電源に接続され、該出力点と接地間とに
    接続されるダーリントン回路の入力ベース端子を
    上記増幅用トランジスタ４のコレクタ側の端子５
    に接続し、上記端子５と１０との間に負荷抵抗６
    を接続し、上記ダーリントン回路の該出力点１０
    と接地との間にスピーカ回路を接続するよう構成
    された半導体集積回路において、 コレクタが上記増幅用トランジスタ４のコレク
    タ側端子５に接続され、エミツタが抵抗１４を介
    して接地される第１のスイツチングトランジスタ
    １３、 上記抵抗１４に並列に接続されるキヤパシタ１
    ５と抵抗１６を直列接続した外付回路、 コレクタが上記端子５とほぼ同一電位の電圧点
    に接続されエミツタ側の端子が上記第１のスイツ
    チングトランジスタ１３のエミツタに接続される
    第２のスイツチングトランジスタ１７、 上記第１のスイツチングトランジスタ１３がオ
    ンの間は上記第２のトランジスタ１７はオフとな
    り、１３がオフの間は１７がオンとなるよう制御
    する手段、 を備えたことを特徴とする半導体集積回路。
JP3086989U 1989-03-20 1989-03-20 半導体集積回路 Expired - Fee Related JPH071871Y2 (ja)

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JPH071871Y2 JPH071871Y2 (ja) 1995-01-18

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