JPH02126441U - - Google Patents
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- Publication number
- JPH02126441U JPH02126441U JP3439289U JP3439289U JPH02126441U JP H02126441 U JPH02126441 U JP H02126441U JP 3439289 U JP3439289 U JP 3439289U JP 3439289 U JP3439289 U JP 3439289U JP H02126441 U JPH02126441 U JP H02126441U
- Authority
- JP
- Japan
- Prior art keywords
- clock
- receiving device
- tuner
- supplied
- pll circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000003990 capacitor Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Stereo-Broadcasting Methods (AREA)
Description
第１図は本考案の一実施例の受信装置の要部の
ブロツク図である。
ブロツク図である。
Claims (1)
- 【実用新案登録請求の範囲】 (1) ＰＬＬ回路で決定される周波数で選局を行
うチユーナ部を複数有する複数チヤンネルの受信
装置において、 上記各チユーナ部のＰＬＬ回路の基準クロツク
を１個のクロツク源から供給したことを特徴とす
る受信装置。 (2) 上記クロツク源を１個のチーナ部に組み込
み、他のチユーナ部へのクロツク供給をコンデン
サを介して行つたことを特徴とする実用新案登録
請求の範囲第１項記載の受信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3439289U JPH02126441U (ja) | 1989-03-28 | 1989-03-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3439289U JPH02126441U (ja) | 1989-03-28 | 1989-03-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02126441U true JPH02126441U (ja) | 1990-10-18 |
Family
ID=31538823
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3439289U Pending JPH02126441U (ja) | 1989-03-28 | 1989-03-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02126441U (ja) |
-
1989
- 1989-03-28 JP JP3439289U patent/JPH02126441U/ja active Pending
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