JPH0212765U - - Google Patents
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- Publication number
- JPH0212765U JPH0212765U JP8963688U JP8963688U JPH0212765U JP H0212765 U JPH0212765 U JP H0212765U JP 8963688 U JP8963688 U JP 8963688U JP 8963688 U JP8963688 U JP 8963688U JP H0212765 U JPH0212765 U JP H0212765U
- Authority
- JP
- Japan
- Prior art keywords
- shot multivibrator
- error rate
- input
- output pulse
- error
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 230000008676 import Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
- 238000005070 sampling Methods 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
- Debugging And Monitoring (AREA)
Description
第１図乃至第４図はこの考案に係るＤＡＴ用の
エラーレートカウンタの実施例を示し、第１図は
要部のブロツク図、第２図ＡはＳＷＰのタイミン
グチヤート、第２図ＢはＭＮＴＧの出力タイミン
グを示すタイミングチヤート、第２図ＣはＭＮＴ
Ｇの拡大図、第２図ＤはＭＮＴＧに同期したエラ
ーデータのタイミングチヤート、第３図はメモリ
にエラーデータが格納されている状態を示すメモ
リマツプ、第４図Ａはマイクロコンピユータのメ
インルーチンのフローチヤート、第４図Ｂはマイ
クロコンピユータの割り込みルーチンのフローチ
ヤートである。第５図は従来の実施例を示すブロ
ツク図である。 主な符号の説明、１……データ入力端子、２…
…ＭＮＴＧ入力端子、３……ＳＷＰ入力端子、６
……ワンシヨツトマルチバイブレータ、７……ラ
ツチ、８……ＣＰＵボード、９……割り込み入力
端子、１０……ＰＣＭ／ＳＵＢ選択スイツチ、１
１……サンプリングスイツチ、１７，１８……Ｌ
ＥＤ表示器、１９，２０……クセグメントデコー
ダ・ドライバ、２１……Ｉ／Ｏボード、２２，２
３……Ｄ／Ａコンバータ及びアンプ、２４……良
否表示器。
エラーレートカウンタの実施例を示し、第１図は
要部のブロツク図、第２図ＡはＳＷＰのタイミン
グチヤート、第２図ＢはＭＮＴＧの出力タイミン
グを示すタイミングチヤート、第２図ＣはＭＮＴ
Ｇの拡大図、第２図ＤはＭＮＴＧに同期したエラ
ーデータのタイミングチヤート、第３図はメモリ
にエラーデータが格納されている状態を示すメモ
リマツプ、第４図Ａはマイクロコンピユータのメ
インルーチンのフローチヤート、第４図Ｂはマイ
クロコンピユータの割り込みルーチンのフローチ
ヤートである。第５図は従来の実施例を示すブロ
ツク図である。 主な符号の説明、１……データ入力端子、２…
…ＭＮＴＧ入力端子、３……ＳＷＰ入力端子、６
……ワンシヨツトマルチバイブレータ、７……ラ
ツチ、８……ＣＰＵボード、９……割り込み入力
端子、１０……ＰＣＭ／ＳＵＢ選択スイツチ、１
１……サンプリングスイツチ、１７，１８……Ｌ
ＥＤ表示器、１９，２０……クセグメントデコー
ダ・ドライバ、２１……Ｉ／Ｏボード、２２，２
３……Ｄ／Ａコンバータ及びアンプ、２４……良
否表示器。
Claims (1)
- 【実用新案登録請求の範囲】 モニタトリガタイミングパルスに同期してエラ
ーデータをマイクロコンピユータに取り込みエラ
ーレートを計測するようにしたＤＡＴ用のエラー
レートカウンタにおいて、 前記モニタトリガタイミングパルスの入力に応
じて１つのパルスを出力するワンシヨツトマルチ
バイブレータと、このワンシヨツトマルチバイブ
レータの出力パルスで前記エラーデータを保持す
るラツチとを設け、ワンシヨツトマルチバイブレ
ータの出力パルスをマイクトコンピユータの割り
込み入力端子に入力すると共に、このワンシヨツ
トマルチバイブレータの出力パルスに基づき、前
記ラツチに保持したエラーデータをマイクロコン
ピユータに入力するように構成したことを特徴と
するＤＡＴ用のエラーレートカウンタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8963688U JPH0810881Y2 (ja) | 1988-07-06 | 1988-07-06 | Ｄａｔ用のエラーレートカウンタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8963688U JPH0810881Y2 (ja) | 1988-07-06 | 1988-07-06 | Ｄａｔ用のエラーレートカウンタ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0212765U true JPH0212765U (ja) | 1990-01-26 |
| JPH0810881Y2 JPH0810881Y2 (ja) | 1996-03-29 |
Family
ID=31314181
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8963688U Expired - Lifetime JPH0810881Y2 (ja) | 1988-07-06 | 1988-07-06 | Ｄａｔ用のエラーレートカウンタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0810881Y2 (ja) |
-
1988
- 1988-07-06 JP JP8963688U patent/JPH0810881Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0810881Y2 (ja) | 1996-03-29 |
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