JPH0216064U - - Google Patents
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- Publication number
- JPH0216064U JPH0216064U JP9300188U JP9300188U JPH0216064U JP H0216064 U JPH0216064 U JP H0216064U JP 9300188 U JP9300188 U JP 9300188U JP 9300188 U JP9300188 U JP 9300188U JP H0216064 U JPH0216064 U JP H0216064U
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- JP
- Japan
- Prior art keywords
- level
- data conversion
- conversion circuit
- display
- display device
- Prior art date
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- Granted
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- 238000006243 chemical reaction Methods 0.000 claims description 10
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Measurement Of Current Or Voltage (AREA)
Description
第1図乃至第3図はこの考案に係るレベル装置
の実施例を示し、第1図はデジタル記録再生装置
などのレベル表示装置のブロツク図、第2図は入
力レベルとレベル表示器のレベルスケールとの関
係を示した特性図、第3図はレベル表示器の表示
図である。第4図は従来例のブロツク図である。
主な番号の説明、2:ADコンバータ、3:入
力側の短絡用スイツチ、4:オフセツト調整器、
5:信号処理回路、6:DAコンバータ、8:ピ
ークホールド回路、9,12:切換器、10:第
1のレベルデータ変換回路、11:第2のレベル
データ変換回路、14:レベル表示器、15:コ
ントローラ、16:オフセツト調整用テストスイ
ツチ、17:表示ドライブ回路、20:レベル表
示部、21,22:表示バー形セグメント、23
,24:レベルスケール、26:「TEST」文
字表示。
1 to 3 show an embodiment of the level device according to this invention, FIG. 1 is a block diagram of a level display device such as a digital recording/reproducing device, and FIG. 2 shows an input level and a level scale of a level display device. FIG. 3 is a characteristic diagram showing the relationship between the levels and the level indicator. FIG. 4 is a block diagram of a conventional example. Explanation of the main numbers, 2: AD converter, 3: Input side short circuit switch, 4: Offset adjuster,
5: signal processing circuit, 6: DA converter, 8: peak hold circuit, 9, 12: switch, 10: first level data conversion circuit, 11: second level data conversion circuit, 14: level indicator, 15: Controller, 16: Offset adjustment test switch, 17: Display drive circuit, 20: Level display section, 21, 22: Display bar type segment, 23
, 24: Level scale, 26: "TEST" character display.
Claims (1)
バータと、この出力デジタル信号をピークホール
ドするピークホールド回路と、このピークホール
ドレベルを変換して所定のレベル表示を行うため
のレベルデータ変換回路と、このレベルデータ変
換回路の出力データを表示する表示器とで構成し
たデジタル記録再生装置のレベル表示装置におい
て、 上記レベルデータ変換回路が通常時のレベル表
示を行う第1のレベルデータ変換回路と、上記A
/Dコンバータのオフセツト調整時のレベル表示
を行う第2のレベルデータ変換回路と、上記レベ
ル表示器がオフセツト出力レベルを表示する表示
手段とを設け、オフセツト調整を行うためのスイ
ツチとコントローラによつて、第1のレベルデー
タ変換回路と第2のレベルデータ変換回路とを切
換える切換器とで構成したことを特徴とするデジ
タル記録再生装置のレベル表示装置。 2 上記第1及び第2のレベルデータ変換回路を
ROMにプログラムメモリされた第1及び第2の
ROMテーブルで構成したことを特徴とする請求
項1記載のレベル表示装置。 3 オフセツト調整時、上記レベル表示器にオフ
セツト調整動作を確認するための表示文字を表示
することを特徴とする請求項1記載のレベル表示
装置。 4 上記A/Dコンバータの入力端子を短絡する
ための切換器を設け、オフセツト調整時コントロ
ーラによつて切換え制御される切換手段を備えた
ことを特徴とする請求項1記載のレベル表示装置
。[Claims for Utility Model Registration] 1. An A/D converter having an output offset adjustment means, a peak hold circuit for peak holding this output digital signal, and a circuit for converting this peak hold level to display a predetermined level. In a level display device for a digital recording/reproducing device comprising a level data conversion circuit and a display device for displaying output data of the level data conversion circuit, the level data conversion circuit displays a level at a first level in a normal state. A data conversion circuit and the above A
A second level data conversion circuit for displaying a level during offset adjustment of the /D converter, and display means for the level display to display the offset output level, and a switch and a controller for performing offset adjustment. 1. A level display device for a digital recording/reproducing device, comprising a switch for switching between a first level data conversion circuit and a second level data conversion circuit. 2. The level display device according to claim 1, wherein the first and second level data conversion circuits are constructed from first and second ROM tables stored in program memory in a ROM. 3. The level display device according to claim 1, wherein during offset adjustment, display characters for confirming the offset adjustment operation are displayed on the level display. 4. The level display device according to claim 1, further comprising a switching means for short-circuiting the input terminals of the A/D converter, and switching means controlled by a controller during offset adjustment.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9300188U JPH0714912Y2 (en) | 1988-07-15 | 1988-07-15 | Level display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9300188U JPH0714912Y2 (en) | 1988-07-15 | 1988-07-15 | Level display device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0216064U true JPH0216064U (en) | 1990-02-01 |
| JPH0714912Y2 JPH0714912Y2 (en) | 1995-04-10 |
Family
ID=31317449
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9300188U Expired - Lifetime JPH0714912Y2 (en) | 1988-07-15 | 1988-07-15 | Level display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0714912Y2 (en) |
-
1988
- 1988-07-15 JP JP9300188U patent/JPH0714912Y2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0714912Y2 (en) | 1995-04-10 |
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