JPH0216669A - セキュリティ方式 - Google Patents

セキュリティ方式

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Publication number
JPH0216669A
JPH0216669A JP63167605A JP16760588A JPH0216669A JP H0216669 A JPH0216669 A JP H0216669A JP 63167605 A JP63167605 A JP 63167605A JP 16760588 A JP16760588 A JP 16760588A JP H0216669 A JPH0216669 A JP H0216669A
Authority
JP
Japan
Prior art keywords
node
cpu
access
operator
pass
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP63167605A
Other languages
English (en)
Inventor
Mitsunobu Aoyama
光伸 青山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
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Priority to US07/374,067 priority patent/US4995112A/en
Priority to EP19890112270 priority patent/EP0350005A3/en
Publication of JPH0216669A publication Critical patent/JPH0216669A/ja
Pending legal-status Critical Current

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Classifications

    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F21/00—Security arrangements for protecting computers, components thereof, programs or data against unauthorised activity
    • G06F21/30—Authentication, i.e. establishing the identity or authorisation of security principals
    • G06F21/31—User authentication

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Security & Cryptography (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Software Systems (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Storage Device Security (AREA)
  • Computer And Data Communications (AREA)
  • Multi Processors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） 本発明はネットワークシステムに於けるセキュリティ方
式に係り、特にノード間をパススルーさせる際の２階層
以上でのアクセス時に於ける正当性チェック機構を確立
したセキュリティ方式に関する。
（従来の技術） 従来、ネットワークシステムに於ける七゛キュリティ機
構は第３図のように構成され、例えばセキュリティ技術
としてオペレータパスワードを用いるときには、ワーク
ステーション（ＷＳ）Ｏｆ側のオペレータがノード１の
ＣＰＵＯ２にログオンするとき、そのノード１のＣＰＵ
Ｏ２側のオペレーティングシステム（Ｏ８）により、そ
のオペレータパスワードの正当性がチェックされる。
このような従来の正当性チェック機構は、単純な系（１
階層構成）に於いてはセキュリティを実現できる。
しかしながら、第４図に示すように、オペレータがノー
ド１のＣＰＵＯ２にログオンし、ノード１のＣＰＵＯ２
上のパススルー装置によって、更にノード２のＣＰＵＯ
３にアクセスするような２階層以上でのアクセス時に於
いて全くの無防備となるという欠点があった。
（発明が解決しようとする課題） 上述したように、ネットワークシステムに於ける従来の
セキュリティ機構に於いては、オペレータがノード１に
ログオンし、ノード１上のパススルー装置によって更に
ノード２にアクセスするような２階層以上でのアクセス
時に於いて全く無防備になるという欠点があった。
本発明は上記実情に鑑みなされたもので、２階層以上の
構成を持つネットワークシステムに於けるセキュリティ
機能を容易に実現できるセキュリティ方式を提供するこ
とを目的とする。
［発明の構成］ （課題を解決するための手段及び作用）本発明は、２階
層以上の構成を持つネットワークシステムに於いて、同
システムの各ノードとパスワードの対応を示すノードデ
ィレクトリィを設ケ、ノード間をパススルーさせるとき
に上記ノードディレクトリィを用いてアクセスの正当性
をチェックする構成としたもので、これにより２階層以
上の構成を持つネットワークシステムに於いてセキュリ
ティ機能を容易に実現できる。
（実施例） 以下第１図及び第２図を参照して本発明の一実施例を説
明する。ここではセキュリティ技術としてオペレータパ
スワード（Ｐｉ　／Ｐ２　）を用いることにする。
第１図は、本発明の一実施例を示すブロック図である。
図中、■はオペレータのアクセスポイントであるワーク
ステーション（ＷＳ）であり、ここではセキュリティ情
報としてパスワード（ＰＬ、Ｐ２）が入力される。２は
上記ワークステーション１を介してオペレータにより直
接アクセスされるノード１のＣＰＵであり、ここではオ
ペレータパスワードＰＩ　／Ｐ２のいずれかによりアク
セス可能となる。３はノード１のＣＰＵ２上に存在し、
他のノードのＣＰＵヘアクセスをパススルーさせるため
のパススルー装置である。４は第２図に示すような各ノ
ードとパスワードとの対応をとるディレクトリイ　（Ｎ
Ｄ）４ａが格納された記憶装置であり、パススルー装置
３によりノード間をパススルーさせるときに参照される
。以下このディレクトリイをノードディレクトリィと称
す。５，６．７はそれぞれ上記ノード１のＣＰＵ２を含
めて互いに回線接続された各ノードのＣＰＵであり、５
はノード２のＣＰＵ、８はノード３のＣＰＵ、７はノー
ド４のＣＰＵである。ここでは、ノード２のＣＰＵ５が
オペレータパスワードＰＩ、ノード３のＣＰＵ５がオペ
レータパスワードＰ２、ノード４のＣＰＵ７がオペレー
タパスワードＰＬ又はＰ２により、それぞれアクセス可
能となる。
第２図は上記実施例に於けるノードディレクトリィ４ａ
に定義されたノードとパスワード（Ｐｉ　。
Ｐ２）との対応を示す図である。
ここで上記第１図及び第２図を参照して本発明の一実施
例に於ける動作を説明する。
ノード１のＣＰＵ２によりアクセスされる記憶装置４に
は、ネットワークシステム上に於けるノードとパスワー
ド（ＰＬ、Ｐ２）との対応を示す情報が予め登録される
。
オペレータがワークステーション１よりノード１のＣＰ
Ｕ２にアクセスすると、ＣＰＵ２はその際のオペレータ
パスワードから正当性をチェックする。
この正当性チェックで正当なアクセスであることが判断
されると、ノード１のＣＰＵ２へのアクセスが可能とな
る。ここでは第２図に示す如くオペレータパスワードが
Ｐｌ又はＰ２であればノード１のＣＰＵ２へのアクセス
が許される。
更にこの際、パススルー装置３のノード間パススルーに
よりノード２のＣＰＵ５にアクセスしようとするとき、
ノード１のＣＰＵ２の制御の下に記憶装置４のノードデ
ィレクトリィ４ａが参照されて、そのオペレータパスワ
ードの正当性がチェックされる。
ここでは第２図に示すようにノード２のパスワードがＰ
ｌであるので、ワークステーション１より人力されたオ
ペレータパスワードがＰｌであるときノード２のＣＰＵ
５へのアクセスが許可され、Ｐ２であるとき（Ｐ２以外
のとき）拒否される。
上記した以外のノード（ノード３．ノード４）にアクセ
スするときも上記同様にノードディレクトリィ４ａを用
いてオペレータパスワードの正当性がチェックされる。
このように、アクセス対象が２階層のノードに及ぶとき
、ノード間をパススルーさせる際に、ノードディレクト
リィ４ａを用いてオペレータパスワードの正当性をチェ
ックする構成としたことにより、複雑なネットワーク構
成でのセキュリティが従来の単純構成でのセキュリティ
技術の延長で実現できる。
尚、上記した実施例では、セキュリティ技術としてパス
ワードを用いたが、これに限らず、他の技術ユーザＩＤ
、許可リスト等に於いても容易に応用できる。
又、上記実施例では２階層構成を持つネットワークシス
テムを例に採ったが、２階層以上の構成を持つネットワ
ークシステムに於いても適用可能である。
［発明の効果コ 以上詳記したように本発明のセキュリティ方式によれば
、２階層以上の構成を持つネットワークシステムに於い
て、同システムの各ノードとパスワードの対応を示すノ
ードディレクトリィを設け、ノード間をパススルーさせ
るときに上記ノードディレクトリィを用いてアクセスの
正当性をチェックする構成としたことにより、２階層以
上の構成を持つネットワークシステムに於けるセキュリ
ティ機能を容易に実現できる。
【図面の簡単な説明】
第１図は本発明の一実施例を示すブロック図、第２図は
上記実施例に於けるノードディレクトリィに設定された
ノードとセキュリティ情報の関係を説明するための図、
第３図は単純構成によるネットワークシステムの構成例
を示すブロック図、第４図は本発明で対象とする２階層
構成を持つネットワークシステムの構成例を示すブロッ
ク図である。 １・・・ワークステーション（ＷＳ）　、２・・・ノー
ド１のＣＰＵ、３・・・パススルー装置、４・・・記憶
装置（Ｍ）　　４ａ・・・ノードディレクトリィ　（Ｎ
Ｄ）、５・・・ノード２のＣＰＵ、８・・・ノード３の
ＣＰＵ。 ７・・・ノード４のＣＰＵ、ＰＬ　、Ｐ２・・・パスワ
ード。 出願人代理人　弁理士　鈴江武彦 第１図 ｔ４２図

Claims (1)

    【特許請求の範囲】
  1. ２階層以上の構成を持つネットワークシステムに於いて
    、ノード間をパススルーさせるパススルー装置と、同パ
    ススルー装置によりノード間をパススルーさせる際に参
    照されるノードと特定セキュリティ情報の対応を示すノ
    ードディレクトリィとを有し、ノード間をパススルーさ
    せる際に上記ノードディレクトリィを用いてアクセスの
    正当性をチェックすることを特徴としたセキュリティ方
    式。
JP63167605A 1988-07-05 1988-07-05 セキュリティ方式 Pending JPH0216669A (ja)

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JP63167605A JPH0216669A (ja) 1988-07-05 1988-07-05 セキュリティ方式
US07/374,067 US4995112A (en) 1988-07-05 1989-06-30 Security system
EP19890112270 EP0350005A3 (en) 1988-07-05 1989-07-05 Security system

Applications Claiming Priority (1)

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ID=15852876

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US (1) US4995112A (ja)
EP (1) EP0350005A3 (ja)
JP (1) JPH0216669A (ja)

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