JPH02186393A - インターフェース回路 - Google Patents
インターフェース回路Info
- Publication number
- JPH02186393A JPH02186393A JP1006627A JP662789A JPH02186393A JP H02186393 A JPH02186393 A JP H02186393A JP 1006627 A JP1006627 A JP 1006627A JP 662789 A JP662789 A JP 662789A JP H02186393 A JPH02186393 A JP H02186393A
- Authority
- JP
- Japan
- Prior art keywords
- digital television
- signal
- memory
- communication
- supplied
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Synchronizing For Television (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
［産業上の利用分野］
この発明は、ディジタルテレビジョン受像機にプリンタ
、パーソナルコンピュータ等の外部機器を接続するのに
使用して好適なインターフェース回路に関する。 ［従来の技術］ 従来のテレビジョン受像機はアナログ信号処理をしてい
るため、外部機器のディジタルインターフェースを介し
てデータ通信の端末あるいは情報源として使用すること
が困難であった。 しかしながら、ＨＤＴＶ （ハイ・デフィニションＴＶ
）、ＥＤＴＶ （エクステンデッド・デフィニションＴ
Ｖ）等に対応したディジタルテレビジョン受像機では、
ディジタル信号処理が行なわれている。したがって、信
号処理系の途中から信号を得るだけで外部機器のディジ
タルインターフェースを介してデータ通信の端末あるい
は情報源として使用することが容易になった。 ［発明が解決しようとする課題］ ところで、−船釣に受像機内の１ｇ号処理系における動
作クロック周波数に比べてデータ通信における伝送りロ
ック周波数は低く、それぞれの動作周波数は一致しない
。そのため、ディジタルテレビジョン受像機と外部機器
とを直接接続することはできない。 そこで、この発明では、ディジタルテレビジョン受像機
と外部機器との間に介在させる良好なインターフェース
回路を提供するものである。 ［ｉ！’題を解決するための手段］ この発明は、ディジタルテレビジョン受像機と外部機器
との間に介在されるインターフェース回路であって、映
像信号の整数画部分のメモリ容量を有１゛るメモリと、
ディジタルテしビジョン受像機の同期系と外部機器の同
期系を合わせるための時間軸変肉手段とを有するもので
ある。 ［作 ｍ］ Ｉ−述構成においては、時間軸変肉手段１４によ−〕て
ディジタルテレビジョン受像機の同期系と外部機器の同
期系が合わせられるので、これらの同期系が異なる場合
であっても、ディジタルテレビジョン受ｔｔ ｎと外部
ＩＩ器とを接続できるようになり２ これにより、ディ
ジタルテレビジョン受１象機をデータ通１Ｈの端末ある
いは情９８Ｒとして受用することが容易となる。 ［実 施 例コ 以下、第１図を参照しながらこの発明の一実施例につい
て説明する。本例はインターフェース回路１００がディ
ジタルテレビジョン受像機内に内蔵された例である。 同図において、１はディジタルテレビジョン受像機の信
号処理回路、２はメモリ、３はＣＰＵである。メモリ２
は１フイールドまたはｌフレームもしくはそれ以上の容
量を有するものとされ、本例においてはフレームメモリ
とされる。 ここで、ディジタルテレビジョン受像機が情報源として
使用される場合は、実線で示すように、層号処理回１３
１からのディジタルデータはバッファ４を介してメモリ
２の入力端子に供給されて書き込まれる。そして、メモ
リ２より読みだされて出力端子に得られるディジタルデ
ータは、バッファ５を介してＣＰＵ３に供給される。 一方、ディジタルテレビジョン受像機がデータ通信の端
末として使用される場合は、破線で示すように、ＣＰＵ
３からのディジタルデータはバッフ７６を介してメモリ
２の入力端子に供給されて書き込まれろ。そして、メモ
リ２より読みだされて出ノコ端子に１”４られるディジ
タルデータは、バッフ７７を介して１８号処理回路１に
供給される。 また、ＣＰＵ３より、例えばＧＰＩＢ、Ｒ９−２３２Ｃ
＃よりなる通１８線用インターフェース回路８およびバ
ッフ７９，１０を介して端子１１が導出される。そして
、この端子１１には、外部通（８線１２を介してパーソ
ナルコンピュータ等の外部機器１３が接続される。 ここで、ディジタルテしヒジョン受ｔｔｎが情報源とし
て
、パーソナルコンピュータ等の外部機器を接続するのに
使用して好適なインターフェース回路に関する。 ［従来の技術］ 従来のテレビジョン受像機はアナログ信号処理をしてい
るため、外部機器のディジタルインターフェースを介し
てデータ通信の端末あるいは情報源として使用すること
が困難であった。 しかしながら、ＨＤＴＶ （ハイ・デフィニションＴＶ
）、ＥＤＴＶ （エクステンデッド・デフィニションＴ
Ｖ）等に対応したディジタルテレビジョン受像機では、
ディジタル信号処理が行なわれている。したがって、信
号処理系の途中から信号を得るだけで外部機器のディジ
タルインターフェースを介してデータ通信の端末あるい
は情報源として使用することが容易になった。 ［発明が解決しようとする課題］ ところで、−船釣に受像機内の１ｇ号処理系における動
作クロック周波数に比べてデータ通信における伝送りロ
ック周波数は低く、それぞれの動作周波数は一致しない
。そのため、ディジタルテレビジョン受像機と外部機器
とを直接接続することはできない。 そこで、この発明では、ディジタルテレビジョン受像機
と外部機器との間に介在させる良好なインターフェース
回路を提供するものである。 ［ｉ！’題を解決するための手段］ この発明は、ディジタルテレビジョン受像機と外部機器
との間に介在されるインターフェース回路であって、映
像信号の整数画部分のメモリ容量を有１゛るメモリと、
ディジタルテしビジョン受像機の同期系と外部機器の同
期系を合わせるための時間軸変肉手段とを有するもので
ある。 ［作 ｍ］ Ｉ−述構成においては、時間軸変肉手段１４によ−〕て
ディジタルテレビジョン受像機の同期系と外部機器の同
期系が合わせられるので、これらの同期系が異なる場合
であっても、ディジタルテレビジョン受ｔｔ ｎと外部
ＩＩ器とを接続できるようになり２ これにより、ディ
ジタルテレビジョン受１象機をデータ通１Ｈの端末ある
いは情９８Ｒとして受用することが容易となる。 ［実 施 例コ 以下、第１図を参照しながらこの発明の一実施例につい
て説明する。本例はインターフェース回路１００がディ
ジタルテレビジョン受像機内に内蔵された例である。 同図において、１はディジタルテレビジョン受像機の信
号処理回路、２はメモリ、３はＣＰＵである。メモリ２
は１フイールドまたはｌフレームもしくはそれ以上の容
量を有するものとされ、本例においてはフレームメモリ
とされる。 ここで、ディジタルテレビジョン受像機が情報源として
使用される場合は、実線で示すように、層号処理回１３
１からのディジタルデータはバッファ４を介してメモリ
２の入力端子に供給されて書き込まれる。そして、メモ
リ２より読みだされて出力端子に得られるディジタルデ
ータは、バッファ５を介してＣＰＵ３に供給される。 一方、ディジタルテレビジョン受像機がデータ通信の端
末として使用される場合は、破線で示すように、ＣＰＵ
３からのディジタルデータはバッフ７６を介してメモリ
２の入力端子に供給されて書き込まれろ。そして、メモ
リ２より読みだされて出ノコ端子に１”４られるディジ
タルデータは、バッフ７７を介して１８号処理回路１に
供給される。 また、ＣＰＵ３より、例えばＧＰＩＢ、Ｒ９−２３２Ｃ
＃よりなる通１８線用インターフェース回路８およびバ
ッフ７９，１０を介して端子１１が導出される。そして
、この端子１１には、外部通（８線１２を介してパーソ
ナルコンピュータ等の外部機器１３が接続される。 ここで、ディジタルテしヒジョン受ｔｔｎが情報源とし
て
【吏用される場合には、メモリ２よりバッファ５を介
してＣＰＵ３に１共給されるディジタルデータは通１ｇ
線用インターフェース回路８およびバッファ９を介して
端子１１に供給され、この端子１１より外部通信線１２
を介して外部機器１３に供給される。 一方、ディジタルテレビジョン受像機がデータ通信の端
末として使用される場合には、外部１［１３からのディ
ジタルデータは外部通信線１２を介して端子１１に供給
され、この端子１］よりバッファ１０および通信線用イ
ンターフェース回路８を介してＣＰＵ３に供給される。 また、 １４は時間軸変換回路であり、この時間軸変換
回路１４には、信号処理回路１より垂直同期信号、動作
クロック、水平ブランキング信号が供給されると共に、
通信線用インターフェース回路８より通信開始信号およ
び通信用りＯツクが供給される。 第２図は、時間軸変換回路１４の具体構成を示すもので
ある。 同図において、セレクタ２３には信号処理回路１からの
動作クロックと通信線用インターフェース回路８からの
通信用クロックが供給される。このセレクタ２３て選択
されるクロックはメモリ２にライトイネーブル信号ＶＴ
として供給されると共に、カウンタ２６にカウンタクロ
ックとして供給される。 また、セレクタ２４には信号処理回路１からの水平ブラ
ンキング信号が供給されると共に、高しヘル°゛１゛°
の信号が供給される。この場合、水平ブランキング１言
号はブランキング期間が低レベル＋ｉ ０ ＋＋とされ
、その他の部分は高レベル“１″とされる。このセレク
タ２４で選択される（８号はカウンタ２６にカウンタス
トップ信号として供給される。カウンタ２６はセレクタ
２４で選択される信号が高レベル゛°１゛であるときカ
ウントが行なわれ、−力紙レベル“０″であるときカウ
ントが停止１ニされる。 また、セレクタ２５には信号処理回路１からの垂直同期
信号が供給されると共に、通信用インターフェース回路
８からの通信開始４Ｍ号が供給され私 このセレクタ２
５で選択される信号はカウンタ２６にカウンタロード信
号として供給される。 カウンタ２Ｇの出力信号はメモリ２にアドレス（８号と
して供給される。 また、セレクタ２３〜２５での選択は、ＣＰＵ３によっ
て制御される。 まず、ディジタルテレビジョン受ＩＲ機が情報源として
使用される場合について述べる。 メモリ２への書き込み命令が起きると、セレクタ２３で
は動作りａツクが選択され、セレクタ２４では水平ブラ
ンキング信号が選択され、セレクタ２５では垂直同期信
号が選択されて、信号処理回路１からのディジタルデー
タの１フレ一ム分がメモリに書き込まれる。つまり、垂
直同期信号が検出されると動作クロックによってカウン
タ２６のカウント動作が開始され、メモリ２にディジタ
ルデータが順次書き込まれる。この場合、水平ブランキ
ング期間ではカウンタ２６のカウントが停止されるため
、メモリ２へのディジタルデータの書き込みは停止され
る。これにより、メモリ容度の節約が図られる。 また、メモリ２への１フレ一ム分のディジタルデータの
書き込みが終了すると、セレクタ２３では通信用クロッ
クが選択され、セレクタ２４では高レベル１°１ ＋＋
の信号が選択され、セレクタ２５では通信開始信号が選
択されて、メモリ２より１フレ一ム分のディジタルデー
タが順次読みだされ、ＣＰＵ３を介して外部機器１３に
供給される。つまり、通信開始信号が検出されると通信
クロックによってカウンタ２６のカウント動作が開始さ
れ、メモリ２よりディジタルデータが順次読みだされる
。 これにより、外部機器１３では、ディジタルテレビジョ
ン受像機の信号処理回路１より１フレーノ、の画ＩＩ情
摺を得ることになり、画像のプリントアウトや静ｌに１
画ファイルとして記憶しておくことが可能となる。 次に、ディジタルテレビジョン受像機がデータ通）３の
端末として使用される場合について述へる。 メモリ２への會き込み命令が起きると、セレクタ２３で
は通信用クロックが選択され、セレクタ２４ては高レベ
ル゛ｌ′°の信号が選択され、セレクタ２５では通信開
始信号が選択されて、外部機器１３からのディジタルデ
ータの１フレ一ム分がＣＰＵ３を介してメモリに書き込
まれる。つまり、通信開始信号が検出されると通信用ク
ロックによってカウンタ２６のカウント動作が開始され
、メモリ２にディジタルデータが順次きき込まれる。 また、メモリ２への１フレ一ム分のディジタルデータの
書き込みが終了すると、セレクタ２３では動作りａ・ツ
クが選択され、セレクタ２４では水平ブランキング信号
が選択され、セレクタ２５ては垂直同門信号が選択され
て、メモリ２より１フレ一ム分のディジタルデータが順
次読みたされて１８号処理回路Ｉに供給される。つまり
、垂直同門信号が検出されると動作りａツクによってカ
ウンタ２Ｇのカウント動作が開始され、メモリ２よりデ
ィジタルデータが順次読みだされる。この場合、水平ブ
ランキング期間ではカウンタ２Ｇのカウントが停止され
るため、メモリ２からのディジタルデータの読みだしは
停止される。これにより、外部機器１３からのディジタ
ルデータはディジタルテレビジョン受（を機の同期に合
わせられる。 これにより、ディジタルテレビジョン受像機の信号処理
回路１には、外部機器１３より１フレームの画像情報が
供給されるため、この画像情報による静止画の表示が可
能となる。 このように、本例によれば、ディジタルテレビジョン受
像機と外部機器の動作周波数が一致しなくても、これら
を良好に接続することができ、ディジタルテレビジョン
受像機を情報源あるいはデータ通信の端末として使用す
ることができる。 なお、上述実施例においては、インターフェース回路１
００がディジタルテレビジョン受像機内に内蔵された例
であるが、これに限定されるものでないことは勿論であ
る。 ［発明の効果］ 以上説明したように５ この発明によれば、時閉軸変換
手段によってディジタルテレビジョン受像機の同期系と
外部機器の同期系が合わせられるので、これらの同期系
が異なる場合であっても、ディジタルテレビジョン受像
機と外部機器とを接続できろようになり、これにより、
ディジタルテレビジョン受像機をデータ通信の端末ある
いは情報源とし・て使用することが容易となり、その汎
用性を広げることができる。 第１図はこの発明の一実施例を示す構成図、第２図は時
間軸変換回路の具体構成図である。 １−φ争ディジタルテレビジョン受像機の信号処理回路 ―−メモリ ｌＣＰＵ 争−通信線用インターフェース回路 ・・外部機器 ・９時間軸変換回路 ２４．２５ ４−−セレクタ ２６・Φ会カウンタ ０〇−赤拳インターフェース回路 ２ φ ３ ・ ８ 書 】３１ ！ ４− ２３゜
してＣＰＵ３に１共給されるディジタルデータは通１ｇ
線用インターフェース回路８およびバッファ９を介して
端子１１に供給され、この端子１１より外部通信線１２
を介して外部機器１３に供給される。 一方、ディジタルテレビジョン受像機がデータ通信の端
末として使用される場合には、外部１［１３からのディ
ジタルデータは外部通信線１２を介して端子１１に供給
され、この端子１］よりバッファ１０および通信線用イ
ンターフェース回路８を介してＣＰＵ３に供給される。 また、 １４は時間軸変換回路であり、この時間軸変換
回路１４には、信号処理回路１より垂直同期信号、動作
クロック、水平ブランキング信号が供給されると共に、
通信線用インターフェース回路８より通信開始信号およ
び通信用りＯツクが供給される。 第２図は、時間軸変換回路１４の具体構成を示すもので
ある。 同図において、セレクタ２３には信号処理回路１からの
動作クロックと通信線用インターフェース回路８からの
通信用クロックが供給される。このセレクタ２３て選択
されるクロックはメモリ２にライトイネーブル信号ＶＴ
として供給されると共に、カウンタ２６にカウンタクロ
ックとして供給される。 また、セレクタ２４には信号処理回路１からの水平ブラ
ンキング信号が供給されると共に、高しヘル°゛１゛°
の信号が供給される。この場合、水平ブランキング１言
号はブランキング期間が低レベル＋ｉ ０ ＋＋とされ
、その他の部分は高レベル“１″とされる。このセレク
タ２４で選択される（８号はカウンタ２６にカウンタス
トップ信号として供給される。カウンタ２６はセレクタ
２４で選択される信号が高レベル゛°１゛であるときカ
ウントが行なわれ、−力紙レベル“０″であるときカウ
ントが停止１ニされる。 また、セレクタ２５には信号処理回路１からの垂直同期
信号が供給されると共に、通信用インターフェース回路
８からの通信開始４Ｍ号が供給され私 このセレクタ２
５で選択される信号はカウンタ２６にカウンタロード信
号として供給される。 カウンタ２Ｇの出力信号はメモリ２にアドレス（８号と
して供給される。 また、セレクタ２３〜２５での選択は、ＣＰＵ３によっ
て制御される。 まず、ディジタルテレビジョン受ＩＲ機が情報源として
使用される場合について述べる。 メモリ２への書き込み命令が起きると、セレクタ２３で
は動作りａツクが選択され、セレクタ２４では水平ブラ
ンキング信号が選択され、セレクタ２５では垂直同期信
号が選択されて、信号処理回路１からのディジタルデー
タの１フレ一ム分がメモリに書き込まれる。つまり、垂
直同期信号が検出されると動作クロックによってカウン
タ２６のカウント動作が開始され、メモリ２にディジタ
ルデータが順次書き込まれる。この場合、水平ブランキ
ング期間ではカウンタ２６のカウントが停止されるため
、メモリ２へのディジタルデータの書き込みは停止され
る。これにより、メモリ容度の節約が図られる。 また、メモリ２への１フレ一ム分のディジタルデータの
書き込みが終了すると、セレクタ２３では通信用クロッ
クが選択され、セレクタ２４では高レベル１°１ ＋＋
の信号が選択され、セレクタ２５では通信開始信号が選
択されて、メモリ２より１フレ一ム分のディジタルデー
タが順次読みだされ、ＣＰＵ３を介して外部機器１３に
供給される。つまり、通信開始信号が検出されると通信
クロックによってカウンタ２６のカウント動作が開始さ
れ、メモリ２よりディジタルデータが順次読みだされる
。 これにより、外部機器１３では、ディジタルテレビジョ
ン受像機の信号処理回路１より１フレーノ、の画ＩＩ情
摺を得ることになり、画像のプリントアウトや静ｌに１
画ファイルとして記憶しておくことが可能となる。 次に、ディジタルテレビジョン受像機がデータ通）３の
端末として使用される場合について述へる。 メモリ２への會き込み命令が起きると、セレクタ２３で
は通信用クロックが選択され、セレクタ２４ては高レベ
ル゛ｌ′°の信号が選択され、セレクタ２５では通信開
始信号が選択されて、外部機器１３からのディジタルデ
ータの１フレ一ム分がＣＰＵ３を介してメモリに書き込
まれる。つまり、通信開始信号が検出されると通信用ク
ロックによってカウンタ２６のカウント動作が開始され
、メモリ２にディジタルデータが順次きき込まれる。 また、メモリ２への１フレ一ム分のディジタルデータの
書き込みが終了すると、セレクタ２３では動作りａ・ツ
クが選択され、セレクタ２４では水平ブランキング信号
が選択され、セレクタ２５ては垂直同門信号が選択され
て、メモリ２より１フレ一ム分のディジタルデータが順
次読みたされて１８号処理回路Ｉに供給される。つまり
、垂直同門信号が検出されると動作りａツクによってカ
ウンタ２Ｇのカウント動作が開始され、メモリ２よりデ
ィジタルデータが順次読みだされる。この場合、水平ブ
ランキング期間ではカウンタ２Ｇのカウントが停止され
るため、メモリ２からのディジタルデータの読みだしは
停止される。これにより、外部機器１３からのディジタ
ルデータはディジタルテレビジョン受（を機の同期に合
わせられる。 これにより、ディジタルテレビジョン受像機の信号処理
回路１には、外部機器１３より１フレームの画像情報が
供給されるため、この画像情報による静止画の表示が可
能となる。 このように、本例によれば、ディジタルテレビジョン受
像機と外部機器の動作周波数が一致しなくても、これら
を良好に接続することができ、ディジタルテレビジョン
受像機を情報源あるいはデータ通信の端末として使用す
ることができる。 なお、上述実施例においては、インターフェース回路１
００がディジタルテレビジョン受像機内に内蔵された例
であるが、これに限定されるものでないことは勿論であ
る。 ［発明の効果］ 以上説明したように５ この発明によれば、時閉軸変換
手段によってディジタルテレビジョン受像機の同期系と
外部機器の同期系が合わせられるので、これらの同期系
が異なる場合であっても、ディジタルテレビジョン受像
機と外部機器とを接続できろようになり、これにより、
ディジタルテレビジョン受像機をデータ通信の端末ある
いは情報源とし・て使用することが容易となり、その汎
用性を広げることができる。 第１図はこの発明の一実施例を示す構成図、第２図は時
間軸変換回路の具体構成図である。 １−φ争ディジタルテレビジョン受像機の信号処理回路 ―−メモリ ｌＣＰＵ 争−通信線用インターフェース回路 ・・外部機器 ・９時間軸変換回路 ２４．２５ ４−−セレクタ ２６・Φ会カウンタ ０〇−赤拳インターフェース回路 ２ φ ３ ・ ８ 書 】３１ ！ ４− ２３゜
Claims (1)
- （１）ディジタルテレビジョン受像機と外部機器との間
に介在されるインターフェース回路であって、 映像信号の整数画面分のメモリ容量を有するメモリと、 上記ディジタルテレビジョン受像機の同期系と上記外部
機器の同期系を合わせるための時間軸変換手段とを有す
ることを特徴とするインターフェース回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1006627A JPH02186393A (ja) | 1989-01-13 | 1989-01-13 | インターフェース回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1006627A JPH02186393A (ja) | 1989-01-13 | 1989-01-13 | インターフェース回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02186393A true JPH02186393A (ja) | 1990-07-20 |
Family
ID=11643599
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1006627A Pending JPH02186393A (ja) | 1989-01-13 | 1989-01-13 | インターフェース回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02186393A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57158879A (en) * | 1981-03-27 | 1982-09-30 | Tokyo Shibaura Electric Co | Scanning converter |
-
1989
- 1989-01-13 JP JP1006627A patent/JPH02186393A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57158879A (en) * | 1981-03-27 | 1982-09-30 | Tokyo Shibaura Electric Co | Scanning converter |
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