JPH02205128A - 付加ビット伝送制御方式 - Google Patents
付加ビット伝送制御方式Info
- Publication number
- JPH02205128A JPH02205128A JP2511389A JP2511389A JPH02205128A JP H02205128 A JPH02205128 A JP H02205128A JP 2511389 A JP2511389 A JP 2511389A JP 2511389 A JP2511389 A JP 2511389A JP H02205128 A JPH02205128 A JP H02205128A
- Authority
- JP
- Japan
- Prior art keywords
- additional bit
- circuit
- separation
- additional
- point
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 title claims abstract description 9
- 238000003780 insertion Methods 0.000 claims abstract description 18
- 230000037431 insertion Effects 0.000 claims abstract description 18
- 238000000926 separation method Methods 0.000 claims abstract description 16
- 238000001514 detection method Methods 0.000 claims abstract description 12
- 238000012937 correction Methods 0.000 claims description 5
- 238000012360 testing method Methods 0.000 abstract description 14
- 230000001360 synchronised effect Effects 0.000 abstract 2
- 238000010586 diagram Methods 0.000 description 4
- 239000008186 active pharmaceutical agent Substances 0.000 description 1
- 238000002474 experimental method Methods 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ディジタル無線伝送路により付加ビットの伝
送を行なう際、これの伝送状況を制御する方式に関する
ものである。
送を行なう際、これの伝送状況を制御する方式に関する
ものである。
第２図は、従来例のブロック図であり、送信端局（以下
、５ＴＥ）１においては、ディジタル信号ＤＳを誤り訂
正符号化回路（以下、ＥＮＣ）２において誤）訂正機能
を有する誤シ訂正符号へ符号化すると共に、これのオー
バヘッドビットを用いて付加ピッ）ＡＢの挿入を行なっ
たうえ、変調器（以下、ＭＯＤ）３により搬送波を変調
し、無線伝送路により中継局（以下、ＲＦＰ）４へ送信
するものとなっている。
、５ＴＥ）１においては、ディジタル信号ＤＳを誤り訂
正符号化回路（以下、ＥＮＣ）２において誤）訂正機能
を有する誤シ訂正符号へ符号化すると共に、これのオー
バヘッドビットを用いて付加ピッ）ＡＢの挿入を行なっ
たうえ、変調器（以下、ＭＯＤ）３により搬送波を変調
し、無線伝送路により中継局（以下、ＲＦＰ）４へ送信
するものとなっている。
ＲＥＰ４では、５ＴＥ１からの受信信号を彷調器（以下
、ＤＥＭ）５により後調し、符号同期回路（以下、ｗｓ
ｙ）６において、誤シ訂正符号により同期状態を設定し
、この同期状態にしたがい付加ビット分離挿入回路（以
下、■ＪＸ）７により付加ピッ） ＡＢの分離および挿
入を行なったうえ、ＭＯＤＢにより再度搬送波を変調し
、つぎのＲＥＰまたは受信端局へ送信するものとなって
いる。
、ＤＥＭ）５により後調し、符号同期回路（以下、ｗｓ
ｙ）６において、誤シ訂正符号により同期状態を設定し
、この同期状態にしたがい付加ビット分離挿入回路（以
下、■ＪＸ）７により付加ピッ） ＡＢの分離および挿
入を行なったうえ、ＭＯＤＢにより再度搬送波を変調し
、つぎのＲＥＰまたは受信端局へ送信するものとなって
いる。
また、ＲＥＰ４においては、自局の折返し試験を行なう
場合、点線により示すとおシ送信出力と受信入力とを接
続すると共に、■、■点間を切断のうえ、０点から試験
信号を送信し、かつ、０点より同信号の受信を行なうも
のとなっておシ、この場合には、ｗｓｙｓが同期状態を
設定できないため、人為的に制御信号ＣＳをＭＵＸ７へ
与え、付加ピッ）ＡＢＯ分陥および挿入を停止させるも
のとなっている。
場合、点線により示すとおシ送信出力と受信入力とを接
続すると共に、■、■点間を切断のうえ、０点から試験
信号を送信し、かつ、０点より同信号の受信を行なうも
のとなっておシ、この場合には、ｗｓｙｓが同期状態を
設定できないため、人為的に制御信号ＣＳをＭＵＸ７へ
与え、付加ピッ）ＡＢＯ分陥および挿入を停止させるも
のとなっている。
しかし、従来においては、折返し試験に際し、人為的に
ＭＵＸ７の機能を停止させねばならず、これが面倒であ
ると共に、この操作を失念すれは、０点から受信する試
験信号に誤シを生じ、折返しに験が円滑に行なえない等
の欠点を生じている。
ＭＵＸ７の機能を停止させねばならず、これが面倒であ
ると共に、この操作を失念すれは、０点から受信する試
験信号に誤シを生じ、折返しに験が円滑に行なえない等
の欠点を生じている。
前述の課題を解決するため、本発明はつぎの手段により
構成するものとなっている。
構成するものとなっている。
すなわち、上述の中継局において、同期外れに応じて検
出信号を送出する手段を符号同期回路へ設けると共に、
検出信号にしたがい付加ビットの分離、挿入を停止する
手段を付加ピット分離挿入回路へ設けたものである。
出信号を送出する手段を符号同期回路へ設けると共に、
検出信号にしたがい付加ビットの分離、挿入を停止する
手段を付加ピット分離挿入回路へ設けたものである。
したがって、折返し試験に際し、同期状態を設定できな
いものとなることにより、符号同期回路が同期外れの検
出出力を送出するため、付加ビットの分離および挿入動
作が自動的に行なわれなくなる。
いものとなることにより、符号同期回路が同期外れの検
出出力を送出するため、付加ビットの分離および挿入動
作が自動的に行なわれなくなる。
以下、実施例を示す第１図のブロック図によって本発明
の詳細な説明する。
の詳細な説明する。
同図においては、ＲＥＰ４のｗｓｙ６へ、同期外れに応
じて検出出力を送出する手段が付加されていると共に、
ＭＵＸ７には、ｗｓｙａの検出出力にしたがい付加ピッ
）ＡＢの分離および挿入を停止する手段が付加されてお
り、折返し試験に隙し、送信出力と受信入力とを接続の
うえ、■、■点間を切断し、０点から試験信号を送信す
ると、ｗｓｙｓが検出出力を送出してＭＵＸ７による付
加ピッ） ＡＢの分離および挿入を停止させるため、Ｄ
ＥＭ５の腹調出力がそのま＼■点から送出され、０点に
おける試験信号の受信に誤シを生じない亀のとなる。
じて検出出力を送出する手段が付加されていると共に、
ＭＵＸ７には、ｗｓｙａの検出出力にしたがい付加ピッ
）ＡＢの分離および挿入を停止する手段が付加されてお
り、折返し試験に隙し、送信出力と受信入力とを接続の
うえ、■、■点間を切断し、０点から試験信号を送信す
ると、ｗｓｙｓが検出出力を送出してＭＵＸ７による付
加ピッ） ＡＢの分離および挿入を停止させるため、Ｄ
ＥＭ５の腹調出力がそのま＼■点から送出され、０点に
おける試験信号の受信に誤シを生じない亀のとなる。
したがって、自動的に付加ピッ）ＡＢの分離および挿入
が停止されるものとなシ、折返し試験を容易に、かつ、
ｌａ、りを生ぜずに行なうことができる。
が停止されるものとなシ、折返し試験を容易に、かつ、
ｌａ、りを生ぜずに行なうことができる。
以上の説明により明らかなとおシ本発明によれば、中継
局において、同期外れの検出出力を送出し、これにより
付加ビットの分離および挿入を停止するものとしたこと
により、人為的に操作を行なわずとも、付加ビットの分
離および挿入が自動的に停止し、中継局の折返し試験を
容易にかつ確実に行なえる丸め、付加ビットの伝送を行
なうディジタル無線伝送路の中継局において顕著な効果
が得られる。
局において、同期外れの検出出力を送出し、これにより
付加ビットの分離および挿入を停止するものとしたこと
により、人為的に操作を行なわずとも、付加ビットの分
離および挿入が自動的に停止し、中継局の折返し試験を
容易にかつ確実に行なえる丸め、付加ビットの伝送を行
なうディジタル無線伝送路の中継局において顕著な効果
が得られる。
第１図は本発明の実施例を示すブロック図、第２図は従
来例のブロック図である。 ４−・・・中継局、６・・・・符号同期回路、７・・・
・付加ビット分離挿入回路。
来例のブロック図である。 ４−・・・中継局、６・・・・符号同期回路、７・・・
・付加ビット分離挿入回路。
Claims (1)
- 誤り訂正符号化信号により同期状態を設定する符号同期
回路と、該回路の同期状態設定にしたがい前記誤り訂正
符号化信号のオーバヘッドビットを用いる付加ビットの
分離、挿入を行なう付加ビット分離挿入回路とを備える
ディジタル無線伝送路の中継局において、同期外れに応
じて検出信号を送出する手段を前記符号同期回路へ設け
ると共に、前記検出信号にしたがい付加ビットの分離、
挿入を停止する手段を前記付加ビット分離挿入回路へ設
けたことを特徴とする付加ビット伝送制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2511389A JPH02205128A (ja) | 1989-02-03 | 1989-02-03 | 付加ビット伝送制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2511389A JPH02205128A (ja) | 1989-02-03 | 1989-02-03 | 付加ビット伝送制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02205128A true JPH02205128A (ja) | 1990-08-15 |
Family
ID=12156875
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2511389A Pending JPH02205128A (ja) | 1989-02-03 | 1989-02-03 | 付加ビット伝送制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02205128A (ja) |
-
1989
- 1989-02-03 JP JP2511389A patent/JPH02205128A/ja active Pending
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