JPH0221805Y2 - - Google Patents
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- Publication number
- JPH0221805Y2 JPH0221805Y2 JP1984196926U JP19692684U JPH0221805Y2 JP H0221805 Y2 JPH0221805 Y2 JP H0221805Y2 JP 1984196926 U JP1984196926 U JP 1984196926U JP 19692684 U JP19692684 U JP 19692684U JP H0221805 Y2 JPH0221805 Y2 JP H0221805Y2
- Authority
- JP
- Japan
- Prior art keywords
- comparator
- input
- output
- level
- capacitor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Manipulation Of Pulses (AREA)
- Measurement Of Length, Angles, Or The Like Using Electric Or Magnetic Means (AREA)
- Transmission And Conversion Of Sensor Element Output (AREA)
Description
【考案の詳細な説明】
［産業上の利用分野］
本考案は電磁ピツクアツプの出力信号を波形整
形するための波形整形回路に関する。
形するための波形整形回路に関する。
［従来技術の説明］
第３図は従来の波形整形回路の要領図、第４図
はその動作説明図である。
はその動作説明図である。
第３図において、１はコンパレータで、その−
入力端子に電磁ピツクアツプの出力信号Ａが与え
られる。電磁ピツクアツプは、少なくともひとつ
の歯を有するパルサと固定電磁巻線とを備え、パ
ルサの回転でその歯が固定電磁巻線を通過する毎
に当該電磁巻線に発生する誘導電圧を出力するも
ので、例えば内燃機関の回転角検出用などに広く
用いられている。このような電磁ピツクアツプの
出力信号Ａは、第４図に示されるように、グラウ
ンドレベルから所定電位だけシフトされてコンパ
レータ１の（−）入力端子に与えられる。コンパ
レータ１の（＋）入力端子は、分圧抵抗２に接続
されると共に抵抗３を介してコンパレータ１の出
力端子に接続され、これにより、（＋）入力端子
に分圧抵抗２による基準電圧に加えて出力電圧が
帰還され、その入力電圧は第４図のＢとなり、コ
ンパレータ１にヒステリシスが与えられる。
入力端子に電磁ピツクアツプの出力信号Ａが与え
られる。電磁ピツクアツプは、少なくともひとつ
の歯を有するパルサと固定電磁巻線とを備え、パ
ルサの回転でその歯が固定電磁巻線を通過する毎
に当該電磁巻線に発生する誘導電圧を出力するも
ので、例えば内燃機関の回転角検出用などに広く
用いられている。このような電磁ピツクアツプの
出力信号Ａは、第４図に示されるように、グラウ
ンドレベルから所定電位だけシフトされてコンパ
レータ１の（−）入力端子に与えられる。コンパ
レータ１の（＋）入力端子は、分圧抵抗２に接続
されると共に抵抗３を介してコンパレータ１の出
力端子に接続され、これにより、（＋）入力端子
に分圧抵抗２による基準電圧に加えて出力電圧が
帰還され、その入力電圧は第４図のＢとなり、コ
ンパレータ１にヒステリシスが与えられる。
以上のごとき構成で、コンパレータ１は、電磁
ピツクアツプの出力信号Ａが（＋）入力電圧Ｂ以
下になることでその出力がＬレベルからＨレベル
に転じ、出力信号Ａが（＋）入力電圧Ｂ以上にな
ることでＨレベルからＬレベルに転じて、第４図
のＣに示される整形出力を与える。コンパレータ
１の（＋）入力電圧Ｂは、コンパレータ１の出力
がＬレベルでは分圧抵抗２による基準電圧であ
り、その出力がＨレベルではこの基準電圧に抵抗
３を介して帰還電圧が加えられる。この結果、コ
ンパレータ１にヒステリシスが与えられる。
ピツクアツプの出力信号Ａが（＋）入力電圧Ｂ以
下になることでその出力がＬレベルからＨレベル
に転じ、出力信号Ａが（＋）入力電圧Ｂ以上にな
ることでＨレベルからＬレベルに転じて、第４図
のＣに示される整形出力を与える。コンパレータ
１の（＋）入力電圧Ｂは、コンパレータ１の出力
がＬレベルでは分圧抵抗２による基準電圧であ
り、その出力がＨレベルではこの基準電圧に抵抗
３を介して帰還電圧が加えられる。この結果、コ
ンパレータ１にヒステリシスが与えられる。
しかしながら、上記従来技術では、ヒステリシ
スの幅ｗを大きく設定することができないのでノ
イズマージンが小さく、回路の耐ノイズ性に問題
がある。すなわち、電磁ピツクアツプの出力信号
Ａの電圧幅Ｗはパルサの回転数に略比例し、低回
転では極めて小となる。従つて、低回転時の出力
信号Ａについても有効に波形整形するために、ヒ
ステリシスの幅ｗは当該低回転時の出力信号Ａの
電圧幅より小さく設定されることとなる。この結
果、電磁ピツクアツプの出力信号ＡにノイズＮが
生じた場合に、このノイズＮがヒステリシスの幅
ｗを容易に越えることとなり、波形整形に支障を
来たすことになる。
スの幅ｗを大きく設定することができないのでノ
イズマージンが小さく、回路の耐ノイズ性に問題
がある。すなわち、電磁ピツクアツプの出力信号
Ａの電圧幅Ｗはパルサの回転数に略比例し、低回
転では極めて小となる。従つて、低回転時の出力
信号Ａについても有効に波形整形するために、ヒ
ステリシスの幅ｗは当該低回転時の出力信号Ａの
電圧幅より小さく設定されることとなる。この結
果、電磁ピツクアツプの出力信号ＡにノイズＮが
生じた場合に、このノイズＮがヒステリシスの幅
ｗを容易に越えることとなり、波形整形に支障を
来たすことになる。
［考案の目的］
本考案は従来技術の上記問題点を改善するのも
ので、その目的は、耐ノイズ性に優れた波形整形
回路を提供することにある。
ので、その目的は、耐ノイズ性に優れた波形整形
回路を提供することにある。
［目的を達成するための手段］
本考案においては、磁気ピツクアツプの出力信
号を一方の入力とし他方の入力として分圧抵抗に
よる基準電圧が与えられるコンパレータを有し、
該コンパレータの出力を前記他方の入力に帰還し
て該コンパレータにヒステリシスをもたせて、前
記磁気ピツクアツプの出力信号を波形整形する波
形整形回路において、一端側が前記コンパレータ
の他方の入力に接続され他端側がダイオードを介
して前記コンパレータの出力に接続されており、
前記磁気ピツクアツプの出力信号と前記基準電圧
とが一致して前記コンパレータの出力が第１レベ
ルから第２レベルに反転することで、前記コンパ
レータの他方の入力に与えられる入力電圧を前記
基準電圧以上に上昇させるコンデンサと、該コン
デンサと並列にコレクタエミツタ回路が挿入され
ベースが第１の抵抗を介して前記コンパレータの
出力に接続されており、前記コンパレータの他方
の入力に与えられる入力電圧と前記電磁ピツクア
ツプの出力信号とが再び一致して前記コンパレー
タの出力が前記第２レベルから前記第１レベルに
戻ることで、オン状態となつて前記コンデンサの
他端側の電位を放電するための放電路を形成し、
この放電で前記コンデンサの他端側の電位がベー
ス電位と略等しくなる程度に低下することでオフ
状態となるトランジスタと、該トランジスタのコ
レクタエミツタ回路に直列挿入された第２の抵抗
とをもうけることによつて、上記目的を達成す
る。
号を一方の入力とし他方の入力として分圧抵抗に
よる基準電圧が与えられるコンパレータを有し、
該コンパレータの出力を前記他方の入力に帰還し
て該コンパレータにヒステリシスをもたせて、前
記磁気ピツクアツプの出力信号を波形整形する波
形整形回路において、一端側が前記コンパレータ
の他方の入力に接続され他端側がダイオードを介
して前記コンパレータの出力に接続されており、
前記磁気ピツクアツプの出力信号と前記基準電圧
とが一致して前記コンパレータの出力が第１レベ
ルから第２レベルに反転することで、前記コンパ
レータの他方の入力に与えられる入力電圧を前記
基準電圧以上に上昇させるコンデンサと、該コン
デンサと並列にコレクタエミツタ回路が挿入され
ベースが第１の抵抗を介して前記コンパレータの
出力に接続されており、前記コンパレータの他方
の入力に与えられる入力電圧と前記電磁ピツクア
ツプの出力信号とが再び一致して前記コンパレー
タの出力が前記第２レベルから前記第１レベルに
戻ることで、オン状態となつて前記コンデンサの
他端側の電位を放電するための放電路を形成し、
この放電で前記コンデンサの他端側の電位がベー
ス電位と略等しくなる程度に低下することでオフ
状態となるトランジスタと、該トランジスタのコ
レクタエミツタ回路に直列挿入された第２の抵抗
とをもうけることによつて、上記目的を達成す
る。
［考案の実施例］
第１図は本考案による波形整形回路の一実施例
を示す回路図でである。なお、第３図と同符号の
ものは同一物を示す。
を示す回路図でである。なお、第３図と同符号の
ものは同一物を示す。
図において、４は電磁ピツクアツプで、歯５ａ
を有するパルサ５と電磁巻線６とを備え、パルサ
５の回転でその歯５ａが電磁巻線６を通過する毎
に巻線６に誘導電圧が発生し、これが出力信号と
して端子ａ，ｂに与えられる。
を有するパルサ５と電磁巻線６とを備え、パルサ
５の回転でその歯５ａが電磁巻線６を通過する毎
に巻線６に誘導電圧が発生し、これが出力信号と
して端子ａ，ｂに与えられる。
７は端子ａとグラウンドとの間に挿入されたノ
イズ低減用のコンデンサ、８は端子ａと電源との
間に挿入された抵抗、９は端子ａにアノードが接
続された半波整流用のダイオードである。ダイオ
ード９のカソードは、一端グラウンドの抵抗１０
および一端グラウンドのノイズ低減用のコンデン
サ１１に接続されると共に、コンパレータ１の保
護抵抗１２の一端に接続されている。抵抗８は電
磁巻線６の断線時に抵抗１０とによる分圧電圧を
コンパレータ１の（−）入力端子に与え、電磁巻
線６の断線でコンパレータ１の出力がＨレベル状
態にロツクされるのを防止する。保護抵抗１２の
他端は、コンパレータ１の（−）入力端子に接続
されると共に、一端グラウンドのコンデンサ１３
およびダイオード１４のアノードに接続されてい
る。コンデンサ１３はノイズ低減用である。ダイ
オード１４のカソードは電源に接続され、電磁ピ
ツクアツプ４の出力信号の上限リミツタとして機
能する。
イズ低減用のコンデンサ、８は端子ａと電源との
間に挿入された抵抗、９は端子ａにアノードが接
続された半波整流用のダイオードである。ダイオ
ード９のカソードは、一端グラウンドの抵抗１０
および一端グラウンドのノイズ低減用のコンデン
サ１１に接続されると共に、コンパレータ１の保
護抵抗１２の一端に接続されている。抵抗８は電
磁巻線６の断線時に抵抗１０とによる分圧電圧を
コンパレータ１の（−）入力端子に与え、電磁巻
線６の断線でコンパレータ１の出力がＨレベル状
態にロツクされるのを防止する。保護抵抗１２の
他端は、コンパレータ１の（−）入力端子に接続
されると共に、一端グラウンドのコンデンサ１３
およびダイオード１４のアノードに接続されてい
る。コンデンサ１３はノイズ低減用である。ダイ
オード１４のカソードは電源に接続され、電磁ピ
ツクアツプ４の出力信号の上限リミツタとして機
能する。
１５は端子ｂに一端が接続された抵抗、１６は
抵抗１５の他端とグラウンドとの間に挿入された
ツエナーダイオード、１７は端子ｂと電源との間
に挿入された抵抗である。ツエナーダイオード１
６は、電磁ピツクアツプ４の出力信号を所定電位
だけシフトする機能を有している。
抵抗１５の他端とグラウンドとの間に挿入された
ツエナーダイオード、１７は端子ｂと電源との間
に挿入された抵抗である。ツエナーダイオード１
６は、電磁ピツクアツプ４の出力信号を所定電位
だけシフトする機能を有している。
１８はタンタル電解コンデンサで、その（−）
側がコンパレータ１の（＋）入力端子に接続さ
れ、（＋）側がダイオード１９のカソードに接続
されている。ダイオード１９のアノードはコンパ
レータ１の出力端子に接続されている。このダイ
オード１９はコンデンサ１８の保護用で、タンタ
ル電解コンデンサ１８の逆バイアスを防止してい
る。２０はトランジスタで、そのコレクタが抵抗
２１を介してコンデンサ１８の（−）側に接続さ
れ、エミツタがコンデンサ１８の（＋）側に接続
されている。トランジスタ２０のベースは抵抗２
２を介してコンパレータ１の出力端子に接続され
ている。２３はコンデンサ１８に並列挿入された
抵抗である。分圧抵抗２は第３図で説明したよう
にコンパレータ１の（＋）入力端子に接続されて
いる。
側がコンパレータ１の（＋）入力端子に接続さ
れ、（＋）側がダイオード１９のカソードに接続
されている。ダイオード１９のアノードはコンパ
レータ１の出力端子に接続されている。このダイ
オード１９はコンデンサ１８の保護用で、タンタ
ル電解コンデンサ１８の逆バイアスを防止してい
る。２０はトランジスタで、そのコレクタが抵抗
２１を介してコンデンサ１８の（−）側に接続さ
れ、エミツタがコンデンサ１８の（＋）側に接続
されている。トランジスタ２０のベースは抵抗２
２を介してコンパレータ１の出力端子に接続され
ている。２３はコンデンサ１８に並列挿入された
抵抗である。分圧抵抗２は第３図で説明したよう
にコンパレータ１の（＋）入力端子に接続されて
いる。
第２図は上記構成の動作説明図で、以下第２図
を併用して第１図の構成の動作を説明する。
を併用して第１図の構成の動作を説明する。
電磁ピツクアツプ４の出力信号は、ツエナーダ
イオード１６および抵抗１５によつてグラウンド
レベルから所定電位だけシフトされた後、ダイオ
ード９の内部抵抗による電圧ドロツプおよびコン
デンサ７，１１，１３によるノイズ抵減を受けた
後、信号Ｄとしてコンパレータ１の（−）入力端
子に与えられる。
イオード１６および抵抗１５によつてグラウンド
レベルから所定電位だけシフトされた後、ダイオ
ード９の内部抵抗による電圧ドロツプおよびコン
デンサ７，１１，１３によるノイズ抵減を受けた
後、信号Ｄとしてコンパレータ１の（−）入力端
子に与えられる。
コンパレータ１は、信号Ｄが（＋）入力電圧Ｅ
以下になることでその出力をＬレベルからＨレベ
ルに転じ、信号Ｄが（＋）入力電圧Ｅ以上になる
ことでＨレベルからＬレベルに転じて、整形出力
Ｆを与える。
以下になることでその出力をＬレベルからＨレベ
ルに転じ、信号Ｄが（＋）入力電圧Ｅ以上になる
ことでＨレベルからＬレベルに転じて、整形出力
Ｆを与える。
今、時点t1であるとすれば、信号Ｄが（＋）入
力電圧Ｅより大であるので、コンパレータ１の出
力はＬレベルである。このときの（＋）入力電圧
Ｅのレベルは分圧抵抗２から与えられる基準電圧
である。
力電圧Ｅより大であるので、コンパレータ１の出
力はＬレベルである。このときの（＋）入力電圧
Ｅのレベルは分圧抵抗２から与えられる基準電圧
である。
時点t1から時点t2に進行し、信号Ｄが（＋）入
力電圧Ｅに達すると、コンパレータ１の出力がＨ
レベルに転じる。この結果、コンデンサ１８の
（＋）側にダイオード１９をとおしてコンパレー
タ１の出力電圧が印加される。これにより、コン
デンサ１８の（−）側も（＋）側と同電位とな
り、（＋）入力電圧Ｅが一気に立上る。その立上
りの高さは、コンパレータ１の出力電圧からダイ
オード１９の順方向内部ドロツプを差し引いた値
となる。
力電圧Ｅに達すると、コンパレータ１の出力がＨ
レベルに転じる。この結果、コンデンサ１８の
（＋）側にダイオード１９をとおしてコンパレー
タ１の出力電圧が印加される。これにより、コン
デンサ１８の（−）側も（＋）側と同電位とな
り、（＋）入力電圧Ｅが一気に立上る。その立上
りの高さは、コンパレータ１の出力電圧からダイ
オード１９の順方向内部ドロツプを差し引いた値
となる。
次いで、時点t2から時点t3に進行するに従い、
コンデンサ１８の（−）側電位は分圧抵抗２を介
した放電により低下し、時点t3で信号Ｄに達す
る。この結果、コンパレータ１の出力がＨレベル
からＬレベルに転じるので、コンデンサ１８の
（＋）側電位の存在によりトランジスタ２０が導
通し、コンデンサ１８の（＋）側電位が抵抗２１
を経て放電される。これにより、コンデンサ１８
の（＋）側と（−）側とが略同電位となり、トラ
ンジスタ２０がオフしてもとの状態に戻る。
コンデンサ１８の（−）側電位は分圧抵抗２を介
した放電により低下し、時点t3で信号Ｄに達す
る。この結果、コンパレータ１の出力がＨレベル
からＬレベルに転じるので、コンデンサ１８の
（＋）側電位の存在によりトランジスタ２０が導
通し、コンデンサ１８の（＋）側電位が抵抗２１
を経て放電される。これにより、コンデンサ１８
の（＋）側と（−）側とが略同電位となり、トラ
ンジスタ２０がオフしてもとの状態に戻る。
なお、抵抗２３は、一気に立上つた（＋）入力
電圧Ｅが低下して来る際に、コンパレータ１のＨ
レベル出力状態において（＋）入力電圧Ｅが到達
する電位を与え、信号Ｄの立上りの際におけるノ
イズマージンを向上させるためにもうけられてい
る。しかし、信号Ｄの立上りは急峻であるのでノ
イズの影響を受けにくく、従つて抵抗２３は必ず
しももうける必要はない。
電圧Ｅが低下して来る際に、コンパレータ１のＨ
レベル出力状態において（＋）入力電圧Ｅが到達
する電位を与え、信号Ｄの立上りの際におけるノ
イズマージンを向上させるためにもうけられてい
る。しかし、信号Ｄの立上りは急峻であるのでノ
イズの影響を受けにくく、従つて抵抗２３は必ず
しももうける必要はない。
［考案の効果］
以上説明したように本考案によれば、コンデン
サを利用して、磁気ピツクアツプの出力信号にお
ける波形の緩やかな部分に対するヒステリシスの
幅を大としたので、ノイズの影響を最も受け易い
部分で大きなノイズマージンをもたせることがで
き、耐ノイズ性に優れた波形整形回路を提供する
ことができる。また、大きなノイズマージンをも
たせることができることによつて、入力段のコン
デンサ容量を減少することができ、信号の遅れを
改善して精度をより向上することができる。
サを利用して、磁気ピツクアツプの出力信号にお
ける波形の緩やかな部分に対するヒステリシスの
幅を大としたので、ノイズの影響を最も受け易い
部分で大きなノイズマージンをもたせることがで
き、耐ノイズ性に優れた波形整形回路を提供する
ことができる。また、大きなノイズマージンをも
たせることができることによつて、入力段のコン
デンサ容量を減少することができ、信号の遅れを
改善して精度をより向上することができる。
第１図は本考案による波形整形回路の一実施例
を示す回路図、第２図は第１図の回路の動作説明
図、第３図は従来の波形整形回路の要領図、第４
図は第３図の構成の動作説明図である。 １：コンパレータ、２：分圧抵抗、４：電磁ピ
ツクアツプ、１８：コンデンサ、２０：トランジ
スタ、２１：抵抗。
を示す回路図、第２図は第１図の回路の動作説明
図、第３図は従来の波形整形回路の要領図、第４
図は第３図の構成の動作説明図である。 １：コンパレータ、２：分圧抵抗、４：電磁ピ
ツクアツプ、１８：コンデンサ、２０：トランジ
スタ、２１：抵抗。
Claims (1)
- 【実用新案登録請求の範囲】 磁気ピツクアツプの出力信号を一方の入力とし
他方の入力として分圧抵抗による基準電圧が与え
られるコンパレータを有し、該コンパレータの出
力を前記他方の入力に帰還して該コンパレータに
ヒステリシスをもたせて、前記磁気ピツクアツプ
の出力信号を波形整形する波形整形回路におい
て、 一端側が前記コンパレータの他方の入力に接続
され他端側がダイオードを介して前記コンパレー
タの出力に接続されており、前記電磁ピツクアツ
プの出力信号と前記基準電圧とが一致して前記コ
ンパレータの出力が第１レベルから第２レベルに
反転することで、前記コンパレータの他方の入力
に与えられる入力電圧を前記基準電圧以上に上昇
させるコンデンサと、 該コンデンサと並列にコレクタエミツタ回路が
挿入されベースが第１の抵抗を介して前記コンパ
レータの出力に接続されており、前記コンパレー
タの他方の入力に与えられる入力電圧と前記電磁
ピツクアツプの出力信号とが再び一致して前記コ
ンパレータの出力が前記第２レベルから前記第１
レベルに戻ることで、オン状態となつて前記コン
デンサの他端側の電位を放電するための放電路を
形成し、この放電で前記コンデンサの他端側の電
位がベース電位と略等しくなる程度に低下するこ
とでオフ状態となるトランジスタと、 該トランジスタのコレクタエミツタ回路に直列
挿入された第２の抵抗とを有することを特徴とす
る波形整形回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1984196926U JPH0221805Y2 (ja) | 1984-12-28 | 1984-12-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1984196926U JPH0221805Y2 (ja) | 1984-12-28 | 1984-12-28 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61116434U JPS61116434U (ja) | 1986-07-23 |
| JPH0221805Y2 true JPH0221805Y2 (ja) | 1990-06-12 |
Family
ID=30754867
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1984196926U Expired JPH0221805Y2 (ja) | 1984-12-28 | 1984-12-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0221805Y2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57201318A (en) * | 1981-06-04 | 1982-12-09 | Fujitsu Denso Ltd | Voltage level detecting circuit |
-
1984
- 1984-12-28 JP JP1984196926U patent/JPH0221805Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61116434U (ja) | 1986-07-23 |
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