JPH0221806Y2 - - Google Patents

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Publication number
JPH0221806Y2
JPH0221806Y2 JP6546883U JP6546883U JPH0221806Y2 JP H0221806 Y2 JPH0221806 Y2 JP H0221806Y2 JP 6546883 U JP6546883 U JP 6546883U JP 6546883 U JP6546883 U JP 6546883U JP H0221806 Y2 JPH0221806 Y2 JP H0221806Y2
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JP
Japan
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signal
circuit
threshold
sample
binarization
Prior art date
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Expired
Application number
JP6546883U
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English (en)
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JPS59171429U (ja
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  • Transmission And Conversion Of Sensor Element Output (AREA)
  • Picture Signal Circuits (AREA)
  • Manipulation Of Pulses (AREA)

Description

【考案の詳細な説明】 (イ) 産業上の利用分野 この考案はいわゆる浮動しきい値法によつて映
像信号等を2値化する2値化装置に関する。
(ロ) 従来技術 第1図は従来技術を説明するための原理図、第
2図は従来装置の構成を略示したブロツク図であ
る。
即ち、撮像装置のシエージング、微小部におけ
る映像信号のレベルが小さいことなどに対処する
ため、TVカメラ等の映像信号の2値化は、映像
信号Saを二つに分岐して、一方は比較回路1に
直接入力し、他方は遅延回路2及び減衰回路3を
介して得た信号にバイアス回路4でもつて適宜の
バイアスを与えた後しきい値信号Sbとして、前
記比較回路1の他方入力として与えている。その
結果、比較回路1の出力として第1図に示すよう
な2値化信号Scを得ている。
一方、前記遅延回路2及び減衰回路3の構成素
子は固定定数であるため、入力映像信号のレベル
が小さいと、その信号の減衰される量も極めて小
さくなるから、両信号の差が僅かになる。その結
果、比較回路1が十分精度よく両信号を比較でき
ず、2値化が不成功に終わることがある。
しかしながら、従来の装置では、2値化が不成
功に終わつたことを表示する手段がないので、前
記不成功に終わつた2値化に基づくデータ処理結
果からそのことを類推しなければならないという
煩わしさがある。
(ハ) 目的 この考案は浮動しきい値法による2値化が成功
しているか否かを容易に判断することができる2
値化装置を提供することを目的としている。
(ニ) 構成 この考案に係る2値化装置は、原信号を遅延減
衰させるとともにバイアス電圧を与えて得られた
しきい値信号と、前記原信号とを比較することに
より2値化信号を得る装置において、前記原信号
としきい値信号とをサンプルホールドするサンプ
ル・ホールド回路と、前記2値化信号の立ち上が
りと立ち下がりを受けて時間遅れを伴つたトリガ
パルスを前記サンプル・ホールド回路に与える遅
延回路と、前記サンプル・ホールド回路の原信号
としきい値信号の出力のレベル差を表示する手段
とを設けたことを構成の要旨としている。
(ホ) 実施例 第3図はこの考案に係る2値化装置の一実施例
の構成を略示したブロツク図である。
同図において第2図と同一部分は同一符号で示
している。5は映像信号Saとしきい値信号Sbと
を入力して、それぞれをサンプル・ホールドする
サンプル・ホールド回路、6は2値化信号Scを
入力して、その立ち上がり又は立ち下がりに関連
して前記サンプル・ホールド回路5にホールド指
令を出す遅延回路である。この遅延回路6は例え
ば、クロツク信号と遅延時間に応じた設定値が予
め与えられるカウンタ等で構成される。7はサン
プル・ホールド回路5の各ホールド出力を入力し
て、その差動信号を出力する差動増幅器、8は前
記差動信号を与えられてそのレベルを表示する表
示手段としてメータである。
次に、上述した如き構成を備えた実施例の動作
を説明する。
第4図は第3図に示した実施例の各部の動作波
形図である。
第4図イに示すような映像信号Saは分岐され
て、比較回路1及び遅延回路2にそれぞれ入力す
る。遅延回路2の出力信号は減衰回路3に与えら
れる。減衰回路3の出力にバイアス回路4からバ
イアス電圧が与えられることにより得られるしき
い値信号Sbは前記比較回路1の他方入力として
与えられる。
比較回路1は映像信号Saとしきい値信号Sbと
を比較して、同図ロに示すような2値化信号Sc
を出力する。遅延回路6は2値化信号Scの立ち
上がり又は立ち下がりを受けて、同図ハに示す如
き一定の時間の遅れをともなつたトリガパルス
Sdをサンプル・ホールド回路5に与える。
一方、前記映像信号Sa及びしきい値信号Sbは
サンプル・ホールド5にもそれぞれ入力する。し
かして、サンプル・ホールド回路5は前記トリガ
パルスSdが入力したときの映像信号Sa及びしき
い値信号Sbの各値をサンプルし、これらを保持
する。同図ニのSe及びSfは映像信号Sa及びしき
い値信号Sbのホールド出力信号を示している。
前記ホールド出力信号Se及びSfは差動増幅器
7に与えられることにより、前記両信号の差動出
力がメータ8に与えられる。それ故、メータ8は
映像信号Saとしきい値信号Sbの差を表示してい
るから、2値化が十分なレベル差で行われている
ときは、メータ指示は大きく振れ、一方、両信号
のレベル差が非常に少なく、ノイズ等で容易に反
転するようであれば、メータはほとんど振れな
い。
このようにして、オペレータはメータ指示が大
きいときは2値化処理の信頼性は高く、一方、そ
の指示が少ないときは信頼性が低いことを判断す
る。
なお、実施例では映像信号としきい値信号との
レベル差を表示する手段としてメータを用いてい
るが、この考案はこれに限られるものではなく例
えば、ランプ等の表示器を用いるものであつても
よい。
(ヘ) 効果 この考案は原信号としきい値信号とのレベル差
を表示器で知らせるものであるから、その表示に
より2値化の信頼度が容易に判断できて大変便利
である。
また、この考案によれば、表示結果を見ながら
被写体を照らす照明等を調整できるので、最適の
2値化条件の設定を容易に行えるという別異の効
果も奏する。
【図面の簡単な説明】
第1図は従来技術を説明するための原理図、第
2図は従来装置の構成を略示したブロツク図、第
3図はこの考案に係る2値化装置の一実施例の構
成を略示したブロツク図、第4図は第3図に示し
た実施例の各部の動作波形図である。 1……比較回路、2……遅延回路、3……減衰
回路、4……バイアス回路、5……サンプル・ホ
ールド回路、6……遅延回路、7……差動増幅
器、8……メータ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 原信号を遅延減衰させるとともにバイアス電圧
    を与えて得られたしきい値信号と、前記原信号と
    を比較することにより2値化信号を得る装置にお
    いて、前記原信号としきい値信号とをサンプルホ
    ールドするサンプル・ホールド回路と、前記2値
    化信号の立ち上がりと立ち下がりを受けて時間遅
    れを伴つたトリガパルスを前記サンプル・ホール
    ド回路に与える遅延回路と、前記サンプル・ホー
    ルド回路の原信号としきい値信号の出力のレベル
    差を表示する手段とを設けたことを特徴とする2
    値化装置。
JP6546883U 1983-04-30 1983-04-30 2値化装置 Granted JPS59171429U (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6546883U JPS59171429U (ja) 1983-04-30 1983-04-30 2値化装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP6546883U JPS59171429U (ja) 1983-04-30 1983-04-30 2値化装置

Publications (2)

Publication Number Publication Date
JPS59171429U JPS59171429U (ja) 1984-11-16
JPH0221806Y2 true JPH0221806Y2 (ja) 1990-06-12

Family

ID=30195668

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6546883U Granted JPS59171429U (ja) 1983-04-30 1983-04-30 2値化装置

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JP (1) JPS59171429U (ja)

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JPS59171429U (ja) 1984-11-16

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