JPH02230185A - Control of plasma display panel for each dot - Google Patents
Control of plasma display panel for each dotInfo
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Abstract
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、プラズマディスプレイパネルの点順次制御方
法に関するものである。本発明は、アナログ、アルファ
ニュメリック、またはそれ以外の画像を例えばカラーで
表示するのに応用可能である。DETAILED DESCRIPTION OF THE INVENTION Field of the Invention The present invention relates to a method for point-sequential control of a plasma display panel. The present invention is applicable to displaying analog, alphanumeric, or other images, for example in color.
従来の技術
プラズマディスプレイパネルはフラットパネルディスプ
レイ装置として現在重要な位置を占めている。ガス(一
般にはネオンを主体とした混合ガス)が収容される体積
を規定する2枚の絶縁性プレートを備える装置が公知で
ある。これらプレートは、画素マ} IJックスを規定
する交差する2つのグループの電極を支持する。電極を
適切に励起するとガス中で放電が起こり、この放電によ
って光が放射される。2. Description of the Related Art Plasma display panels currently occupy an important position as flat panel display devices. Devices are known that include two insulating plates defining a volume in which a gas (generally a neon-based gas mixture) is accommodated. These plates support two intersecting groups of electrodes that define the pixel matrix. Proper excitation of the electrodes causes a discharge in the gas, which emits light.
改良されたプラズマディスプレイパネルは、この放電を
維持する手段を備えていることが好ましい。有利である
と思われる態様によると、この手段は、同じ基板上に対
にして堆積されたいわゆる維持電極からなる。従って、
このプラズマディスプレイパネルはコプラナ一式維持プ
ラズマディスプレイパネルと呼ばれる。Preferably, the improved plasma display panel includes means for maintaining this discharge. According to an embodiment that appears to be advantageous, this means consists of so-called sustain electrodes deposited in pairs on the same substrate. Therefore,
This plasma display panel is called a coplanar complete maintenance plasma display panel.
このタイプの装置が第1図と第2図に示されている。こ
の装置は、ヨーロッパ特許出願公開第135. 382
号に記載されている。この装置は、維持電極2と3が表
面にコーティングされたガラスプレート1を備えている
。各維持電極2、3には突起部2a,3aが設けられて
いる。このユニットは絶縁層4で覆われている。書き込
み電極5が維持電極2、3と交差している。このユニッ
トは、絶縁層6とMgOからなる保護層7で覆われてい
る。A device of this type is shown in FIGS. 1 and 2. This device is described in European Patent Application No. 135. 382
listed in the number. The device comprises a glass plate 1 with sustain electrodes 2 and 3 coated on its surface. Each sustain electrode 2, 3 is provided with a protrusion 2a, 3a. This unit is covered with an insulating layer 4. The write electrode 5 crosses the sustain electrodes 2 and 3. This unit is covered with an insulating layer 6 and a protective layer 7 made of MgO.
第2のプレート8によってこのユニットが完成する。ガ
ス9が、気密性シム(図示せず)によって分離状態に保
たれた2枚のプレートの間に収容されている。A second plate 8 completes this unit. Gas 9 is contained between two plates kept separated by airtight shims (not shown).
このタイプのプラズマディスプレイパネルの動作原理は
以下の通りである。すなわち、アドレス用放電を電極5
と電極2の交差部分に選択的に発生させる。この放電に
より、電極を被覆している絶縁性材料に電荷が蓄積する
。次に、この放電は、互いに平行で同一平面上にある電
極2と3の間に維持放電を発生させるのを容易にするの
に利用される。有効光の大部分を与えるこの放電は、電
極2と3の間で一方向に電圧を印加し、次に別の方向に
電圧を印加することにより維持される。The operating principle of this type of plasma display panel is as follows. In other words, the addressing discharge is applied to the electrode 5.
selectively generated at the intersection of electrode 2 and electrode 2. This discharge causes charge to accumulate in the insulating material covering the electrode. This discharge is then utilized to facilitate the generation of a sustaining discharge between electrodes 2 and 3 which are parallel and coplanar with each other. This discharge, which provides most of the useful light, is maintained by applying a voltage between electrodes 2 and 3 in one direction and then in the other direction.
1画素当たり3電極であるこのタイプの構造の価値は二
重である。The value of this type of structure, with three electrodes per pixel, is twofold.
第1に、維持放電が交差部2−5の外で起こる。有効光
が電極によって阻止されず、従って光出力の利得が高い
。First, a sustaining discharge occurs outside the intersection 2-5. Effective light is not blocked by the electrodes and therefore the gain in light output is high.
第2に、維持放電が単一の基板(電極2、3、5を支持
するレベル)に局在する。従って、他の基板は例えば発
光体を堆積させるのに利用することができるため、この
発光体は放電から保護されることになる。Second, the sustaining discharge is localized to a single substrate (the level supporting electrodes 2, 3, 5). Therefore, another substrate can be used, for example, to deposit the phosphor, which will be protected from discharge.
このタイプのプラズマディスプレイパネルを制御する方
法は、上記の文献に記載されているように1行ごとの制
御方法である。これは、同じ電極5の下に位置するすべ
ての点が制御されることを意味する。この方法を用いた
のでは、プラズマディスプレイパネルを点ごとに制御す
ることはできない。点ごとの制御方法は、ビデオ画像の
表示の場合に有効である。というのは、この方法はビデ
オ画像信号の構造と整合性があるからである。The method of controlling this type of plasma display panel is a line-by-line control method as described in the above-mentioned document. This means that all points located under the same electrode 5 are controlled. Using this method, it is not possible to control the plasma display panel point by point. Point-by-point control methods are useful for displaying video images. This is because this method is consistent with the structure of the video image signal.
ジー.ダブり二一.ディック(G, W, nick)
は、rsIDプロシーディングズ」第27/3巻、19
86年、183〜187ページに、コプラナー維持方式
で1画素当たり3電極であるプラズマディスプレイパネ
ルを記載している。このタイプのプラズマディスプレイ
パネルの制御原理が第3図に示されている。G. Double 21. Dick (G, W, nick)
rsID Proceedings” Volume 27/3, 19
1986, pages 183 to 187, describes a plasma display panel that uses a coplanar maintenance method and has three electrodes per pixel. The control principle of this type of plasma display panel is shown in FIG.
この図面では、維持電極がY1 とEで表示されている
(電極Eには同定用の添字】がない。というのは、この
タイプの維持電極にはすべて同じ電圧が印加されるから
である)。アドレス用電極はX,で表示されている。従
って、画素PI,は、2つの指数1とjによって規定さ
れる。維持信号は、全電極Eに印加される正と負を交互
する第1の交流電圧と、全電極Ylに印加され、この第
1の電圧とは位相が逆の第2の電圧とからなる。従って
、電極Eが+Vのときには、電極Y1が逆に電位Vであ
る。In this drawing, the sustain electrodes are designated Y1 and E (electrode E has no identifying subscript ] since all sustain electrodes of this type have the same voltage applied to them). . Address electrodes are indicated by an X. Therefore, pixel PI, is defined by two indices 1 and j. The sustain signal consists of a first alternating current voltage that is applied to all the electrodes E and is alternately positive and negative, and a second voltage that is applied to all the electrodes Yl and whose phase is opposite to the first voltage. Therefore, when the electrode E is at +V, the electrode Y1 is at the potential V, conversely.
画素PIJにアドレスする方法、すなわちこの画素をオ
ンにする(つまり点弧させ始める)か、あるいはオフに
する(消弧する)方法は、2段階からなる。The method of addressing the pixel PIJ, ie turning it on (ie starting to fire) or turning it off (extinguishing), consists of two steps.
a)第1に、維持信号の中に段階を1つ挿入し、この段
階において電極YIをグラウンド(基準レベル)に接続
する。次に、選択した電極xjに正のパルス(振幅+V
イ)を印加する。最終結果が画素を点弧することである
場合には、同時に負のパルス−Vyを対応する電極Y1
に印加する。a) First, insert one step in the sustain signal and connect the electrode YI to ground (reference level) in this step. Next, a positive pulse (amplitude +V
b) is applied. If the final result is to fire the pixel, simultaneously apply a negative pulse -Vy to the corresponding electrode Y1
to be applied.
b)この第1段階の直後に、振幅が+Veのパルスを電
極Eに印加する。このようにすると、X,とEの間の選
択した点、すなわちX,とY,の間で放電が起こった点
においてのみ放電を起こさせることができる。この結果
、対応する点の点弧状態が、すなわちYi−X,の交差
点の近くとYIとの間で一連の放電が最終的に維持され
る。b) Immediately after this first step, a pulse of amplitude +Ve is applied to electrode E. In this way, discharge can be caused only at a selected point between X and E, that is, at a point where discharge occurs between X and Y. As a result, the ignition state of the corresponding point is finally maintained, i.e., a series of discharges between near the intersection of Yi-X and YI.
選択されなかった電極Yにはパルス−Vyが印加されず
、その点は以前のくオンまたはオフ)状態のままにされ
る。No pulse -Vy is applied to the unselected electrodes Y, leaving that point in its previous state (on or off).
このアドレス法は、各画素を点ごとに選択的に制御する
のに使用される。また、この方法は、半選択式制御(行
ごとの制御または列ごとの制御)法とも整合性がある。This addressing method is used to selectively control each pixel point by point. This method is also compatible with semi-selective control (row-by-row or column-by-column control) methods.
この方法の欠点は、複雑な信号が必要とされることであ
る。電極Y8には4つの異なる電圧レベルが現れ、電極
Eには3つの異なる電圧レベルが現れる。さらに、この
方法を用いると、アドレスシーケンスが極めて長くなり
、スクリーン上で情報を更新する最大速度が制限される
。The disadvantage of this method is that complex signals are required. Four different voltage levels appear on electrode Y8 and three different voltage levels appear on electrode E. Additionally, this method results in extremely long address sequences, which limits the maximum speed at which information can be updated on the screen.
本発明の方法をうまく適用することのできる別のタイプ
のプラズマディスプレイパネルが第4図に示されている
。このタイプのプラズマディスプレイパネル自体は、本
出願人によるフランス国特許出願第88 03953号
及び同フランス国特許出願に基づク{憂先権を主張して
、本件出願と同日に出願した特許願(1)を対象とする
ものである。従って、このタイプのプラズマディスプレ
イパネルは公知ではなく、十分な説明を行うためにここ
にこのプラズマディスプレイパネルを記述する。Another type of plasma display panel to which the method of the invention can be successfully applied is shown in FIG. This type of plasma display panel itself is based on the French Patent Application No. 88 03953 filed by the present applicant and the patent application filed on the same day as the present application (claiming first priority right). 1). Therefore, this type of plasma display panel is not known and is described here for the sake of a thorough explanation.
第4図のプラズマディスプレイパネルは、第1のグルー
プの電極XJ (Jは1〜Nの整数)で表面をコーテ
ィングされた第1のガラスプレート10を備えている(
1つの電極X,だけが図示されている)。プレート10
と電極X,を備えるこのユニットは、誘電材料層12で
覆われる。この誘電材料層12は、電子の放出をより簡
単にするためにMgOなどの酸化物層(図示せず)で覆
われることもある。この誘電材料層l2の上には、発光
材料の点14、すなわち紫外線照射によって発色するこ
とのできる材料が存在している。The plasma display panel of FIG. 4 includes a first glass plate 10 whose surface is coated with a first group of electrodes XJ (J is an integer from 1 to N).
Only one electrode, X, is shown). plate 10
and electrodes X, is covered with a layer of dielectric material 12. This dielectric material layer 12 may be covered with an oxide layer (not shown) such as MgO to make electron emission easier. On this layer of dielectric material l2 there are spots 14 of luminescent material, ie a material capable of developing a color upon irradiation with ultraviolet light.
このプラズマディスプレイパネルは、対電極からなる第
2のグループの電極をコーティングされた第2のガラス
プレート20も備えている。対電極は、それぞれ、アド
レス−維持電極(Ye.)(1は1〜Pの整数)、維持
電極(Y@)と呼ばれる。アドレス−維持電極と維持電
極は、互いに対向する位置に突起部22、24を備えて
いる。プレート20とこれら電極を有するこのユニット
は、誘電材料層26で覆われる。The plasma display panel also includes a second glass plate 20 coated with a second group of counter electrodes. The counter electrodes are called an address-sustain electrode (Ye.) (1 is an integer from 1 to P) and a sustain electrode (Y@), respectively. The address-sustain electrode and the sustain electrode are provided with protrusions 22 and 24 at positions facing each other. This unit with plate 20 and these electrodes is covered with a layer of dielectric material 26.
通常の動作中は、2枚のプレート10、20とその表面
の電極アレイが接近状態にされてシム(図示せず)の厚
さの分だけ離される。プレートとシムの間の空間にはガ
スが収容される。During normal operation, the two plates 10, 20 and the electrode arrays on their surfaces are brought into close proximity and separated by the thickness of a shim (not shown). Gas is contained in the space between the plate and the shim.
従って、プラズマディスプレイパネルは、一旦組み立て
られると直交する2つの電極アレイを有することになる
。すなわち、電極X,が電極(Ye.)i,(Ye)と
直交する。電極X,は、突起部22と24の上に重なっ
ていてもよいし、あるいはわずかに横にずれていてもよ
い。Thus, once assembled, the plasma display panel will have two orthogonal electrode arrays. That is, electrode X, is perpendicular to electrode (Ye.)i, (Ye). Electrode X, may overlap projections 22 and 24 or may be slightly offset laterally.
このようにして、画素P1,が電極X,と一対の維持電
極(Ye.)i,(Ye)によって規定される。In this way, pixel P1 is defined by electrode X and a pair of sustain electrodes (Ye.)i, (Ye).
発明が解決しようとする課題
このタイプのプラズマディスプレイパネルが上記の公知
の方法で制御される場合には、再び同じ問題点が現れる
。すなわち、制御が複雑であり、しかも、半選択式アド
レス法、すなわち、行ごとまたは列ごとのアドレス法で
あって点ごとのアドレス法ではないという問題である。Problem to be Solved by the Invention When this type of plasma display panel is controlled by the above-mentioned known method, the same problems arise again. That is, the control is complex, and it is a semi-selective addressing method, that is, a row-by-row or column-by-column addressing method, rather than a point-by-point addressing method.
本発明の目的は、第4図に示したタイプのプラズマディ
スプレイパネルに特に(しかしこれだけに限られないで
)使用することのできる点ごとの簡単な制御方法を提供
することにより上記の問題点を解決することである。It is an object of the present invention to overcome the above-mentioned problems by providing a simple point-by-point control method that can be used in particular (but not exclusively) for plasma display panels of the type shown in FIG. It's about solving it.
課題を解決するだめの手段
さらに詳細には、本発明によると以下の手順が利用され
る。More specifically, according to the invention, the following procedure is utilized.
a)表示を維持するために、サイクル式維持電圧のセッ
トを印加し、このセットは、
すべての第1のアドレス−維持電極(Ye.)に印加さ
れ、複数のサイクル(T)で構成されており、各サイク
ルは、第1の極性のパルスのあとに第2の極性のパルス
が続くことによって形成された第1の部分と、上記第1
の極性のパルスのあとに上記第2の極性のパルスが続く
第2の部分とを含み、ピーク間の振幅が値Vyに等しい
第1の電圧V (Ye.)と、
すべての維持電極に印加され、上記第1の電圧のサイク
ルと同じ持続期間のサイクル(T)によって形成されて
おり、各サイクルは、上記第1の維持電極に印加される
上記第1の電圧V (Ye.)とは極性が反対のパルス
で形成された第1の部分と、上記第2の極性のパルスと
そのあとに続く上記第1の極性のパルスで形成された第
2の部分とを含む第2の電圧V (Ye)と
で形成されており、
維持用上記第2の電圧のピーク間の振幅は値V6に等し
く、この第2の電圧のサイクルの上記第1の部分には記
録期間と呼ばれる第1の期間(’r+)が存在していて
この記録期間の間に上記アドレス−維持電極に印加され
る第1の電圧V (Ye.)と上記維持電極に印加され
る第2の電圧V (Ye)は、それぞれ第1の極性と第
2の極性であり、サイクルの第2の部分には消去期間と
呼ばれる第2の期間が存在していてこの消去期間の間に
上記アドレス用維持電極に印加される第1の電圧V (
Ye.)と上記維持電極に印加される第2の電圧V(Y
e)は同じ第2の極性であり、
b)制御のために、第1の極性と振幅VXとを有するア
ドレス用パルスを、画素P.Jを点弧するために記録期
間(T、)に、あるいは画素を消弧するために消去期間
(T.)に上記第1のグループの制御電極(X1)に印
加し、
上記第1のアドレス−維持電極(Ye.)に印加される
第1の電圧V (Ye.) iは、画素Pijの状態
をそれぞれ点弧または消弧させるのであれば変化させず
、
画素PI,の状態を変えずに維持して点弧しているとき
には点弧のまま、消弧しているときには消弧のままにす
ることを望む場合には、上記第1のアドレス−維持電極
(Ye.)に印加される第1の電圧V (Ye.)
iにアドレス用パルスと同じ電圧か、あるいは同じ極性
の電圧を印加する。a) Apply a set of cyclic sustain voltages to maintain the display, this set being applied to all first address-sustain electrodes (Ye.) and consisting of a number of cycles (T). and each cycle includes a first portion formed by a pulse of a first polarity followed by a pulse of a second polarity;
a first voltage V (Ye.) with a peak-to-peak amplitude equal to the value Vy; and is formed by a cycle (T) of the same duration as the cycle of the first voltage, and each cycle is formed by the first voltage V (Ye.) applied to the first sustain electrode. a second voltage V comprising a first portion formed by pulses of opposite polarity and a second portion formed by a pulse of said second polarity followed by a pulse of said first polarity; (Ye), the peak-to-peak amplitude of said second voltage for sustaining is equal to the value V6, and said first part of the cycle of this second voltage includes a first period called a recording period. A period ('r+) exists, during which a first voltage V (Ye.) is applied to the address-sustain electrode and a second voltage V (Ye) is applied to the sustain electrode. have a first polarity and a second polarity, respectively, and there is a second period called an erase period in the second part of the cycle, during which the voltage is applied to the address sustain electrode. The first voltage V (
Ye. ) and a second voltage V(Y
e) are of the same second polarity, and b) for control, an addressing pulse with the first polarity and amplitude VX is applied to the pixels P. applied to the control electrodes (X1) of said first group during the recording period (T, ) to fire the pixels or during the erase period (T.) to extinguish the pixels; - The first voltage V (Ye.) i applied to the sustain electrode (Ye.) does not change if it turns on or off the state of the pixel Pij, respectively, and does not change the state of the pixel PI, If it is desired to maintain the voltage at the same time and keep it on when it is ignited, and keep it off when it is extinguished, the voltage is applied to the first address-sustain electrode (Ye.). First voltage V (Ye.)
The same voltage as the address pulse or a voltage of the same polarity is applied to i.
従って、本発明によれば、3通りの電圧VN、VySV
eのみが主として使用される。その結果、振幅vyを振
幅VXの関数として決定して、電圧VX+vyが制御電
極(Xノ)とアドレス−維持電極(Yes} iの間
のプラズマを光らせ始めるのに十分な値にし、振幅Ve
をこのようにして決定されたVyの関数として決定して
、電圧Vy+Vyがアドレス−維持電極(yas)
iと隣接する維持電極(Ye)との間のプラズマの光を
維持するのに十分な値にする。Therefore, according to the present invention, there are three voltages VN, VySV
Only e is primarily used. As a result, the amplitude vy is determined as a function of the amplitude VX such that the voltage VX+vy is sufficient to start lighting up the plasma between the control electrode (X) and the address-sustain electrode (Yes}
is determined as a function of Vy thus determined, so that the voltage Vy+Vy is the address-sustain electrode (yas)
The value is set to be sufficient to maintain the plasma light between i and the adjacent sustain electrode (Ye).
電圧VyとV0は、従来とは異なり必ずしも同じ振幅で
ある必要はないことがわかる(第3図参照)。It can be seen that voltages Vy and V0 do not necessarily have to have the same amplitude, unlike in the conventional case (see FIG. 3).
任意の形状のアドレス用電圧を用いることができるが、
実際には矩形波状電圧を使用することが好ましい。Addressing voltages of any shape can be used, but
In practice it is preferable to use a square wave voltage.
さらに、遷移の瞬間に電極Y.. i、Y6に中間電圧
レベルを印加して容量性電圧を小さくすることが常に可
能である。Furthermore, at the moment of transition, electrode Y. .. It is always possible to apply an intermediate voltage level to i, Y6 to reduce the capacitive voltage.
いずれにせよ、本発明の特徴は、添付の図面を参照した
実施例についての以下の説明により明らかになろう。In any case, the features of the invention will become clearer from the following description of an exemplary embodiment with reference to the accompanying drawings.
実施例 第5図には信号と電圧がいくつか示されている。Example Several signals and voltages are shown in FIG.
aは、アドレス−維持電極Yaoに印加される第1の維
持電圧v (y..)を示す。a indicates the first sustain voltage v (y..) applied to the address-sustain electrode Yao.
bは、維持電極Y8印加される第2の維持電圧V (Y
e)を示す。b is the second sustain voltage V (Y
e) is shown.
Cは、これら2つの維持電圧の差(V (Ye.)−V
(Ye))を示す。C is the difference between these two sustaining voltages (V (Ye.) - V
(Ye)).
dは、電圧差(V (Ya.) 一V (Ye))の各
端部に現れる光パルスを示す。これら光パルスは放電の
維持を表しており、図示の実施例では、図示のサイクル
の前から光っていると仮定されている。d indicates the light pulse appearing at each end of the voltage difference (V (Ya.) - V (Ye)). These light pulses represent the sustaining of the discharge, and in the illustrated embodiment are assumed to have been lit since before the illustrated cycle.
図示の電圧は周期Tのサイクルで変化するという特徴を
有することがわかる。期間TI とT。はそれぞれ記録
用と消去用であり、電圧V (Ye.)、V (Ye)
は極性が逆または同じになっている。It can be seen that the illustrated voltage has the characteristic of changing in cycles of period T. Periods TI and T. are for recording and erasing, respectively, and the voltages V (Ye.) and V (Ye)
have opposite or the same polarity.
第6図は記録段階を示す図である。期間T1において記
録パルスI,が電極X」に印加されるが、他の電圧(b
)を変化させることはない。この結果として電圧差(V
(X.+) V (Ye−) i) (c)が
急に太き《なり、 (V (XJ) V (Ye−)
i)の過剰電圧の前縁に対応してガス(d)が放電
32する。この放電によって、電極に電荷が現れる。FIG. 6 is a diagram showing the recording stage. During the period T1, a recording pulse I, is applied to the electrode X', but another voltage (b
) will not change. This results in a voltage difference (V
(X.+) V (Ye-) i) (c) suddenly becomes thick (V (XJ) V (Ye-)
Gas (d) discharges 32 in response to the leading edge of the excess voltage of i). This discharge causes an electric charge to appear on the electrode.
電荷は、放電が維持されるのに逆らう。しかし、この電
荷は、第5図dに示した放電(パルス30)を維持する
のに利用される。The charge is opposed by the discharge being maintained. However, this charge is utilized to sustain the discharge (pulse 30) shown in Figure 5d.
第7図を見ると、2段階の点弧機構がさらによく理解さ
れる。第1に、電極(X,)とアドレス−維持電極(y
aa) 1の間の放電によって記録を行い(a)、次
に、維持電極(Ye@) iと(Y0)の間で交互に
放電させることによって電荷を回復させる(b)。The two stage ignition mechanism is better understood by looking at FIG. First, the electrode (X,) and the address-sustain electrode (y
aa) Record by discharging between 1 (a) and then restoring the charge (b) by discharging alternately between sustain electrodes (Ye@) i and (Y0).
電荷の符号は第6図bに記号で示されている。The sign of the charge is indicated symbolically in FIG. 6b.
記録バルスV(XJ)を対応する電極XJに印加するが
画素Pijの状態を変更したくないときには、第6図b
に点線で示したように記録パルスを電圧v (Ya−)
1に重ね合わせるだけでよい。すると画素Pijは
、オン状態のときにはオンのままに留まり、オフ状態の
ときにはオフのままに留まる。When applying a recording pulse V(XJ) to the corresponding electrode XJ but not changing the state of the pixel Pij, FIG. 6b
As shown by the dotted line, the recording pulse is changed to the voltage v (Ya-)
All you have to do is superimpose it on top of 1. The pixel Pij then remains on when it is in the on state, and remains off when it is in the off state.
第8図は、消去段階に印加される電圧を示している。期
間T8には、消去パルスI. (a)が印加される。FIG. 8 shows the voltages applied during the erase phase. During the period T8, the erase pulse I. (a) is applied.
他の電圧V (Ye.) iとV (Ye)は変化し
ない(bとC)。第8図dの維持放電30は、消去パル
スが印加されるとアドレス−維持電極(Ye。)lに存
在する電荷が除去されるので消える。The other voltages V (Ye.) i and V (Ye) do not change (b and C). The sustain discharge 30 in FIG. 8d disappears when the erase pulse is applied because the charges existing in the address-sustain electrode (Ye.)l are removed.
第9図は、維持段階(a)と消去パルスの直後(b)の
電荷を示している。電荷は第8図と同様に符号で示され
ている。FIG. 9 shows the charge during the sustain phase (a) and immediately after the erase pulse (b). Charges are indicated by symbols as in FIG.
画素PIJを消したくない場合には、電極XJに印加し
たのと同じパルスを電圧y (Ye.) lに重ね合
わせる。この電圧は、第8図bに点線で示されている。If it is not desired to erase the pixel PIJ, the same pulse applied to the electrode XJ is superimposed on the voltage y (Ye.) l. This voltage is shown as a dotted line in FIG. 8b.
従って、いずれの場合にも、アドレス段階で記録用また
は消去用に電極Xjに印加したのと同じパルスを電圧”
J (Yaa) lに重ね合わせることにより、現状
が維持される。Therefore, in any case, the same pulse applied to the electrode Xj for recording or erasing at the address stage is applied to the voltage
By superimposing it on J (Yaa) l, the status quo is maintained.
この方法の別の実施例では、アドレス−維持電極に印加
された電圧y (yas) 1は、消去期間T.の間
は+VyとーVyの中間のレベルをとることができる。In another embodiment of this method, the voltage y (yas) 1 applied to the address-sustain electrodes is applied to the erase period T. Between +Vy and -Vy, an intermediate level can be taken.
すべての維持電極に適当な電圧を印加することによりス
クリーンを完全に消去することや、一度に1行ごとまた
は1列ごとに消去することが可能であることがわかる。It can be seen that by applying appropriate voltages to all sustain electrodes it is possible to erase the screen completely, or one row or column at a time.
本発明の方法は本質的には画素の選択的アドレス法であ
るが、行全体または列全体による半選択アドレス法にも
適している。Although the method of the invention is essentially a selective addressing of pixels, it is also suitable for semi-selective addressing of entire rows or entire columns.
さらに、信号が簡単になっているため、電子システムの
制御を簡単化することができる。3通りの電圧レベルの
みを電極Ya.に印加する必要があり、2通りの電圧レ
ベルを電極Y8に印加する必要がある。6アドレス用パ
ルスは同じでよいため、パルス発生器は1つのみ必要で
ある。しかし、必要であれば、同じアドレス用電圧を使
用しないことももちろん可能である。Additionally, the simpler signals simplify the control of electronic systems. Only three voltage levels are applied to electrode Ya. It is necessary to apply two voltage levels to the electrode Y8. Since the pulses for the six addresses can be the same, only one pulse generator is required. However, it is of course possible not to use the same addressing voltages if necessary.
さらに、従来のように特別な段階がもはや必要とされな
いため、アドレス時間を短くすることができる。この結
果としてアクセスが速くなる。Furthermore, the addressing time can be shortened since special steps are no longer required as in the past. This results in faster access.
最後に、電極X.からの関与する放電の数が少なくなる
ため、発光体が劣化する程度が少なくなる(すなわち寿
命がより長くなる)。Finally, electrode X. Since fewer discharges are involved, the light emitter is degraded to a lesser extent (ie, has a longer lifetime).
最後に、第10図は、本発明のプラズマパネルディスプ
レイとその制御手段の概略図である。プラズマパネルデ
ィスプレイ40は、制御電極X, (]は1〜Nの整数
)がN出力のアドレス回路42に接続され、アドレス−
維持電極(Ye.) i いは1〜Pの整数)がP
出力のアドレス回路44に接続され、電極(Y8)が発
生器46に接続されている。表示する情報は、デコーダ
50への人力48から入力される。このデコーダ50は
デコード信号SDIをアドレス回路42に出力し、デコ
ード信号SDYをアドレス回路44に出力する。Finally, FIG. 10 is a schematic diagram of the plasma panel display of the present invention and its control means. In the plasma panel display 40, the control electrodes X, ( ] is an integer from 1 to N) are connected to an address circuit 42 with N outputs,
The sustain electrode (Ye. i or an integer from 1 to P) is P
It is connected to the address circuit 44 of the output, and the electrode (Y8) is connected to the generator 46. Information to be displayed is input from human input 48 to decoder 50 . This decoder 50 outputs a decode signal SDI to the address circuit 42 and a decode signal SDY to the address circuit 44.
第1図は、従来のプラズマパネルディスプレイの断面図
である。
第2図は、この同じプラズマパネルディスプレイの平面
図である。
第3図は、従来の制御方法を示す図である。
第4図は、本発明を適用することのできる新しいタイプ
のプラズマパネルディスプレイの図であるある。
第5図は、本発明の方法の維持電圧の形状を示しており
、この図には維持機構が説明されている。
第6図は、記録信号を示しており、この図には画素がオ
ンにされる機構が説明されている。
第7図aとbは、記録段階で電極間に発生する放電の形
状の概略図である。
第8図は、消去信号を示しており、この図には消去機構
が説明されている。
第9図aとbは、消去段階において電極に存在している
電荷の概略図である。
第10図は、プラズマパネルディスプレイとその制御手
段の概略図である。
(主な参照番号)
1、8、10、20・・ガラスプレート、2、3、E,
Y.、Yl, ・・維持電極、2a、3a、22、
24・・突起部、
4、6・・絶縁層、 5・・書き込み電極、7・・
保護層、 9・・ガス、12、26・・誘電
材料層、 14・・発光材料の点、40・・プラズマデ
ィスプレイパネノペ42、44・・アドレス回路、
50・・デコーダ、 PI,・・画素、X,・・
アドレス用電極(制御電極)、(Ye。)i・・アドレ
ス−維持電極FIG. 1 is a cross-sectional view of a conventional plasma panel display. FIG. 2 is a plan view of this same plasma panel display. FIG. 3 is a diagram showing a conventional control method. FIG. 4 is a diagram of a new type of plasma panel display to which the present invention can be applied. FIG. 5 shows the shape of the sustaining voltage of the method of the invention, and the sustaining mechanism is explained in this figure. FIG. 6 shows the recording signal and explains the mechanism by which the pixels are turned on. FIGS. 7a and 7b are schematic diagrams of the shape of the discharge generated between the electrodes during the recording stage. FIG. 8 shows the erase signal and explains the erase mechanism. Figures 9a and b are schematic illustrations of the charge present on the electrodes during the erase phase. FIG. 10 is a schematic diagram of a plasma panel display and its control means. (Main reference numbers) 1, 8, 10, 20...Glass plate, 2, 3, E,
Y. , Yl, ... sustain electrode, 2a, 3a, 22,
24... Protrusion, 4, 6... Insulating layer, 5... Writing electrode, 7...
Protective layer, 9... Gas, 12, 26... Dielectric material layer, 14... Luminescent material dot, 40... Plasma display panel 42, 44... Address circuit, 50... Decoder, PI,... Pixel, X,...
Address electrode (control electrode), (Ye.) i...address-sustain electrode
Claims (3)
る対電極からなり、対の一方の電極はアドレス−維持電
極と呼ばれ、他方の電極は維持電極と呼ばれる第2のグ
ループの電極とを備え、該維持電極は互いに平行で第1
のグループの制御電極とは直交しており、該維持電極は
それぞれ突起部を有し、1つの電極の突起部は同じ対の
電極の突起部と対向しており、1つの表示画素P_i_
jは、1つの制御電極と1対の維持電極の突起部の間の
重なり領域によってほぼ規定されているプラズマディス
プレイパネルを点ごとに制御する方法であって、 a)サイクル式維持電圧のセットをすべての維持電極に
印加し、このセットは、 −すべての第1のアドレス−維持電極に印加され、複数
のサイクルTで構成されており、各サイクルは、第1の
極性のパルスのあとに第2の極性の極性のパルスが続く
ことによって形成された第1の部分と、上記第1の極性
のパルスのあとに上記第2の極性のパルスが続く第2の
部分とを含み、ピーク間の振幅が値V_yに等しい第1
の電圧V(Y_a_e)と、 −すべての維持電極に印加され、上記第1の電圧のサイ
クルと同じ持続期間のサイクルTによって形成されてお
り、各サイクルは、上記第1の維持電極に印加される上
記第1の電圧V(Y_a_e)とは極性が反対のパルス
で形成された第1の部分と、上記第2の極性のパルスと
そのあとに続く上記第1の極性のパルスで形成された第
2の部分とを含む第2の電圧V(Y_e)と で形成されており、 維持用上記第2の電圧のピーク間の振幅は値V_eに等
しく、この第2の電圧のサイクルの上記第1の部分には
記録期間と呼ばれる第1の期間が存在していてこの記録
期間の間に上記アドレス−維持電極に印加される第1の
電圧V(Y_a_e)と上記維持電極に印加される第2
の電圧V(Y_e)は、それぞれ第1の極性と第2の極
性であり、サイクルの第2の部分には消去期間と呼ばれ
る第2の期間が存在していてこの消去期間の間に上記ア
ドレス用維持電極に印加される第1の電圧V(Y_a_
e)と上記維持電極に印加される第2の電圧V(Y_e
)は同じ第2の極性であり、 b)第1の極性と振幅V_Nとを有するアドレス用パル
スを、画素P_i_jを点弧するために記録期間に、あ
るいは画素を消弧するために消去期間に上記第1のグル
ープの制御電極に印加し、 −上記第1のアドレス−維持電極に印加される第1の電
圧V(Y_a_e)iは、画素P_i_jの状態をそれ
ぞれ点弧または消弧させるのであれば変化させず、 −画素P_i_jの状態を変えずに維持して点弧してい
るときには点弧のまま、消弧しているときには消弧のま
まにすることを望む場合には、上記第1のアドレス−維
持電極に印加される第1の電圧V(Y_a_e)iにア
ドレス用パルスと同じ電圧か、あるいは同じ極性の電圧
を印加し、 c)振幅V_yを振幅V_Nの関数として決定して、電
圧V_N+V_yが制御電極とアドレス−維持電極の間
のプラズマを光らせ始めるのに十分な値にし、振幅V_
eをこのようにして決定されたV_yの関数として決定
して、電圧V_y+V_eがアドレス−維持電極と隣接
する維持電極との間のプラズマの光を維持するのに十分
な値にすることを特徴とする方法。(1) A first group of control electrodes and a counter electrode called a sustain electrode, one electrode of the pair is called an address-sustain electrode and the other electrode is a second group of electrodes called a sustain electrode. , the sustain electrodes are parallel to each other and the first
The sustain electrodes each have a protrusion, and the protrusion of one electrode faces the protrusion of the same pair of electrodes.
j is a method for point-by-point control of a plasma display panel substantially defined by an overlap area between a control electrode and a pair of sustain electrode protrusions, comprising: a) a set of cyclic sustain voltages; applied to all sustain electrodes, this set consists of a plurality of cycles T, each cycle consisting of a pulse of the first polarity followed by a pulse of the first polarity; a first portion formed by a pulse of two polarities followed by a pulse of said second polarity, and a second portion formed by a pulse of said first polarity followed by a pulse of said second polarity; The first whose amplitude is equal to the value V_y
voltage V(Y_a_e) of - applied to all sustain electrodes and formed by cycles T of the same duration as the cycles of said first voltage, each cycle being applied to said first sustain electrode; a first portion formed by a pulse of opposite polarity to the first voltage V(Y_a_e), and a pulse of the second polarity followed by a pulse of the first polarity. a second voltage V(Y_e) comprising a second part, the peak-to-peak amplitude of said second voltage for sustaining being equal to the value V_e, and said second voltage of said second voltage cycle for sustaining; There is a first period called a recording period in part 1, and during this recording period, the first voltage V (Y_a_e) applied to the address-sustain electrode and the first voltage V (Y_a_e) applied to the sustain electrode are 2
The voltages V(Y_e) are of a first polarity and a second polarity, respectively, and there is a second period called an erase period in the second part of the cycle, and during this erase period the address The first voltage V (Y_a_
e) and the second voltage V(Y_e
) are of the same second polarity, and b) an addressing pulse with the first polarity and amplitude V_N is applied during the recording period to fire the pixel P_i_j or during the erasing period to extinguish the pixel. A first voltage V(Y_a_e)i applied to the control electrodes of said first group and applied to said first address-sustain electrodes is adapted to cause the state of the pixel P_i_j to be ignited or extinguished, respectively. - If you wish to maintain the state of the pixel P_i_j without changing it so that it remains lit when it is lit, and remains extinguished when it is extinguished, the first c) applying the same voltage or voltage of the same polarity as the addressing pulse to the first voltage V(Y_a_e)i applied to the address-sustain electrode of the address-sustain electrode; c) determining the amplitude V_y as a function of the amplitude V_N; The voltage V_N+V_y is sufficient to start lighting up the plasma between the control electrode and the address-sustain electrode, and the amplitude V_
e is determined as a function of V_y thus determined such that the voltage V_y+V_e is of a value sufficient to maintain the plasma light between the address-sustain electrode and the adjacent sustain electrode. how to.
上記アドレス用維持電極に印加される上記アドレス用パ
ルスが矩形波パルスであることを特徴とする請求項1に
記載の方法。2. The method of claim 1, wherein the addressing pulse applied to the control electrode and optionally to the addressing sustain electrode is a square wave pulse.
印加することを特徴とする請求項1に記載の方法。3. The method of claim 1, further comprising applying an intermediate voltage level to the applied voltage at the moment of the transition.
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