JPH02244026A - 液晶表示装置 - Google Patents
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- JPH02244026A JPH02244026A JP2031912A JP3191290A JPH02244026A JP H02244026 A JPH02244026 A JP H02244026A JP 2031912 A JP2031912 A JP 2031912A JP 3191290 A JP3191290 A JP 3191290A JP H02244026 A JPH02244026 A JP H02244026A
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Landscapes
- Liquid Crystal (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はマトリックス画素を有する液晶表示体に関する
ものである。
ものである。
第１図は従来のドツトマトリックス・タイプの画素の配
列を示す１通常はＸ側にｎ行、Ｙ側にｍ列のマトリック
ス状に配置されており、全体は（ｎｘｍ）個の画素より
構成され、キャラクタ等の表示がなされる。この画素の
駆９ｈは、電１「甲均化法と言われる駆動法により、Ｙ
側電極により選択されたラインに、Ｘ （ｆｕｌｌ電極
より点灯、非点灯のデータを駆動するマルチプレックス
駆動や、薄膜トランジスタ（ＴＰＴ）や非線形素子を介
して画素に電荷を蓄積、駆動するアクティブ・マトリッ
クス法により行なわれる。最近コンピュータの発ｊヱに
より、液晶デイスプレィがそのターミナルに（す！用さ
れる機会が増えて来た。又液晶ディスブし・イバネルの
低電力性や、フラット性を生かしたＣ ＲＴに匹敵する
デイスプレィが要求されてきた。その結果表示内容が川
なるキャラクタのみならず、グラフィックやカラー・表
示の可能性が追求されている。しかもグラフィックとな
ると表示分解能が大きな問題となる。ところが、第１図
に示すような画素の単純なＸ−Ｙの下行配列では分解能
を上げることはむずかしく、待にマルチ・カラーデイス
プレィを実現する時は大きな問題である。
列を示す１通常はＸ側にｎ行、Ｙ側にｍ列のマトリック
ス状に配置されており、全体は（ｎｘｍ）個の画素より
構成され、キャラクタ等の表示がなされる。この画素の
駆９ｈは、電１「甲均化法と言われる駆動法により、Ｙ
側電極により選択されたラインに、Ｘ （ｆｕｌｌ電極
より点灯、非点灯のデータを駆動するマルチプレックス
駆動や、薄膜トランジスタ（ＴＰＴ）や非線形素子を介
して画素に電荷を蓄積、駆動するアクティブ・マトリッ
クス法により行なわれる。最近コンピュータの発ｊヱに
より、液晶デイスプレィがそのターミナルに（す！用さ
れる機会が増えて来た。又液晶ディスブし・イバネルの
低電力性や、フラット性を生かしたＣ ＲＴに匹敵する
デイスプレィが要求されてきた。その結果表示内容が川
なるキャラクタのみならず、グラフィックやカラー・表
示の可能性が追求されている。しかもグラフィックとな
ると表示分解能が大きな問題となる。ところが、第１図
に示すような画素の単純なＸ−Ｙの下行配列では分解能
を上げることはむずかしく、待にマルチ・カラーデイス
プレィを実現する時は大きな問題である。
従って本発明の目的は、グラフィック表示等における、
特にマルチカラーグラフィック表示における、分解能を
向Ｊ−させる手段を提供することにある。
特にマルチカラーグラフィック表示における、分解能を
向Ｊ−させる手段を提供することにある。
第２図は本発明の画素配列を示す基本概念図である。
（イ）はＸ方向に一段おきに半ピッチずらす方法であり
、 （ロ）はＹ方向に一段おきに半ピッチずらす方法で
ある。この配列の画素は斜め方向に分解能が向」−する
のでモノクロであってもグラフィックにおいて斜線が不
自然にならず、最も少ない画素でもかなりの視覚分解能
が帰られる。
（イ）はＸ方向に一段おきに半ピッチずらす方法であり
、 （ロ）はＹ方向に一段おきに半ピッチずらす方法で
ある。この配列の画素は斜め方向に分解能が向」−する
のでモノクロであってもグラフィックにおいて斜線が不
自然にならず、最も少ない画素でもかなりの視覚分解能
が帰られる。
又マルチカラーにする時、Ｒ，Ｇ、 Ｈのカラーフィ
ルタを平面配置することを考えると、Ｒ，Ｇ。
ルタを平面配置することを考えると、Ｒ，Ｇ。
Ｂが三角形の各ＩＦ１点において繰り返し配置になるの
でカラーグラフィックでも、少ない画素で結構満足しつ
る分解能を実現できる。
でカラーグラフィックでも、少ない画素で結構満足しつ
る分解能を実現できる。
第３図は本発明のマルチプレックス駆動法における応用
例である。第２図（イ）の配列のために）ｌ極を一段お
きに半ピッチずつずらしながら配線してゆく、ここでＸ
電極、Ｙ電極は通常は透明Ｉ４電性電極からなり、必要
ならば配線抵抗を下げるため金ａＳ膜による微少幅の配
線材が配置されることもある。
例である。第２図（イ）の配列のために）ｌ極を一段お
きに半ピッチずつずらしながら配線してゆく、ここでＸ
電極、Ｙ電極は通常は透明Ｉ４電性電極からなり、必要
ならば配線抵抗を下げるため金ａＳ膜による微少幅の配
線材が配置されることもある。
表示分解能を上げるためには［１ｊｌＰ：数を増やす。
このため従来のマルチプレックス駆動を凌ぐものとして
ＴＰＴを用いて、電荷［積効果により、ライン数を改善
する方法がある。第４１１はＴＰＴを用いた画１ｇ５を
示す、ゲートａ４により薄膜トランジスタ（ＴＰＴ）ｌ
をＯＮさせて、データ線３により点灯父は非点灯データ
を画素、即ち液晶２に書き込み、次にＴＦＴＩをゲート
線４によりＯＦＦさせて、液晶２に書き込まれた電荷を
蓄積し駆動する。
ＴＰＴを用いて、電荷［積効果により、ライン数を改善
する方法がある。第４１１はＴＰＴを用いた画１ｇ５を
示す、ゲートａ４により薄膜トランジスタ（ＴＰＴ）ｌ
をＯＮさせて、データ線３により点灯父は非点灯データ
を画素、即ち液晶２に書き込み、次にＴＦＴＩをゲート
線４によりＯＦＦさせて、液晶２に書き込まれた電荷を
蓄積し駆動する。
第５図はＴ、 Ｆ Ｔを用いた本発明による分解能を向
上するための配列方法である。データ！１１１３〜１５
、ゲート線１０〜１２により構成され、奇数列目はトラ
ンジスタ１６と画素電極１７の如く通常の配置となるが
、偶数列目はデータ線１４に対し、トランジスタ１９，
２２、画素電極２１，２３の如く並列配置をして、実質
的に半ピッチずらす、この例はデータ１ｉｌ１３〜１５
の配線材と駆動電極１７，２０，２１．２３が同一層、
又は同一層上に形成されている時であるが、もしデータ
線と駆動電極が重なっても差し支えない構造の時は第６
図の如くトランジスタ２５をシングルとして半ピッチず
らすのに、画素電極２４をそのままずらすこともある。
上するための配列方法である。データ！１１１３〜１５
、ゲート線１０〜１２により構成され、奇数列目はトラ
ンジスタ１６と画素電極１７の如く通常の配置となるが
、偶数列目はデータ線１４に対し、トランジスタ１９，
２２、画素電極２１，２３の如く並列配置をして、実質
的に半ピッチずらす、この例はデータ１ｉｌ１３〜１５
の配線材と駆動電極１７，２０，２１．２３が同一層、
又は同一層上に形成されている時であるが、もしデータ
線と駆動電極が重なっても差し支えない構造の時は第６
図の如くトランジスタ２５をシングルとして半ピッチず
らすのに、画素電極２４をそのままずらすこともある。
第７図はＴＰＴを用いた本発明の他の具体例であり、デ
ータ＄１１３０〜３２をジグザグにして半ピッチずら１
°力法である。この方法は竺１２ピッチずらした所とず
らさない所との両１ｇ構成が全く同一になり、半ピッチ
ずらした不自然さが解消されることにある。
ータ＄１１３０〜３２をジグザグにして半ピッチずら１
°力法である。この方法は竺１２ピッチずらした所とず
らさない所との両１ｇ構成が全く同一になり、半ピッチ
ずらした不自然さが解消されることにある。
第８図はＴＰＴを用いた￥４２図（ロ）の方法に対応す
る具体例である。データ線４０〜４２、ゲート＃ｓ４３
〜４５に対しＸ側ラインにそって奇数列目はトランジス
タ４８．４８と駆動電極４７゜４９が通常の如く配置さ
れているが、偶数列目はゲート線に対し画素を上下に並
列に配置する０例えばゲート線４４によりトランジスタ
４８．５０゜５１がＯＮＬ、駆動電極４９，５２．５３
にデータが書き込まれ、′１１ピッチずれた画素を駆動
することになる。この場合、第６図と同様に第９図の如
く駆動電極５８をゲート線５６にオーバラップさせると
一層効果が上がる。
る具体例である。データ線４０〜４２、ゲート＃ｓ４３
〜４５に対しＸ側ラインにそって奇数列目はトランジス
タ４８．４８と駆動電極４７゜４９が通常の如く配置さ
れているが、偶数列目はゲート線に対し画素を上下に並
列に配置する０例えばゲート線４４によりトランジスタ
４８．５０゜５１がＯＮＬ、駆動電極４９，５２．５３
にデータが書き込まれ、′１１ピッチずれた画素を駆動
することになる。この場合、第６図と同様に第９図の如
く駆動電極５８をゲート線５６にオーバラップさせると
一層効果が上がる。
第１０図はゲート線６３〜６５をジグザグにして、半ピ
ッチ駆動電極をずらせる方法であり効果は第７図と同等
である。
ッチ駆動電極をずらせる方法であり効果は第７図と同等
である。
第１１図はＴＰＴを用いた更に他の配置例である。ドラ
イバ７０〜７３はデータ線７７．７９゜８１．８３に直
接つながれており、又データ線７８．８０．８２はスイ
ッチ７４〜７６により、Ｙ側スキャンの一ライン毎に右
か左に交互に接続される０例えばゲート線８４がＴＰＴ
をＯＮさせ、スイッチ７４〜７６が左へ倒れている詩画
１８９ト９０．９１と９２が夫々ベアで同一のデータが
書き込まれる０次にゲート線８４がＴＰＴをＯＦＦさせ
、ゲート線８５がＴＰＴをＯＮさせ、スイッチ７４〜７
６が右へ倒れると画素９４と９５゜９６と９７．９８と
９９が夫々ベアで同一のブタが書き込まれ、屯２図（イ
）の方式が実現できる。
イバ７０〜７３はデータ線７７．７９゜８１．８３に直
接つながれており、又データ線７８．８０．８２はスイ
ッチ７４〜７６により、Ｙ側スキャンの一ライン毎に右
か左に交互に接続される０例えばゲート線８４がＴＰＴ
をＯＮさせ、スイッチ７４〜７６が左へ倒れている詩画
１８９ト９０．９１と９２が夫々ベアで同一のデータが
書き込まれる０次にゲート線８４がＴＰＴをＯＦＦさせ
、ゲート線８５がＴＰＴをＯＮさせ、スイッチ７４〜７
６が右へ倒れると画素９４と９５゜９６と９７．９８と
９９が夫々ベアで同一のブタが書き込まれ、屯２図（イ
）の方式が実現できる。
第５図〜第１１図までの具体例において、当然のことな
からＲ，Ｇ、 Ｂのカラーフィルタ３ ｆ！１１は第
２図の原理に従って各駆動電極（画素）に配置されるも
のである。また当然のことながら同一のデータが書き込
まれる画素ベア、例えば第１１図の８９と９０には同一
のカラーのフィルタが割り当てられることになり、Ｒ（
赤）、Ｇ（緑）、Ｂ（青）の３原色が、三角心配：αさ
れる様にしてマルチカラーデイスプレィパネルを実現す
ることになる。
からＲ，Ｇ、 Ｂのカラーフィルタ３ ｆ！１１は第
２図の原理に従って各駆動電極（画素）に配置されるも
のである。また当然のことながら同一のデータが書き込
まれる画素ベア、例えば第１１図の８９と９０には同一
のカラーのフィルタが割り当てられることになり、Ｒ（
赤）、Ｇ（緑）、Ｂ（青）の３原色が、三角心配：αさ
れる様にしてマルチカラーデイスプレィパネルを実現す
ることになる。
更に高分解パネルを実現する手段として、ＴＰＴ駆動と
よく似た駆動法に非線形素子を用いる方式がある。第１
２図は非線形素子１０３を用いた画１ｇ１００の構成で
ある。タイミング線（第１図、第３図のＹ電極に相当）
とデータ線１０２間で液晶１０４を駆動するのに非線形
索子１０３を用いるβ式であり、−ＩＩ・線形素ｒ−は
高電圧Ｔζでは低抵抗、ｇ？Ｔｔ圧下では１１１１１ｉ
ｔ抗どなり、データ線１０２とタイミング線１０１間に
高？ｌ！ Ｊ、Ｅをかけて点灯のデータを非線形素子を
１１℃抵抗状態にして書き込み、その後低電圧にするこ
とによりＪ１〜に！ｉＡ形累了−を高低ＩＡ状態にして
画累電ｔＵを＃積駆動する方法である。
よく似た駆動法に非線形素子を用いる方式がある。第１
２図は非線形素子１０３を用いた画１ｇ１００の構成で
ある。タイミング線（第１図、第３図のＹ電極に相当）
とデータ線１０２間で液晶１０４を駆動するのに非線形
索子１０３を用いるβ式であり、−ＩＩ・線形素ｒ−は
高電圧Ｔζでは低抵抗、ｇ？Ｔｔ圧下では１１１１１ｉ
ｔ抗どなり、データ線１０２とタイミング線１０１間に
高？ｌ！ Ｊ、Ｅをかけて点灯のデータを非線形素子を
１１℃抵抗状態にして書き込み、その後低電圧にするこ
とによりＪ１〜に！ｉＡ形累了−を高低ＩＡ状態にして
画累電ｔＵを＃積駆動する方法である。
具体的にはこの非線形素子はＴａやＮｂ、Ｔｉ等の酸化
膜を金属電極でシンドイッチした構造が最もよく用いら
れる。
膜を金属電極でシンドイッチした構造が最もよく用いら
れる。
第１３図〜第１５図は非線形素子を用いた高分解ｆ１ヒ
画素の構成例である。この図では走査用のＹ側の電極は
省略しであるが、実際に４才ｉｒｉ １図、第３図のよ
うに液晶層をはさんで存在するわけである。
画素の構成例である。この図では走査用のＹ側の電極は
省略しであるが、実際に４才ｉｒｉ １図、第３図のよ
うに液晶層をはさんで存在するわけである。
第１３図はデータ線１０５〜１０８に対し４１線形素子
１０９，１１１，１１３を介して画素（駆動？［１極）
１１０，１１２，１１４が構成されている。データ線１
０６に対し・１６列接続された非線形素子１１１ト１１
３ニヨＦ）、ＸＫ ａ＃ ？［ｆ、極１１２ど］１４に
は同一のデータが書き込まれ、この結果第２図（イ）の
電極構成が実現できる。
１０９，１１１，１１３を介して画素（駆動？［１極）
１１０，１１２，１１４が構成されている。データ線１
０６に対し・１６列接続された非線形素子１１１ト１１
３ニヨＦ）、ＸＫ ａ＃ ？［ｆ、極１１２ど］１４に
は同一のデータが書き込まれ、この結果第２図（イ）の
電極構成が実現できる。
第１４図はデータ線１１１，１１２，１１３がジグザグ
に配線されていることによりやはり第２図（イ）の構成
となる。
に配線されていることによりやはり第２図（イ）の構成
となる。
第１５図は画素を効率的に用いる、即ち駆動電極比率を
」−げて、かつ半ピッチずらした不自然さを解消できる
方式である。データ線ドライバ１２０〜１２３はデータ
線１２７〜１３０に直接接続され、又データ線１３１〜
１３４はスイッチ１２４〜１２６によりドライバへの接
続点が走査用のＹ電極１本毎に切り換えられる０例えば
可数番「１の走査電極が選択されている時はスイッチ１
２４〜１２６は左へ倒れており、従って駆動電極１３６
と１３７，１３８と１３９がペアどなり同一のデータが
書き込まれる。一方偶数番口の走査電極が選択されると
スイッチ１２４〜１２６は右へ倒れて１４１と１４２，
１４３と１４４，１４５と１４６がペアとなり同一のデ
ータが書き込まれる。
」−げて、かつ半ピッチずらした不自然さを解消できる
方式である。データ線ドライバ１２０〜１２３はデータ
線１２７〜１３０に直接接続され、又データ線１３１〜
１３４はスイッチ１２４〜１２６によりドライバへの接
続点が走査用のＹ電極１本毎に切り換えられる０例えば
可数番「１の走査電極が選択されている時はスイッチ１
２４〜１２６は左へ倒れており、従って駆動電極１３６
と１３７，１３８と１３９がペアどなり同一のデータが
書き込まれる。一方偶数番口の走査電極が選択されると
スイッチ１２４〜１２６は右へ倒れて１４１と１４２，
１４３と１４４，１４５と１４６がペアとなり同一のデ
ータが書き込まれる。
この結果、等価等に第２図（イ）の電極構成となる。
第１３図〜第１５図も各駆動電極にカラーフィルタが割
り当てられて配列することによりマルチカラーデイスプ
レィが実現できる。例えば第１５図の例テハ駆動７１極
１３６．！：：１３７Ｇ：ｌ；ｔＲ，１４１と１４２に
はＧ、１４３と１４４にはＢのカラーフィルタが割り当
てられ、駆動電極１ユ、又は下にカラーフィルタを配置
する。
り当てられて配列することによりマルチカラーデイスプ
レィが実現できる。例えば第１５図の例テハ駆動７１極
１３６．！：：１３７Ｇ：ｌ；ｔＲ，１４１と１４２に
はＧ、１４３と１４４にはＢのカラーフィルタが割り当
てられ、駆動電極１ユ、又は下にカラーフィルタを配置
する。
・本発明は以」二述べた如く、基本的には第２図（イ）
、 （ロ）の如くの電極配列（画素配置）によりグラフ
ィック、更にはカラーグラフィック８１歳・ｌしても十
分の分解能のある表示体が実現できる。
、 （ロ）の如くの電極配列（画素配置）によりグラフ
ィック、更にはカラーグラフィック８１歳・ｌしても十
分の分解能のある表示体が実現できる。
第１図は従来の液晶表示体である１ニット・７トリツク
スパネルの画素措成図であり、第２図（イ）（ロ）は本
発明の高分解能画素（駆動電極）の基本構成図である。 第３図はマルチプレックス駆動における本発明の駆動電
極構成例を示す図である。 又第４図は薄膜トランジスタを用いた画素の構成図であ
り、第５図から！１ｒ１１１図はそのＦＢＩ膜トランジ
スタを利用した本発明の高分解能画素の実現例を示す図
である。更に第１・２図は非線形素子を用いた画素の構
成図であり、第１３図から第１５１１１は非線形素子を
用いた本発明の高分解能画素の実現例を示す図である。 ｌ・・・Ｍ＠トランジスタ １０３・・・非線形素子 ７０〜７３，１２０〜１２３・・・データ線ドライバ 以 上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴木 喜三部 他１名第８図 第９図 第１０図 第１４図 第１５図 特許請求の範囲 マ ｌ 刑 ス 。 手続補正書 （自発） 平成 ２年 ３月！３日 ２、発明の名称 単純マトリクス型液晶表示装置 ３、補正する者 事件との関係 出願人 東京都新宿区西新宿２丁目４番１号 （２３６）セイコーエプソン株式会社 代表取締役 中 村 恒 也 ４、代理人 １、発明の名称を「液晶表示装置］とあ６を「単純マト
リクス型液晶表示装置１と補正する。 ２、特許請求の範囲を別紙の通り補正する。
スパネルの画素措成図であり、第２図（イ）（ロ）は本
発明の高分解能画素（駆動電極）の基本構成図である。 第３図はマルチプレックス駆動における本発明の駆動電
極構成例を示す図である。 又第４図は薄膜トランジスタを用いた画素の構成図であ
り、第５図から！１ｒ１１１図はそのＦＢＩ膜トランジ
スタを利用した本発明の高分解能画素の実現例を示す図
である。更に第１・２図は非線形素子を用いた画素の構
成図であり、第１３図から第１５１１１は非線形素子を
用いた本発明の高分解能画素の実現例を示す図である。 ｌ・・・Ｍ＠トランジスタ １０３・・・非線形素子 ７０〜７３，１２０〜１２３・・・データ線ドライバ 以 上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴木 喜三部 他１名第８図 第９図 第１０図 第１４図 第１５図 特許請求の範囲 マ ｌ 刑 ス 。 手続補正書 （自発） 平成 ２年 ３月！３日 ２、発明の名称 単純マトリクス型液晶表示装置 ３、補正する者 事件との関係 出願人 東京都新宿区西新宿２丁目４番１号 （２３６）セイコーエプソン株式会社 代表取締役 中 村 恒 也 ４、代理人 １、発明の名称を「液晶表示装置］とあ６を「単純マト
リクス型液晶表示装置１と補正する。 ２、特許請求の範囲を別紙の通り補正する。
Claims (2)
- （１）表示用の駆動電極をＸ方向、Ｙ方向それぞれ一定
のピッチにてマトリックス状に配置した液晶表示体にお
いて、Ｘ方向に一行毎に、又はＹ方向に１列毎に、半ピ
ッチ、マトリックスピッチをずらして画素を配列したこ
とを特徴とする液晶表示装置。 - （２）各画素にはＲ（赤）、Ｇ（緑）、Ｂ（青）のカラ
ーフィルタが一定の繰り返し周期で配置されていること
を特徴とする特許請求の範囲第１項記載の液晶表示装置
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2031912A JPH02244026A (ja) | 1990-02-13 | 1990-02-13 | 液晶表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2031912A JPH02244026A (ja) | 1990-02-13 | 1990-02-13 | 液晶表示装置 |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57118258A Division JPS599636A (ja) | 1982-07-07 | 1982-07-07 | 液晶表示体 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02244026A true JPH02244026A (ja) | 1990-09-28 |
Family
ID=12344192
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2031912A Pending JPH02244026A (ja) | 1990-02-13 | 1990-02-13 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02244026A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100455551B1 (ko) * | 1995-08-21 | 2005-09-30 | 가부시끼가이샤 히다치 세이사꾸쇼 | 컬러액정표시소자 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55143582A (en) * | 1979-04-26 | 1980-11-08 | Suwa Seikosha Kk | Liquid crystal unit |
| JPS5732481A (en) * | 1980-08-06 | 1982-02-22 | Hitachi Ltd | Dot matrix liquid crystal display element |
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1990
- 1990-02-13 JP JP2031912A patent/JPH02244026A/ja active Pending
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