JPH02250576A - Ｔｖシステムのデータ保管方式 - Google Patents
Ｔｖシステムのデータ保管方式Info
- Publication number
- JPH02250576A JPH02250576A JP1073215A JP7321589A JPH02250576A JP H02250576 A JPH02250576 A JP H02250576A JP 1073215 A JP1073215 A JP 1073215A JP 7321589 A JP7321589 A JP 7321589A JP H02250576 A JPH02250576 A JP H02250576A
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- JP
- Japan
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- memory
- data
- monitor
- tuner
- video
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、ＣＲＴ （陰極線管）を有するモニタのメモ
リデータを保持するＴＶ（テレビジョン）システムのデ
ータ保管方式に関する。
リデータを保持するＴＶ（テレビジョン）システムのデ
ータ保管方式に関する。
［発明の概要］
本発明は、ＣＲＴ及びメモリを有するモニタと、メモリ
を有し且？ＣＲＴを有しない映像機器とを備え、前記モ
ニタのメモリデータを館記映像機器のメモリにストアす
ることにより、 Ｃｌ ’１’の放電などによりモニタのメモリが破壊さ
れても映像機器のメモリにストアされているデータをモ
ニタのメモリに転送して補填できるため、メモリが破壊
されることによる事故を防止できる。
を有し且？ＣＲＴを有しない映像機器とを備え、前記モ
ニタのメモリデータを館記映像機器のメモリにストアす
ることにより、 Ｃｌ ’１’の放電などによりモニタのメモリが破壊さ
れても映像機器のメモリにストアされているデータをモ
ニタのメモリに転送して補填できるため、メモリが破壊
されることによる事故を防止できる。
［従来の技術］
従来のＴＶシステムは、第３図に示すように、０ｒ（Ｔ
Ｉを有するモニタＢとこのモニタＢにビデオ信号線ｅ
を介してビデオ信号を送出する映像機器のチューナＡと
から構成されている。チューナＡとモニタＢはそれぞれ
信号処理回路２０．２１と管面表示の信号を生成するキ
ャラクタジェネレータ２２．２３を有し、この各信号処
理回路２０゜２１とキャラクタジェネレータ２２．２３
は各ＣＰＵ２４，２５にて制御される。又、チューナＡ
とモニタＢにはそれぞれメモリａ、ｂが設けられ、この
各メモリａ、ｂは各ＣＰＵ２４，２５にて制御される。
Ｉを有するモニタＢとこのモニタＢにビデオ信号線ｅ
を介してビデオ信号を送出する映像機器のチューナＡと
から構成されている。チューナＡとモニタＢはそれぞれ
信号処理回路２０．２１と管面表示の信号を生成するキ
ャラクタジェネレータ２２．２３を有し、この各信号処
理回路２０゜２１とキャラクタジェネレータ２２．２３
は各ＣＰＵ２４，２５にて制御される。又、チューナＡ
とモニタＢにはそれぞれメモリａ、ｂが設けられ、この
各メモリａ、ｂは各ＣＰＵ２４，２５にて制御される。
チューナＡのメモリａにはチューナ自体の調整データや
コントロールデータが記憶され、又、モニタＢのメモリ
ｂにはモニタ自体の調整データ（ミスコンバーゼンス量
等）やコントロールデータが記憶されている。
コントロールデータが記憶され、又、モニタＢのメモリ
ｂにはモニタ自体の調整データ（ミスコンバーゼンス量
等）やコントロールデータが記憶されている。
而して、チューナＡの信号処理回路２０から出力された
ビデオ信号はビデオ信号線ｅを介してモニタＢの信号処
理回路２１に導かれる。この信号処理回路２１で所定の
信号処理を施されたビデオ信号がＣＲＴ １に供給され
て映像が映し出される。
ビデオ信号はビデオ信号線ｅを介してモニタＢの信号処
理回路２１に導かれる。この信号処理回路２１で所定の
信号処理を施されたビデオ信号がＣＲＴ １に供給され
て映像が映し出される。
そして、各ＣＰＵ２４，２５はそれぞれのメモリａ、ｂ
に記憶されているデータに基づいて各信号処理回路２０
．２１や各キャラクタジェネレータ２２．２３などを制
御する。
に記憶されているデータに基づいて各信号処理回路２０
．２１や各キャラクタジェネレータ２２．２３などを制
御する。
［発明が解決しようとする課題］
上記構成において、ＣＲＴ １式のモニタＢは放電を起
こしたり、人の接触による人体チャージなどが起こると
内蔵のメモリｂのデータが破壊されるという欠点があっ
た。ＴＶのディジタルコントロールが進んだ今日では調
整データが破壊されると重大な不良事故につながる。
こしたり、人の接触による人体チャージなどが起こると
内蔵のメモリｂのデータが破壊されるという欠点があっ
た。ＴＶのディジタルコントロールが進んだ今日では調
整データが破壊されると重大な不良事故につながる。
そこで、本発明はメモリデータか破壊されても破壊され
たデータ内容を補填可能なＴＶシステ、ムのデータ保管
方式を提供することを目的とする。
たデータ内容を補填可能なＴＶシステ、ムのデータ保管
方式を提供することを目的とする。
〔課題を解決するための手段］
上記目的を達成するための本発明のＴＶシステムのデー
タ保管方式は、ＣＲＴ、データを保持するメモリ及びこ
のメモリを制御する制御部を有するモニタと、データを
保持するメモリ及びこのメモリを制御する制御部を有す
ると共にＣＲＴを持たない映像ＩＩ器とを備え、前記モ
ニタのメモリデータと前記映像機器のメモリデータをチ
ェック及び転送可能とし、前記モニタのメモリのデータ
を前記映像機器のメモリにストアしてデータを保持する
ものである。
タ保管方式は、ＣＲＴ、データを保持するメモリ及びこ
のメモリを制御する制御部を有するモニタと、データを
保持するメモリ及びこのメモリを制御する制御部を有す
ると共にＣＲＴを持たない映像ＩＩ器とを備え、前記モ
ニタのメモリデータと前記映像機器のメモリデータをチ
ェック及び転送可能とし、前記モニタのメモリのデータ
を前記映像機器のメモリにストアしてデータを保持する
ものである。
［作用］
モニタに放電等が起こりモニタのメモリのデータか破壊
されると、映像機器のメモリにストアされているモニタ
のデータをモニタのメモリに転送してモニタのメモリデ
ータを補填する。
されると、映像機器のメモリにストアされているモニタ
のデータをモニタのメモリに転送してモニタのメモリデ
ータを補填する。
［実施例コ
以下、本発明の実施例を図面を用いて説明する。
第１図及び第２図には本発明の実施例が示されている。
第１図には本願のメモリ保管方式を実施するテレビジョ
ンシステムの回路ブロック図が示されている。第１図に
おいて、ＴＶシステムはＣＲＴを有しない映像機器のチ
ューナＡとＣＲＴ １を有するモニタＢとが結線されて
おり、チューナＡが出力するビデオ信号がモニタＢに供
給されてＣＲＴｌに映像が映し出される。チューナＡの
入力端子ｊｉ、ｊ＊にはＳ ＨＦアンテナ２とＵ／Ｖア
ンテナ３とがそれぞれ接続されている。ＳＨＦアンテナ
２とＵ／Ｖアンテナ３からのビデオ信号はスイッチＳＷ
にて選択的にチューナＡへ入力され、入力されたビデオ
信号はビデオ信号処理回路４と同期信号検出回路５にそ
れぞれ供給される。ビデオ信号処理回路４は入力ビデオ
信号から画情報信号を抜き出し、この画情報信号に所定
の信号処理を施して加算器６に出力する。同期信号検出
回路５は入力ビデオ信号から同期信号を検出し、検出し
た同期信号を出力端子ｔ４に導くと共にキャラクタジェ
ネレータ７に供給する。キャラクタジェネレータ７はｃ
ｐｕｓからのアドレス信号に基づいて管面表示の信号を
生成し、この管面表示信号を加算器６に出力する。加算
器６は画情報信号に管面表示信号を加算し、管面表示信
号が加算された画情報信号が出力端子し、に導かれてい
る。制御部であるＣＰＵ（中央処理装置）８はビデオ信
号処理回路４及び同期信号検出回路５を制御すると共に
内蔵のメモリａの読み出し・書き込みを制御する。メモ
リａにはチューナＡ自体の調整データやコントロールデ
ータが記憶されていると共にこのメモリａはその他にモ
ニタＢのメモリｂの全データを記憶可能な余分な容量を
有している。
ンシステムの回路ブロック図が示されている。第１図に
おいて、ＴＶシステムはＣＲＴを有しない映像機器のチ
ューナＡとＣＲＴ １を有するモニタＢとが結線されて
おり、チューナＡが出力するビデオ信号がモニタＢに供
給されてＣＲＴｌに映像が映し出される。チューナＡの
入力端子ｊｉ、ｊ＊にはＳ ＨＦアンテナ２とＵ／Ｖア
ンテナ３とがそれぞれ接続されている。ＳＨＦアンテナ
２とＵ／Ｖアンテナ３からのビデオ信号はスイッチＳＷ
にて選択的にチューナＡへ入力され、入力されたビデオ
信号はビデオ信号処理回路４と同期信号検出回路５にそ
れぞれ供給される。ビデオ信号処理回路４は入力ビデオ
信号から画情報信号を抜き出し、この画情報信号に所定
の信号処理を施して加算器６に出力する。同期信号検出
回路５は入力ビデオ信号から同期信号を検出し、検出し
た同期信号を出力端子ｔ４に導くと共にキャラクタジェ
ネレータ７に供給する。キャラクタジェネレータ７はｃ
ｐｕｓからのアドレス信号に基づいて管面表示の信号を
生成し、この管面表示信号を加算器６に出力する。加算
器６は画情報信号に管面表示信号を加算し、管面表示信
号が加算された画情報信号が出力端子し、に導かれてい
る。制御部であるＣＰＵ（中央処理装置）８はビデオ信
号処理回路４及び同期信号検出回路５を制御すると共に
内蔵のメモリａの読み出し・書き込みを制御する。メモ
リａにはチューナＡ自体の調整データやコントロールデ
ータが記憶されていると共にこのメモリａはその他にモ
ニタＢのメモリｂの全データを記憶可能な余分な容量を
有している。
モニタＢには二つの入力端子ｔｓ、ｊ７が設けられ、こ
の各入力端子ｔｏ、ｔｙとチューナＡの各出力端子ｊｓ
、ｔｏが画情報信号線乙及び同期信号線ａ、を介してそ
れぞれ接続されている。入力端子ｔ、から入力された画
情報信号はビデオ信号処理回路９にて所定の信号処理が
施されて加算器ｌＯに出力される。入力端子ｔ７から入
力された同期信号は偏向回路１１とキャラクタジェネレ
ータ１２にそれぞれ供給されている。偏向回路１１は同
期信号に基づいてノコギリ波を形成する。キャラクタジ
ェネレータ１２は、前記チューナＡのものと同様に、Ｃ
ＰＵ１３からのアドレス信号に基づいて管面表示の信号
を生成し、この管面表示信号を加算器ＩＯに出力する。
の各入力端子ｔｏ、ｔｙとチューナＡの各出力端子ｊｓ
、ｔｏが画情報信号線乙及び同期信号線ａ、を介してそ
れぞれ接続されている。入力端子ｔ、から入力された画
情報信号はビデオ信号処理回路９にて所定の信号処理が
施されて加算器ｌＯに出力される。入力端子ｔ７から入
力された同期信号は偏向回路１１とキャラクタジェネレ
ータ１２にそれぞれ供給されている。偏向回路１１は同
期信号に基づいてノコギリ波を形成する。キャラクタジ
ェネレータ１２は、前記チューナＡのものと同様に、Ｃ
ＰＵ１３からのアドレス信号に基づいて管面表示の信号
を生成し、この管面表示信号を加算器ＩＯに出力する。
制御部であるＣＰＵｌ３は前記チューナＡのものと同様
にビデオ信号処理回路９やキャラクタジェネレータＩ２
を制御すると共に内蔵のメモリｂの読み出し・書き込み
を制御する。このメモリｂにはモニタ１自体の調整デー
タやコントロールデータが記憶されている。
にビデオ信号処理回路９やキャラクタジェネレータＩ２
を制御すると共に内蔵のメモリｂの読み出し・書き込み
を制御する。このメモリｂにはモニタ１自体の調整デー
タやコントロールデータが記憶されている。
又、モニタＢのＣＰＵＩとチューナＡのｃｐｕｓにはデ
ータ転送用の端子ｊａ、ｔ・がそれぞれ設けられ、この
端子ｔｓ、ｊｅ間がデータ線Ｑ３にて結線されている。
ータ転送用の端子ｊａ、ｔ・がそれぞれ設けられ、この
端子ｔｓ、ｊｅ間がデータ線Ｑ３にて結線されている。
以下、上記構成の作用について説明する。
チューナＡ及びモニタＢの電源がオンされ、ＳＨＦアン
テナ２又はＵ／Ｖアンテナ３からのビデオ信号がビデオ
信号処理回路４及び同期信号検出回路５にて信号処理さ
れる。ビデオ信号処理回路４の出力である画情報信号が
画情報信号線ｅｌを介して又、同期信号検出回路５の出
力である同期信号が同期信号線Ｑ、を介してそれぞれモ
ニタＢへ伝送されてＣＲＴｌに映像が映し出される。
テナ２又はＵ／Ｖアンテナ３からのビデオ信号がビデオ
信号処理回路４及び同期信号検出回路５にて信号処理さ
れる。ビデオ信号処理回路４の出力である画情報信号が
画情報信号線ｅｌを介して又、同期信号検出回路５の出
力である同期信号が同期信号線Ｑ、を介してそれぞれモ
ニタＢへ伝送されてＣＲＴｌに映像が映し出される。
次に、データ保管の動作について第２図を参照して説明
する。
する。
チューナＡとモニタＢが結線された後、最初に両方の電
源がオンされると、モニタＢのＣＰＵｌ３がメモリｂの
データを読み出してこのメモリデータをチューナＡのＣ
ＰＵ８に転送し、チューナＡのＣＰＵ８が転送されたメ
モリデータをメモリａに全て書き込むことによってスト
アする。次に、モ、ニタＢ内のコントロールが実行され
、メモリｂのデータ付加やデータ更新が行われると、モ
ニタＢのｃｐｕｔａがそのコントロールデータをチュー
ナＡのＣＰＵ８が転送してメモリａのデータ付加やデー
タ更新が行われる。そして、電源がオフされるまでモニ
タＢのメモリｂのデータ付加・更新される毎にチューナ
Ａのメモリｂのデータ付加・更新されるため、チューナ
Ａのメモリｂには常にモニタＢのメモリｂの最新のデー
タがストアされる。
源がオンされると、モニタＢのＣＰＵｌ３がメモリｂの
データを読み出してこのメモリデータをチューナＡのＣ
ＰＵ８に転送し、チューナＡのＣＰＵ８が転送されたメ
モリデータをメモリａに全て書き込むことによってスト
アする。次に、モ、ニタＢ内のコントロールが実行され
、メモリｂのデータ付加やデータ更新が行われると、モ
ニタＢのｃｐｕｔａがそのコントロールデータをチュー
ナＡのＣＰＵ８が転送してメモリａのデータ付加やデー
タ更新が行われる。そして、電源がオフされるまでモニ
タＢのメモリｂのデータ付加・更新される毎にチューナ
Ａのメモリｂのデータ付加・更新されるため、チューナ
Ａのメモリｂには常にモニタＢのメモリｂの最新のデー
タがストアされる。
チューナＡ及びモニタＢの電源がオフされ再度チューナ
Ａ及びモニタＢの電源がオンされると、両方のｃｐｕｓ
、ｉａが各メモリａ、ｂのデータを読み出してメモリｂ
のデータが抜けているか否かいずれか一方のＣＰＵ８，
１３がチェックする。
Ａ及びモニタＢの電源がオンされると、両方のｃｐｕｓ
、ｉａが各メモリａ、ｂのデータを読み出してメモリｂ
のデータが抜けているか否かいずれか一方のＣＰＵ８，
１３がチェックする。
メモリｂのデータが抜けている場合には抜けているデー
タをｃｐｕｓがモニタＢのＣＰＵ１３に転送してＣＰＵ
１３がメモリｂに記憶する。従って、ＣＲＴＩの放電等
によってモニタＢのメモリｂのデータが一部又は全部破
壊されてもチューナＡのメモリａから転送されてモニタ
Ｂのメモリｂ内容が補填されるため、データ破壊による
事故が発生しない。
タをｃｐｕｓがモニタＢのＣＰＵ１３に転送してＣＰＵ
１３がメモリｂに記憶する。従って、ＣＲＴＩの放電等
によってモニタＢのメモリｂのデータが一部又は全部破
壊されてもチューナＡのメモリａから転送されてモニタ
Ｂのメモリｂ内容が補填されるため、データ破壊による
事故が発生しない。
また、チューナＡのメモリａがモニタＢのメモリデータ
を保持しているため、モニタＢのコントロールを行う時
でもチューナＡのキャラクタジェネレータ７を使用して
管面表示を行うことができる。尚、モニタＢを単品とし
て動作させるときにはモニタＢのＣＰＵ１３が全コント
ロールを行うと共に管面表示もモニタＢ内のキャラクタ
ジェネレータ１２を使用して行われる。また、前記実施
例ではメモリデータの転送をデータ線ｅ３を用いて行っ
ているが、メモリデータを画情報信号や同期信号の無情
報区間を利用して転送すればデータ線ｇ、が不用となる
。
を保持しているため、モニタＢのコントロールを行う時
でもチューナＡのキャラクタジェネレータ７を使用して
管面表示を行うことができる。尚、モニタＢを単品とし
て動作させるときにはモニタＢのＣＰＵ１３が全コント
ロールを行うと共に管面表示もモニタＢ内のキャラクタ
ジェネレータ１２を使用して行われる。また、前記実施
例ではメモリデータの転送をデータ線ｅ３を用いて行っ
ているが、メモリデータを画情報信号や同期信号の無情
報区間を利用して転送すればデータ線ｇ、が不用となる
。
［発明の効果］
以上述べたように本発明によれば、ＣＲＴ及びメモリを
有するモニタと、メモリζ有し且つＣＲＴを有しない映
像機器とを備え、前記モニタのメモリデータを前記映像
機器のメモリにストアしたので、ＣＲＴの放電などによ
りモニタのメモリが破壊されても映像機器のメモリにス
トアされているデータをモニタのメモリに転送して補填
できるため、メモリが破壊されることによる事故を防止
できるという効果を奏する。
有するモニタと、メモリζ有し且つＣＲＴを有しない映
像機器とを備え、前記モニタのメモリデータを前記映像
機器のメモリにストアしたので、ＣＲＴの放電などによ
りモニタのメモリが破壊されても映像機器のメモリにス
トアされているデータをモニタのメモリに転送して補填
できるため、メモリが破壊されることによる事故を防止
できるという効果を奏する。
第１図及び第２図は本発明の実施例を示し、第１図はテ
レビジョンシステムの回路ブロック図、第２図はメモリ
保管のフローチャート図であり、第３図は従来のテレビ
ジョンシステムの回路ブロック図である。 Ａ・・・チューナ（映像機器）、Ｂ・・・モニタ、ｌ・
・・ＣＲＴ、８．１３−ＣＰＵ （制御部）、ａ、、ｂ
−メモリ。
レビジョンシステムの回路ブロック図、第２図はメモリ
保管のフローチャート図であり、第３図は従来のテレビ
ジョンシステムの回路ブロック図である。 Ａ・・・チューナ（映像機器）、Ｂ・・・モニタ、ｌ・
・・ＣＲＴ、８．１３−ＣＰＵ （制御部）、ａ、、ｂ
−メモリ。
Claims (1)
- （１）ＣＲＴ、データを保持するメモリ及びこのメモリ
を制御する制御部を有するモニタと、データを保持する
メモリ及びこのメモリを制御する制御部を有すると共に
ＣＲＴを持たない映像機器とを備え、前記モニタのメモ
リデータと前記映像機器のメモリデータをチェック及び
転送可能とし、前記モニタのメモリのデータを前記映像
機器のメモリにストアしてデータを保持することを特徴
とするＴＶシステムのデータ保管方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1073215A JPH02250576A (ja) | 1989-03-24 | 1989-03-24 | Ｔｖシステムのデータ保管方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1073215A JPH02250576A (ja) | 1989-03-24 | 1989-03-24 | Ｔｖシステムのデータ保管方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02250576A true JPH02250576A (ja) | 1990-10-08 |
Family
ID=13511720
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1073215A Pending JPH02250576A (ja) | 1989-03-24 | 1989-03-24 | Ｔｖシステムのデータ保管方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02250576A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5652845A (en) * | 1993-02-10 | 1997-07-29 | Hitachi, Ltd. | Display apparatus |
-
1989
- 1989-03-24 JP JP1073215A patent/JPH02250576A/ja active Pending
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5652845A (en) * | 1993-02-10 | 1997-07-29 | Hitachi, Ltd. | Display apparatus |
| US5887147A (en) * | 1993-02-10 | 1999-03-23 | Hitachi, Ltd. | Display apparatus |
| US6247090B1 (en) | 1993-02-10 | 2001-06-12 | Hitachi, Ltd. | Display apparatus enabled to control communicatability with an external computer using identification information |
| US6513088B2 (en) | 1993-02-10 | 2003-01-28 | Hitachi, Ltd. | Display unit and method enabling bi-directional communication with video source |
| US6549970B2 (en) | 1993-02-10 | 2003-04-15 | Hitachi, Ltd. | Display unit with controller enabling bi-directional communication with computer |
| US7089342B2 (en) | 1993-02-10 | 2006-08-08 | Hitachi, Ltd. | Method enabling display unit to bi-directionally communicate with video source |
| US7475181B2 (en) | 1993-02-10 | 2009-01-06 | Mondis Technology Ltd. | Display unit with processor and communication controller which communicates information to the processor |
| US7475180B2 (en) | 1993-02-10 | 2009-01-06 | Mondis Technology Ltd. | Display unit with communication controller and memory for storing identification number for identifying display unit |
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