JPH02266659A - フアクシミリ装置の読み取り回路 - Google Patents
フアクシミリ装置の読み取り回路Info
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- JPH02266659A JPH02266659A JP1087442A JP8744289A JPH02266659A JP H02266659 A JPH02266659 A JP H02266659A JP 1087442 A JP1087442 A JP 1087442A JP 8744289 A JP8744289 A JP 8744289A JP H02266659 A JPH02266659 A JP H02266659A
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- Japan
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- frequency
- processing section
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 14
- 101100328957 Caenorhabditis elegans clk-1 gene Proteins 0.000 abstract 1
- 101100113692 Caenorhabditis elegans clk-2 gene Proteins 0.000 abstract 1
- 238000000034 method Methods 0.000 description 4
- 238000009825 accumulation Methods 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
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- Facsimile Scanning Arrangements (AREA)
- Storing Facsimile Image Data (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はファクシミリ装置に関し、特に原稿を読み取っ
て画像処理を行なう読み取ｐ部の処理能率を高めたファ
クシミリ装置の読み取り回路に関する。
て画像処理を行なう読み取ｐ部の処理能率を高めたファ
クシミリ装置の読み取り回路に関する。
（従来の技術）
従来のこの梅のファクシミリ装置の読み取り部は、固体
撮像素子として使用される電荷結合デバイス（以下００
Ｄとい５）と、ＯＯＤの出力のアナログ信号をデジタル
多値データに変換するアナログデジタル変換部（以下Ａ
／ｌ）変換部という）と、００１）出力ｉ Ａ ／ Ｌ
）変換部で変換したデジタル多１直データを入力し画像
信号の処理を行う画像処理部の駆動線、すべて同一周波
数のクロックで行われていた。
撮像素子として使用される電荷結合デバイス（以下００
Ｄとい５）と、ＯＯＤの出力のアナログ信号をデジタル
多値データに変換するアナログデジタル変換部（以下Ａ
／ｌ）変換部という）と、００１）出力ｉ Ａ ／ Ｌ
）変換部で変換したデジタル多１直データを入力し画像
信号の処理を行う画像処理部の駆動線、すべて同一周波
数のクロックで行われていた。
（発明が解決しよりとする課題）
上述した従来のファクシミリ装置の絖み取り部Ｈ，ｏｏ
ｕのシフトクロックと、Ａ／Ｄ変換器および画像処理部
の駆動クロックの周阪数が同一なので、処理能力の遅い
部分に早い方が合わぜる必要がある。
ｕのシフトクロックと、Ａ／Ｄ変換器および画像処理部
の駆動クロックの周阪数が同一なので、処理能力の遅い
部分に早い方が合わぜる必要がある。
一般に、原稿またはＯ（Ｉ Ｄのいずれかが移動し、あ
る相対速度で走食し読み取ｖを行うが、００Ｄの読み取
りライン数と画像として採用するライン数の比（以下サ
ンプル比という）は。
る相対速度で走食し読み取ｖを行うが、００Ｄの読み取
りライン数と画像として採用するライン数の比（以下サ
ンプル比という）は。
２対ｌ以±の場合が１：ｌの場合より画質が良いとされ
ている。ところが、このサンプル死金２対１以上にする
と、見掛は上本来の画像処理部の駆動クロック周波数の
２分の１以下の周波数で画像処理部を駆動していること
となる。したがって〔］ＯＤシフトクロック周波数１に
：、画像処理駆動周波数が同一である従来の装置の読み
取り方式で蝶、サンプル比を２対ｌあるいは２対ｌ以上
にすると、０ＯＬ）が採用しないラインを出力している
期間中画像処理部を有効に使用できないという欠点があ
る。
ている。ところが、このサンプル死金２対１以上にする
と、見掛は上本来の画像処理部の駆動クロック周波数の
２分の１以下の周波数で画像処理部を駆動していること
となる。したがって〔］ＯＤシフトクロック周波数１に
：、画像処理駆動周波数が同一である従来の装置の読み
取り方式で蝶、サンプル比を２対ｌあるいは２対ｌ以上
にすると、０ＯＬ）が採用しないラインを出力している
期間中画像処理部を有効に使用できないという欠点があ
る。
本発明の目的はこのような欠点全解消し、００Ｄｆ％光
源光量に対応した蓄積時間に対応した周波数で動作させ
ながら、画像処理部の非可動期間を小さくすることがで
きるようなファクシミリ装置の読み取り回路を提供する
ことにある。
源光量に対応した蓄積時間に対応した周波数で動作させ
ながら、画像処理部の非可動期間を小さくすることがで
きるようなファクシミリ装置の読み取り回路を提供する
ことにある。
（課題を解決するための手段）
前記の目的を達成するため１本発明のファクシミリ装置
の読み取り方式は％０ＯＤ１０ｔ−用いたイメージセン
サ部１１と、イメージセンサ部１１の出力の゛アナログ
データをデジタル多値データに変換するＡ／Ｄ変換器１
２と、前記デジタル多値データに画像処理を施す画像処
理部１４を有するファクシミリ装置の読み取り方式にお
いて、入力データの駆動クロック周波数を変換して出力
データの駆動クロックとする周波数変換部１３を有し、
Ａ／Ｄ変換器１２と画像処理部１４の間に周波数変換部
１３を挿入し。
の読み取り方式は％０ＯＤ１０ｔ−用いたイメージセン
サ部１１と、イメージセンサ部１１の出力の゛アナログ
データをデジタル多値データに変換するＡ／Ｄ変換器１
２と、前記デジタル多値データに画像処理を施す画像処
理部１４を有するファクシミリ装置の読み取り方式にお
いて、入力データの駆動クロック周波数を変換して出力
データの駆動クロックとする周波数変換部１３を有し、
Ａ／Ｄ変換器１２と画像処理部１４の間に周波数変換部
１３を挿入し。
周波数変換部１３に入力し友前記デジタル多値データを
出力するとき、クロック周波数を前記画像処理部駆動ク
ロックの周波数に変えて出力する回路構成とする。
出力するとき、クロック周波数を前記画像処理部駆動ク
ロックの周波数に変えて出力する回路構成とする。
（実 施例）
次に、本発明について図面を参照して説明する。
ｍ１図は、本発明の一実施例を示す回路略図である。
第１図に示すように１本実施例は、００１）１０を使用
するイメージセンサ部１１のアナログデータ出力を、デ
ジタル多値データに変換するＡ／Ｌ）変換器１２と画像
処理部１４の間に周波数変換用メモリからなる周波数変
換部１３が挿入されている。
するイメージセンサ部１１のアナログデータ出力を、デ
ジタル多値データに変換するＡ／Ｌ）変換器１２と画像
処理部１４の間に周波数変換用メモリからなる周波数変
換部１３が挿入されている。
第１図においてＣ０Ｄ１０のシフトクロック１！：、Ａ
／Ｄ変換器１２のサンプルクロックは。
／Ｄ変換器１２のサンプルクロックは。
同一の周波数（図中の０ＬＫＩの周波数）ｔ′ある。
Ａ／Ｄ変換器１２で変換されたデータｔ−％Ａ／Ｄｌｊ
Ｊｋ器１２のサンプルクロックと同じ周波数で周波数変
換用メモリ１３に書き込む。この周波数変換用メモリ１
３に書き込まれたデータを１画像処理部１４の駆動クロ
ック（図中０ＬＫ２）と同じ周波数で読み出し１画像処
理部１４に入力する。
Ｊｋ器１２のサンプルクロックと同じ周波数で周波数変
換用メモリ１３に書き込む。この周波数変換用メモリ１
３に書き込まれたデータを１画像処理部１４の駆動クロ
ック（図中０ＬＫ２）と同じ周波数で読み出し１画像処
理部１４に入力する。
このよりにして０ＯＤＩＯのシフトクロック（ＯＬＫり
と画像処理部１４の駆動クロック（ＯＬＫ２）の周波数
の比を適当な値とすることによって画像処理部１４の能
率を上げることができる。
と画像処理部１４の駆動クロック（ＯＬＫ２）の周波数
の比を適当な値とすることによって画像処理部１４の能
率を上げることができる。
（発明の効果）
以上説明したように本発明は、読み取り部のＡ／Ｄ変換
器と画像処理部の間にクロックの周波数を変換する周波
数変換部を挿入することによｔ）、ＯＯＤのシフトクロ
ックの周波数と画壇象処理部の駆動クロックの周波数を
同一ではなく適当な比にすることができるので％光源光
量に応じた蓄積時間に対応する周波数のシフトクロック
でＯＯＤを動作させながら、画像処理部の非可動期間を
小さくできるという効果がある。
器と画像処理部の間にクロックの周波数を変換する周波
数変換部を挿入することによｔ）、ＯＯＤのシフトクロ
ックの周波数と画壇象処理部の駆動クロックの周波数を
同一ではなく適当な比にすることができるので％光源光
量に応じた蓄積時間に対応する周波数のシフトクロック
でＯＯＤを動作させながら、画像処理部の非可動期間を
小さくできるという効果がある。
第１図は１本発明の一実施例を示す回路略図である。
１０・・・００１） １１・・・イメージセンサ部
１２・・・Ａ／Ｌ）変換器 １３・・・周波数変換部（周波数変換用メモリ）ｌ４・
・・画像処理部
１２・・・Ａ／Ｌ）変換器 １３・・・周波数変換部（周波数変換用メモリ）ｌ４・
・・画像処理部
Claims (1)
- 電荷結合デバイスを用いたイメージセンサ部と、前記イ
メージセンサ部の出力のアナログデータをデジタル多値
データに変換するアナログデジタル変換器と、前記デジ
タル多値データに画像処理を施す画像処理部を有するフ
ァクシミリ装置の読み取り回路において、入力データの
駆動クロック周波数を変換して出力データの駆動クロッ
クとする周波数変換部を有し、前記アナログデジタル変
換器と前記画像処理部の間に前記周波数変換部を挿入し
、前記周波数変換部に入力した前記デジタル多値データ
を出力するとき、クロック周波数を前記画像処理部駆動
クロックの周波数に変えて出力することを特徴とするフ
ァクシミリ装置の読み取り回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1087442A JP2830028B2 (ja) | 1989-04-06 | 1989-04-06 | フアクシミリ装置の読み取り回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1087442A JP2830028B2 (ja) | 1989-04-06 | 1989-04-06 | フアクシミリ装置の読み取り回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02266659A true JPH02266659A (ja) | 1990-10-31 |
| JP2830028B2 JP2830028B2 (ja) | 1998-12-02 |
Family
ID=13914974
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1087442A Expired - Lifetime JP2830028B2 (ja) | 1989-04-06 | 1989-04-06 | フアクシミリ装置の読み取り回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2830028B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5825511A (en) * | 1991-04-26 | 1998-10-20 | Canon Kabushiki Kaisha | Image pickup apparatus |
-
1989
- 1989-04-06 JP JP1087442A patent/JP2830028B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5825511A (en) * | 1991-04-26 | 1998-10-20 | Canon Kabushiki Kaisha | Image pickup apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2830028B2 (ja) | 1998-12-02 |
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Legal Events
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